28 assign out_r_ = out_r;
31 assign in2_a_ = in2_a;
33 assign in1_a_ = in1_a;
35 always @(posedge clk) begin
36 if (out_r && out_a) begin out_r<=0; end
37 if (!in1_r && in1_a) in1_a<=0;
38 if (!in2_r && in2_a) in2_a<=0;
39 if (1 && in2_r && !in2_a && !out_r && !out_a) begin
44 if (1 && in1_r && !in1_a && !out_r && !out_a) begin