Removed all old design files prior to updating with Ivan's newest design

diff --git a/electric/arbiterK.jelib b/electric/arbiterK.jelib
deleted file mode 100755 (executable)
index c2a429f..0000000
--- a/electric/arbiterK.jelib
+++ /dev/null
@@ -1,1426 +0,0 @@
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-X
-
-# Cell arbiter2;1{lay}
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-X
-
-# Cell arbiter2;1{sch}
-Carbiter2;1{sch}||schematic|1188764205282|1225193995044|
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-Ihalf2inArb;1{ic}|halfArb@3||6|0|YRRR||D5G4;
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-X
-
-# Cell arbiter3;1{ic}
-Carbiter3;1{ic}||artwork|1188826704874|1225311268907|EI
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-X
-
-# Cell arbiter3;1{lay}
-Carbiter3;1{lay}||cmos90|1225193389429|1225305229549||ATTR_NCC(D5G3;NTY140;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1225309318031
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ihalf3inArb;1{lay}|half3inA@0||0|72|||D5G4;
-Ihalf3inArb;2{lay}|half3inA@2||0|-72|Y||D5G4;
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-Ametal-1|net@5|||S1800|half3inA@2|cross|36.5|-8|pin@4||44.5|-8
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index 295d35c..0000000
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-X

diff --git a/electric/countersL.jelib b/electric/countersL.jelib
deleted file mode 100755 (executable)
index 32e4806..0000000
--- a/electric/countersL.jelib
+++ /dev/null
@@ -1,2385 +0,0 @@
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-HcountersL|8.08j
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-
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-X
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-X
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-IorangeTSMC090nm:wire90;1{ic}|wire90@5||6|-7|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-X
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-X
-
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-NX-Metal-1-Metal-2-Con|contact@6||2474|56||||
-NX-Metal-1-Metal-2-Con|contact@7||2474|-44||||
-NX-Metal-1-Metal-2-Con|contact@8||-44|56||||
-NMetal-1-Pin|pin@0||-44|41||||
-IwiresL:wellContacts13;1{lay}|wellCont@0||1064.5|-72|||D5G4;
-IwiresL:wellContacts13;1{lay}|wellCont@1||1064.5|72|||D5G4;
-Ametal-2|net@9|||S0|wellCont@1|gnd|1060|72|cntScnNi@0|gnd|1060|72
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-Ametal-2|net@31|||S0|cntScnNi@0|p1p_1|43|6|cntShift@0|p1p|0|6
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-Ametal-1|net@47||0.4|S2700|cntScnTw@5|out_1|-1452|53|contact@0||-1452|94
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-Ametal-2|net@60|||S0|cntFreq@0|vdd_2@884472906|2374|122|cntScnTw@4|vdd|2374|122
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-Ametal-2|net@63|||S0|cntFreq@0|vdd_14|2374|22|cntScnTw@4|vdd_6|2374|22
-Ametal-1|net@65||0.4|S2700|cntScnTw@4|out_1|1072.5|53|contact@2||1072.5|56
-Ametal-2|net@66|||S1800|cntScnNi@0|cin|1060|56|contact@2||1072.5|56
-Ametal-2|net@68|||S1800|cntScnTw@4|cin|2374|56|contact@6||2474|56
-Ametal-2|net@89|||S0|contact@7||2474|-44|cntScnTw@4|sin|2374|-44
-Ametal-2|net@110|||S0|cntScnOn@0|ctg_1|-150.5|0|cntScnTw@5|ctgLO|-150.5|0
-Ametal-2|net@111|||S0|cntScnOn@0|gnd_2|-150.5|72|cntScnTw@5|gnd|-150.5|72
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-Ametal-2|net@113|||S0|cntScnOn@0|p1p_1|-150.5|6|cntScnTw@5|p1p|-150.5|6
-Ametal-2|net@114|||S0|cntScnOn@0|p2p_1|-150.5|-6|cntScnTw@5|p2p|-150.5|-6
-Ametal-2|net@115|||S0|cntScnOn@0|out|-150.5|-44|cntScnTw@5|sin|-150.5|-44
-Ametal-2|net@116|||S0|cntScnOn@0|vdd_4|-150.5|122|cntScnTw@5|vdd|-150.5|122
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-Ametal-2|net@127|||S1800|cntScnOn@0|ctgLO|-45.5|0|cntShift@0|ctgLO|0|0
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-Ametal-1|net@130||0.4|S2700|cntScnOn@0|out_1|-147|53|contact@3||-147|56
-Ametal-2|net@142|||S0|cntShift@0|sout|-43|-44|cntScnOn@0|sin|-45.5|-44
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-Ametal-1|net@146||0.4|S2700|cntScnNi@0|out_1|46.5|53|contact@4||46.5|56
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-Ametal-1|net@151|||S2700|contact@6||2474|56|contact@5||2474|94
-Ametal-2|net@153|||S1800|cntScnOn@0|cin|-45.5|56|contact@8||-44|56
-Ametal-1|net@157|||S2700|pin@0||-44|41|contact@8||-44|56
-Exx|cin|D5G2;|pin@0||I
-Ecount||D5G2;|cntFreq@0|count|I
-Efin||D5G2;|cntFreq@0|inb|I
-Efout||D5G2;|cntFreq@0|out_4|O
-Egnd_2|gnd|D5G2;|cntScnTw@5|gnd_2|G
-Egnd_3||D5G2;|cntScnTw@5|gnd_3|G
-Egnd_5||D5G2;|cntFreq@0|gnd_5|G
-Egnd_6||D5G2;|cntFreq@0|gnd_6|G
-Esid[1]||D5G2;|cntShift@0|sid[1]|B
-Esid[2]||D5G2;|cntShift@0|sid[2]|B
-Esid[3]||D5G2;|cntShift@0|sid[3]|B
-Esid[4]||D5G2;|cntShift@0|sid[4]|B
-Esid[5]||D5G2;|cntShift@0|sid[5]|B
-Esid[6]||D5G2;|cntShift@0|sid[6]|B
-Esid[7]||D5G2;|cntShift@0|sid[7]|B
-Esid[8]||D5G2;|cntShift@0|sid[8]|B
-Esid[9]||D5G2;|cntShift@0|sid[9]|B
-Esod[1]||D5G2;|cntShift@0|sod[1]|B
-Esod[2]||D5G2;|cntShift@0|sod[2]|B
-Esod[3]||D5G2;|cntShift@0|sod[3]|B
-Esod[4]||D5G2;|cntShift@0|sod[4]|B
-Esod[5]||D5G2;|cntShift@0|sod[5]|B
-Esod[6]||D5G2;|cntShift@0|sod[6]|B
-Esod[7]||D5G2;|cntShift@0|sod[7]|B
-Esod[8]||D5G2;|cntShift@0|sod[8]|B
-Esod[9]||D5G2;|cntShift@0|sod[9]|B
-Evdd_4|vdd|D5G2;|cntScnTw@5|vdd_4|P
-Evdd_5||D5G2;|cntScnTw@5|vdd_5|P
-Evdd_7||D5G2;|cntScnTw@5|vdd_7|P
-Evdd_8||D5G2;|cntScnTw@5|vdd_8|P
-Evdd_10||D5G2;|cntFreq@0|vdd_10|P
-Evdd_11||D5G2;|cntFreq@0|vdd_11|P
-Evdd_12||D5G2;|cntFreq@0|vdd_12|P
-Evdd_13||D5G2;|cntFreq@0|vdd_13|P
-X
-
-# Cell instructionCount;2{sch}
-CinstructionCount;2{sch}||schematic|1226189708894|1226277335052|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IcntShift;1{ic}|cntContr@0||-15|24|||D5G4;
-IcntFreq;1{ic}|cntFreq@0||-42|12|X||D5G4;
-IcntScnNine;1{ic}|cntScnNi@2||-18|0|||D5G4;
-IcntScnOne;1{ic}|cntScnOn@2||27|0|||D5G4;
-IcntScnTwelve;2{ic}|cntScnTw@3||12|0|||D5G4;
-IcntScnTwelve;2{ic}|cntScnTw@4||-3|0|||D5G4;
-NOff-Page|conn@9||-52|12|||X|
-NOff-Page|conn@10||28|10|||RRR|
-NOff-Page|conn@11||-42|2|||R|
-NOff-Page|conn@12||-32|14|||X|
-NOff-Page|conn@13||4|29||||
-NOff-Page|conn@14||-26|29|||Y|
-IinstructionCount;1{ic}|instruct@0||20.5|44|||D5G4;
-NBus_Pin|pin@1||-18|-6|-1|-1||
-NBus_Pin|pin@3||27|-6|-1|-1||
-NBus_Pin|pin@4||12|-6|-1|-1||
-NBus_Pin|pin@5||27|-10|-1|-1||
-Ngeneric:Invisible-Pin|pin@8||-11|58|||||ART_message(D5G5;)SinstructionCount
-Ngeneric:Invisible-Pin|pin@9||-10.5|54|||||ART_message(D5G3;)Sies 9 November 2008
-Ngeneric:Invisible-Pin|pin@10||-10.5|46|||||ART_message(D5G3;)S[this 34 bit counter,counts instructions,in the instruction ring]
-Ngeneric:Invisible-Pin|pin@12||-15|33.5|||RR||ART_message(D5G2;)Sthis is the data scan chain
-NWire_Pin|pin@13||16|2||||
-NWire_Pin|pin@22||13|6||||
-NWire_Pin|pin@23||16|6||||
-NWire_Pin|pin@24||-17|6||||
-NWire_Pin|pin@25||-14|6||||
-NWire_Pin|pin@26||-14|2||||
-NBus_Pin|pin@40||-3|-6|-1|-1||
-NWire_Pin|pin@43||-2|6||||
-NWire_Pin|pin@45||1|6||||
-NWire_Pin|pin@46||1|2||||
-NWire_Pin|pin@47||1|10||||
-Ngeneric:Invisible-Pin|pin@48||-12.5|15.5|||||ART_message(D3G2;)S[frequency is divided by 2**13,should be about 40 KHz]
-NWire_Pin|pin@54||31.5|19||||
-NWire_Pin|pin@55||31.5|2||||
-NBus_Pin|pin@56||-3.5|28|-1|-1||
-NWire_Pin|pin@58||-42|24||||
-NWire_Pin|pin@59||-23|2||||
-NWire_Pin|pin@61||-23|19||||
-NBus_Pin|pin@62||-3.5|24|-1|-1||
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||21|2|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@1||5|2|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@2||-10|2|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-Awire|ctgLO|D5G2;||900|pin@58||-42|24|cntFreq@0|fout_1|-42|15.5
-Abus|myp1p,myp2p|D5G2;|-0.5|IJ2700|pin@62||-3.5|24|pin@56||-3.5|28
-Abus|myp1p,myp2p,ctgLO|D5G2;|-0.5|IJ900|pin@3||27|-6|pin@5||27|-10
-Awire|net@1|||0|cntScnOn@2|sout|24.5|2|wire90@0|a|23.5|2
-Awire|net@2|||0|pin@13||16|2|cntScnTw@3|sin|14|2
-Awire|net@3|||0|cntScnTw@3|sout|9.5|2|wire90@1|a|7.5|2
-Abus|net@5||-0.5|IJ900|cntScnNi@2|p1p,p2p,ctgLO|-18|-4|pin@1||-18|-6
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-Abus|net@9||-0.5|IJ1800|pin@1||-18|-6|pin@40||-3|-6
-Abus|net@10||-0.5|IJ900|cntScnTw@3|p1p,p2p,ctgLO|12|-4|pin@4||12|-6
-Awire|net@25|||0|wire90@0|b|18.5|2|pin@13||16|2
-Awire|net@39|||2700|cntScnTw@3|cin|13|4|pin@22||13|6
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-Awire|net@42|||2700|cntScnNi@2|cin|-17|4|pin@24||-17|6
-Awire|net@43|||1800|pin@24||-17|6|pin@25||-14|6
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-Awire|net@45|||900|pin@25||-14|6|pin@26||-14|2
-Awire|net@54|||0|pin@47||1|10|cntFreq@0|myFin|-40|10
-Awire|net@56|||0|cntFreq@0|fout|-44|12|conn@9|a|-50|12
-Awire|net@57|||900|conn@10|y|28|8|cntScnOn@2|sin_1|28|4
-Awire|net@66|||0|conn@12|y|-34|14|cntFreq@0|fin|-40|14
-Awire|net@77|||0|pin@46||1|2|cntScnTw@4|sin|-1|2
-Awire|net@78|||0|cntScnTw@4|sout|-5.5|2|wire90@2|a|-7.5|2
-Awire|net@79|||0|wire90@2|b|-12.5|2|pin@26||-14|2
-Abus|net@80||-0.5|IJ1800|pin@40||-3|-6|pin@4||12|-6
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-Awire|net@112|||1800|pin@61||-23|19|cntContr@0|ctgLO_1|-17|19
-Abus|net@113||-0.5|IJ1800|cntContr@0|sod[1:9]|-13|29|conn@13|a|2|29
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-Abus|net@116||-0.5|IJ0|pin@62||-3.5|24|cntContr@0|sout|-12|24
-Awire|net@118|||900|cntFreq@0|ctgLO|-42|8|conn@11|y|-42|4
-Awire|net@119|||2700|pin@59||-23|2|pin@61||-23|19
-Ecin||D4G2;|conn@10|a|I
-Ectg|count|D4G2;|conn@11|a|I
-Efin||D4G2;|conn@12|a|I
-Efout||D6G2;|conn@9|y|O
-Esid[1:9]||D4G2;|conn@14|a|I
-Esod[1:9]||D6G2;|conn@13|y|O
-X
-
-# Cell instructionCount;1{sch}
-CinstructionCount;1{sch}||schematic|1226189708894|1226277288089|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IcntShift;1{ic}|cntContr@0||-36|-1|XR||D5G4;
-IcntFreq;1{ic}|cntFreq@0||-42|12|X||D5G4;
-IcntScnNine;1{ic}|cntScnNi@2||-18|0|||D5G4;
-IcntScnOne;1{ic}|cntScnOn@2||27|0|||D5G4;
-IcntScnTwelve;2{ic}|cntScnTw@3||12|0|||D5G4;
-IcntScnTwelve;2{ic}|cntScnTw@4||-3|0|||D5G4;
-NOff-Page|conn@9||-52|12|||X|
-NOff-Page|conn@10||28|10|||RRR|
-NOff-Page|conn@11||-52.5|7||||
-NOff-Page|conn@12||-29|14|||X|
-NOff-Page|conn@13||-31|9.5|||R|
-NOff-Page|conn@14||-31|-11.5|||YRRR|
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-NBus_Pin|pin@4||12|-6|-1|-1||
-NBus_Pin|pin@5||27|-10|-1|-1||
-Ngeneric:Invisible-Pin|pin@8||-11.5|42|||||ART_message(D5G5;)SinstructionCount
-Ngeneric:Invisible-Pin|pin@9||-11|38|||||ART_message(D5G3;)Sies 8 November 2008
-Ngeneric:Invisible-Pin|pin@10||-11|30|||||ART_message(D5G3;)S[this 34 bit counter,counts instructions,in the instruction ring]
-Ngeneric:Invisible-Pin|pin@12||-39|-16.5|||RR||ART_message(D7G2;)Sfrom the data scan chain
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-NWire_Pin|pin@47||1|10||||
-Ngeneric:Invisible-Pin|pin@48||-12.5|15.5|||||ART_message(D3G2;)S[frequency is divided by 2**13,should be about 40 KHz]
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-IorangeTSMC090nm:wire90;1{ic}|wire90@1||5|2|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@2||-10|2|X||D0G4;|ATTR_L(D5G1;PUD)D506.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-Abus|myp1p,myp2p,ctgLO|D5G2;|-0.5|IJ900|pin@3||27|-6|pin@5||27|-10
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-Awire|net@56|||0|cntFreq@0|fout|-44|12|conn@9|a|-50|12
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-Awire|net@64|||2700|pin@34||-36|-6|cntContr@0|ctgLO|-36|-4
-Awire|net@66|||0|conn@12|y|-31|14|cntFreq@0|fin|-40|14
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-Awire|net@99|||2700|cntContr@0|myp1p_1,myp2p_1|-41|1|pin@53||-41|20
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-Awire|net@102|||900|pin@54||31|20|pin@55||31|2
-Efin|cin|D4G2;|conn@10|a|I
-Esin_1|ctg|D4G2;|conn@11|a|I
-Esin_1@70994942|fin|D4G2;|conn@12|a|I
-Efout||D6G2;|conn@9|y|O
-Esid[1:9]||D4G2;|conn@14|a|I
-Esod[1:9]||D6G2;|conn@13|y|O
-X

diff --git a/electric/dockK.jelib b/electric/dockK.jelib
deleted file mode 100755 (executable)
index 2db5149..0000000
--- a/electric/dockK.jelib
+++ /dev/null
@@ -1,1088 +0,0 @@
-# header information:
-HdockK|8.08j
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
-LdockPartOD|dockPartOD
-
-LfansK|fansK
-
-LfifoL|fifoL
-
-LgaspL|gaspL
-
-LlatchesK|latchesK
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-LregistersJ|registersJ
-
-LtestsL|testsL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell aDockGallery;1{lay}
-CaDockGallery;1{lay}||cmos90|1208086429025|1227364833506|I
-IgaspL:aNewGallery;1{lay}|aNewGall@0||-2142|-566|||D5G4;
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IfifoWreg;2{lay}|fifoWreg@0||-1254|-2110|||D5G4;
-X
-
-# Cell aDockGallery;1{sch}
-CaDockGallery;1{sch}||schematic|1223424148680|1227364833506|I
-ItestsL:aTestGallery;1{ic}|aTestGal@0||0|1|||D5G4;
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Invisible-Pin|pin@1||-2|21|||||ART_message(D5G4;)Sjust to get testsL in
-Ngeneric:Invisible-Pin|pin@2||0|26|||||ART_message(D5G6;)SaDockGallery
-X
-
-# Cell dataPath;1{ic}
-CdataPath;1{ic}||artwork|1226941060360|1227549830099|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@1||2|-9|-1|-1||
-Nschematic:Bus_Pin|pin@3||-2|-6|-1|-1||
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-NPin|pin@30||1.5|-10|1|1||
-Ngeneric:Invisible-Pin|pin@31||0|6|||||ART_message(D5G1.5;)S43
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-Ngeneric:Invisible-Pin|pin@72||2|3|1|1||
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-NPin|pin@77||3|-2|1|1||
-Nschematic:Bus_Pin|pin@78||-1|6|-1|-1||
-Nschematic:Bus_Pin|pin@80||2|6|-1|-1||
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-Aschematic:bus|net@58||-0.5|IJ1800|pin@72||2|3|pin@9||3|3
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-AThicker|net@73|||FS1800|pin@76||2|-2|pin@77||3|-2
-EfreqOut||D5G2;|pin@75||O
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-Ein[1:36,T]||D5G2;|pin@3||I
-Eaout[1:14],outS[T,1:37]|outS[1:37,T],aout[1:14]|D5G2;|pin@1||O
-Epred||D5G2;|pin@4||I
-Epred[T,D]||D5G2;|pin@5||I
-Esi[1:9]||D5G2;|pin@78||B
-EsigS||D5G2;|pin@6||I
-Eso[1:9]||D5G2;|pin@80||O
-Esucc[T,D]||D5G2;|pin@9||O
-X
-
-# Cell dataPath;3{lay}
-CdataPath;3{lay}||cmos90|1208098805747|1227390442824||DRC_last_good_drc_area_date()G1227391175308
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IdockPartOD:dataAddrRegAll;1{lay}|dataAddr@0||-648|1224|||D5G4;
-IfansK:fan18m4m3at72;1{lay}|fan18m4m@1||1575|900|||D5G4;
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-NMetal-3-Pin|pin@3||-1944|1723||||
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-
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-X
-
-# Cell fifoWreg;2{lay}
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-X
-
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-X
-
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-Etorp||D6G2;|conn@30|y|O
-X
-
-# Cell tryIcons;2{sch}
-CtryIcons;2{sch}||schematic|1217962972321|1227364833506|I
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-IoutputDock;2{ic}|outputDo@1||21|0.5|||D5G4;
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-Ngeneric:Invisible-Pin|pin@1||-0.5|26|||||ART_message(D5G3;)Sies 20 August 2008
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-X

diff --git a/electric/dockPartOD.jelib b/electric/dockPartOD.jelib
deleted file mode 100755 (executable)
index 8679fb0..0000000
--- a/electric/dockPartOD.jelib
+++ /dev/null
@@ -1,4252 +0,0 @@
-# header information:
-HdockPartOD|8.08n
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
-LdockPartsK|dockPartsK
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-LdriversL|driversL
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-LfanPinsK|fanPinsK
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-LfansK|fansK
-
-LfifoL|fifoL
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-LgatesK|gatesK
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-LorangeTSMC090nm|orangeTSMC090nm
-
-LredFour|redFour
-
-LregistersL|registersL
-
-LscanK|scanK
-
-LskipL|skipL
-
-LstepsM|stepsM
-
-LwiresL|wiresL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell dRegAll;1{ic}
-CdRegAll;1{ic}||artwork|1217252608495|1226698650732|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@10||-2|-10|-1|-1||
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-X
-
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-
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-X

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index bee2ea0..0000000
--- a/electric/dockPartsK.jelib
+++ /dev/null
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-Ametal-2|net@274|||RS1800|predCond@2|pred|51.5|-82|contact@35||55.5|-82
-Ametal-2|net@277|||S0|contact@28||88|-50|contact@26||26.5|-50
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-X
-
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-IredFour:inv;1{ic}|inv@1||-45|30|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@2||-53|36|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-NWire_Pin|pin@84||-18|9||||
-NWire_Pin|pin@105||-18|23||||
-NWire_Pin|pin@108||-18|14||||
-NWire_Pin|pin@126||0|-1||||
-NWire_Pin|pin@127||-6|7||||
-NWire_Pin|pin@128||-6|31||||
-Ngeneric:Invisible-Pin|pin@135||42|-3|||||ART_message(D3G2;)S[OUTPUT dock:,Token successor and,"data successor same,",but differ in T bit.]
-Ngeneric:Invisible-Pin|pin@136||38.5|-14|||||ART_message(D3G2;)S[INPUT dock:,Can send only tokens,"to switch fabric, sends",data to Ship.]
-Ngeneric:Invisible-Pin|pin@137||-84|17|||||ART_message(D3G2;)S[OUTPUT dock:,Token predecessor,"is switch fabric,",data predecessor is Ship.]
-Ngeneric:Invisible-Pin|pin@138||-91.5|28|||||ART_message(D3G2;)S[INPUT dock:,"Data predecessor is switch fabric,",Token predecessor does not exist.]
-NWire_Pin|pin@149||-12|32||||
-NWire_Pin|pin@151||-12|4||||
-NWire_Pin|pin@153||-6|29||||
-Ngeneric:Invisible-Pin|pin@159||-47.5|-1|||||ART_message(D3G2;)SDoes not exist at input dock.
-Ngeneric:Invisible-Pin|pin@160||18.5|27|||||ART_message(D3G2;)S["At output dock, sending a token","fills succ[D] but marks as token."]
-Ngeneric:Invisible-Pin|pin@161||18|3|||||ART_message(D3G2;)Sdoes not exist at output dock.
-NWire_Pin|pin@164||-39|30||||
-NWire_Pin|pin@165||-39|25||||
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-Ngeneric:Invisible-Pin|pin@172||-0.5|50|||||ART_message(D5G3;)Sscan chain moved up the hierarchy
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-X
-
-# Cell moveD;3{sch}
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-NOff-Page|conn@5||-18.5|-24|||Y|
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-ImoveD;1{ic}|dStates@0||51|48|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0|66.5|||||ART_message(D5G6;)SmoveD
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-Ngeneric:Invisible-Pin|pin@2||-0.5|55|||||ART_message(D5G3;)Sies 13 November 2008
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-NWire_Pin|pin@81||0|5||||
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-NBus_Pin|pin@129||-7|-30|-1|-1||
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-Ngeneric:Invisible-Pin|pin@136||38.5|-14|||||ART_message(D3G2;)S[INPUT dock:,Can send only tokens,"to switch fabric, sends",data to Ship.]
-Ngeneric:Invisible-Pin|pin@137||-84|17|||||ART_message(D3G2;)S[OUTPUT dock:,Token predecessor,"is switch fabric,",data predecessor is Ship.]
-Ngeneric:Invisible-Pin|pin@138||-91.5|28|||||ART_message(D3G2;)S[INPUT dock:,"Data predecessor is switch fabric,",Token predecessor does not exist.]
-NWire_Pin|pin@149||-12|32||||
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-Ngeneric:Invisible-Pin|pin@159||-47.5|-1|||||ART_message(D3G2;)SDoes not exist at input dock.
-Ngeneric:Invisible-Pin|pin@160||18.5|27|||||ART_message(D3G2;)S["At output dock, sending a token","fills succ[D] but marks as token."]
-Ngeneric:Invisible-Pin|pin@161||18|3|||||ART_message(D3G2;)Sdoes not exist at output dock.
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-X
-
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-Ngeneric:Invisible-Pin|pin@138||-91.5|28|||||ART_message(D3G2;)S[INPUT dock:,"Data predecessor is switch fabric,",Token predecessor does not exist.]
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-Ngeneric:Invisible-Pin|pin@160||18.5|27|||||ART_message(D3G2;)S["At output dock, sending a token","fills succ[D] but marks as token."]
-Ngeneric:Invisible-Pin|pin@161||18|3|||||ART_message(D3G2;)Sdoes not exist at output dock.
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-IdriversL:predCond20wMC;1{ic}|predCond@4||-30|6|RR||D5G4;
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-X
-
-# Cell moveE;2{ic}
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-Nschematic:Bus_Pin|pin@3||3|3|-1|-1||
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-X
-
-# Cell moveE;1{lay}
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index 83839ba..0000000
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-X

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deleted file mode 100755 (executable)
index a18497a..0000000
--- a/electric/driversL.jelib
+++ /dev/null
@@ -1,3960 +0,0 @@
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
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-
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-
-# Cell easy2inDriver;1{sch}
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-X

diff --git a/electric/fanPinsK.jelib b/electric/fanPinsK.jelib
deleted file mode 100755 (executable)
index 285f3fd..0000000
--- a/electric/fanPinsK.jelib
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-X
-
-# Cell pins18m3at144;1{lay}
-Cpins18m3at144;1{lay}||cmos90|1217144142045|1225666554451||DRC_last_good_drc_area_date()G1217144852041|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1225667467766
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-X
-
-# Cell pins19m3;1{lay}
-Cpins19m3;1{lay}||cmos90|1217144142045|1217150513502||DRC_last_good_drc_area_date()G1217144852041|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1217150571402
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-X
-
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-Cpins19m3at144;1{lay}||cmos90|1217144142045|1225666311760||DRC_last_good_drc_area_date()G1217144852041|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1225796378409
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-X
-
-# Cell pins19m3stag;1{lay}
-Cpins19m3stag;1{lay}||cmos90|1217144142045|1217150513502||DRC_last_good_drc_area_date()G1217144852041|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1217150571402
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pins36m3at144;1{lay}
-Cpins36m3at144;1{lay}||cmos90|1227466094863|1227466115517||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227467143621
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-Ipins18m3at144;1{lay}|pins18m3@1||864|0|||D5G4;
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-X
-
-# Cell pinsIn03m2;1{lay}
-CpinsIn03m2;1{lay}||cmos90|1204696663454|1218403288240||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1218404239517
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-X
-
-# Cell pinsIn04m3;1{lay}
-CpinsIn04m3;1{lay}||cmos90|1204696358144|1213050720879||DRC_last_good_drc_bit()I11|DRC_last_good_drc_date()G1204746240509
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-X
-
-# Cell pinsIn06m2;1{lay}
-CpinsIn06m2;1{lay}||cmos90|1204696663454|1218403248800||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1218404239517
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-CpinsIn07m2;1{lay}||cmos90|1204696663454|1205537048993||DRC_last_good_drc_bit()I11|DRC_last_good_drc_date()G1204742769143
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-
-# Cell pinsIn07m3;1{lay}
-CpinsIn07m3;1{lay}||cmos90|1204696358144|1205537052121||DRC_last_good_drc_bit()I11|DRC_last_good_drc_date()G1204746240509
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-CpinsIn07m4;1{lay}||cmos90|1204696663454|1227273908905||DRC_last_good_drc_area_date()G1217154647074|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1220652652080
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
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-CpinsIn08m3;1{lay}||cmos90|1204696358144|1207333169883||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1207332914389
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsIn09m1;1{lay}
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-
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-
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-
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-
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-X
-
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-
-# Cell pinsIn18m2;1{lay}
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-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut04m3;1{lay}
-CpinsOut04m3;1{lay}||cmos90|1204696358144|1213050768109||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1213050977992
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut06m2;1{lay}
-CpinsOut06m2;1{lay}||cmos90|1204696663454|1225739214422||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1225751542276
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut06m2;1{sch}
-CpinsOut06m2;1{sch}||schematic|1225741614532|1225741614536|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut06m3A;1{lay}
-CpinsOut06m3A;1{lay}||cmos90|1219106030125|1219106074895||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1220653934194
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut07m3;1{lay}
-CpinsOut07m3;1{lay}||cmos90|1204696358144|1205537073695||DRC_last_good_drc_bit()I11|DRC_last_good_drc_date()G1204701595620
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut08m3;1{lay}
-CpinsOut08m3;1{lay}||cmos90|1204696358144|1207333127147||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1207332914389
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell pinsOut08m4;1{lay}
-CpinsOut08m4;1{lay}||cmos90|1204696663454|1227307664815||DRC_last_good_drc_area_date()G1217154647074|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227307911783
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NMetal-4-Pin|pin@9||0|8.7||||
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-X
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-X
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-X
-
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-X

diff --git a/electric/fansK.jelib b/electric/fansK.jelib
deleted file mode 100755 (executable)
index ef256b6..0000000
--- a/electric/fansK.jelib
+++ /dev/null
@@ -1,1894 +0,0 @@
-# header information:
-HfansK|8.08j
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-# Views:
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-# External Libraries:
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-CaddressFan;1{lay}||cmos90|1217154717592|1227283626750||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227284747163
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-
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-X
-
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-
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-
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-
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-X
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-X
-
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-X
-
-# Cell literals;1{lay}
-Cliterals;1{lay}||cmos90|1225467938626|1227290727101|I|ATTR_NCC(D5G3;NTY140;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]|DRC_last_good_drc_area_date()G1225468812548|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1225468812548
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-Eout[31]||D5G2;|ins20Bx1@2|out[13]|I
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-Epred||D5G2;|aStageB@0|pred|I
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-Erd[F_1]||D5G2;|scanKhx2@0|rd[F_1]|I
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-Esin||D5G2;|pin@8||I
-Esout||D5G2;|scanKhx2@0|sout|O
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-X
-
-# Cell m1stageD;2{sch}
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-Ngeneric:Invisible-Pin|pin@5||-6|20|||||ART_message(D5G3;)Sies 17 November 2008
-NWire_Pin|pin@9||-1|-5||||
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-NWire_Pin|pin@13||-2|11||||
-Ngeneric:Invisible-Pin|pin@14||-38|14|||||ART_message(D3G2;)S[m1stageD provides scan,for m2stageD as well.,N.B. M2 is first in scan chain.]
-NWire_Pin|pin@18||9|9||||
-NWire_Pin|pin@19||0|9||||
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-NWire_Pin|pin@21||-7|-6||||
-Ngeneric:Invisible-Pin|pin@22||27|-11|||||ART_message(D3G2;)S["wait[M] is a state wire.",M1 fills it only for move instructions.,M1 waits for it to drain.,"OD drains wait[M], but with a delay.",This retards next firing of M1 after,a move.]
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-IorangeTSMC090nm:wire90;1{ic}|wire90@2||4|9|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D447.1|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-Awire|in[25]|D5G2;||900|pin@20||-7|-1|pin@21||-7|-6
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-Awire|net@59|||0|aStageM1@2|pred_1|-4|-1|pin@20||-7|-1
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-Ecl[T,F],clS[T,F],rd[T,F],mc||D4G2;|conn@8|a|I
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-X
-
-# Cell m1stageD;1{sch}
-Cm1stageD;1{sch}||schematic|1224182442214|1227290727101|I
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-NOff-Page|conn@7||-15.5|-16|||XRR|
-NOff-Page|conn@8||-26|-6.5|||YR|
-NOff-Page|conn@9||-36|-16|||XRR|
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-IdriversJ:latchDriver60;1{ic}|latchDri@0||8|-11.5|RRR||D5G4;
-Im1stageD;1{ic}|m1stageD@0||32|14|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||-3|25|||||ART_message(D5G4;)Sthis is the minus one stage
-Ngeneric:Invisible-Pin|pin@1||-4.5|30.5|||||ART_message(D5G6;)Sm1stageD
-NWire_Pin|pin@2||8|-5||||
-NWire_Pin|pin@3||8|-20||||
-NWire_Pin|pin@4||-3|-20||||
-Ngeneric:Invisible-Pin|pin@5||-6|20|||||ART_message(D5G3;)Sies 18 October 2008
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-Ngeneric:Invisible-Pin|pin@14||-38|14|||||ART_message(D3G2;)S[m1stageD provides scan,for m2stageD as well.,N.B. M2 is first in scan chain.]
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-IorangeTSMC090nm:wire90;1{ic}|wire90@2||4|9|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D447.1|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-Awire|net@15|||900|pin@2||8|-5|latchDri@0|inA|8|-7.5
-Awire|net@16|||0|conn@4|a|11|-5|pin@2||8|-5
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-Abus|s[m2,m1]|D5G2;|-0.5|IJ900|scanKhx2@0|din[2]|-25|-19|pin@11||-25|-23
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-Esin_1|s[m2]|D4G2;|conn@11|a|I
-Esin||D4G2;|conn@9|a|I
-Esout||D6G2;|conn@7|y|O
-Esucc||D6G2;|conn@2|y|O
-X
-
-# Cell m2stageD;1{ic}
-Cm2stageD;1{ic}||artwork|1224326401175|1227290727101|EI
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-
-# Cell m2stageD;1{lay}
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-NX-Metal-1-Metal-2-Con|contact@1||-95.5|12||||
-IdriversJ:driveConnecter;1{lay}|driveCon@0||217.5|-24.4|X||D5G4;
-IregistersL:ins20Bx18m2;6{lay}|ins20Bx1@2||-648|0|X||D5G4;
-IregistersL:ins20Bx18m2;6{lay}|ins20Bx1@3||648|0|||D5G4;
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-Efire[m2]||D5G2;|m12stage@0|fire[m1]|O
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-X
-
-# Cell split10plus;1{sch}
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-Im12stageD;1{ic}|m12stage@0||36|0|||D5G4;
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-Ngeneric:Invisible-Pin|pin@2||4|34|||||ART_message(D5G3;)Sies 17 November 2008
-Ngeneric:Invisible-Pin|pin@3||6|41|||||ART_message(D5G4;)Sencompasing the split FIFO, epi, m2 and m1
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-X
-
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-X
-
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-X
-
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-
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-Eod[35]||D5G2;|odRQstag@0|od[35]|I
-Eod[36]||D5G2;|odRQstag@0|od[36]|I
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-X
-
-# Cell theRing;1{sch}
-CtheRing;1{sch}||schematic|1226966820500|1227363393589|I
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-Ngeneric:Invisible-Pin|pin@1||5.5|51.5|||||ART_message(D5G6;)StheRing
-Ngeneric:Invisible-Pin|pin@2||6|28|||||ART_message(D5G3;)Sies 22 November 2008
-Ngeneric:Invisible-Pin|pin@3||6|41|||||ART_message(D5G4;)Sencompasing epi, rq, split FIFO, m2, m1, and od
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-X
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-
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-X

diff --git a/electric/gaspL.jelib b/electric/gaspL.jelib
deleted file mode 100755 (executable)
index 11654de..0000000
--- a/electric/gaspL.jelib
+++ /dev/null
@@ -1,7607 +0,0 @@
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-X
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-X
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-
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-X
-
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-X
-
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-
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-X
-
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-CgaspDrain;1{ic}||artwork|1189094730318|1226321857513|EI
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-X
-
-# Cell gaspDrain;1{lay}
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-
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-Ein[RQ]||D5G2;|nor10sym@0|inB|I
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-Es[3]||D5G2;|pin@102||I
-Es[4]||D5G2;|pin@73||O
-Etail||D5G2;|pin@339||I
-Etake[E]||D5G2;|pin@357||I
-Etake[R]||D5G2;|pin@360||I
-Etakee[E]||D5G2;|pin@358||I
-Etakee[R]||D5G2;|pin@359||I
-Evdd||D5G2;|pinsVddG@5|vdd|P
-Evdd_1||D5G2;|pinsVddG@5|vdd_1|P
-Evdd_6||D5G2;|pinsVddG@7|vdd|P
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-Evdd_13||D5G2;|pinsVddG@9|vdd|P
-Evdd_14||D5G2;|pinsVddG@9|vdd_1|P
-X
-
-# Cell rqStage;1{sch}
-CrqStage;1{sch}||schematic|1220208743747|1227396585373|
-IgatesK:andOrInv5;1{ic}|andOrInv@0||43.5|17|Y||D5G4;
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-66|12|||Y|
-NOff-Page|conn@1||-30|12|||Y|
-NOff-Page|conn@2||72|17||||
-NOff-Page|conn@4||40|-33|||YRR|
-NOff-Page|conn@5||-55|27|||R|
-NOff-Page|conn@6||-36|-33|||Y|
-NOff-Page|conn@8||-6|-29|||YRRR|
-NOff-Page|conn@9||-6|30.5|||YRRR|
-IcentersJ:ctrAND2in30;1{ic}|ctrAND2i@0||-6|0|XR||D5G4;
-IcentersJ:ctrAND3in30;1{ic}|ctrAND3i@0||-42|0|XR||D5G4;
-IcentersJ:ctrAND4in30;2{ic}|ctrAND4i@1||24|0|R||D5G4;
-IredFour:inv;1{ic}|inv@12||-56|-12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@13||-44.5|-20|RRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@14||-12|-28|RRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@15||22|-28|RRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@16||14|-0.5|R||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@17||-18|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S100|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S10|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1|ATTR_su()I-1
-IredFour:inv;1{ic}|inv@18||-36.5|-39|RR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IdriversJ:latchDriver60;1{ic}|latchDri@0||24|29.5|YRRR||D5G4;
-IdriversJ:latchDriver60;1{ic}|latchDri@1||-42|29|R||D5G4;
-IredFour:nor2_sy;1{ic}|nor2_sy@1||36|-22|XR||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||0|59.5|||||ART_message(D5G6;)SrqStage
-Ngeneric:Invisible-Pin|pin@1||-0.5|52|||||ART_message(D5G4;)S[puts instructions back in the ring,also rejects an end from epi]
-Ngeneric:Invisible-Pin|pin@2||-1.5|40.5|||||ART_message(D5G3;)S[ies 4 September 2008,moved to gaspL and renamed,16 October 2008]
-NWire_Pin|pin@3||-42|14||||
-NWire_Pin|pin@5||-60|12||||
-NWire_Pin|pin@7||-60|-12||||
-NWire_Pin|pin@8||-44.5|-12||||
-NWire_Pin|pin@13||68|17||||
-NWire_Pin|pin@14||68|-12||||
-NWire_Pin|pin@17||28|-12||||
-NWire_Pin|pin@18||8|-21||||
-NWire_Pin|pin@20||-22|-18||||
-NWire_Pin|pin@23||-24|12||||
-NWire_Pin|pin@25||-24|-9||||
-NWire_Pin|pin@27||4|-21||||
-NWire_Pin|pin@29||-47|10||||
-NWire_Pin|pin@30||-47|7||||
-NWire_Pin|pin@31||-12|10||||
-NWire_Pin|pin@33||-12|7||||
-NWire_Pin|pin@34||-6|12||||
-NWire_Pin|pin@37||24|14||||
-NWire_Pin|pin@44||-5|-21||||
-NWire_Pin|pin@46||-17|-31||||
-NWire_Pin|pin@47||-17|-27||||
-NWire_Pin|pin@49||13|-31||||
-NWire_Pin|pin@50||-17|-33||||
-NWire_Pin|pin@51||-17|-39||||
-NWire_Pin|pin@53||13|-33||||
-NWire_Pin|pin@54||13|-39||||
-NWire_Pin|pin@57||32|-39||||
-NWire_Pin|pin@61||-31|-31||||
-NWire_Pin|pin@66||-1|-31||||
-NWire_Pin|pin@69||-26|-21||||
-NWire_Pin|pin@78||-1|-26||||
-NWire_Pin|pin@79||6|-24||||
-NWire_Pin|pin@80||-24|-24||||
-NWire_Pin|pin@81||-6|-24||||
-NWire_Pin|pin@84||13|-27||||
-NWire_Pin|pin@85||-31|-27||||
-NWire_Pin|pin@99||-1|-33||||
-NWire_Pin|pin@109||36|-15|||X|
-NWire_Pin|pin@115||-1|-36||||
-NWire_Pin|pin@116||22|-21||||
-NWire_Pin|pin@118||-12|-18||||
-NWire_Pin|pin@125||14|-9||||
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-NWire_Pin|pin@142||-42|20||||
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-NWire_Pin|pin@144||27|18||||
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-NWire_Pin|pin@154||37|-27||||
-NWire_Pin|pin@157||36|8|||Y|
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-NWire_Pin|pin@165||-54|-39|||RR|
-NWire_Pin|pin@166||-54|-35|||RR|
-NWire_Pin|pin@170||-31|-33||||
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-NWire_Pin|pin@176||-7|-9||||
-NWire_Pin|pin@177||-42|37.5||||
-NWire_Pin|pin@178||24|38||||
-NWire_Pin|pin@179||40|-27||||
-NWire_Pin|pin@180||40|-30||||
-NWire_Pin|pin@182||32|-27||||
-NWire_Pin|pin@183||35|-27||||
-NWire_Pin|pin@185||-22|-16||||
-NWire_Pin|pin@187||36|20||||
-NWire_Pin|pin@188||36|14||||
-NWire_Pin|pin@189||26|-9||||
-NWire_Pin|pin@190||20|-18||||
-NWire_Pin|pin@191||-39.5|-21||||
-NWire_Pin|pin@193||-42.5|-12||||
-Ngeneric:Invisible-Pin|pin@194||74|-24|||||ART_message(D5G3;)Sin[RQ] HI is a one shot instruction
-Ngeneric:Invisible-Pin|pin@195||-28|-44|||||ART_message(D1G2;)S[An arriving tail sets this,flip flop to NOT FILLING;,the tail is consumed and,NOT delivered to the ring.]
-Ngeneric:Invisible-Pin|pin@196||-25|-44|||||ART_message(D3G2;)S[A recirculating zero sets,this flip flop to FILLING.]
-Ngeneric:Invisible-Pin|pin@197||40|8|||||ART_message(D3G2;)S["This gate blocks tails,",one-shot and,zero-marked,instructions.]
-Ngeneric:Invisible-Pin|pin@198||55|-28|||||ART_message(D3G2;)S[nzrq goes LO for,one shot or,zero-marked,instructions.]
-Ngeneric:Invisible-Pin|pin@199||-15|27|||||ART_message(D3G2;)SUse fireB for draining.
-Ngeneric:Invisible-Pin|pin@200||-71|21|||||ART_message(D3G2;)SUse fire[E] for filling.
-Ngeneric:Invisible-Pin|pin@201||33|31|||||ART_message(D3G2;)SUse fire[R] for recirculating.
-Ngeneric:Invisible-Pin|pin@202||74|-28|||||ART_message(D3G2;)S[nzrq goes HI for,recirculating instructions,with non-zero markings.]
-IdriversL:predDri20wMC;1{ic}|predDri2@0||-54|12|X||D5G4;
-IdriversL:predORdri20wMC;2{ic}|predORdr@0||-18|12|X||D5G4;
-IrqStage;1{ic}|requeueB@1||48|41|||D5G4;
-IlatchesK:rsLatchC;1{ic}|rsLatchC@0||-24|-30|||D5G4;
-IlatchesK:rsLatchC;1{ic}|rsLatchC@1||6|-30|||D5G4;
-IdriversL:sucDri20plain;1{ic}|sucDri20@1||62.5|17|||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-49|-12|||D0G4;|ATTR_L(D5G1;PUD)D314.69999999999993|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-X
-
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-X

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deleted file mode 100755 (executable)
index 07a43ef..0000000
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@@ -1,1375 +0,0 @@
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-
-# Cell data1inTwin30m1;1{lay}
-Cdata1inTwin30m1;1{lay}|data1inTwin30|cmos90|1197076555516|1216150419426||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/",exportsConnectedByParent hcl hcl_1]|DRC_last_good_drc_bit()I11|DRC_last_good_drc_date()G1204643626037
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-X

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deleted file mode 100755 (executable)
index 55c4b48..0000000
--- a/electric/latchPartsK.jelib
+++ /dev/null
@@ -1,3170 +0,0 @@
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-
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-
-# Cell latchPointTmcLO;1{ic}
-ClatchPointTmcLO;1{ic}||artwork|1189205655218|1207703652982|EI
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-
-# Cell latchPointTmcLO;1{lay}
-ClatchPointTmcLO;1{lay}||cmos90|1188657354781|1207705953056||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1207705964208
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-X
-
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deleted file mode 100755 (executable)
index a6aba51..0000000
--- a/electric/latchesK.jelib
+++ /dev/null
@@ -1,12963 +0,0 @@
-# header information:
-HlatchesK|8.08j
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-# Views:
-Vicon|ic
-Vlayout|lay
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-
-# External Libraries:
-
-LlatchPartsK|latchPartsK
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-LorangeTSMC090nm|orangeTSMC090nm
-
-LredFour|redFour
-
-LwiresL|wiresL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell aLatchGallery;1{lay}
-CaLatchGallery;1{lay}||cmos90|1194232063674|1216652458743||DRC_last_good_drc_area_date()G1216652461603|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1216652461603
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-Clatch1in20Bm1;1{lay}|latch1in20B|cmos90|1197076555516|1216652301282||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/",exportsConnectedByParent hcl hcl_1]|DRC_last_good_drc_area_date()G1216651857466|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1216652448576
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-
-# Cell latch2in10Aimc;1{ic}
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-
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-Clatch2in10Aimc;1{lay}||cmos90|1194186085518|1206031539827||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1206038362814
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-X
-
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-Clatch2in10Aimc;1{sch}||schematic|1194187081843|1206031597769|
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-X
-
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-Clatch2in10Alo;1{ic}||artwork|1194654947838|1206033658156|E
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-X
-
-# Cell latch2in10Alo;1{lay}
-Clatch2in10Alo;1{lay}||cmos90|1194186085518|1206031209843||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1206038362814
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@1||17.5|-22||||
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-Ametal-1|net@37|||S2700|pin@14||17.5|-25|contact@1||17.5|-22
-Egnd||D5G2;|hi2inLat@2|gnd|G
-Egnd_1||D5G2;|latchAmp@0|gnd_1|G
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-Ehcl_1||D5G2;|hi2inLat@2|hcl_1|I
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-EinB[1]||D5FLeave alone;G2;|hi2inLat@2|inB[1]|I
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-Evdd_1||D5G2;|latchAmp@0|vdd_1|P
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-X
-
-# Cell latch2in10Alo;1{sch}
-Clatch2in10Alo;1{sch}||schematic|1194187081843|1225233421626|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-21|-9|||Y|
-NOff-Page|conn@2||-21|3|||XYRR|
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-NOff-Page|conn@4||12|0||||
-Iraw2inLatchF;1{ic}|hi2inLat@0||-9|0|Y||D5G4;
-IredFour:invLT;1{ic}|invLT@0||4.5|0|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ilatch2in10Alo;1{ic}|latch2in@0||8|9|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||-0.5|16.5|||||ART_message(D5G3;)S[ies 9 November 2007,renamed 20 March 2008]
-Ngeneric:Invisible-Pin|pin@1||0|22.5|||||ART_message(D5G4;)Slatch with one amplifier
-Ngeneric:Invisible-Pin|pin@2||0|27.5|||||ART_message(D5G6;)Slatch2in10Alo
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-NWire_Pin|pin@7||-16|1|||Y|
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-NWire_Pin|pin@9||-11|9|||Y|
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-NWire_Pin|pin@11||-5|5||||
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-Awire|dataBar|D5G2;||2700|pin@10||-5|0|pin@11||-5|5
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-X
-
-# Cell latch2in10Alomc;1{ic}
-Clatch2in10Alomc;1{ic}||artwork|1194654947838|1206031843532|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Invisible-Pin|pin@11||0|0|||||ART_message(D5G3;)S10A
-NPin|pin@12||-3|2|1|1||
-NPin|pin@13||-3|-2|1|1||
-NPin|pin@14||2|-2|1|1||
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-EinA[1]||D5G2;|pin@4||I
-Emc||D5G2;|pin@2||I
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-
-# Cell latch2in10Alomc;1{lay}
-Clatch2in10Alomc;1{lay}||cmos90|1194186085518|1206031835497||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1206038362814
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NX-Metal-1-Metal-2-Con|contact@0||15.5|-22||||
-NX-Metal-1-Metal-2-Con|contact@1||-4|-22||||
-IlatchPartsK:latchAmp10;1{lay}|latchAmp@0||19|0|||D5G4;
-NMetal-2-Pin|pin@12||27|50||||
-NMetal-1-Pin|pin@13||-4|-12.5||||
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-IlatchPartsK:shoulderFill;1{lay}|shoulder@1||27|50|X||D5G4;
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-Egnd||D5G2;|raw2inLa@0|gnd_1|G
-Egnd_1||D5G2;|latchAmp@0|gnd_1|G
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-Evdd_1||D5G2;|latchAmp@0|vdd_1|P
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-X
-
-# Cell latch2in10Alomc;1{sch}
-Clatch2in10Alomc;1{sch}||schematic|1194187081843|1225233453322|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-21|0||||
-NOff-Page|conn@1||-21|9||||
-NOff-Page|conn@3||-21|-9||||
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-
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-
-# Cell latch2in30Bmc;1{ic}
-Clatch2in30Bmc;1{ic}||artwork|1194792867936|1207493297586|E
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-
-# Cell latch2in30Bmc;1{lay}
-Clatch2in30Bmc;1{lay}||cmos90|1207491179652|1207706177566||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1207706178953|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1207706178953
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-
-# Cell latch2in30Bmc;1{sch}
-Clatch2in30Bmc;1{sch}||schematic|1194187081843|1207493280050|
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-Ngeneric:Invisible-Pin|pin@1||0|22.5|||||ART_message(D5FLeave alone;G4;)S[latch with two amplifiers,and Master Clear]
-Ngeneric:Invisible-Pin|pin@2||0|31.5|||||ART_message(D5G6;)Slatch2in30Bmc
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-# Cell latch2in60C;1{ic}
-Clatch2in60C;1{ic}||artwork|1194792867936|1216151386666|E
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-
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-Craw2inLatchTmc;1{ic}||artwork|1194186804882|1205361319436|E
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-# Cell raw2inLatchTmc;1{lay}
-Craw2inLatchTmc;1{lay}||cmos90|1194182014255|1205533766842||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1206038362814
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-APolysilicon|net@281|||S1800|contact@87||-2.5|-23|pin@26||-1|-23
-APolysilicon|net@282|||S2700|pin@53||19|-30|pin@73||19|-25
-APolysilicon|net@283|||S1800|pin@73||19|-25|contact@88||20.5|-25
-Ametal-1|net@284|||S2700|contact@87||-2.5|-24.5|pin@74||-2.5|-24
-Ametal-1|net@285|||S2700|contact@88||20.5|-24.5|pin@75||20.5|-24
-Egnd||D5G2;|pinsVddG@2|gnd|G
-Egnd_1||D5G2;|pinsVddG@3|gnd|G
-Emc||D5G2;|pin@64||I
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-Evdd||D5G2;|pinsVddG@2|vdd|P
-Evdd_1||D5G2;|pinsVddG@2|vdd_1|P
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-X
-
-# Cell rsLatchC;1{sch}
-CrsLatchC;1{sch}||schematic|1188777360591|1227013754395|
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOSx@6||24|6|X||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)S5
-IorangeTSMC090nm:PMOSx;1{ic}|PMOSx@7||24|12|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)S5
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-NOff-Page|conn@1||48|15|||R|
-NOff-Page|conn@2||6|-18|||R|
-NOff-Page|conn@4||60|15|||R|
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-NOff-Page|conn@6||30|-24|||R|
-NOff-Page|conn@7||-30|4.5|||RRR|
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-IredFour:inv;1{ic}|inv@2||54|0|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S20|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:nand2_sy;1{ic}|nand2_sy@0||-24|-8|XRR||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)S4|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Ngeneric:Invisible-Pin|pin@2||2|38|||||ART_message(D5G4;)S[conditional set reset latch,with MC used in hatch]
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-NWire_Pin|pin@57||48|0||||
-NWire_Pin|pin@59||18|18||||
-NWire_Pin|pin@60||-12|6||||
-NWire_Pin|pin@61||-12|-8||||
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-NWire_Pin|pin@82||60|0||||
-NWire_Pin|pin@96||18|-4||||
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-NWire_Pin|pin@106||48|6||||
-NWire_Pin|pin@107||-30|-7||||
-Ngeneric:Invisible-Pin|pin@108||37|28|||||ART_message(D3G2;)S[true inputs make,output on that side HI]
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-NPower|pwr@2||24|24||||
-IrsLatchC;1{ic}|rsLatchC@0||44.5|33.5|||D5G4;
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-IorangeTSMC090nm:wire90;1{ic}|wire90@1||12|0|||D0G4;|ATTR_L(D5G1;PUD)D353.2|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-Awire|net@121|||1800|NMOSx@1|g|3|-6|pin@42||6|-6
-Awire|net@168|||900|pin@106||48|6|pin@57||48|0
-Awire|net@170|||0|pin@57||48|0|inv@0|out|44.5|0
-Awire|net@177|||0|PMOSx@3|g|-9|6|pin@60||-12|6
-Awire|net@178|||900|pin@60||-12|6|pin@61||-12|-8
-Awire|net@180|||900|pin@57||48|0|pin@62||48|-12
-Awire|net@186|||900|pwr@1||-6|15|PMOSx@3|s|-6|8
-Awire|net@188|||2700|pin@66||-6|0|PMOSx@3|d|-6|4
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-Awire|net@211|||2700|conn@5|y|-30|-16|pin@72||-30|-9
-Awire|net@214|||1800|wire90@0|b|-14.5|-8|pin@61||-12|-8
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-Awire|net@239|||1800|pin@79||0|0|wire90@1|a|9.5|0
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-Awire|net@261|||1800|pin@96||18|-4|nms2_sy@0|g2|21|-4
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-Awire|net@265|||0|pin@62||48|-12|nms2@1|g|-3|-12
-Awire|net@266|||900|pin@66||-6|0|nms2@1|d|-6|-6
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-Awire|net@271|||2700|nms2_sy@0|d|24|-2|pin@67||24|0
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-Awire|net@273|||2700|PMOSx@6|s|24|8|PMOSx@7|d|24|10
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-Awire|net@301|||1800|pin@107||-30|-7|nand2_sy@0|ina|-26.5|-7
-Emc||D4G2;|conn@2|a|I
-Eout||D6G2;|conn@4|y|O
-EoutBar||D6G2;|conn@1|y|O
-Ereset|resetA|D4G2;|conn@0|a|I
-EresetA_1|resetB|D4G2;|conn@6|a|I
-Eset_1|setA|D4G2;|conn@7|a|I
-Eset|setB|D4G2;|conn@5|a|I
-X

diff --git a/electric/loopCountL.jelib b/electric/loopCountL.jelib
deleted file mode 100755 (executable)
index bb02de0..0000000
--- a/electric/loopCountL.jelib
+++ /dev/null
@@ -1,9936 +0,0 @@
-# header information:
-HloopCountL|8.08j
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
-LfanPinsK|fanPinsK
-
-LgatesK|gatesK
-
-LlatchesK|latchesK
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-LpurpleFour|purpleFour
-
-LredFour|redFour
-
-LscanK|scanK
-
-LwiresL|wiresL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell countLogic;1{ic}
-CcountLogic;1{ic}||artwork|1216796698094|1226517921416|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NThick-Circle|art@3||3|-2|4|4|RR||ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@4||9|2|4|4|||ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@6||-15|2|4|4|||ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@7||-9|-2|4|4|RR||ART_degrees()F[0.0,3.1415927]
-Nschematic:Bus_Pin|pin@4||15|-4|-1|-1||
-Nschematic:Bus_Pin|pin@6||9|4|-1|-1||
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-Ebit[1]||D5G2;|pin@16||I
-Ebit[2]||D5G2;|pin@18||I
-Ebit[3]||D5G2;|pin@20||I
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-Ebit[6]||D5G2;|pin@26||I
-Edo[2]||D5G2;|pin@4||O
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-Edo[7]|zoo|D5G2;|pin@14||O
-X
-
-# Cell countLogic;4{lay}
-CcountLogic;4{lay}||cmos90|1216735796008|1227290833891|I|ATTR_NCC(D5G3;NTX56;Y70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1227190663443|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227296377317
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@2||13.5|28||||
-NX-Metal-1-Metal-2-Con|contact@4||-128.5|16||||
-NX-Metal-1-Metal-2-Con|contact@5||117.5|16||||
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-NX-Metal-1-Metal-2-Con|contact@8||-224.5|-16||||
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-NX-Metal-1-Metal-2-Con|contact@19||205|16||||
-IgatesK:inv10A;2{lay}|inv10A@0||259.5|0|X||D5G4;
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-
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-Ngeneric:Invisible-Pin|pin@119||-75|50|||||ART_message(D3G2;)S[ies 12 November 2008,applied the name zoo,(zero or one) to what,"was formerly do[7] and",added a statizer for it.]
-Ngeneric:Invisible-Pin|pin@120||-22|40|||||ART_message(D5G3;)Sies 12 November 2008
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-
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-Ngeneric:Invisible-Pin|pin@152||-64.5|40|||||ART_message(D3G3;)SIn bits[1:6], 0 = HI, 1 = LO.
-Ngeneric:Invisible-Pin|pin@153||-45.5|-8.5|||||ART_message(D3G2;)S["ilc[done] is HI when",ilc = 0 AND not infinity.]
-Ngeneric:Invisible-Pin|pin@159||-19|50|||||ART_message(D3G3;)S[the Inner Loop Counter is a,"six bit counter on bit[1:6]","with fast allZero bit[7].","It also knows infinity bit[8]","which prevents ilc[done]."]
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-Ngeneric:Invisible-Pin|pin@179||-48|24|||||ART_message(D3G2;)S["bit[7] is the allZero bit.","It goes LO when bits[1:6]","become zero = HI, or",if ilc is loaded with zero.]
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-X
-
-# Cell ilcEvenZoo;1{sch}
-CilcEvenZoo;1{sch}||schematic|1216766649341|1227290833891|I
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-NOff-Page|conn@23||-2.5|-29|||RRR|
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-IredFour:inv;1{ic}|inv@8||37|-24|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S30|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Ngeneric:Invisible-Pin|pin@0||-1|46|||||ART_message(D5G6;)SilcEvenZoo
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-Ngeneric:Invisible-Pin|pin@126||-71|36.5|||||ART_message(D3G2;)S["bit[8] = ilc[i] is the infinity bit.",It prevents the counter,from finishing.]
-NWire_Pin|pin@137||-16|-20||||
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-NWire_Pin|pin@139||-34|-20||||
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-NWire_Pin|pin@144||-16|-24||||
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-NWire_Pin|pin@158||-47|-3.5||||
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-NWire_Pin|pin@161||-57|12||||
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-NBus_Pin|pin@168||-2.5|-18|-1|-1||
-NWire_Pin|pin@169||-69|0||||
-Ngeneric:Invisible-Pin|pin@171||-10|-35.5|||||ART_message(D3G2;)Sfor scan readout
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-IringB;1{ic}|ringB@1||30|0|X||D5G4;
-IringB;1{ic}|ringB@2||-30|0|X||D5G4;
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-IorangeTSMC090nm:wire90;1{ic}|wire90@8||-39.5|-24|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D1915.8000000000002|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@9||30.5|-24|X||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D1810.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-X
-
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-Ekill_1||D5G2;|ilcOddZo@0|kill|I
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-X
-
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-CilcZoo;1{sch}||schematic|1216797097518|1227290833891|I
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-NOff-Page|conn@17||-18.5|5|||X|
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-IilcZoo;1{ic}|ilcZoo@0||36|33|||D5G4;
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-Ngeneric:Invisible-Pin|pin@91||36|-12|||||ART_message(D3G2;)S["Make ilc[cnt] HI",to decrement.]
-Ngeneric:Invisible-Pin|pin@152||-61.5|34|||||ART_message(D3G3;)SIn bits[1:6], 0 = HI, 1 = LO.
-Ngeneric:Invisible-Pin|pin@159||31.5|65|||||ART_message(D3G2;)S[The Inner Loop Counter is a,"six bit counter on bit[1:6]","with fast allZero bit[7],",and a done bit.,Loading requires an external,"zero detector to load bit[7].",Loading always sets not done.,Done gets set when the,count runs out.,"It also knows infinity bit[8]","which prevents ilc[done]."]
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-NWire_Pin|pin@204||-20|-3.5||||
-Ngeneric:Invisible-Pin|pin@205||-40.5|1|||||ART_message(D3G2;)S["bitt[7] = ilc[zLO]","bitt[8] = ilc[i]","bitt[9] = ils[dLO]"]
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-IorangeTSMC090nm:wire90;1{ic}|wire90@2||-62.5|12|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D464.80000000000007|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@3||-62.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D398.80000000000007|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@4||-62.5|0|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D474.80000000000007|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-IorangeTSMC090nm:wire90;1{ic}|wire90@35||37.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D898.9000000000002|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-Awire|bit[3]|D5G2;||2700|countLog@0|bit[3]|6|3|ilcOddZo@0|bit[3]|6|13
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-Awire|bit[4]|D5G2;||2700|ilcEvenZ@0|bit[4]|0|-13|countLog@0|bit[4]|0|-3
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-X
-
-# Cell inMux;1{ic}
-CinMux;1{ic}||artwork|1217722162854|1227289699028|EI
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-NPin|pin@9||0|-4|1|1||
-Ngeneric:Invisible-Pin|pin@10||0|2.5|||||ART_message(D5G1.5;)S6
-Ngeneric:Invisible-Pin|pin@11||0|-2.5|||||ART_message(D5G1.5;)S7
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-X
-
-# Cell inMux;3{lay}
-CinMux;3{lay}||cmos90|1226756550608|1227363785048||ATTR_NCC(D5G4;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1227307911783|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227366204016
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@12||196|22||||
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-Ngeneric:Invisible-Pin|pin@2||-0.5|31|||||ART_message(D5G3;)Srevised ies 21 November 2008
-NBus_Pin|pin@3||-3|6|-1|-1||
-NBus_Pin|pin@4||-3|2|-1|-1||
-NBus_Pin|pin@5||-3|-6|-1|-1||
-NBus_Pin|pin@6||-3|-2|-1|-1||
-NBus_Pin|pin@7||6|8|-1|-1||
-NWire_Pin|pin@8||20|15.5||||
-NWire_Pin|pin@9||20|12.5||||
-NWire_Pin|pin@10||3.5|15.5||||
-NWire_Pin|pin@11||3.5|12.5||||
-Ngeneric:Invisible-Pin|pin@33||-14|26.5|||||ART_message(D3G2;)S["out[8] is for loading",ILC with infinity from,input B only.]
-Ngeneric:Invisible-Pin|pin@34||-13.5|-10|||||ART_message(D3G2;)S[inA is for D register,inB is for literal]
-Ngeneric:Invisible-Pin|pin@47||-51|27.5|||||ART_message(D3G2;)S["out[7]=HI if out[1:6]",all zero = HI.,"bit[7] is also the",done bit.]
-NWire_Pin|pin@53||-27|-3||||
-NBus_Pin|pin@56||-42|0|-1|-1||
-NBus_Pin|pin@57||-42|-3|-1|-1||
-NWire_Pin|pin@58||-26.5|0||||
-NWire_Pin|pin@59||-26.5|4.5||||
-NWire_Pin|pin@62||-26.5|12||||
-NWire_Pin|pin@63||-26.5|7||||
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-0.5|15.5|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D2740.3|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@1||15|15.5|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D2463.0|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-Abus|inA[1:6,x],xx|D5G2;|-0.5|IJ900|pin@3||-3|6|pin@4||-3|2
-Awire|inA[x]|D5G2;X0.5;Y0.5;||900|pin@62||-26.5|12|pin@63||-26.5|7
-Abus|inB[1:6,x,8]|D5G2;|-0.5|IJ2700|pin@5||-3|-6|pin@6||-3|-2
-Abus|inB[1:6]|D5G2;|-0.5|IJ900|pin@56||-42|0|pin@57||-42|-3
-Awire|inB[x]|D5G2;||2700|pin@58||-26.5|0|pin@59||-26.5|4.5
-Abus|net@2||-0.5|IJ1800|pin@4||-3|2|mux[1:8]|inA[1]|5|2
-Abus|net@5||-0.5|IJ1800|pin@6||-3|-2|mux[1:8]|inB[1]|5|-2
-Awire|net@8|||0|inv@0|in|-10.5|15.5|conn@3|y|-15|15.5
-Awire|net@10|||1800|inv@0|out|-5.5|15.5|wire90@0|a|-3|15.5
-Awire|net@11|||1800|wire90@0|b|2|15.5|pin@10||3.5|15.5
-Awire|net@12|||1800|inv@1|out|9.5|15.5|wire90@1|a|12.5|15.5
-Awire|net@13|||1800|wire90@1|b|17.5|15.5|pin@8||20|15.5
-Awire|net@15|||1800|pin@10||3.5|15.5|inv@1|in|4.5|15.5
-Awire|net@53|||2700|gnd@0||-27|-10|conn@4||-27|-7.5
-Abus|net@56||-0.5|IJ0|extZeroB@0|in[1:6]|-37.5|0|pin@56||-42|0
-Awire|net@58|||1800|extZeroB@0|out|-31.5|0|pin@58||-26.5|0
-Awire|net@61|||1800|extZeroB@1|out|-31.5|12|pin@62||-26.5|12
-Abus|net@63||-0.5|IJ0|extZeroB@1|in[1:6]|-37.5|12|conn@1|y|-47|12
-Abus|net@65||-0.5|IJ1800|mux[1:8]|out[1]|8|0|conn@2|a|18|0
-Awire|s[F]|D5G2;||900|pin@10||3.5|15.5|pin@11||3.5|12.5
-Abus|s[T,F]|D5G2;|-0.5|IJ2700|mux[1:8]|s[T,F]|6|3|pin@7||6|8
-Awire|s[T]|D5G2;||900|pin@8||20|15.5|pin@9||20|12.5
-Awire|xx|D5G2;||2700|conn@4||-27|-7.5|pin@53||-27|-3
-EinA[1:6]||D4G2;|conn@1|a|I
-EinB[1:6,8]||D4G2;|conn@0|a|I
-Eout[1:8]||D6G2;|conn@2|y|O
-Esel[A]||D4G2;|conn@3|a|I
-X
-
-# Cell inMux;2{sch}
-CinMux;2{sch}||schematic|1216238895693|1227290833891|I
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-5.5|-7.5||||
-NOff-Page|conn@1||-6.5|8||||
-NOff-Page|conn@2||27|-2||||
-NOff-Page|conn@3||-17|15.5||||
-NWire_Con|conn@4||-12.5|2||||
-NGround|gnd@0||-12.5|-3||||
-IinMux;1{ic}|inMux@0||32.5|14.5|||D5G4;
-IredFour:inv;1{ic}|inv@0||-8|15.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S20|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@1||7|15.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S20|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IgatesK:mux10;1{ic}|mux[1:6,8]|D5G3;X6;Y4;|6|0|||D5G4;
-IredFour:nand3;1{ic}|nand3@1||-24|-0.5|XYRRR||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)S6.667|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:nand3;1{ic}|nand3@2||-48|-0.5|XYRRR||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)S6.667|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:nor2n_sy;1{ic}|nor2n_sy@0||-36|11|R||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.25;Y2.25;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||-0.5|37|||||ART_message(D5G4;)Sprovides the inverted inputs to the loop counters
-Ngeneric:Invisible-Pin|pin@1||-0.5|42|||||ART_message(D5G6;)SinMux
-Ngeneric:Invisible-Pin|pin@2||-0.5|31|||||ART_message(D5G3;)S[copied from inMux and revised,ies 14 October 2008]
-NBus_Pin|pin@3||-3|6|-1|-1||
-NBus_Pin|pin@4||-3|2|-1|-1||
-NBus_Pin|pin@5||-3|-6|-1|-1||
-NBus_Pin|pin@6||-3|-2|-1|-1||
-NBus_Pin|pin@7||6|8|-1|-1||
-NWire_Pin|pin@8||20|15.5||||
-NWire_Pin|pin@9||20|12.5||||
-NWire_Pin|pin@10||3.5|15.5||||
-NWire_Pin|pin@11||3.5|12.5||||
-NWire_Pin|pin@12||-35|6||||
-NWire_Pin|pin@13||-37|6||||
-NWire_Pin|pin@14||-48|6||||
-NWire_Pin|pin@16||-24|6||||
-NWire_Pin|pin@18||-26|-12||||
-NWire_Pin|pin@20||-24|-9||||
-NWire_Pin|pin@22||-22|-6||||
-NBus_Pin|pin@29||12|0|-1|-1||
-NBus_Pin|pin@30||12|-6|-1|-1||
-Ngeneric:Invisible-Pin|pin@33||-13.5|26|||||ART_message(D3G2;)S["out[8] is for loading",ILC with infinity from,input B only.]
-Ngeneric:Invisible-Pin|pin@34||-13.5|-10|||||ART_message(D3G2;)S["inA is at top, for D register","inB is at bottom, for literal"]
-NWire_Pin|pin@41||-50|-12||||
-NWire_Pin|pin@42||-48|-9||||
-NWire_Pin|pin@43||-46|-6||||
-NWire_Pin|pin@44||-36|17.5||||
-Ngeneric:Invisible-Pin|pin@47||-51|27.5|||||ART_message(D3G2;)S["out[7]=HI if out[1:6]",all zero = HI.,"bit[7] is also the",done bit.]
-NWire_Pin|pin@53||-12.5|6||||
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-0.5|15.5|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D2740.3|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@1||15|15.5|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D2463.0|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@2||-41.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D406.30000000000007|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@3||-30.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D381.79999999999995|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-Abus|inA[1:6],xx|D5G2;|-0.5|IJ900|pin@3||-3|6|pin@4||-3|2
-Abus|inB[1:6,8]|D5G2;|-0.5|IJ2700|pin@5||-3|-6|pin@6||-3|-2
-Abus|net@2||-0.5|IJ1800|pin@4||-3|2|mux[1:6,8]|inA[1]|5|2
-Abus|net@5||-0.5|IJ1800|pin@6||-3|-2|mux[1:6,8]|inB[1]|5|-2
-Awire|net@8|||0|inv@0|in|-10.5|15.5|conn@3|y|-15|15.5
-Awire|net@10|||1800|inv@0|out|-5.5|15.5|wire90@0|a|-3|15.5
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-Awire|net@12|||1800|inv@1|out|9.5|15.5|wire90@1|a|12.5|15.5
-Awire|net@13|||1800|wire90@1|b|17.5|15.5|pin@8||20|15.5
-Awire|net@15|||1800|pin@10||3.5|15.5|inv@1|in|4.5|15.5
-Awire|net@18|||1800|pin@12||-35|6|wire90@3|a|-33|6
-Awire|net@20|||0|pin@13||-37|6|wire90@2|b|-39|6
-Awire|net@24|||1800|pin@14||-48|6|wire90@2|a|-44|6
-Awire|net@25|||1800|wire90@3|b|-28|6|pin@16||-24|6
-Awire|net@26|||900|pin@16||-24|6|nand3@1|out|-24|2
-Abus|net@45||-0.5|IJ1800|mux[1:6,8]|out[1]|8|0|pin@29||12|0
-Awire|net@46|||900|nor2n_sy@0|inb|-37|8.5|pin@13||-37|6
-Awire|net@47|||900|nor2n_sy@0|ina|-35|8.5|pin@12||-35|6
-Awire|net@53|||2700|gnd@0||-12.5|-1|conn@4||-12.5|1.5
-Awire|net@56|||900|pin@14||-48|6|nand3@2|out|-48|2
-Abus|out[1:6,8]|D5G2;|-0.5|IJ900|pin@29||12|0|pin@30||12|-6
-Awire|out[1]|D5G2;||900|nand3@1|ina|-22|-3|pin@22||-22|-6
-Awire|out[2]|D5G2;||900|nand3@1|inb|-24|-3|pin@20||-24|-9
-Awire|out[3]|D5G2;||900|nand3@2|ina|-46|-3|pin@43||-46|-6
-Awire|out[4]|D5G2;||900|nand3@2|inb|-48|-3|pin@42||-48|-9
-Awire|out[5]|D5G2;||900|nand3@1|inc|-26|-3|pin@18||-26|-12
-Awire|out[6]|D5G2;||900|nand3@2|inc|-50|-3|pin@41||-50|-12
-Awire|out[7]|D5G2;||2700|nor2n_sy@0|out|-36|13.5|pin@44||-36|17.5
-Awire|s[F]|D5G2;||900|pin@10||3.5|15.5|pin@11||3.5|12.5
-Abus|s[T,F]|D5G2;|-0.5|IJ2700|mux[1:6,8]|s[T,F]|6|3|pin@7||6|8
-Awire|s[T]|D5G2;||900|pin@8||20|15.5|pin@9||20|12.5
-Awire|xx|D5G2;||2700|conn@4||-12.5|1.5|pin@53||-12.5|6
-EinA[1:6]||D4G2;|conn@1|a|I
-EinB[1:7,9]|inB[1:6,8]|D4G2;|conn@0|a|I
-Eout[1:9]|out[1:8]|D6G2;|conn@2|y|O
-Esel[A]||D4G2;|conn@3|a|I
-X
-
-# Cell inMux2;1{sch}
-CinMux2;1{sch}||schematic|1224032246688|1227290833891|I
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@3||-30|-6||||
-NOff-Page|conn@4||-30|12||||
-NOff-Page|conn@5||-10|12||||
-NOff-Page|conn@6||-30|3||||
-NOff-Page|conn@7||8|-6||||
-NOff-Page|conn@8||8|12||||
-NOff-Page|conn@9||32|12||||
-NOff-Page|conn@11||-10|-6||||
-NOff-Page|conn@12||28|-6||||
-Ngeneric:Invisible-Pin|pin@0||0.5|39.5|||||ART_message(D5G6;)SinMux2
-Ngeneric:Invisible-Pin|pin@1||0.5|28.5|||||ART_message(D5G3;)Sies 15 November 2008
-NWire_Pin|pin@11||-18|18||||
-NWire_Pin|pin@12||-18|-12||||
-NWire_Pin|pin@15||18|-12||||
-NWire_Pin|pin@18||18|20||||
-NWire_Pin|pin@19||-18|6||||
-NWire_Pin|pin@21||18|6||||
-NWire_Pin|pin@23||-18|0||||
-NWire_Pin|pin@24||18|0||||
-Ngeneric:Invisible-Pin|pin@25||0|33.5|||||ART_message(D5G3;)Stwo half muxes with one output
-IredFour:triInv;1{ic}|triInv@2||-18|12|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@3||-18|-6|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@4||18|12|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@5||18|-6|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-Awire|net@14|||1800|conn@4|y|-28|12|triInv@2|in|-20.5|12
-Awire|net@15|||1800|conn@3|y|-28|-6|triInv@3|in|-20.5|-6
-Awire|net@20|||1800|conn@8|y|10|12|triInv@4|in|15.5|12
-Awire|net@21|||1800|conn@7|y|10|-6|triInv@5|in|15.5|-6
-Awire|net@26|||0|conn@5|a|-12|12|triInv@2|out|-15.5|12
-Awire|net@29|||1800|triInv@4|out|20.5|12|conn@9|a|30|12
-Awire|net@32|||1800|triInv@3|out|-15.5|-6|conn@11|a|-12|-6
-Awire|net@33|||1800|triInv@5|out|20.5|-6|conn@12|a|26|-6
-Awire|s[F]|D5G2;||2700|triInv@2|enB|-18|14|pin@11||-18|18
-Awire|s[F]|D5G2;||2700|triInv@4|enB|18|14|pin@18||18|20
-Awire|s[F]|D5G2;||2700|triInv@3|enB|-18|-4|pin@23||-18|0
-Awire|s[F]|D5G2;||2700|triInv@5|enB|18|-4|pin@24||18|0
-Awire|s[T]|D5G2;||900|triInv@3|en|-18|-8|pin@12||-18|-12
-Awire|s[T]|D5G2;||900|triInv@5|en|18|-8|pin@15||18|-12
-Awire|s[T]|D5G2;||2700|pin@19||-18|6|triInv@2|en|-18|10
-Awire|s[T]|D5G2;||2700|pin@21||18|6|triInv@4|en|18|10
-Ein[1]||D4G2;|conn@4|a|I
-Ein[2]||D4G2;|conn@3|a|I
-Ein[3]||D4G2;|conn@8|a|I
-Ein[4]||D4G2;|conn@7|a|I
-Eout[1]||D6G2;|conn@5|y|O
-Eout[2]||D6G2;|conn@11|y|O
-Eout[3]||D6G2;|conn@9|y|O
-Eout[4]||D6G2;|conn@12|y|O
-Es[T,F]||D4G2;|conn@6|a|I
-X
-
-# Cell inMux3;1{sch}
-CinMux3;1{sch}||schematic|1224032246688|1227290833891|I
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@3||-30|-6||||
-NOff-Page|conn@4||-30|12||||
-NOff-Page|conn@5||-10|12||||
-NOff-Page|conn@6||-30|3||||
-NOff-Page|conn@7||8|-6||||
-NOff-Page|conn@8||8|12||||
-NOff-Page|conn@9||32|12||||
-NOff-Page|conn@11||-10|-6||||
-NOff-Page|conn@12||28|-6||||
-Ngeneric:Invisible-Pin|pin@0||0.5|39.5|||||ART_message(D5G6;)SinMux3
-Ngeneric:Invisible-Pin|pin@1||0.5|28.5|||||ART_message(D5G3;)Sies 14 October 2008
-NWire_Pin|pin@11||-18|18||||
-NWire_Pin|pin@12||-18|-12||||
-NWire_Pin|pin@15||18|-12||||
-NWire_Pin|pin@18||18|20||||
-NWire_Pin|pin@19||-18|6||||
-NWire_Pin|pin@21||18|6||||
-NWire_Pin|pin@23||-18|0||||
-NWire_Pin|pin@24||18|0||||
-Ngeneric:Invisible-Pin|pin@25||0|33.5|||||ART_message(D5G3;)Sthree half muxes that turn on together
-IredFour:triInv;1{ic}|triInv@2||-18|12|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@3||-18|-6|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@4||18|12|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-IredFour:triInv;1{ic}|triInv@5||18|-6|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)S10
-Awire|net@14|||1800|conn@4|y|-28|12|triInv@2|in|-20.5|12
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-
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-X
-
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-
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-IolcOdd;2{ic}|olcOdd@1||39|37|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||-31|45|||||ART_message(D5G6;)SolcOdd
-Ngeneric:Invisible-Pin|pin@1||-31|36|||||ART_message(D5G3;)Sies 6 October 2008
-Ngeneric:Invisible-Pin|pin@2||-31|40|||||ART_message(D5G4;)Sodd bits of Outer Loop Counter
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-Ngeneric:Invisible-Pin|pin@124||-75|-3|||||ART_message(D3G2;)S["To feed flag[Z] properly,","inLO[7] must be HI","if inLO[1:6] is all HI = 0."]
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-
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-IorangeTSMC090nm:wire90;1{ic}|wire90@1||-7.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D173.2|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@2||7.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D381.09999999999997|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@3||-2.5|-12|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D981.3999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@5||16.5|-10|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D523.4000000000001|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@6||36|-6|X||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D535.0999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@7||22.5|18|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D555.1000000000001|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@8||35.5|6|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D677.1000000000001|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-Awire|count[F]|D5G2;||900|pin@44||31|22.5|nor2n@0|inb|31|15.5
-Awire|net@1|||0|inv@0|out|-15.5|-12|pin@3||-21|-12
-Awire|net@3|||1800|pin@4||-21|6|inv@1|in|-18|6
-Awire|net@9|||1800|mlat1in5@0|out|17|6|pin@7||21|6
-Awire|net@13|||1800|mlat2in1@0|inA|10|-14|pin@10||21|-14
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-Abus|net@36||-0.5|IJ900|mlat2in1@0|clA[T,F]|8|-16|conn@2|y|8|-18
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-Abus|xx[F,T]|D5G2;|-0.5|IJ2700|mlat1in5@0|c[T,F]|15|9|pin@43||15|11.5
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-Abus|xx[T,F]|D5G2;|-0.5|IJ2700|mlat2in1@0|clB[T,F]|8|-8|pin@19||8|-2
-Awire|xx[T]|D5G2;||2700|pin@39||42|6|pin@40||42|12
-Ebit[1]||D6G2;|conn@0|y|O
-Ehold[T,F]|count[T,F]|D4G2;|conn@5|a|I
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-X

diff --git a/electric/marinaL.jelib b/electric/marinaL.jelib
deleted file mode 100755 (executable)
index 265f768..0000000
--- a/electric/marinaL.jelib
+++ /dev/null
@@ -1,152 +0,0 @@
-# header information:
-HmarinaL|8.08n
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
-LdockK|dockK
-
-LfifoL|fifoL
-
-LstageGroupsL|stageGroupsL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell marina;1{lay}
-Cmarina;1{lay}||cmos90|1226007603576|1227290766732|I
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IdockK:dataPath;3{lay}|dataPath@1||648|0|||D5G4;
-IstageGroupsL:northFifo;1{lay}|northFif@0||2520|2736|||D5G4;
-IstageGroupsL:southFifo;1{lay}|southFif@0||2520|-2736|||D5G4;
-X
-
-# Cell marina;1{sch}
-Cmarina;1{sch}||schematic|1226940444999|1228773937741|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-49|-1||||
-NOff-Page|conn@1||70|-2||||
-NOff-Page|conn@2||-48|6||||
-NOff-Page|conn@3||-48|12|||Y|
-NOff-Page|conn@4||-48|9|||Y|
-NWire_Con|conn@5||-22|-23||||
-IdockK:dataPath;1{ic}|dataPath@0||0|0|||D5G4;
-IstageGroupsL:northFifo;1{ic}|northFif@0||60|0|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||-14.5|46.5|||||ART_message(D5G6;)Smarina
-Ngeneric:Invisible-Pin|pin@1||-15.5|36.5|||||ART_message(D5G3;)Sies 24 November 2008
-Ngeneric:Invisible-Pin|pin@2||-16.5|40.5|||||ART_message(D5G4;)Sthis is the experiment
-NBus_Pin|pin@7||66|-9|-1|-1||
-NBus_Pin|pin@8||66|-15|-1|-1||
-NBus_Pin|pin@9||-6|-15|-1|-1||
-NBus_Pin|pin@10||-6|-9|-1|-1||
-NWire_Pin|pin@11||-18|3||||
-NWire_Pin|pin@12||-18|-1||||
-NBus_Pin|pin@17||10|3|-1|-1||
-NBus_Pin|pin@18||10|0|-1|-1||
-NWire_Pin|pin@20||51|3||||
-NWire_Pin|pin@21||51|0||||
-NBus_Pin|pin@22||-11|3|-1|-1||
-NWire_Pin|pin@25||67|6||||
-NBus_Pin|pin@27||-11|1|-1|-1||
-NWire_Pin|pin@30||67|3||||
-NWire_Pin|pin@31||-23|-2||||
-NWire_Pin|pin@32||-23|-13||||
-NWire_Pin|pin@33||52|-13||||
-NWire_Pin|pin@34||52|-2||||
-NWire_Pin|pin@35||9|-2||||
-NWire_Pin|pin@36||9|-17||||
-NWire_Pin|pin@37||-43|-17||||
-NWire_Pin|pin@39||-43|-3||||
-Ngeneric:Invisible-Pin|pin@40||-55.5|-10.5|||||ART_message(D5G2;)S[fin is from input pad,to test bonding pads.,"When no counters count,",fin is reported to fout.]
-Ngeneric:Invisible-Pin|pin@41||79.5|-6.5|||||ART_message(D5G2;)S[fout goes to output pad,for measuring speeds.]
-Ngeneric:Invisible-Pin|pin@42||1.5|-23.5|||||ART_message(D5G2;)S["scan chain in the dock has [T,F]","inputs, differs from scan chain",in the north and south FIFO.,The sin and sout signals match.]
-NBus_Pin|pin@47||-22|-28|-1|-1||
-NBus_Pin|pin@48||-22|-18|-1|-1||
-NBus_Pin|pin@50||25|-15|-1|-1||
-NBus_Pin|pin@51||25|-20|-1|-1||
-NWire_Pin|pin@52||-9|-3||||
-NWire_Pin|pin@53||-9|-11||||
-Ngeneric:Invisible-Pin|pin@54||1.5|-33.5|||||ART_message(D5G2;)S[sigS comes from the ship.,Here we fake it by using,input address bit 14.]
-Ngeneric:Invisible-Pin|pin@57||28.5|29.5|||||ART_message(D5G2;)S["ddo[T] and doo[T], the token",state wires use the three stage,token FIFO.]
-NBus_Pin|pin@58||-27|-6|-1|-1||
-NBus_Pin|pin@59||-27|-12|-1|-1||
-NBus_Pin|pin@60||-14|-6|-1|-1||
-NBus_Pin|pin@61||-14|-2|-1|-1||
-NWire_Pin|pin@76||17|1||||
-NWire_Pin|pin@77||17|-4||||
-NWire_Pin|pin@78||32|1||||
-NWire_Pin|pin@79||32|-3||||
-NBus_Pin|pin@80||40|-9|-1|-1||
-NBus_Pin|pin@81||40|-12|-1|-1||
-IstageGroupsL:southFifo;1{ic}|southFif@0||-36|0|||D5G4;
-IfifoL:tokenFIFO;1{ic}|tokenFIF@0||24|1|||D5G4;
-Awire|ddo[D]|D5G2;||900|pin@20||51|3|pin@21||51|0
-Abus|ddo[T,D]|D5G2;|-0.5|IJ900|pin@17||10|3|pin@18||10|0
-Awire|ddo[T]|D5G2;||900|pin@76||17|1|pin@77||17|-4
-Awire|dinA[14]|D5G2;||900|pin@52||-9|-3|pin@53||-9|-11
-Abus|dinD[1:37,T],dinA[1:14]|D5G2;|-0.5|IJ900|pin@50||25|-15|pin@51||25|-20
-Awire|doo[D]|D5G2;||900|pin@25||67|6|pin@30||67|3
-Abus|doo[T,D]|D5G2;|-0.5|IJ900|pin@22||-11|3|pin@27||-11|1
-Awire|doo[T]|D5G2;||900|pin@78||32|1|pin@79||32|-3
-Abus|doutD[1:37,T],doutA[1:14]|D5G2;|-0.5|IJ900|pin@80||40|-9|pin@81||40|-12
-Abus|instrD[1:36],instrA[T]|D5G2;|-0.5|IJ2700|pin@60||-14|-6|pin@61||-14|-2
-Abus|instrD[1:37],instrA[T,1:14]|D5G2;|-0.5|IJ900|pin@58||-27|-6|pin@59||-27|-12
-Abus|net@6||-0.5|IJ1800|pin@60||-14|-6|dataPath@0|in[1:36,T]|-2|-6
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-Abus|net@10||-0.5|IJ900|pin@7||66|-9|pin@8||66|-15
-Abus|net@11||-0.5|IJ0|pin@50||25|-15|pin@9||-6|-15
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-Abus|net@13||-0.5|IJ1800|pin@10||-6|-9|dataPath@0|ain[1:14],od[15],in[1:37]|-2|-9
-Awire|net@14|||1800|southFif@0|succ[tap]|-33|3|pin@11||-18|3
-Awire|net@15|||900|pin@11||-18|3|pin@12||-18|-1
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-Abus|xx[2:9]|D5G2;|-0.5|IJ900|conn@5||-22|-23|pin@47||-22|-28
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-Efin||D4G2;|conn@0|a|I
-Efout||D6G2;|conn@1|y|O
-Esic[1:9]||D4G2;|conn@4|a|B
-Esid[1:9]||D4G2;|conn@3|a|B
-Esir[1:9]||D4G2;X-4;|conn@2|y|I
-X

diff --git a/electric/olcTransfer.jelib b/electric/olcTransfer.jelib
deleted file mode 100755 (executable)
index 9679440..0000000
--- a/electric/olcTransfer.jelib
+++ /dev/null
@@ -1,561 +0,0 @@
-# header information:
-HolcTransfer|8.08j
-
-# Views:
-Vicon|ic
-Vschematic|sch
-
-# External Libraries:
-
-LloopCountL|loopCountL
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-LredFour|redFour
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell olc;1{ic}
-Colc;1{ic}||artwork|1216798799522|1226517964726|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@4||0|-3.5|1|1||
-Nschematic:Bus_Pin|pin@0||-6|-2|-1|-1||
-Nschematic:Bus_Pin|pin@4||0|-5|-1|-1|R|
-Ngeneric:Invisible-Pin|pin@5||0|-4|1|1|R|
-NPin|pin@8||-5|-3|1|1||
-NPin|pin@9||-5|3|1|1||
-NPin|pin@10||5|3|1|1||
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-Ngeneric:Invisible-Pin|pin@12||0|0|||||ART_message(D5G3;)SOLC
-Nschematic:Bus_Pin|pin@27||-6|2|-1|-1||
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-Ngeneric:Invisible-Pin|pin@84||39|18.5|||||ART_message(D3G2;)S[Predicate delivers the,"slow decrement clock, sloDecClk[F].",It goes LO for each count.,It stays HI if zeroLO is LO.]
-Ngeneric:Invisible-Pin|pin@90||-59|48|||||ART_message(D3G2;)S["Bit[7] is the all zero bit,","a part of the skip circuit,","where it is called flag[Z].",The same count that drives,"bit[1:6] to zero = HI also","drives flag[Z] to FALSE = LO.","When loading inLO[1:6] with","all HI = 0, make inLO[7]",also be HI = all zero.]
-Ngeneric:Invisible-Pin|pin@91||-60|27|||||ART_message(D3G3;)SIn bit[1:6], 0 = HI, 1 = LO.
-Ngeneric:Invisible-Pin|pin@94||27|48|||||ART_message(D3G3;)S[the Outer Loop Counter,is a six bit counter,with collective allZero,"in the skip circuit, flag[Z]."]
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-Ngeneric:Invisible-Pin|pin@124||-75|-3|||||ART_message(D3G2;)S["To feed flag[Z] properly,","inLO[7] must be HI","if inLO[1:6] is all HI = 0."]
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-IorangeTSMC090nm:wire90;1{ic}|wire90@2||-37|-18|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D1373.3999999999996|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
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-X

diff --git a/electric/oldPins.jelib b/electric/oldPins.jelib
deleted file mode 100755 (executable)
index af45ea9..0000000
--- a/electric/oldPins.jelib
+++ /dev/null
@@ -1,97 +0,0 @@
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-X
-
-# Cell pins18m3;2{lay}
-Cpins18m3;2{lay}||cmos90|1216718275233|1225724218616||DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1224890777939
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-X

diff --git a/electric/orangeTSMC090nm.jelib b/electric/orangeTSMC090nm.jelib
deleted file mode 100755 (executable)
index 761f36f..0000000
--- a/electric/orangeTSMC090nm.jelib
+++ /dev/null
@@ -1,5476 +0,0 @@
-# header information:
-HorangeTSMC090nm|8.08j|USER_electrical_units()I70464
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-# Views:
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-Vschematic|sch
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-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
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-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
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-
-# Cell LEload;1{ic}
-CLEload;1{ic}||artwork|1083966364000|1204140525662|E|ATTR_L(D5G1;HOLPUDX0.5;)S100|ATTR_LEWIRE(D5G1;HPT)I1|ATTR_layer(D5G1;HNOLPY-1;)S1|ATTR_width(D5G1;HNOLPY-2;)S3|prototype_center()I[0,0]
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-AThicker|net@1|||FS0|pin@2||2|-1|pin@3||-2|-1|ART_color()I74
-AThicker|net@3|||FS900|pin@0||-2|1|pin@3||-2|-1|ART_color()I74
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-AThicker|net@5|||FS0|pin@6||-2|0|pin@7||-3|0|ART_color()I74
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-X
-
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-CLEload;1{sch}||schematic|1083965121000|1176245140811||ATTR_L(D5FLeave alone;G1;HNOLPUDX-20.5;Y-6.5;)S100|ATTR_LEWIRE(D5G1;HNPTX-20.5;Y-9.5;)I1|ATTR_layer(D5FLeave alone;G1;HNOLPX-20.5;Y-7.5;)S1|ATTR_width(D5FLeave alone;G1;HNOLPX-20.5;Y-8.5;)S3|prototype_center()I[0,0]
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-Ea||D4G2;|conn@0|a|B
-X
-
-# Cell LEload_sub;1{ic}
-CLEload_sub;1{ic}||artwork|1083964052000|1176245054736|E|prototype_center()I[0,0]
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-NThick-Circle|art@2||2|0|1.5|1.5|||ART_color()I74
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-NPin|pin@1||-4|0||||
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-X
-
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-CLEload_sub;1{sch}||schematic|1083961993000|1176245054736||prototype_center()I[0,0]
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-NOff-Page|conn@1||-7.5|3||||
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-Awire|a|D5G1.5;||1800|conn@1|y|-5.5|3|pin@12||8|3|ART_color()I0
-Ea||D4G2;|conn@1|a|U
-X
-
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-X
-
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-CNMOS4f;1{sch}||schematic|1021415734000|1159313256884||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S2|ATTR_SPICE_template_calibre(D5G1;HNPX-3;Y-26;)SM$(node_name) $(d) $(g) $(s) $(b) nch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S3|ATTR_CDL_template(D5G1;NTX-3.5;Y-24;)SM$(node_name) $(d) $(g) $(s) $(b) nch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template(D5G1;NTX2.5;Y-19.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-6;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOS4f;1{ic}|NMOS4f@0||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NOLPX3.25;Y-0.25;)S2|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-CNMOS4f_io25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.25;Y-0.25;)S5.6|ATTR_W(D6FLeave alone;G1;HNOLPX1.75;Y0.75;)S3|prototype_center()I[0,0]
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-CNMOS4f_io25;1{sch}||schematic|1021415734000|1159313192055||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S3|ATTR_CDL_template(D5G1;NTX-1;Y-26;)SM$(node_name) $(d) $(g) $(s) $(b) nch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-1.5;Y-23.5;)StransistorType  OD25-N-Transistor|ATTR_SPICE_template(D5G1;NTX2.5;Y-19.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_25 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-0.5;Y-28;)SM$(node_name) $(d) $(g) $(s) $(b) nch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_25 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-6;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOS4f_io25;1{ic}|NMOS4f_i@1||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.25;Y-0.25;)S5.6|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S3
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-Awire|net@3|||1800|pin@1||0|-12.5|conn@1|a|2.5|-12.5
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-
-# Cell NMOS4f_io33;1{ic}
-CNMOS4f_io33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.25;Y-0.25;)S7.6|ATTR_W(D6FLeave alone;G1;HNOLPX1.75;Y0.75;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell NMOS4f_io33;1{sch}
-CNMOS4f_io33;1{sch}||schematic|1021415734000|1159313151805||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S7.6|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S3|ATTR_CDL_template(D5G1;NTX-3.5;Y-26;)SM$(node_name) $(d) $(g) $(s) $(b) nch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-5;Y-24;)StransistorType  OD33-N-Transistor|ATTR_SPICE_template(D5G1;NTX-1.5;Y-19.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_33 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-3;Y-28;)SM$(node_name) $(d) $(g) $(s) $(b) nch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_33 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-6;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOS4f_io33;1{ic}|NMOS4f_i@3||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.25;Y-0.25;)S7.6|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@2||4.5|0||||
-NOff-Page|conn@3||-18.5|-6.5||||
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-Ngeneric:Invisible-Pin|pin@0||-2|13.5|||||ART_message(D5G2;)S4-terminal NMOS device for 3.3V I/O pads
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-Ngeneric:Invisible-Pin|pin@3||-1.5|19|||||ART_message(D5G6;)SNMOS4f_io33
-Ngeneric:Invisible-Pin|pin@4||-2|8.5|||||ART_message(D5G2;)Sminimum length for 3.3V thick-oxide devices is 7.6
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-X
-
-# Cell NMOS4f_low;1{ic}
-CNMOS4f_low;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.25;Y-0.25;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX1.75;Y0.75;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell NMOS4f_low;1{sch}
-CNMOS4f_low;1{sch}||schematic|1021415734000|1159313276571||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S3|ATTR_CDL_template(D5G1;NTX-4;Y-25.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-3.75;Y-23.5;)StransistorType VTL-N-Transistor|ATTR_SPICE_template(D5G1;NTX-3.5;Y-19.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_lvt W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-3.5;Y-27.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_lvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-6;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOS4f_low;1{ic}|NMOS4f@0||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.25;Y-0.25;)S2|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||4.5|-7.5||||
-NOff-Page|conn@1||4.5|-12.5||||
-NOff-Page|conn@2||4.5|0||||
-NOff-Page|conn@3||-18.5|-6.5||||
-N4-Port-Transistor|nmos4p@0||-2|-6.5|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-3;)Snch_lvt
-Ngeneric:Invisible-Pin|pin@0||-2|8.5|||||ART_message(D5G3;)S4-terminal low-threshold NMOS device
-NWire_Pin|pin@1||0|-12.5||||
-NWire_Pin|pin@2||0|0||||
-Ngeneric:Invisible-Pin|pin@3||-1.5|14|||||ART_message(D5G6;)SNMOS4f_low
-Awire|net@0|||0|nmos4p@0|g|-3|-6.5|conn@3|y|-16.5|-6.5
-Awire|net@1|||1800|nmos4p@0|b|0|-7.5|conn@0|a|2.5|-7.5
-Awire|net@2|||900|nmos4p@0|s|0|-8.5|pin@1||0|-12.5
-Awire|net@3|||1800|pin@1||0|-12.5|conn@1|a|2.5|-12.5
-Awire|net@4|||1800|pin@2||0|0|conn@2|a|2.5|0
-Awire|net@5|||900|pin@2||0|0|nmos4p@0|d|0|-4.5
-Eb||D5G2;|conn@0|y|B
-Ed||D5G2;|conn@2|y|B
-Eg||D5G2;|conn@3|a|I
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-X
-
-# Cell NMOS4f_native;1{ic}
-CNMOS4f_native;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.25;Y-0.25;)S4|ATTR_W(D6FLeave alone;G1;HNOLPX1.75;Y0.75;)S10|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NPin|pin@1||-0.25|-0.25||||
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-NPin|pin@3||0|-0.5|||RR|
-Ngeneric:Invisible-Pin|pin@4||0|-0.5||||
-Ngeneric:Invisible-Pin|pin@5||0|-2||||
-NPin|pin@6||-0.75|0|1|1|RR|
-NPin|pin@7||-2.5|0|||RR|
-Nschematic:Bus_Pin|pin@8||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@9||0|2|-2|-2||
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-NPin|pin@15||-0.75|1|1|1||
-NPin|pin@16||0|1||||
-NPin|pin@17||0|2||||
-AThicker|net@0|||FS2250|pin@0||-0.25|-0.75|pin@3||0|-0.5|ART_color()I74
-AThicker|net@1|||FS1350|pin@1||-0.25|-0.25|pin@3||0|-0.5|ART_color()I74
-AThicker|net@2|||FS1800|pin@2||-0.75|-0.5|pin@3||0|-0.5|ART_color()I74
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-AThicker|net@4|||FS1800|pin@7||-2.5|0|pin@6||-0.75|0|ART_color()I74
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-AThicker|net@8|||FS0|pin@16||0|1|pin@15||-0.75|1|ART_color()I74
-AThicker|net@9|||FS900|pin@17||0|2|pin@16||0|1|ART_color()I74
-Eb||D5G1;|pin@4||B
-Ed||D5G1;|pin@9||B
-Eg||D5G1;|pin@8||I
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-X
-
-# Cell NMOS4f_native;1{sch}
-CNMOS4f_native;1{sch}||schematic|1021415734000|1158099366852||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S4|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S10|ATTR_CDL_template(D5G1;NTX-6;Y-25.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-5;Y-23.5;)StransistorType  NT-N-Transistor|ATTR_SPICE_template(D5G1;NTX-3.5;Y-19.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_na W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-5.5;Y-27.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) nch_na W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-6;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOS4f_native;1{ic}|NMOS4f@0||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.25;Y-0.25;)S4|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S10
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||4.5|-7.5||||
-NOff-Page|conn@1||4.5|-12.5||||
-NOff-Page|conn@2||4.5|0||||
-NOff-Page|conn@3||-12.5|-6.5||||
-N4-Port-Transistor|nmos4p@0||-2|-6.5|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X2;Y-4;)Snch_na
-Ngeneric:Invisible-Pin|pin@0||-2|15.5|||||ART_message(D5G2;)S4-terminal native-threshold NMOS device
-NWire_Pin|pin@1||0|-12.5||||
-NWire_Pin|pin@2||0|0||||
-Ngeneric:Invisible-Pin|pin@3||-1.5|22|||||ART_message(D5G6;)SNMOS4f_native
-Ngeneric:Invisible-Pin|pin@4||-2.5|9|||||ART_message(D5G2;)S[note that the minimum allowed native,"device dimensions are W=10, L=4"]
-Awire|net@0|||0|nmos4p@0|g|-3|-6.5|conn@3|y|-10.5|-6.5
-Awire|net@1|||1800|nmos4p@0|b|0|-7.5|conn@0|a|2.5|-7.5
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-X
-
-# Cell NMOS4fwk;1{ic}
-CNMOS4fwk;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||0|2||||
-NPin|pin@1||0|0.75||||
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-Nschematic:Bus_Pin|pin@8||0|2|-2|-2||
-Nschematic:Bus_Pin|pin@9||-3|0|-2|-2||
-NPin|pin@10||-3|0|||RR|
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-Ngeneric:Invisible-Pin|pin@12||0|-2||||
-Ngeneric:Invisible-Pin|pin@13||-0.5|0|||||ART_message(D5G1;)S[wk]
-NPin|pin@14||0|-0.5||||
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-NPin|pin@16||-0.5|-0.75|1|1|YRR|
-NPin|pin@17||-0.75|-0.5|1|1|Y|
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-NPin|pin@19||-0.5|-0.25|1|1|RR|
-Nschematic:Bus_Pin|pin@20||0|-0.5||||
-AThicker|net@0|||FS900|pin@0||0|2|pin@1||0|0.75|ART_color()I74
-AThicker|net@1|||FS0|pin@1||0|0.75|pin@2||-0.75|0.75|ART_color()I74
-AThicker|net@2|||FS1800|pin@3||-0.75|-0.75|pin@4||0|-0.75|ART_color()I74
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-AThicker|net@4|||FS900|pin@6||-1.25|0.75|pin@5||-1.25|-0.75|ART_color()I74
-AThicker|net@5|||FS1800|pin@10||-3|0|pin@11||-1.25|0|ART_color()I74
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-AThicker|net@9|||FS450|pin@19||-0.5|-0.25|pin@18||-0.75|-0.5|ART_color()I74
-Eb||D5G1;|pin@20||B
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-X
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-# Cell NMOS4fwk;1{sch}
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-CNMOS4x_io25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-
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-# Cell NMOS4x_io33;1{ic}
-CNMOS4x_io33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-# Cell NMOS4x_io33;1{sch}
-CNMOS4x_io33;1{sch}||schematic|1021415734000|1158100921910||ATTR_Delay(D5G1;HNPX-8.5;Y-12.75;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-8.5;Y-11.25;)S1|prototype_center()I[0,0]
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-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
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-NOff-Page|conn@2||-18.5|-8||||
-NOff-Page|conn@3||8.5|-8.5||||
-Ngeneric:Invisible-Pin|pin@0||-13|-2|||||ART_message(D5G1;)S[Note: Gate Resistor removed for,NCC in miniheater chip]
-NWire_Pin|pin@1||0|-16.5||||
-NWire_Pin|pin@2||0|0||||
-Ngeneric:Invisible-Pin|pin@3||0|11.5|||||ART_message(D5G6;)SNMOS4x_io33
-Ngeneric:Invisible-Pin|pin@4||-8.5|-4.5|||||ART_message(D5G1;)S[model,gate,resistance]
-Ngeneric:Invisible-Pin|pin@5||-0.5|6|||||ART_message(D5G2;)S4-terminal strength-based NMOS device for 3.3V I/O pads
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-X
-
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-X
-
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-INMOSf;1{ic}|NMOSf@0||28|0.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-3;)Snch
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||1.5|14|||||ART_message(D5G6;)S[NMOSf]
-Ngeneric:Invisible-Pin|pin@3||1.5|7.5|||||ART_message(D5G2;)S3-terminal standard threshold NMOS device
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-Awire|net@3|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||900|pin@1||0|0|nmos4p@0|d|0|-6
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-X
-
-# Cell NMOSf_high;1{ic}
-CNMOSf_high;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I74
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I74
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-X
-
-# Cell NMOSf_high;1{sch}
-CNMOSf_high;1{sch}||schematic|1021415734000|1159313222266||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTX4;Y-31;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX4.5;Y-28.5;)StransistorType VTH-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX4.5;Y-33;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX2.5;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_high;1{ic}|NMOSf@0||28|0.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
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-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1;Y-3;)Snch_hvt
-NWire_Pin|pin@0||0|-16.5||||
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-Ngeneric:Invisible-Pin|pin@2||1.5|14|||||ART_message(D5G6;)SNMOSf_high
-Ngeneric:Invisible-Pin|pin@3||1.5|7.5|||||ART_message(D5G2;)S3-terminal high-threshold NMOS device
-Awire|net@0|||0|conn@1|a|4.5|0|pin@1||0|0
-Awire|net@1|||0|nmos4p@0|g|-3|-8|conn@2|y|-14.5|-8
-Awire|net@2|||900|nmos4p@0|s|0|-10|pin@0||0|-16.5
-Awire|net@3|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||900|pin@1||0|0|nmos4p@0|d|0|-6
-Awire|net@5|||1800|nmos4p@0|b|0|-9|gnd@0||5|-9
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
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-
-# Cell NMOSf_io18;1{ic}
-CNMOSf_io18;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.25;Y-0.25;)S4|ATTR_W(D6FLeave alone;G1;HNOLPX1.75;Y0.75;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@5||0|-2||||
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-NPin|pin@7||-3.5|0|||RR|
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-Nschematic:Bus_Pin|pin@9||0|2|-2|-2||
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-Ngeneric:Invisible-Pin|pin@18||-2.25|1.75|||||ART_message(D5G1;)S1.8V
-AThicker|net@3|||FS900|pin@15||-0.75|1|pin@14||-0.75|-1|ART_color()I74
-AThicker|net@4|||FS1800|pin@7||-3.5|0|pin@6||-2|0|ART_color()I74
-AThicker|net@5|||FS900|pin@11||-2|1|pin@12||-2|-1|ART_color()I74
-AThicker|net@6|||FS900|pin@13||0|-1|pin@10||0|-2|ART_color()I74
-AThicker|net@7|||FS1800|pin@14||-0.75|-1|pin@13||0|-1|ART_color()I74
-AThicker|net@8|||FS0|pin@16||0|1|pin@15||-0.75|1|ART_color()I74
-AThicker|net@9|||FS900|pin@17||0|2|pin@16||0|1|ART_color()I74
-Ed||D5G1;|pin@9||B
-Eg||D5G1;|pin@8||I
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-X
-
-# Cell NMOSf_io18;1{sch}
-CNMOSf_io18;1{sch}||schematic|1021415734000|1159313203077||ATTR_Delay(D5G1;HNPX-18.25;Y-12.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-18;Y-11.5;)S4|ATTR_W(D5FLeave alone;G1;HNOLPX-18;Y-10.5;)S3|ATTR_CDL_template(D5G1;NTY-26;)SM$(node_name) $(d) $(g) $(s) gnd nch_18 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-1.5;Y-23.75;)StransistorType OD18-N-Transistor|ATTR_SPICE_template(D5G1;NTX-3;Y-19.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_18 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX0.5;Y-28;)SM$(node_name) $(d) $(g) $(s) gnd nch_18 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-17.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_18 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-21.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_io18;1{ic}|NMOSf_io@1||18.5|1|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.25;Y-0.25;)S4|ATTR_W(D6FLeave alone;G1;NOLPX1.75;Y0.75;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-N4-Port-Transistor|nmos4p@0||-2|-6.5|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-4;)Snch_18
-Ngeneric:Invisible-Pin|pin@0||-2|13.5|||||ART_message(D5G2;)S3-terminal NMOS device for 1.8V I/O pads
-NWire_Pin|pin@1||0|-12.5||||
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-Ngeneric:Invisible-Pin|pin@3||-1.5|19|||||ART_message(D5G6;)SNMOSf_io18
-Ngeneric:Invisible-Pin|pin@4||-2|8.5|||||ART_message(D5G2;)Sminimum length for 1.8V thick-oxide devices is 4
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-Ed||D5G2;|conn@2|y|B
-Eg||D5G2;|conn@3|a|I
-Es||D5G2;|conn@1|y|B
-X
-
-# Cell NMOSf_io25;1{ic}
-CNMOSf_io25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HPT)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S5.6|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
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-NPin|pin@2||-3.5|0|||RR|
-Nschematic:Bus_Pin|pin@3||-3.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||0|2|-2|-2||
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-NPin|pin@7||-2|-1|1|1||
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-AThicker|net@0|||FS900|pin@10||-0.75|1|pin@9||-0.75|-1|ART_color()I74
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-AThicker|net@5|||FS0|pin@11||0|1|pin@10||-0.75|1|ART_color()I74
-AThicker|net@6|||FS900|pin@12||0|2|pin@11||0|1|ART_color()I74
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
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-
-# Cell NMOSf_io25;1{sch}
-CNMOSf_io25;1{sch}||schematic|1021415734000|1159313179436||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTX0.5;Y-31;)SM$(node_name) $(d) $(g) $(s) gnd nch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX0.5;Y-29;)StransistorType  OD25-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_25 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1;Y-33;)SM$(node_name) $(d) $(g) $(s) gnd nch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_25 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_io25;1{ic}|NMOSf_25@1||28|0.5|||D0G4;|ATTR_Delay(P)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S5.6|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1;Y-4;)Snch_25
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-NWire_Pin|pin@1||0|0||||
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-Ngeneric:Invisible-Pin|pin@4||0|13.5|||||ART_message(D5G2;)S3-terminal NMOS device for 2.5V I/O pads
-Ngeneric:Invisible-Pin|pin@5||0|8.5|||||ART_message(D5G2;)Sminimum length for 2.5V thick-oxide devices is 5.6
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-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell NMOSf_io33;1{ic}
-CNMOSf_io33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HPT)I100|ATTR_L(D5G1;HNOLPX3.5;)S7.6|ATTR_W(D6G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
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-Ngeneric:Invisible-Pin|pin@13||-2.5|1.5|||||ART_message(D5G1;)S3.3V
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-X
-
-# Cell NMOSf_io33;1{sch}
-CNMOSf_io33;1{sch}||schematic|1021415734000|1159313127323||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S7.6|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTX2;Y-31.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1.5;Y-29;)StransistorType  OD33-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_33 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX2.5;Y-33.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_33 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_io33;1{ic}|NMOSf_33@1||28|0.5|||D0G4;|ATTR_Delay(P)I100|ATTR_L(D5G1;NOLPX3.5;)S7.6|ATTR_W(D6G1;NOLPX2;Y1;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;NOLX-1.5;Y2;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;NOLX2.5;Y-6;)S"P(\"W\")"|SIM_spice_model(D5G1;X0.5;Y-3;)Snch_33
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||-0.5|20|||||ART_message(D5G6;)SNMOSf_33
-Ngeneric:Invisible-Pin|pin@4||-1|12.5|||||ART_message(D5G2;)S3-terminal NMOS device for 3.3V I/O pads
-Ngeneric:Invisible-Pin|pin@5||-1|7.5|||||ART_message(D5G2;)Sminimum length for 3.3V thick-oxide devices is 7.6
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-X
-
-# Cell NMOSf_low;1{ic}
-CNMOSf_low;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I74
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I74
-AThicker|net@5|||FS0|pin@11||0|1|pin@10||-0.75|1|ART_color()I74
-AThicker|net@6|||FS900|pin@12||0|2|pin@11||0|1|ART_color()I74
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
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-X
-
-# Cell NMOSf_low;1{sch}
-CNMOSf_low;1{sch}||schematic|1021415734000|1159313266395||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTX1.5;Y-30.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX2;Y-28.5;)StransistorType VTL-N-Transistor|ATTR_SPICE_template(D5G1;NTX2;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX2;Y-32.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_low;1{ic}|NMOSf@0||28|0.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-3;)Snch_lvt
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||1.5|14|||||ART_message(D5G6;)SNMOSf_low
-Ngeneric:Invisible-Pin|pin@3||1.5|7.5|||||ART_message(D5G2;)S3-terminal low threshold NMOS device
-Awire|net@0|||0|conn@1|a|4.5|0|pin@1||0|0
-Awire|net@1|||0|nmos4p@0|g|-3|-8|conn@2|y|-14.5|-8
-Awire|net@2|||900|nmos4p@0|s|0|-10|pin@0||0|-16.5
-Awire|net@3|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||900|pin@1||0|0|nmos4p@0|d|0|-6
-Awire|net@5|||1800|nmos4p@0|b|0|-9|gnd@0||5|-9
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell NMOSf_native;1{ic}
-CNMOSf_native;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S4|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S10|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
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-AThicker|net@1|||FS1800|pin@2||-2.5|0|pin@1||-0.75|0|ART_color()I74
-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I74
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I74
-AThicker|net@5|||FS0|pin@11||0|1|pin@10||-0.75|1|ART_color()I74
-AThicker|net@6|||FS900|pin@12||0|2|pin@11||0|1|ART_color()I74
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
-X
-
-# Cell NMOSf_native;1{sch}
-CNMOSf_native;1{sch}||schematic|1021415734000|1158099348261||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S4|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S10|ATTR_CDL_template(D5G1;NTX-1;Y-31;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-0.5;Y-28.5;)StransistorType  NT-N-Transistor|ATTR_SPICE_template(D5G1;NTY-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-1.5;Y-33.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSf_native;1{ic}|NMOSf@0||27|7.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S4|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S10
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||6.5|0||||
-NOff-Page|conn@2||-16.5|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X2;Y-4;)Snch_na
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||-3.5|20|||||ART_message(D5G6;)SNMOSf_native
-Ngeneric:Invisible-Pin|pin@3||-3.5|13|||||ART_message(D5G2;)S3-terminal native NMOS device
-Ngeneric:Invisible-Pin|pin@4||-3.5|8|||||ART_message(D5G2;)S[note that the minimum allowed native,"device dimensions are W=10, L=4"]
-Awire|net@0|||0|conn@1|a|4.5|0|pin@1||0|0
-Awire|net@1|||0|nmos4p@0|g|-3|-8|conn@2|y|-14.5|-8
-Awire|net@2|||900|nmos4p@0|s|0|-10|pin@0||0|-16.5
-Awire|net@3|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||900|pin@1||0|0|nmos4p@0|d|0|-6
-Awire|net@5|||1800|nmos4p@0|b|0|-9|gnd@0||5|-9
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell NMOSf_native_od18;1{ic}
-CNMOSf_native_od18;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S24|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S10|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
-NPin|pin@1||-1.75|0|1|1|RR|
-NPin|pin@2||-3|0|||RR|
-Nschematic:Bus_Pin|pin@3||-3|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||0|2|-2|-2||
-NPin|pin@5||0|-2||||
-NPin|pin@8||0|-1||||
-NPin|pin@9||-1.75|-1|1|1||
-NPin|pin@10||-1.75|1|1|1||
-NPin|pin@11||0|1||||
-NPin|pin@12||0|2||||
-Ngeneric:Invisible-Pin|pin@13||-2.25|1.75|||||ART_message(D5G1;)S1.8V
-AThicker|net@0|||FS2700|pin@9||-1.75|-1|pin@10||-1.75|1|ART_color()I74
-AThicker|net@1|||FS0|pin@1||-1.75|0|pin@2||-3|0|ART_color()I74
-AThicker|net@3|||FS2700|pin@5||0|-2|pin@8||0|-1|ART_color()I74
-AThicker|net@4|||FS0|pin@8||0|-1|pin@9||-1.75|-1|ART_color()I74
-AThicker|net@5|||FS1800|pin@10||-1.75|1|pin@11||0|1|ART_color()I74
-AThicker|net@6|||FS2700|pin@11||0|1|pin@12||0|2|ART_color()I74
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
-X
-
-# Cell NMOSf_native_od18;1{sch}
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-X
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-# Cell NMOSf_native_od25;1{ic}
-CNMOSf_native_od25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5G1;HNOLPX3.5;)S24|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S10|prototype_center()I[0,-8000]
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-X
-
-# Cell NMOSf_native_od25;1{sch}
-CNMOSf_native_od25;1{sch}||schematic|1021415734000|1158082583609||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5G1;HNOLPX-9;Y-13.5;)S24|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S10|ATTR_CDL_template(D5G1;NTX4;Y-31.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX2.5;Y-29;)StransistorType  NT-OD25-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na25 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX3.5;Y-34;)SM$(node_name) $(d) $(g) $(s) gnd nch_na25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_na25 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1.5;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
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-
-# Cell NMOSf_native_od33;1{ic}
-CNMOSf_native_od33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5G1;HNOLPX3.5;)S24|ATTR_W(D6G1;HNOLPX2;Y1;)S10|prototype_center()I[0,-8000]
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-
-# Cell NMOSf_native_od33;1{sch}
-CNMOSf_native_od33;1{sch}||schematic|1021415734000|1158082542097||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5G1;HNOLPX-9;Y-13.5;)S24|ATTR_W(D5G1;HNOLPX-8.5;Y-12.5;)S10|ATTR_CDL_template(D5G1;NTX3;Y-31;)SM$(node_name) $(d) $(g) $(s) gnd nch_na33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-28.5;)StransistorType  NT-OD33-N-Transistor|ATTR_SPICE_template(D5G1;NTX2;Y-24.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na33 W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX2.5;Y-33.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2.5;Y-22;)SM$(node_name) $(d) $(g) $(s) gnd nch_na33 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1.5;Y-26.5;)Stranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
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-
-# Cell NMOSfwk;1{ic}
-CNMOSfwk;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
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-
-# Cell NMOSfwk_high;1{ic}
-CNMOSfwk_high;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5G1;HNOLPX3.5;)S2|ATTR_W(D6G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
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-Es||D5G1;|pin@1||B
-X
-
-# Cell NMOSfwk_high;1{sch}
-CNMOSfwk_high;1{sch}||schematic|1021415734000|1159313313027||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5G1;HNOLPX-9;Y-13.5;)S2|ATTR_W(D5G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTY-31;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTY-28.75;)StransistorType VTH-N-Transistor|ATTR_SPICE_template(D5G1;NTX1.5;Y-24;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)'  DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX0.5;Y-33;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTY-21.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_hvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Srtranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSfwk_high;1{ic}|NMOSfwk@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NOLPX3.5;)S2|ATTR_W(D6G1;NOLPX2;Y1;)S3|ATTR_GEO(T)I0|ATTR_M(T)I1
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||4.5|0||||
-NOff-Page|conn@2||-10|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1;Y-3.5;)Snch_hvt
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-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||0|13.5|||||ART_message(D5G6;)SNMOSfwk_high
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-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
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-X
-
-# Cell NMOSfwk_low;1{ic}
-CNMOSfwk_low;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||-0.5|0|||||ART_message(D5G1;)S[wk]
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-NPin|pin@3||-2.5|0|||RR|
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-Ed||D5G1;|pin@5||B
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-X
-
-# Cell NMOSfwk_low;1{sch}
-CNMOSfwk_low;1{sch}||schematic|1021415734000|1159313378128||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S3|ATTR_CDL_template(D5G1;NTY-31.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-29;)StransistorType VTL-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)'  DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX0.5;Y-33.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTY-21.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_lvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Srtranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSfwk_low;1{ic}|NMOSfwk@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3|ATTR_GEO(T)I0|ATTR_M(T)I1
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||4.5|0||||
-NOff-Page|conn@2||-10|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X1;Y-3.5;)Snch_lvt
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||0|13.5|||||ART_message(D5G6;)SNMOSfwk_low
-Ngeneric:Invisible-Pin|pin@3||2|7|||||ART_message(D5G2;)S3-terminal low-threshold weak NMOS device
-Awire|net@0|||900|nmos4p@0|s|0|-10|pin@0||0|-16.5
-Awire|net@1|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
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-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
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-X
-
-# Cell NMOSfwk_native;1{ic}
-CNMOSfwk_native;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S4|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S10|prototype_center()I[0,-8000]
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-AThicker|net@4|||FS1800|pin@10||-0.75|-0.75|pin@9||0|-0.75|ART_color()I74
-AThicker|net@5|||FS0|pin@12||0|0.75|pin@11||-0.75|0.75|ART_color()I74
-AThicker|net@6|||FS900|pin@13||0|2|pin@12||0|0.75|ART_color()I74
-Ed||D5G1;|pin@5||B
-Eg||D5G1;|pin@4||I
-Es||D5G1;|pin@1||B
-X
-
-# Cell NMOSfwk_native;1{sch}
-CNMOSfwk_native;1{sch}||schematic|1021415734000|1158099882605||ATTR_Delay(D5G1;HNPX-8.5;Y-14.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-9;Y-13.5;)S4|ATTR_W(D5FLeave alone;G1;HNOLPX-8.5;Y-12.5;)S10|ATTR_CDL_template(D5G1;NTX1.5;Y-31.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-1;Y-29;)StransistorType  NT-N-Transistor|ATTR_SPICE_template(D5G1;NTX4;Y-24;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*(1+ABN/sqrt($(W)*$(L)))' L='$(L)'  DELVTO='AVT0N/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1;Y-34;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTY-21.5;)SM$(node_name) $(d) $(g) $(s) gnd nch_na W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-1;Y-26.5;)Srtranif1 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-INMOSfwk_native;1{ic}|NMOSfwk@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S4|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S10|ATTR_GEO(T)I0|ATTR_M(T)I1
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||4.5|0||||
-NOff-Page|conn@2||-10|-8||||
-NGround|gnd@0||5|-11||||
-N4-Port-Transistor|nmos4p@0||-2|-8|||R||ATTR_length(D5FLeave alone;G1;OLX-1;Y1;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX0.5;Y-1;)S"P(\"W\")"|SIM_spice_model(D5G1;X2;Y-3.5;)Snch_na
-NWire_Pin|pin@0||0|-16.5||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||0|19.5|||||ART_message(D5G6;)SNMOSfwk_native
-Ngeneric:Invisible-Pin|pin@3||2|13|||||ART_message(D5G2;)S3-terminal native weak NMOS device
-Ngeneric:Invisible-Pin|pin@4||2.5|7|||||ART_message(D5G2;)S[note that the minimum allowed native,"device dimensions are W=10, L=4"]
-Awire|net@0|||900|nmos4p@0|s|0|-10|pin@0||0|-16.5
-Awire|net@1|||1800|pin@0||0|-16.5|conn@0|a|4|-16.5
-Awire|net@2|||1800|pin@1||0|0|conn@1|a|2.5|0
-Awire|net@3|||1800|conn@2|y|-8|-8|nmos4p@0|g|-3|-8
-Awire|net@4|||900|pin@1||0|0|nmos4p@0|d|0|-6
-Awire|net@5|||1800|nmos4p@0|b|0|-9|gnd@0||5|-9
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell NMOSx;1{ic}
-CNMOSx;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
-NPin|pin@1||-1.5|0|1|1|RR|
-NPin|pin@2||-3|0|||RR|
-Nschematic:Bus_Pin|pin@3||-3|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||0|2|-2|-2||
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-NPin|pin@10||-0.75|1|1|1||
-NPin|pin@11||0|1||||
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-AThicker|net@0|||FS900|pin@10||-0.75|1|pin@9||-0.75|-1|ART_color()I10
-AThicker|net@1|||FS1800|pin@2||-3|0|pin@1||-1.5|0|ART_color()I10
-AThicker|net@2|||FS900|pin@6||-1.5|1|pin@7||-1.5|-1|ART_color()I10
-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I10
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I10
-AThicker|net@5|||FS0|pin@11||0|1|pin@10||-0.75|1|ART_color()I10
-AThicker|net@6|||FS900|pin@12||0|2|pin@11||0|1|ART_color()I10
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
-X
-
-# Cell NMOSx;1{sch}
-CNMOSx;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-8.5;Y-12.75;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-8.5;Y-11.25;)S1|prototype_center()I[0,0]
-INMOSx;1{ic}|NMOS@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S1
-INMOSf;1{ic}|NMOSf@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S@X == 0 ? 0 : (@X<1) ? (1.0 * (2-0.4) / @X + 0.4) : 2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S@X > 1 ? 3.0*@X : 3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||5.5|0||||
-NOff-Page|conn@2||-18.5|-8||||
-Ngeneric:Invisible-Pin|pin@0||-13|-2|||||ART_message(D5G1;)S[Note: Gate Resistor removed for,NCC in miniheater chip]
-NWire_Pin|pin@1||0|-16.5||||
-NWire_Pin|pin@2||0|0||||
-Ngeneric:Invisible-Pin|pin@3||0|11.5|||||ART_message(D5G6;)SNMOSx
-Ngeneric:Invisible-Pin|pin@4||-8.5|-4.5|||||ART_message(D5G1;)S[model,gate,resistance]
-Ngeneric:Invisible-Pin|pin@5||-0.5|6|||||ART_message(D5G2;)Sstandard-threshold strength-based NMOS device
-Awire|net@0|||0|NMOSf@0|g|-3|-8|conn@2|y|-16.5|-8
-Awire|net@1|||2700|pin@1||0|-16.5|NMOSf@0|s|0|-10
-Awire|net@2|||900|pin@2||0|0|NMOSf@0|d|0|-6
-Awire|net@3|||1800|pin@1||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||1800|pin@2||0|0|conn@1|a|3.5|0
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell NMOSx_high;1{ic}
-CNMOSx_high;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
-NPin|pin@1||-2|0|1|1|RR|
-NPin|pin@2||-3.5|0|||RR|
-Nschematic:Bus_Pin|pin@3||-3.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||0|2|-2|-2||
-NPin|pin@5||0|-2||||
-NPin|pin@6||-2|1|1|1||
-NPin|pin@7||-2|-1|1|1||
-NPin|pin@8||0|-1||||
-NPin|pin@9||-0.75|-1|1|1||
-NPin|pin@10||-0.75|1|1|1||
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-NPin|pin@12||0|2||||
-AThicker|net@0|||FS900|pin@10||-0.75|1|pin@9||-0.75|-1|ART_color()I10
-AThicker|net@1|||FS1800|pin@2||-3.5|0|pin@1||-2|0|ART_color()I10
-AThicker|net@2|||FS900|pin@6||-2|1|pin@7||-2|-1|ART_color()I10
-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I10
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I10
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-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
-X
-
-# Cell NMOSx_high;1{sch}
-CNMOSx_high;1{sch}||schematic|1021415734000|1158100931062||ATTR_Delay(D5G1;HNPX-8.5;Y-12.75;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-8.5;Y-11.25;)S1|prototype_center()I[0,0]
-INMOSx_high;1{ic}|NMOS@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S1
-INMOSf_high;1{ic}|NMOSf@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S@X == 0 ? 0 : (@X<1) ? (1.0 * (2-0.4) / @X + 0.4) : 2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S@X > 1 ? 3.0*@X : 3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
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-
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-CNMOSx_native_od18;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-CNMOSx_native_od25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-Ngeneric:Invisible-Pin|pin@5||0|6|||||ART_message(D5G2;)S3 terminal 2.5V native strength-based NMOS device
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-Awire|net@4|||1800|pin@2||0|0|conn@1|a|3.5|0
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-CNMOSx_native_od33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-# Cell NMOSx_native_od33;1{sch}
-CNMOSx_native_od33;1{sch}||schematic|1021415734000|1158100912091||ATTR_Delay(D5G1;HNPX-8.5;Y-12.75;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-8.5;Y-11.25;)S1|prototype_center()I[0,0]
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-CNMOSxwk_native;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3.5;Y0.5;)S1|prototype_center()I[0,-8000]
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-CPMOS4f_io18;1{sch}||schematic|1021415734000|1159313469323||ATTR_Delay(D5G1;HNPX-8.5;Y-1.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y0.25;)S4|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y2;)S3|ATTR_CDL_template(D5G1;NTX1;Y-15.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch_18 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-13;)StransistorType  OD18-P-Transistor|ATTR_SPICE_template(D5G1;NTX3.5;Y-9;)SM$(node_name) $(d) $(g) $(s) $(b) pch_18 W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1.5;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch_18 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX1;Y-7;)SM$(node_name) $(d) $(g) $(s) $(b) pch_18 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-11;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
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-
-# Cell PMOS4f_io25;1{ic}
-CPMOS4f_io25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX3;Y1;)S3|prototype_center()I[0,0]
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-CPMOS4f_io25;1{sch}||schematic|1021415734000|1159313450692||ATTR_Delay(D5G1;HNPX-8.5;Y-1.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y0.25;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y2;)S3|ATTR_CDL_template(D5G1;NTX0.5;Y-15.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-13;)StransistorType  OD25-P-Transistor|ATTR_SPICE_template(D5G1;NTX3.5;Y-9;)SM$(node_name) $(d) $(g) $(s) $(b) pch_25 W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1;Y-17.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX1;Y-7;)SM$(node_name) $(d) $(g) $(s) $(b) pch_25 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-11;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOS4f_io25;1{ic}|PMOS4f@0||23.25|11.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2.5;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S5.6|ATTR_W(D5FLeave alone;G1;NOLPX3;Y1;)S3
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-NOff-Page|conn@1||5|8||||
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-Ngeneric:Invisible-Pin|pin@4||-1|17.5|||||ART_message(D5G2;)Sminimum length for 2.5V thick-oxide devices is 5.6
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-CPMOS4f_low;1{sch}||schematic|1021415734000|1158015601561||ATTR_Delay(D5G1;HNPX-8.5;Y-1.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y0.25;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y2;)S3|ATTR_CDL_template(D5G1;NTX1;Y-15;)SM$(node_name) $(d) $(g) $(s) $(b) pch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-13;)StransistorType  VTL-P-Transistor|ATTR_SPICE_template(D5G1;NTX3.5;Y-9;)SM$(node_name) $(d) $(g) $(s) $(b) pch_lvt W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1.5;Y-17;)SM$(node_name) $(d) $(g) $(s) $(b) pch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX1;Y-7;)SM$(node_name) $(d) $(g) $(s) $(b) pch_lvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-11;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
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-CPMOS4fwk;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,0]
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-CPMOS4fwk;1{sch}||schematic|1021415734000|1159313551113||ATTR_Delay(D5G1;HNPX-8.5;Y-0.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y1.25;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y3;)S3|ATTR_CDL_template(D5G1;NTX-2;Y-12.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template(D5G1;NTX-2;Y-8;)SM$(node_name) $(d) $(g) $(s) $(b) pch W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-1.5;Y-14.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX-2;Y-5.5;)SM$(node_name) $(d) $(g) $(s) $(b) pch W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-2.5;Y-10;)Srtranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOS4fwk;1{ic}|PMOS4fwk@0||23.25|13.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
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-CPMOS4fwk_high;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[0,0]
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-CPMOSf_io25;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX3;Y1;)S3|prototype_center()I[0,0]
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-CPMOSf_io25;1{sch}||schematic|1021415734000|1159313441380||ATTR_Delay(D5G1;HNPX-8.5;Y-1.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y0.25;)S5.6|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y2;)S3|ATTR_CDL_template(D5G1;NTX2.5;Y-15.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-13;)StransistorType  OD25-P-Transistor|ATTR_SPICE_template(D5G1;NTX3.5;Y-9;)SM$(node_name) $(d) $(g) $(s) vdd pch_25 W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX3;Y-17.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_25 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX1;Y-7;)SM$(node_name) $(d) $(g) $(s) vdd pch_25 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-11;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
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-Ngeneric:Invisible-Pin|pin@4||-1|17.5|||||ART_message(D5G2;)Sminimum length for 2.5V thick-oxide devices is 5.6
-N4-Port-Transistor|pmos4p@0||-2|7|||YR|2|ATTR_length(D5FLeave alone;G1;OLX1.5;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX-0.5;Y-2;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-3.5;)Spch_25
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-# Cell PMOSf_io33;1{ic}
-CPMOSf_io33;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2.5;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S7.6|ATTR_W(D5FLeave alone;G1;HNOLPX3;Y1;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-2.5|0|1|1|||ART_color()I74
-Ngeneric:Invisible-Pin|pin@4||0|2||||
-Nschematic:Bus_Pin|pin@6||0|-2|-2|-2||
-Nschematic:Bus_Pin|pin@7||-3.5|0|-2|-2||
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-Ngeneric:Invisible-Pin|pin@18||-2.25|1.75|||||ART_message(D5G1;)S3.3V
-AThicker|net@3|||FS1800|pin@9||-0.75|1|pin@8||0|1|ART_color()I74
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-Ed||D5G1;|pin@6||B
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-# Cell PMOSf_io33;1{sch}
-CPMOSf_io33;1{sch}||schematic|1021415734000|1159313419552||ATTR_Delay(D5G1;HNPX-8.5;Y-1.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y0.25;)S7.6|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y2;)S3|ATTR_CDL_template(D5G1;NTX1;Y-15.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX1;Y-13;)StransistorType  OD33-P-Transistor|ATTR_SPICE_template(D5G1;NTX3.5;Y-9;)SM$(node_name) $(d) $(g) $(s) vdd pch_33 W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1.5;Y-17.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_33 W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX1;Y-7;)SM$(node_name) $(d) $(g) $(s) vdd pch_33 W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX1;Y-11;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOSf_io33;1{ic}|PMOS4f@0||23.25|11.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2.5;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S7.6|ATTR_W(D5FLeave alone;G1;NOLPX3;Y1;)S3
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-X
-
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-CPMOSf_low;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[-8000,16000]
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-
-# Cell PMOSf_low;1{sch}
-CPMOSf_low;1{sch}||schematic|1021415734000|1159313513376||ATTR_Delay(D5G1;HNPX-8.5;Y-0.25;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y1.25;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;Y3;)S3|ATTR_CDL_template(D5G1;NTX-2;Y-16.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-3;Y-14.5;)StransistorType  VTL-P-Transistor|ATTR_SPICE_template(D5G1;NTX2.5;Y-10.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_lvt W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)'  DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-1.5;Y-18.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_lvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX0.5;Y-8.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_lvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-3.5;Y-12.5;)Stranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOSf_low;1{ic}|PMOSf@0||26.75|20.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3
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-Ngeneric:Invisible-Pin|pin@3||-0.5|18.5|||||ART_message(D5G2;)S3-terminal low-threshold PMOS device
-N4-Port-Transistor|pmos4p@0||-2|7|||YR|2|ATTR_length(D5FLeave alone;G1;OLX1.5;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX-0.5;Y-2;)S"P(\"W\")"|SIM_spice_model(D5G1;X1.5;Y-3;)Spch_lvt
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-X
-
-# Cell PMOSfwk;1{ic}
-CPMOSfwk;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[-8000,16000]
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-
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-CPMOSfwk;1{sch}||schematic|1021415734000|1159313542858||ATTR_Delay(D5G1;HNPX-8.5;Y-4.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y-1.75;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;)S3|ATTR_CDL_template(D5G1;NTX-1.5;Y-17;)SM$(node_name) $(d) $(g) $(s) vdd pch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template(D5G1;NTX2;Y-12.5;)SM$(node_name) $(d) $(g) $(s) vdd pch W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX-1;Y-19;)SM$(node_name) $(d) $(g) $(s) vdd pch W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2;Y-10;)SM$(node_name) $(d) $(g) $(s) vdd pch W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-2.5;Y-14.5;)Srtranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOSfwk;1{ic}|PMOSfwk@0||28.25|11.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3|ATTR_GEO(T)I0|ATTR_M(T)I1
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-Ngeneric:Invisible-Pin|pin@3||-1.5|16.5|||||ART_message(D5G2;T)S3 terminal standard threshold weak PMOS device
-N4-Port-Transistor|pmos4p@0||-2|4|||YR|2|ATTR_length(D5FLeave alone;G1;OLX1.5;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX-0.5;Y-2;)S"P(\"W\")"|SIM_spice_model(D5G1;X2;Y-2.5;)Spch|SIM_weak_node(D5G1;)SWeak
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-Ed||D5G2;|conn@2|y|B
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-X
-
-# Cell PMOSfwk_high;1{ic}
-CPMOSfwk_high;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[-8000,16000]
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-AThicker|net@4|||FS900|pin@7||0|-0.75|pin@8||0|-2|ART_color()I74
-AThicker|net@5|||FS900|pin@5||-0.75|0.75|pin@6||-0.75|-0.75|ART_color()I74
-AThicker|net@6|||FS2700|pin@13||-1.5|-0.75|pin@12||-1.5|0.75|ART_color()I74
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-
-# Cell PMOSfwk_high;1{sch}
-CPMOSfwk_high;1{sch}||schematic|1021415734000|1159313524375||ATTR_Delay(D5G1;HNPX-8.5;Y-4.75;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX-8.5;Y-1.75;)S2|ATTR_W(D5FLeave alone;G1;HNOLPX-8.75;)S3|ATTR_CDL_template(D5G1;NTX0.5;Y-19;)SM$(node_name) $(d) $(g) $(s) vdd pch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_NCC(D5G1;NTX-1;Y-16.5;)StransistorType  VTH-P-Transistor|ATTR_SPICE_template(D5G1;NTX0.5;Y-12.5;)SM$(node_name) $(d) $(g) $(s) vdd pch_hvt W='$(W)*(1+ABP/sqrt($(W)*$(L)))' L='$(L)' DELVTO='AVT0P/sqrt($(W)*$(L))'|ATTR_SPICE_template_calibre(D5G1;NTX1;Y-21;)SM$(node_name) $(d) $(g) $(s) vdd pch_hvt W='$(W)*0.05u' L='$(L)*0.05u'|ATTR_SPICE_template_smartspice(D5G1;NTX2;Y-10;)SM$(node_name) $(d) $(g) $(s) vdd pch_hvt W='$(W)' L='$(L)'|ATTR_verilog_template(D5G1;NTX-2.5;Y-14.5;)Srtranif0 #($(Delay)) $(node_name) ($(d), $(s), $(g));|prototype_center()I[0,0]
-IPMOSfwk_high;1{ic}|PMOSfwk@0||28.25|11.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;NOLPX2;Y1;)S3|ATTR_GEO(T)I0|ATTR_M(T)I1
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-8|4||||
-NOff-Page|conn@2||5|-2||||
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-Ngeneric:Invisible-Pin|pin@3||-1.5|16.5|||||ART_message(D5G2;T)S3 terminal high-threshold weak PMOS device
-N4-Port-Transistor|pmos4p@0||-2|4|||YR|2|ATTR_length(D5FLeave alone;G1;OLX1.5;)S"P(\"L\")"|ATTR_width(D5FLeave alone;G1.5;OLX-0.5;Y-2;)S"P(\"W\")"|SIM_spice_model(D5G1;X1;Y-3;)Spch_hvt|SIM_weak_node(D5G1;)SWeak
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-Awire|net@1|||2700|pmos4p@0|s|0|6|pin@0||0|8.5
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-Awire|net@5|||1800|pmos4p@0|b|0|5|pwr@0||6|5
-Ed||D5G2;|conn@2|y|B
-Eg||D5G2;|conn@1|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell PMOSfwk_low;1{ic}
-CPMOSfwk_low;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_L(D5FLeave alone;G1;HNOLPX3.5;)S2|ATTR_W(D6FLeave alone;G1;HNOLPX2;Y1;)S3|prototype_center()I[-8000,16000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1.25|0|0.5|0.5|RR||ART_color()I74
-Ngeneric:Invisible-Pin|pin@0||-0.5|0|||||ART_message(D5G1;)S[wk]
-Ngeneric:Invisible-Pin|pin@1||0|2||||
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-Nschematic:Bus_Pin|pin@3||-2.5|0|-2|-2||
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-NPin|pin@8||0|-2||||
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-CPMOSxwk;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-8.5;Y-0.25;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-8.5;Y1.25;)S1|prototype_center()I[0,0]
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-IPMOSxwk_low;1{ic}|PMOSwk@0||22.25|13.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S1
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-CR110;1{ic}||artwork|1047945855000|1204140525662|E|ATTR_L(D5FLeave alone;G1;HNOLPX-2;Y-2.25;)S40|ATTR_W(D5FLeave alone;G1;HNOLPX2.25;Y-2.25;)S8.8|prototype_center()I[0,0]
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-CR110;1{sch}||schematic|1047945706000|1159314050023||ATTR_L(D5FLeave alone;G1;HNOLPX-22.5;Y-0.75;)S40|ATTR_W(D5FLeave alone;G1;HNOLPX-22.25;Y-1.75;)S8.8|ATTR_CDL_template(D5G1;NTX-2.5;Y-14;)SXR$(node_name) $(in) $(out) /rnpolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_NCC(D5G1;NTX-1.5;Y-18.5;)SresistorType  N-Poly-RPO-Resistor|ATTR_SPICE_template_assura(D5G1;NTX0.5;Y-23;)SXR$(node_name) $(in) $(out) rnpolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_SPICE_template_calibre(D5G1;NTX0.5;Y-21;)SXR$(node_name) $(in) $(out) rnpolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_SPICE_template_hspice(D5G1;NTX-1.5;Y-16.25;)SXR$(node_name) $(in) $(out) rnpolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_SPICE_template_smartspice(D5G1;NTY-12;)SXR$(node_name) $(in) $(out) rnpolywo l='$(L)' w='$(W)' scale=0.05u|prototype_center()I[0,0]
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-NCapacitor|cap@1||4.75|0|||||SCHEM_capacitance(D5FLeave alone;G1.5;OLUCX1.75;Y-1.25;)S(0.265*@W*@L + 8.882*@W + 4.43*@L + 74.42)*1e-18/2
-NOff-Page|conn@0||10|5||||
-NOff-Page|conn@1||-11.5|5||||
-IR110;1{ic}|gateResi@0||25.5|7.5|||D0G4;|ATTR_L(D5FLeave alone;G1;NOLPX-2;Y-2.25;)S40|ATTR_W(D5FLeave alone;G1;NOLPX2.25;Y-2.25;)S8.8
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-Awire|net@9|||0|pin@7||0|-4.5|pin@3||-5.5|-4.5
-Awire|net@10|||0|pin@5||4.75|-4.5|pin@7||0|-4.5
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-CR440;1{ic}||artwork|1047945855000|1204140525662|E|ATTR_L(D5FLeave alone;G1;HNOLPX-2;Y-2.25;)S40|ATTR_W(D5FLeave alone;G1;HNOLPX2.25;Y-2.25;)S8.8|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NPin|pin@16||0|-0.75|1|1|YRRR|
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-NPin|pin@19||-1|-1.5|1|1|YRR|
-NPin|pin@20||0.5|-2|1|1|YRR|
-NPin|pin@21||-0.5|-2|1|1|YRR|
-Ngeneric:Invisible-Pin|pin@22||0.5|1|||||ART_message(D5G1;)S440
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-
-# Cell R440;1{sch}
-CR440;1{sch}||schematic|1047945706000|1159314102885||ATTR_L(D5FLeave alone;G1;HNOLPX-22.5;Y-0.75;)S40|ATTR_W(D5FLeave alone;G1;HNOLPX-22.25;Y-1.75;)S8.8|ATTR_CDL_template(D5G1;NTX-2.5;Y-12.5;)SXR$(node_name) $(in) $(out) /rppolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_NCC(D5G1;NTX-1.5;Y-17;)SresistorType  P-Poly-RPO-Resistor|ATTR_SPICE_template_assura(D5G1;NTX-1.5;Y-21;)SXR$(node_name) $(in) $(out) rppolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_SPICE_template_calibre(D5G1;NTX-1.5;Y-19;)SXR$(node_name) $(in) $(out) rppolywo l='$(L)' w='$(W)' scale=0.05u|ATTR_SPICE_template_hspice(D5G1;NTX-1.5;Y-14.75;)SXR$(node_name) $(in) $(out) rppolywo l='$(L)' w='$(W)' scale=0.05u|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NCapacitor|cap@1||4.75|0|||||SCHEM_capacitance(D5FLeave alone;G1.5;OLUCX1.75;Y-1.25;)S(0.265*@W*@L + 8.882*@W + 4.43*@L + 74.42)*1e-18/2
-NOff-Page|conn@0||10|5||||
-NOff-Page|conn@1||-11.5|5||||
-IR440;1{ic}|gateResi@0||25.5|7.5|||D0G4;|ATTR_L(D5FLeave alone;G1;NOLPX-2;Y-2.25;)S40|ATTR_W(D5FLeave alone;G1;NOLPX2.25;Y-2.25;)S8.8
-NGround|gnd@0||0|-9||||
-Ngeneric:Invisible-Pin|pin@0||1|20.5|||||ART_message(D5G2;)Sp-type unsilicided polysilicon resistor for TSMC90nm process
-Ngeneric:Invisible-Pin|pin@1||2.5|26.5|||||ART_message(D5G5;)SR440 (rppolywo)
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-Ngeneric:Invisible-Pin|pin@6||1.5|15|||||ART_message(D5G2;)S["minumum recommended dimensions are l=2.0um, w=0.44um",target resistance is approx 440 ohm/sq]
-NWire_Pin|pin@7||0|-4.5||||
-NResistor|pres@0||0|5||||1|ATTR_length(D5FLeave alone;G1;NOLY-1;)S@L|ATTR_width(D5FLeave alone;G1;NOLY-2;)S@W|SCHEM_resistance(D5FLeave alone;G2;OLY1.5;)S(@L*440/@W)
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-Ein||D5G2;|conn@1|y|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell gallery;1{lay}
-Cgallery;1{lay}||cmos90|1158345347649|1158345387584|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ipnp5;1{lay}|pnp2@1||357|6|||D5G4;
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-X
-
-# Cell gallery;1{sch}
-Cgallery;1{sch}||schematic|1158082936168|1158346546100|
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-INMOS4f_high;1{ic}|NMOS4f_h@0||-37|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)I2|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
-INMOS4f_io18;1{ic}|NMOS4f_i@0||-45.5|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)S4|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
-INMOS4f_io25;1{ic}|NMOS4f_i@1||-54.5|50.5|||D5G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)S5.6|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
-INMOS4f_io33;1{ic}|NMOS4f_i@2||-63.5|50.5|||D5G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)S7.6|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
-INMOS4f_low;1{ic}|NMOS4f_l@0||-19|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)I2|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
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-INMOS4fwk;1{ic}|NMOS4fwk@0||11|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
-INMOS4fwk_low;1{ic}|NMOS4fwk@1||20|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
-INMOS4fwk_high;1{ic}|NMOS4fwk@2||2|50.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
-INMOS4fwk_native;1{ic}|NMOS4fwk@3||29|51|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S4|ATTR_W(D6G1;NPX2;Y1;)S10|ATTR_GEO()I0
-INMOS4x;1{ic}|NMOS4x@0||-28|74|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S1
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-INMOSf;1{ic}|NMOSf@0||-28|57.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3
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-INMOSf_io33;1{ic}|NMOSf_io@1||-63.5|57.5|||D5G4;|ATTR_Delay(P)I100|ATTR_L(D5G1;NPX3.5;)S7.6|ATTR_W(D6G1;NPX2;Y1;)I3
-INMOSf_io18;1{ic}|NMOSf_io@2||-45.5|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.25;Y-2.25;)I100|ATTR_L(D5G1;NPX3.25;Y-0.25;)S4|ATTR_W(D6G1;NPX1.75;Y0.75;)I3
-INMOSf_low;1{ic}|NMOSf_lo@0||-19|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3
-INMOSf_native;1{ic}|NMOSf_na@0||-10|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S4|ATTR_W(D6G1;NPX2;Y1;)S10
-INMOSf_native_od25;1{ic}|NMOSf_na@1||-84.5|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S24|ATTR_W(D6G1;NPX2;Y1;)S10
-INMOSf_native_od18;1{ic}|NMOSf_na@2||-75.5|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S24|ATTR_W(D6G1;NPX2;Y1;)S10
-INMOSf_native_od33;1{ic}|NMOSf_na@3||-94.5|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S24|ATTR_W(D6G1;NPX2;Y1;)S10
-INMOSfwk;1{ic}|NMOSfwk@0||11|57.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
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-INMOSfwk_high;1{ic}|NMOSfwk_@1||2|57.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
-INMOSfwk_native;1{ic}|NMOSfwk_@2||29|57.5|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)S4|ATTR_W(D6G1;NPX2;Y1;)S10|ATTR_GEO()I0
-INMOSx;1{ic}|NMOSx@0||-28|66|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
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-INMOSxwk;1{ic}|NMOSxwk@0||11|66|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-INMOSxwk_low;1{ic}|NMOSxwk_@0||20|66|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
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-IPMOS4fwk_high;1{ic}|PMOS4fwk@1||2|13|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3
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-IPMOSfwk;1{ic}|PMOSfwk@0||11|20|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
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-IPMOSfwk_low;1{ic}|PMOSfwk_@1||20|20|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3|ATTR_GEO()I0
-IPMOSx;1{ic}|PMOSx@0||-28|27.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
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-IPMOSxwk;1{ic}|PMOSxwk@0||11|27.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-IPMOSxwk_high;1{ic}|PMOSxwk_@0||2|27.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-IPMOSxwk_low;1{ic}|PMOSxwk_@1||20|27.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-IR110;1{ic}|R110@0||-95|17|||D5G1;T|ATTR_L(D5G1;NPX-2;Y-2.25;)I40|ATTR_W(D5G1;NPX2.25;Y-2.25;)D8.8
-IR440;1{ic}|R440@0||-95|10.5|||D5G1;T|ATTR_L(D5G1;NPX-2;Y-2.25;)I40|ATTR_W(D5G1;NPX2.25;Y-2.25;)D8.8
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IgateResistor;1{ic}|gateResi@0||-95.5|40.5|||D0G4;|ATTR_W(D5G1;NPY-1.5;)I3
-Indio;1{ic}|ndio@0||-79|36|||D5G4;
-Ngeneric:Invisible-Pin|pin@1||-38|86|||||ART_message(D5G2;R)Shigh-threshold
-Ngeneric:Invisible-Pin|pin@2||-19.5|86|||||ART_message(D5G2;R)Slow-threshold
-Ngeneric:Invisible-Pin|pin@3||-10.5|86|||||ART_message(D5G2;R)Snative
-Ngeneric:Invisible-Pin|pin@4||-28.5|86|||||ART_message(D5G2;R)Sstandard
-Ngeneric:Invisible-Pin|pin@5||-46|86|||||ART_message(D5G2;R)S1.8V thick-ox
-Ngeneric:Invisible-Pin|pin@6||-55|86|||||ART_message(D5G2;R)S2.5V thick-ox
-Ngeneric:Invisible-Pin|pin@7||-64|86|||||ART_message(D5G2;R)S3.3V thick-ox
-Ngeneric:Invisible-Pin|pin@8||-76|86|||||ART_message(D5G2;R)S1.8V native
-Ngeneric:Invisible-Pin|pin@9||-84.5|86|||||ART_message(D5G2;R)S2.5V native
-Ngeneric:Invisible-Pin|pin@10||-95|86|||||ART_message(D5G2;R)S3.3V native
-Ngeneric:Invisible-Pin|pin@11||1.5|86|||||ART_message(D5G2;R)Sweak high-threshold
-Ngeneric:Invisible-Pin|pin@12||10|86|||||ART_message(D5G2;R)Sweak standard
-Ngeneric:Invisible-Pin|pin@13||19.5|86|||||ART_message(D5G2;R)Sweak low-threshold
-Ngeneric:Invisible-Pin|pin@14||28.5|86|||||ART_message(D5G2;R)Sweak native
-Ipnp5;1{ic}|pnp2@0||-79.5|20|||D5G4;
-Ipnp10;1{ic}|pnp2@1||-79.5|13|||D5G4;
-Ipnp2;1{ic}|singlepn@2||-79.5|27|||D5G4;
-Iwire90;1{ic}|wire90@0||-110.5|37|||D5G4;|ATTR_L(D5G1;PUD)I100|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)S2|ATTR_width(D5G1;NPY-2;)S2.8
-Iwire90xcpl2;1{ic}|wire90xc@0||-110.5|30|||D5G4;|ATTR_L(D5G1;PUDY1;)I100|ATTR_layer(D5G1;NPY-0.5;)S2|ATTR_width(D5G1;NPY-1.5;)S2.8
-Iwire90xcpl3;1{ic}|wire90xc@1||-110.5|23|||D5G4;|ATTR_L(D5G1;PUDY1;)I100|ATTR_layer(D5G1;NPY-0.5;)S2|ATTR_width(D5G1;NPY-1.5;)S2.8
-IwireC;1{ic}|wireC@0||-95|26.5|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S100|ATTR_layer(D5G1;NPX3;Y-1.5;)I1|ATTR_width(D5G1;NPX3;Y-0.5;)I3
-IwireR;1{ic}|wireC@1||-95|34|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S100|ATTR_layer(D5G1;NPX3;Y-1.5;)I1|ATTR_width(D5G1;NPX3;Y-0.5;)I3
-Iwire_xcp_gnd;1{ic}|wire_xcp@0||-110.5|17|||D5G4;|ATTR_C(D5G1;NPURX2.5;Y-1;)S0.223f|ATTR_L(D5G1;PURY1;)I100|ATTR_LEWIRE(PUR)I1|ATTR_R(D5G1;NPURX-3;Y-1;)S24m|ATTR_layer(PUR)I2|ATTR_width(PUR)D2.8
-Iwire_xcpl_sides;1{ic}|wire_xcp@1||-110.5|12|||D5G4;|ATTR_C(D5G1;NPUCY-1;)S0.0000223p|ATTR_L(D5G1;PUDY1;)I100|ATTR_LEIGNORE(PUD)I1
-X
-
-# Cell gateResistor;1{ic}
-CgateResistor;1{ic}||artwork|1047945855000|1204140525662|E|ATTR_W(D5G1;HNOLPY-1.5;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||3|0|1|1||
-NPin|pin@1||2|0|1|1||
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-NPin|pin@10||-3|0|1|1||
-Nschematic:Bus_Pin|pin@11||3|0||||
-Nschematic:Bus_Pin|pin@12||-3|0||||
-AThicker|net@0|||FS0|pin@0||3|0|pin@1||2|0|ART_color()I74
-AThicker|net@1|||FS2966|pin@1||2|0|pin@2||1.5|1|ART_color()I74
-AThicker|net@2|||FS760|pin@2||1.5|1|pin@3||1|-1|ART_color()I74
-AThicker|net@3|||FS2840|pin@3||1|-1|pin@4||0.5|1|ART_color()I74
-AThicker|net@4|||FS760|pin@4||0.5|1|pin@5||0|-1|ART_color()I74
-AThicker|net@5|||FS2840|pin@5||0|-1|pin@6||-0.5|1|ART_color()I74
-AThicker|net@6|||FS760|pin@6||-0.5|1|pin@7||-1|-1|ART_color()I74
-AThicker|net@7|||FS2840|pin@7||-1|-1|pin@8||-1.5|1|ART_color()I74
-AThicker|net@8|||FS634|pin@8||-1.5|1|pin@9||-2|0|ART_color()I74
-AThicker|net@9|||FS0|pin@9||-2|0|pin@10||-3|0|ART_color()I74
-Ein||D5G2;|pin@12||I
-Eout||D5G2;|pin@11||O
-X
-
-# Cell gateResistor;1{sch}
-CgateResistor;1{sch}||schematic|1047945706000|1158010267102||ATTR_W(D5G1;HNOLPX-13;Y-1;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||10|3||||
-NOff-Page|conn@1||-11.5|3||||
-IgateResistor;1{ic}|gateResi@0||18|10.5|||D0G4;|ATTR_W(D5G1;NOLPY-1.5;)S3
-Ngeneric:Invisible-Pin|pin@0||0|15.5|||||ART_message(D5G2;)S[models gate resistor in TSMC 180nm technology,where gate resistance is not felt to be important]
-Ngeneric:Invisible-Pin|pin@1||1.5|20.5|||||ART_message(D5G5;)S[gateResistor]
-NResistor|res@0||-0.5|3|||||SCHEM_resistance(D5G1;OL)S0.0010
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-Awire|net@1|||0|conn@0|a|8|3|res@0|b|1.5|3
-Ein||D5G2;|conn@1|y|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell ndio;1{ic}
-Cndio;1{ic}||artwork|1158345992616|1158346111652|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NFilled-Triangle|art@2||0|1|3|2|Y||ART_color()I-4323839
-Ngeneric:Universal-Pin|pin@0||0|-1|-1|-1||
-Ngeneric:Universal-Pin|pin@2||0|3|-1|-1||
-Ngeneric:Invisible-Pin|pin@3||2|1|||||ART_message(D5G1;)Sndio
-NPin|pin@4||0|2|1|1||
-NPin|pin@5||0|3|1|1||
-NPin|pin@6||0|-1|1|1||
-NPin|pin@7||0|0|1|1||
-NPin|pin@8||-1.5|0|1|1||
-NPin|pin@9||1.5|0|1|1||
-AThicker|net@0|||FS2700|pin@4||0|2|pin@5||0|3|ART_color()I-4323839
-AThicker|net@1|||FS2700|pin@6||0|-1|pin@7||0|0|ART_color()I-4323839
-AThicker|net@2|||FS1800|pin@8||-1.5|0|pin@9||1.5|0|ART_color()I-4323839
-Eminus||D5G2;|pin@0||B
-Eplus||D5G2;|pin@2||B
-X
-
-# Cell ndio;1{sch}
-Cndio;1{sch}||schematic|1158345864878|1158346461571||ATTR_CDL_template(D5G1;NTX-7;Y-12.5;)SD$(node_name) $(plus) $(minus) ndio|ATTR_SPICE_template(D5G1;NTX-7;Y-10;)SD$(node_name) $(plus) $(minus) ndio|ATTR_SPICE_template_assura(D5G1;NTX-7;Y-14.5;)SD$(node_name) $(plus) $(minus) ndio|ATTR_SPICE_template_calibre(D5G1;NTX-7;Y-16.5;)SD$(node_name) $(plus) $(minus) ndio
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-7|11|||RRR|
-NOff-Page|conn@1||-7|-3|||YRRR|
-NDiode|diode@0||-7|4|||Y||SCHEM_diode(D5G1;)S10
-Indio;1{ic}|ndio@0||19|19|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||-7|23|||||ART_message(D5G5;)Sndio
-Ngeneric:Invisible-Pin|pin@1||-7|18|||||ART_message(D5G2;)Sn-type diode for TSMC90 process
-Awire|net@0|||900|conn@0|y|-7|9|diode@0|b|-7|6
-Awire|net@1|||2700|conn@1|y|-7|-1|diode@0|a|-7|2
-Eminus||D5G2;|conn@1|a|B
-Eplus||D5G2;|conn@0|a|B
-X
-
-# Cell pnp2;1{ic}
-Cpnp2;1{ic}||artwork|1075166155000|1158173269713|E|prototype_center()I[0,0]
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-NFilled-Triangle|art@1||1|1|1|2|1350||ART_color()I-4323839
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-NPin|pin@1||2|-2|1|1||
-NPin|pin@2||0|-2|1|1||
-NPin|pin@3||0|2|1|1||
-NPin|pin@4||0|0|1|1||
-NPin|pin@5||2|2|1|1||
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-Ngeneric:Invisible-Pin|pin@7||2|-2|||Y|
-Ngeneric:Invisible-Pin|pin@8||-2|0|||R|
-Ngeneric:Invisible-Pin|pin@9||3|0|||||ART_message(C74;D5G2;)S2X2
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-AThicker|net@1|||FS1350|pin@4||0|0|pin@1||2|-2|ART_color()I-4323839
-AThicker|net@2|||FS2700|pin@2||0|-2|pin@3||0|2|ART_color()I-4323839
-AThicker|net@3|||FS2250|pin@4||0|0|pin@5||2|2|ART_color()I-4323839
-Ebase||D5G2;|pin@8||B
-Ecol||D5G2;|pin@7||B
-Eemit||D5G2;|pin@6||B
-X
-
-# Cell pnp2;1{lay}
-Cpnp2;1{lay}||cmos90|1158278317514|1158342712850||DRC_last_good_drc_bit()I6|DRC_last_good_drc_date()G1158342736114
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-NMetal-1-P-Well-Con|contact@8||120|0|34.8|274.8||
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-Eemit_1|base|D5G5;|pin@1||B
-Eemit_2|col|D5G5;|pin@2||B
-Ecol_1||D5G5;|pin@3||B
-Eemit||D5G5;|pin@0||B
-X
-
-# Cell pnp2;1{sch}
-Cpnp2;1{sch}||schematic|1075166061000|1158173414105||ATTR_CDL_template(D5G1;NTX9.5;Y-8;)SQ$(node_name) $(col) $(base) $(emit) pnp2 area=4p|ATTR_NCC(D5G1;NTX9.5;Y-4;)SblackBox does not detect PNPs|ATTR_SPICE_template(D5G1;NTX9.5;Y-6;)SQ$(node_name) $(col) $(base) $(emit) pnp2|ATTR_SPICE_template_assura(D5G1;NTX9;Y-10;)SQ$(node_name) $(col) $(base) $(emit) pnp2 area=4p|ATTR_SPICE_template_calibre(D5G1;NTX10;Y-12;)SQ$(node_name) $(col) $(base) $(emit) pnp2 area=4p|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||10|13|||RRR|
-NOff-Page|conn@1||10|2|||R|
-NOff-Page|conn@2||2|8||||
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-Ngeneric:Invisible-Pin|pin@1||10|21.5|||||ART_message(D5G2;)S2x2 vertical bipolar transistor
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-Ecol||D6G2;X-6;|conn@1|y|B
-Eemit||D4G2;|conn@0|a|B
-X
-
-# Cell pnp5;1{ic}
-Cpnp5;1{ic}||artwork|1075166155000|1158173333366|E|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NFilled-Triangle|art@1||1|1|1|2|1350||ART_color()I-4323839
-NPin|pin@0||-2|0|1|1||
-NPin|pin@1||2|-2|1|1||
-NPin|pin@2||0|-2|1|1||
-NPin|pin@3||0|2|1|1||
-NPin|pin@4||0|0|1|1||
-NPin|pin@5||2|2|1|1||
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-Ngeneric:Invisible-Pin|pin@7||2|-2|||Y|
-Ngeneric:Invisible-Pin|pin@8||-2|0|||R|
-Ngeneric:Invisible-Pin|pin@9||3|0|||||ART_message(C74;D5G2;)S5X5
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-AThicker|net@1|||FS1350|pin@4||0|0|pin@1||2|-2|ART_color()I-4323839
-AThicker|net@2|||FS2700|pin@2||0|-2|pin@3||0|2|ART_color()I-4323839
-AThicker|net@3|||FS2250|pin@4||0|0|pin@5||2|2|ART_color()I-4323839
-Ebase||D5G2;|pin@8||B
-Ecol||D5G2;|pin@7||B
-Eemit||D5G2;|pin@6||B
-X
-
-# Cell pnp5;1{lay}
-Cpnp5;1{lay}||cmos90|1158278317514|1158344578345||DRC_last_good_drc_bit()I6|DRC_last_good_drc_date()G1158344046229
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NMetal-1-N-Well-Con|contact@3||0|85|14.8|184.8|R|
-NMetal-1-N-Well-Con|contact@4||-85|-8|14.8|164.8||
-NMetal-1-P-Well-Con|contact@8||150|0|34.8|334.8||
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-X
-
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-
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-Cpnp10;1{sch}||schematic|1075166061000|1158173555088||ATTR_CDL_template(D5G1;NTX9.5;Y-8;)SQ$(node_name) $(col) $(base) $(emit) pnp10 area=100p|ATTR_NCC(D5G1;NTX9.5;Y-4;)SblackBox does not detect PNPs|ATTR_SPICE_template(D5G1;NTX9.5;Y-6;)SQ$(node_name) $(col) $(base) $(emit) pnp10|ATTR_SPICE_template_assura(D5G1;NTX9.5;Y-10;)SQ$(node_name) $(col) $(base) $(emit) pnp10 area=100p|ATTR_SPICE_template_calibre(D5G1;NTX9.5;Y-12;)SQ$(node_name) $(col) $(base) $(emit) pnp10 area=100p|prototype_center()I[0,0]
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-
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-Cwire;1{ic}||artwork|1083964052000|1204140525662|E|ATTR_C(D5G1;HNOLPUCY-2.5;)S0.0000223p|ATTR_L(D5G1;HOLPUD)S100|ATTR_R(D5G1;HNOLPURY-1.5;)S0.024|prototype_center()I[0,0]
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-NThick-Circle|art@2||2|0|1.5|1.5|||ART_color()I74
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-X
-
-# Cell wire;1{sch}
-Cwire;1{sch}||schematic|1083961993000|1173982560561||ATTR_C(D5G1;HNOLPUCX-19;Y-9;)S0.0000223p|ATTR_L(D5G1;HNOLPUDX-19;Y-7;)S100|ATTR_R(D5G1;HNOLPURX-19;Y-8;)S0.024|prototype_center()I[0,0]
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-NCapacitor|cap@1||10|0|||||SCHEM_capacitance(D5G1;OLUC)S@C*@L/3
-NCapacitor|cap@2||0|0|||||SCHEM_capacitance(D5G1;OLUC)S@C*@L/3
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-NOff-Page|conn@1||-21|4||||
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-Ngeneric:Invisible-Pin|pin@5||-1|22|||||ART_message(D5G6;)S[wire]
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-Iwire;1{ic}|wire@0||15|24|||D0G4;|ATTR_C(D5G1;NOLPUCY-2.5;)S2.23E-16|ATTR_L(D5G1;OLPUD)S100|ATTR_R(D5G1;NOLPURY-1.5;)S0.24
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-X
-
-# Cell wire90;1{ic}
-Cwire90;1{ic}||artwork|1083966364000|1204140525662|E|ATTR_L(D5FLeave alone;G1;HOLPUD)S100|ATTR_LEWIRE(D5G1;HPT)I1|ATTR_layer(D5FLeave alone;G1;HNOLPY-1;)S2|ATTR_width(D5FLeave alone;G1;HNOLPY-2;)S2.8|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1.75|0|1.5|1.5|R||ART_color()I74|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||1.75|0|1.5|1.5|RRR||ART_color()I74|ART_degrees()F[0.0,3.1415927]
-NPin|pin@0||-1.75|0.75|1|1||
-NPin|pin@1||1.75|0.75|1|1||
-NPin|pin@2||1.75|-0.75|1|1||
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-AThicker|net@0|||FS0|pin@1||1.75|0.75|pin@0||-1.75|0.75|ART_color()I74
-AThicker|net@1|||FS0|pin@2||1.75|-0.75|pin@3||-1.75|-0.75|ART_color()I74
-Ea||D5G2;|pin@5||B
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-X
-
-# Cell wire90;1{sch}
-Cwire90;1{sch}||schematic|1083965121000|1173982468235||ATTR_L(D5G1;HNOLPUDX-20.5;Y-6.5;)S100|ATTR_LEWIRE(D5G1;HNPTX-20.5;Y-9.5;)I1|ATTR_layer(D5FLeave alone;G1;HNOLPX-20.5;Y-7.5;)S2|ATTR_width(D5FLeave alone;G1;HNOLPX-20.5;Y-8.5;)S2.8|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-23|-1||||
-NOff-Page|conn@1||-5.5|-1|||YRR|
-Ngeneric:Invisible-Pin|pin@0||-4|6|||||ART_message(BD5G2;)Swire90
-Ngeneric:Invisible-Pin|pin@1||7|-8|||||ART_message(D5G1;)SR = (@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width
-Ngeneric:Invisible-Pin|pin@2||7|-6|||||ART_message(D5G1;)SC = (@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15
-Ngeneric:Invisible-Pin|pin@3||-9|2|||||ART_message(D6G1;)S["wire in layer 'layer', 'L' lambda long,","'width' lambda wide, for the 90nm tech"]
-Ngeneric:Invisible-Pin|pin@4||-12|-14|||||ART_message(D5G1;)Scapacitance (fF/lambda)
-Ngeneric:Invisible-Pin|pin@5||3.5|-14|||||ART_message(D5G1;)Sresistance (ohm/square)
-Ngeneric:Invisible-Pin|pin@6||3.5|-17.5|||||ART_message(D5G1;)SM1 - 0.104
-Ngeneric:Invisible-Pin|pin@7||3.5|-19|||||ART_message(D5G1;)SM2 - M7 : 0.0661
-Ngeneric:Invisible-Pin|pin@8||3.5|-20.5|||||ART_message(D5G1;)SM8 - M9 : 0.0221
-Ngeneric:Invisible-Pin|pin@9||3.5|-16|||||ART_message(D5G1;)Spoly - 8.5
-Ngeneric:Invisible-Pin|pin@10||18|-14|||||ART_message(D5G1;)Swidth (um/lambda)
-Ngeneric:Invisible-Pin|pin@11||18|-17.5|||||ART_message(D5G1;)SM1 - 0.12/2.4L
-Ngeneric:Invisible-Pin|pin@12||18|-19|||||ART_message(D5G1;)SM2 - M7 : 0.14/2.8L
-Ngeneric:Invisible-Pin|pin@13||18|-20.5|||||ART_message(D5G1;)SM8 - M9 : 0.42/8.4L
-Ngeneric:Invisible-Pin|pin@14||18|-16|||||ART_message(D5G1;)Spoly - 0.10/2L
-Ngeneric:Invisible-Pin|pin@15||-12|-18|||||ART_message(D5G1;)SM1 - 0.011
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-Iwire90xcpl3;1{ic}|wire90xc@1||20.5|15.88|||D0G4;|ATTR_L(D5FLeave alone;G1;OLPUDY1;)S100|ATTR_layer(D5FLeave alone;G1;NOLPY-0.5;)S1|ATTR_width(D5FLeave alone;G1;NOLPY-1.5;)S3|ATTR_LEWIRE()I1
-Iwire_xcp_gnd;1{ic}|wire_xcp@2||-0.5|7|||D5G4;|ATTR_C(D5FLeave alone;G1;NOLPURX2.5;Y-1;)S(@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15|ATTR_L(D5FLeave alone;G1;OLPURY1;)S@L|ATTR_LEWIRE(PUR)I1|ATTR_R(D5G1;NOLPURX-3;Y-1;)S(@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width|ATTR_layer(OJPUR)S@layer|ATTR_width(OJPUR)S@width
-Iwire_xcp_gnd;1{ic}|wire_xcp@3||-0.5|0|||D5G4;|ATTR_C(D5FLeave alone;G1;NOLPURX2.5;Y-1;)S(@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15|ATTR_L(D5FLeave alone;G1;OLPURY1;)S@L|ATTR_LEWIRE(PUR)I1|ATTR_R(D5FLeave alone;G1;NOLPURX-3;Y-1;)S(@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width|ATTR_layer(OJPUR)S@layer|ATTR_width(OJPUR)S@width
-Iwire_xcp_gnd;1{ic}|wire_xcp@4||-0.5|-7|||D5G4;|ATTR_C(D5FLeave alone;G1;NOLPURX2.5;Y-1;)S(@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15|ATTR_L(D5FLeave alone;G1;OLPURY1;)S@L|ATTR_LEWIRE(PUR)I1|ATTR_R(D5FLeave alone;G1;NOLPURX-3;Y-1;)S(@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width|ATTR_layer(OJPUR)S@layer|ATTR_width(OJPUR)S@width
-Iwire_xcpl_sides;1{ic}|wire_xcp@7||-0.5|11|||D0G4;|ATTR_C(D5FLeave alone;G1;NOLPUCY-1;)S(@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15|ATTR_L(D5FLeave alone;G1;OLPUDY1;)S@L|ATTR_LEIGNORE(PUD)I1
-Iwire_xcpl_sides;1{ic}|wire_xcp@8||-0.5|-10.5|||D0G4;|ATTR_C(D5FLeave alone;G1;NOLPUCY-1;)S(@layer==0?0.00441:@layer<8?0.011:0.016)*1e-15|ATTR_L(D5FLeave alone;G1;OLPUDY1;)S@L|ATTR_LEIGNORE(PUD)I1
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-Ea||D4G2;|conn@0|a|B
-EaL||D4G2;|conn@2|a|B
-EaR||D4G2;|conn@3|a|B
-Eb||D4G2;|conn@1|a|B
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-EbR||D4G2;|conn@4|a|B
-X
-
-# Cell wireC;1{ic}
-CwireC;1{ic}||artwork|1014599103000|1204140525662|E|ATTR_L(D6FLeave alone;G1.5;HNOLPX1.5;Y0.5;)S100|ATTR_layer(D5FLeave alone;G1;HNOLPX3;Y-1.5;)S1|ATTR_width(D5FLeave alone;G1;HNOLPX3;Y-0.5;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||0|-3|1|1||
-NPin|pin@1||-1|-2|1|1|||ART_color()I78
-NPin|pin@2||1|-2|1|1|||ART_color()I78
-NPin|pin@3||0|-2|1|1||
-NPin|pin@4||0|-0.25|1|1|||ART_color()I78
-NPin|pin@5||0|2|1|1||
-NPin|pin@6||0|0.25|1|1|||ART_color()I78
-NPin|pin@7||-1|0.25|1|1|||ART_color()I78
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-NPin|pin@9||1|-0.25|1|1|||ART_color()I78
-NPin|pin@10||-1|-0.25|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@11||0|2|-2|-2||
-AThicker|net@0|||FS450|pin@2||1|-2|pin@0||0|-3|ART_color()I74
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-AThicker|net@2|||FS0|pin@2||1|-2|pin@1||-1|-2|ART_color()I74
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-AThicker|net@6|||FS0|pin@9||1|-0.25|pin@10||-1|-0.25|ART_color()I74
-Ea||D5G1;|pin@11||I
-X
-
-# Cell wireC;1{sch}
-CwireC;1{sch}||schematic|1014598612000|1158084188511||ATTR_L(D5FLeave alone;G1;HNOLPX-16;Y-4;)S100|ATTR_layer(D5FLeave alone;G1;HNOLPX-16;Y-5;)S1|ATTR_width(D5FLeave alone;G1;HNOLPX-16;Y-6;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@0||0|7|||RRR|
-NGround|gnd@0||0|-6||||
-Ngeneric:Invisible-Pin|pin@0||0|-9|||||ART_message(D5G1;)S[(@layer==0?0.015:@layer<6?0.025:0.030)*@L*1e-15]
-Ngeneric:Invisible-Pin|pin@1||-20|9|||||ART_message(D6G2;)S[the capacitance in fF of,a layer 'layer' wire,L lambda long and,'width' lambda wide]
-Ngeneric:Invisible-Pin|pin@2||-2|18|||||ART_message(D5G6;)SwireC90
-IwireC;1{ic}|wireC@0||9|9|||D0G4;|ATTR_L(D6FLeave alone;G1.5;NOLPX1.5;Y0.5;)S100|ATTR_layer(D5FLeave alone;G1;NOLPX3;Y-1.5;)S1|ATTR_width(D5FLeave alone;G1;NOLPX3;Y-0.5;)S3
-Awire|net@0|||2700|cap@0|a|0|2|conn@0|y|0|5
-Awire|net@1|||2700|gnd@0||0|-4|cap@0|b|0|-2
-Ea||D5G2;|conn@0|a|I
-X
-
-# Cell wireR;1{ic}
-CwireR;1{ic}||artwork|1012169520000|1204140525662|E|ATTR_L(D5FLeave alone;G1.5;HNOLPY1;)S100|ATTR_layer(D5G1;HNOLPY-2.5;)S1|ATTR_width(D5FLeave alone;G1;HNOLPY-1.5;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||-4|0|1|1||
-NPin|pin@1||4|0|1|1||
-NPin|pin@2||2.5|0|1|1||
-NPin|pin@3||2|-1|1|1||
-NPin|pin@4||1|1|1|1||
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-Nschematic:Bus_Pin|pin@9||-4|0|-2|-2||
-Nschematic:Bus_Pin|pin@10||4|0|-2|-2||
-AThicker|net@0|||FS1800|pin@0||-4|0|pin@8||-2.5|0|ART_color()I74
-AThicker|net@1|||FS0|pin@1||4|0|pin@2||2.5|0|ART_color()I74
-AThicker|net@2|||FS634|pin@2||2.5|0|pin@3||2|-1|ART_color()I74
-AThicker|net@3|||FS2966|pin@3||2|-1|pin@4||1|1|ART_color()I74
-AThicker|net@4|||FS634|pin@4||1|1|pin@5||0|-1|ART_color()I74
-AThicker|net@5|||FS2966|pin@5||0|-1|pin@6||-1|1|ART_color()I74
-AThicker|net@6|||FS634|pin@6||-1|1|pin@7||-2|-1|ART_color()I74
-AThicker|net@7|||FS2966|pin@7||-2|-1|pin@8||-2.5|0|ART_color()I74
-Ea||D5G1;|pin@9||U
-Eb||D5G1;|pin@10||U
-X
-
-# Cell wireR;1{sch}
-CwireR;1{sch}||schematic|1012169378000|1158084177716||ATTR_L(D5FLeave alone;G1;HNOLPX-5.5;Y-5;)S100|ATTR_layer(D5FLeave alone;G1;HNOLPX-5.5;Y-6;)S1|ATTR_width(D5FLeave alone;G1;HNOLPX-5.5;Y-7;)S3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|0||||
-NOff-Page|conn@1||14|0|||RR|
-Ngeneric:Invisible-Pin|pin@0||-16|12|||||ART_message(D6G2;)S[the resistance in ohms of,a layer 'layer' wire,L lambda long and,'width' lambda wide]
-Ngeneric:Invisible-Pin|pin@1||0|5|||||ART_message(D5G1;)S(@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width
-Ngeneric:Invisible-Pin|pin@2||-4|20.5|||||ART_message(D5G6;)SwireR90
-NResistor|res@0||0|0|||||SCHEM_resistance(D5G1;OLURY1.5;)S(@layer==0?8.5:@layer==1?0.104:@layer<8?0.0661:0.0221)/@width
-IwireR;1{ic}|wireR@0||11|10|||D0G4;|ATTR_L(D5FLeave alone;G1.5;NOLPY1;)S100|ATTR_layer(D5G1;NOLPY-2.5;)S1|ATTR_width(D5FLeave alone;G1;NOLPY-1.5;)S3
-Awire|net@0|||0|conn@1|y|12|0|res@0|b|2|0
-Awire|net@1|||0|res@0|a|-2|0|conn@0|y|-12|0
-Ea||D5G2;|conn@0|a|U
-Eb||D5G2;|conn@1|a|U
-X
-
-# Cell wire_xcp_gnd;1{ic}
-Cwire_xcp_gnd;1{ic}||artwork|1083964052000|1204140525662|E|ATTR_C(D5G1;HNOLPURX2.5;Y-1;)S0.223f|ATTR_L(D5G1;HOLPURY1;)S100|ATTR_LEWIRE(D5G1;HPTUR)I1|ATTR_R(D5G1;HNOLPURX-3;Y-1;)S24m|ATTR_layer(D5G1;HOLPTUR)S2|ATTR_width(D5G1;HOLPTUR)S2.8|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@3||-2|0|1.5|1.5|R||ART_color()I74|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@4||2|0|1.5|1.5|||ART_color()I74
-Nschematic:Bus_Pin|pin@8||4|0|-2|-2||
-Nschematic:Bus_Pin|pin@9||-4|0|-2|-2||
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-AThicker|net@8|||IJS0|pin@21||2|0.75|pin@20||-2|0.75|ART_color()I74
-AThicker|net@9|||IJS0|pin@22||2|-0.75|pin@23||-2|-0.75|ART_color()I74
-AThicker|net@10|||IJS1800|pin@24||2|0|pin@25||4|0|ART_color()I74
-AThicker|net@11|||IJS0|pin@26||-2.75|0|pin@27||-4|0|ART_color()I74
-AThicker|net@27|||IJS0|pin@56||0.25|-0.25|pin@57||-0.25|-0.25|ART_color()I74
-AThicker|net@28|||IJS2700|pin@56||0.25|-0.25|pin@58||0.25|0.25|ART_color()I74
-AThicker|net@29|||IJS0|pin@58||0.25|0.25|pin@59||-0.25|0.25|ART_color()I74
-AThicker|net@30|||IJS900|pin@59||-0.25|0.25|pin@57||-0.25|-0.25|ART_color()I74
-AThicker|net@31|||IJS0|pin@60||-1.25|-0.25|pin@61||-1.75|-0.25|ART_color()I74
-AThicker|net@32|||IJS2700|pin@60||-1.25|-0.25|pin@62||-1.25|0.25|ART_color()I74
-AThicker|net@33|||IJS0|pin@62||-1.25|0.25|pin@63||-1.75|0.25|ART_color()I74
-AThicker|net@34|||IJS900|pin@63||-1.75|0.25|pin@61||-1.75|-0.25|ART_color()I74
-AThicker|net@35|||IJS0|pin@64||1.75|-0.25|pin@65||1.25|-0.25|ART_color()I74
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-AThicker|net@38|||IJS900|pin@67||1.25|0.25|pin@65||1.25|-0.25|ART_color()I74
-Ea||D5G2;|pin@9||U
-Eb||D5G2;|pin@8||U
-EsL1||D5G2;|pin@46||U
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-EsL3||D5G2;|pin@50||U
-X
-
-# Cell wire_xcp_gnd;1{sch}
-Cwire_xcp_gnd;1{sch}||schematic|1083961993000|1173982789482||ATTR_C(D5FLeave alone;G1;HNOLPURX-20.5;Y-10.5;)S0.223f|ATTR_L(D5FLeave alone;G1;HNOLPURX-20.5;Y-7.5;)S100|ATTR_LEWIRE(D5G1;HNPTURX-20.5;Y-12;)I1|ATTR_R(D5FLeave alone;G1;HNOLPURX-20.5;Y-9;)S24m|ATTR_layer(D5FLeave alone;G1;HNOLPTURX-20.5;Y-13;)S2|ATTR_width(D5FLeave alone;G1;HNOLPTURX-20.5;Y-15;)S2.8|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NCapacitor|cap@9||-10|-5.5|||||SCHEM_capacitance(D5FLeave alone;G1;OLUC)S@C*@L/3*0.1
-NCapacitor|cap@10||10|-5.5|||||SCHEM_capacitance(D5FLeave alone;G1;OLUC)S@C*@L/3*0.1
-NCapacitor|cap@11||0|-5.5|||||SCHEM_capacitance(D5FLeave alone;G1;OLUC)S@C*@L/3*0.1
-NOff-Page|conn@0||24.5|0|||RR|
-NOff-Page|conn@1||-21|0||||
-NOff-Page|conn@6||-10|8|||RRR|
-NOff-Page|conn@7||0|8|||RRR|
-NOff-Page|conn@8||10|8|||RRR|
-NGround|gnd@1||15|-10|||R|
-Ngeneric:Invisible-Pin|pin@0||15|17.5|||||ART_message(D5G1;)S[R2 ]
-Ngeneric:Invisible-Pin|pin@1||-15|17.5|||||ART_message(D5G1;)S[R1 = @R*@L/6]
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-Ngeneric:Invisible-Pin|pin@4||0|25.5|||||ART_message(D5G2;)S[this is a wire 'L' lambda long,with resistance 'R' ohms/lambda,and capacitance 'C' F/lambda]
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-X
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-X
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-Cwire_xcpl_sides;1{sch}||schematic|1083961993000|1173982739755||ATTR_C(D5FLeave alone;G1;HNOLPUCX-20.5;Y-5.5;)S0.0000223p|ATTR_L(D5FLeave alone;G1;HNOLPUDX-20.5;Y-3.5;)S100|ATTR_LEIGNORE(D5G1;HNPTUDX-20.5;Y-1.5;)I1|prototype_center()I[0,0]
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-X

diff --git a/electric/programsK.jelib b/electric/programsK.jelib
deleted file mode 100755 (executable)
index ab51862..0000000
--- a/electric/programsK.jelib
+++ /dev/null
@@ -1,5843 +0,0 @@
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-HprogramsK|8.08j
-
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-Vschematic|sch
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-
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell aSkipGallery;1{sch}
-CaSkipGallery;1{sch}||schematic|1219711905963|1222350213149|
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-X
-
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-X
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-NBus_Pin|pin@203||12|27|-1|-1||
-NWire_Pin|pin@205||69|-1||||
-NWire_Pin|pin@212||69|-16||||
-Ngeneric:Invisible-Pin|pin@214||56.5|33|||||ART_message(D3G2;)S[data B test:,"first instruction goes nowhere,",second goes to LITERAL,third goes to RQ only,fourth goes to RQ and DM]
-Ngeneric:Invisible-Pin|pin@215||31.5|35|||||ART_message(D3G2;)S[bit 19 LO selects Dm,bit 20 LO selects Dl,bit 21 HI selects Rq,bit 22 LO loads flags,bit 23 LO loads OLC,bit 24 LO counts OLC,bit 25 LO loads ILC]
-NPower|pwr@4||-18|-50||||
-IscanK:scanCellKh;1{ic}|scanCell@0||-18|-42|Y||D5G4;
-IscanK:scanCellKh;1{ic}|scanCell@1||0|-42|Y||D5G4;
-IscanK:scanCellKh;1{ic}|scanCell@2||18|-42|Y||D5G4;
-IscanK:scanCellKh;1{ic}|scanCell@3||36|-42|Y||D5G4;
-ItfDriver;1{ic}|tfDriver@0||-47|6|||D5G4;
-ItfDriver;1{ic}|tfDriver@1||-47|-6|||D5G4;
-ItfDriver;1{ic}|tfDriver@2||-47|-18|||D5G4;
-ItfDriver;1{ic}|tfDriver@3||-47|-30|||D5G4;
-ItfDriver;1{ic}|tfDriver@4||54|0|X||D5G4;
-ItfDriver;1{ic}|tfDriver@5||54|-16|X||D5G4;
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-Abus|cl[F,T]|D5G2;|-0.5|IJ2700|conn@3||48|13|pin@127||48|20
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-
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-X
-
-# Cell srLoop;1{sch}
-CsrLoop;1{sch}||schematic|1220548805595|1220549667360|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Invisible-Pin|pin@5||-18.5|56|||||ART_message(D5G4;)Sselects the instruction for loopback
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-X
-
-# Cell srThru;1{ic}
-CsrThru;1{ic}||artwork|1220549014048|1220549523823|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||-3|0|-1|-1||
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-NPin|pin@21||1.5|0|1|1||
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-Aschematic:bus|net@12||-0.5|IJ1800|pin@13||3|0|pin@1||4|0
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-Esout||D5G2;|pin@2||O
-X
-
-# Cell srThru;1{sch}
-CsrThru;1{sch}||schematic|1220548805595|1220549604819|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NWire_Pin|pin@1||-12|0||||
-Ngeneric:Invisible-Pin|pin@3||-12.5|43|||||ART_message(D5G6;)SsrThru
-Ngeneric:Invisible-Pin|pin@4||-12.5|34|||||ART_message(D5G3;)Sies 4 September 2008
-Ngeneric:Invisible-Pin|pin@5||-12.5|38|||||ART_message(D5G4;)Sselects an instruction
-IscanK:scanCellKh;1{ic}|scanCell@0||-12|9|XYR||D5G4;
-IsrThru;1{ic}|srThru@0||5|21|||D5G4;
-ItfDriver;1{ic}|tfDriver@0||0|0|||D5G4;
-Abus|net@4||-0.5|IJ0|scanCell@0|p2p[T,F],p1p[T,F],rd[T,F]|-15|9|conn@0|y|-16|9
-Abus|net@5||-0.5|IJ0|conn@1|a|4|0|tfDriver@0|out[F]|2|0
-Awire|net@6|||900|pin@1||-12|0|conn@2|a|-12|-2
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-Awire|net@10|||1800|pin@1||-12|0|tfDriver@0|shift|-2|0
-Awire|net@12|||0|gnd@1||-4.5|9|scanCell@0|din[1]|-9|9
-Awire|net@28|||2700|scanCell@0|sin|-12|16|conn@3|y|-12|22
-Ecl[T,F],clS[T,F],rd[T,F]||D4G2;|conn@0|a|I
-Eout[T,F]||D6G2;|conn@1|y|O
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-Esout||D6G2;|conn@2|y|O
-X
-
-# Cell tfDriver;1{ic}
-CtfDriver;1{ic}||artwork|1214769478430|1214771137196|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||2|0|-1|-1||
-Nschematic:Bus_Pin|pin@4||-2|0|-1|-1||
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-NPin|pin@10||0|0|1|1||
-NPin|pin@11||1|-1|1|1||
-NPin|pin@12||0|-2|1|1||
-NPin|pin@13||-2|-2|1|1||
-NPin|pin@14||2|0|1|1||
-AThicker|net@3|||FS2700|pin@13||-2|-2|pin@7||-2|2
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-AThicker|net@8|||FS450|pin@11||1|-1|pin@12||0|-2
-AThicker|net@10|||FS0|pin@12||0|-2|pin@13||-2|-2
-AThicker|net@11|||FS1800|pin@10||0|0|pin@14||2|0
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-X
-
-# Cell tfDriver;1{sch}
-CtfDriver;1{sch}||schematic|1214769078933|1214771100664|
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-Ispiceparts:VCVS;1{ic}|VCVS@1||-10|-9|||D5G4;|ATTR_Gain(D5G0.5;NPY1;)I1|ATTR_Maximum(D5G0.5;NPY-1;)S10V|ATTR_Minimum(D5G0.5;NP)S-10V
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-29|0|||XRR|
-NOff-Page|conn@2||7|7|||Y|
-NGround|gnd@0||-20|-15||||
-NGround|gnd@1||0|-15||||
-Ngeneric:Invisible-Pin|pin@0||-1|31|||||ART_message(D5G6;)StfDriver
-Ngeneric:Invisible-Pin|pin@1||-1|22|||||ART_message(D5G3;)Sies 29 June 2008
-Ngeneric:Invisible-Pin|pin@2||-1|26|||||ART_message(D5G4;)Sinstant true false driver
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-ItfDriver;1{ic}|tfDriver@0||24.5|16.5|||D5G4;
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-X
-
-# Cell timerA;1{ic}
-CtimerA;1{ic}||artwork|1212505420437|1216026946153|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@2||-3|3|-1|-1||
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-Ngeneric:Invisible-Pin|pin@20||-8|1.5|||||ART_message(D5G1;)Smc
-Ngeneric:Invisible-Pin|pin@21||0|0|||||ART_message(D5G2;)StimerA @ 25 psec
-NPin|pin@27||8|2|1|1||
-NPin|pin@28||8|5|1|1||
-Nschematic:Bus_Pin|pin@29||3|3|-1|-1||
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-NPin|pin@32||3|3|1|1||
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-X
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-X
-
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-X
-
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-NOff-Page|conn@1||12|6|||YRRR|
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-Ngeneric:Invisible-Pin|pin@0||-1|16.5|||||ART_message(D5G3;)Sies 14 July 2008
-Ngeneric:Invisible-Pin|pin@1||-1|24.5|||||ART_message(D5G4;)S[this is the clock generator,at 20 psec per gate]
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-ItimerC;1{ic}|timerC@0||40|18|||D5G4;
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-Efire[1]||D6G2;|conn@1|y|O
-Efire[2]||D6G2;|conn@2|y|O
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-Emc||D6G2;|conn@0|y|O
-X

diff --git a/electric/purpleFour.jelib b/electric/purpleFour.jelib
deleted file mode 100755 (executable)
index 7dbde3d..0000000
--- a/electric/purpleFour.jelib
+++ /dev/null
@@ -1,4893 +0,0 @@
-# header information:
-HpurpleFour|8.08j|USER_electrical_units()I70464
-
-# Views:
-Vdocumentation|doc
-Vicon|ic
-Vschematic|sch
-
-# External Libraries:
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-LredFour|redFour
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell LEsettings;1{ic}
-CLEsettings;1{ic}||artwork|1023920563000|1204140525662|E|ATTR_LESETTINGS(D6G1;HNPX-4;Y-3.5;)I1|ATTR_alpha(D5G1;HNPX-1.5;Y-1.5;)D0.7|ATTR_epsilon(D6G1;HNPX-4;Y1.5;)S0.01|ATTR_gate_cap(D6G1;HNPX-4;Y-0.5;)F0.4|ATTR_keeper_ratio(D5G1;HNPY-2.5;)F0.1|ATTR_max_iter(D6G1;HNPX-4;Y0.5;)I40|ATTR_su(D6G1;HNPX-4;Y3.5;)S4.5|ATTR_wire_ratio(D6G1;HNPX-4;Y2.5;)S0.22|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||1.5|-0.5|9|9|||ART_color()I78|trace()V[-4.5/-3.5,-4.5/4.5,4.5/4.5,4.5/-4.5,-4.5/-4.5]
-Ngeneric:Invisible-Pin|pin@0||1.5|4.5|||||ART_message(D5G1;)S[LEsettings]
-X
-
-# Cell LEsettings;1{sch}
-CLEsettings;1{sch}||schematic|1023920036000|1213471981644||ATTR_LESETTINGS(D6G1;HNPX-21;Y23;)I1|ATTR_alpha(D5G1;HNPX-18.5;Y25;)D0.7|ATTR_epsilon(D6G1;HNPX-21;Y28;)S0.01|ATTR_gate_cap(D6G1;HNPX-21;Y26;)F0.4|ATTR_keeper_ratio(D5G1;HNPX-17;Y24;)F0.1|ATTR_max_iter(D6G1;HNPX-21;Y27;)I40|ATTR_su(D6G1;HNPX-21;Y30;)S4.5|ATTR_wire_ratio(D6G1;HNPX-21;Y29;)S0.22|ATTR_SPICE_template(D5G1;NTX-7;Y9;)S**LEsettings: None needed for LEsettings|prototype_center()I[12000,48000]
-ILEsettings;1{ic}|LEsettin@2||-4|2|||D5G4;|ATTR_LESETTINGS(D6G1;NPX-4;Y-3.5;)I1|ATTR_alpha(D5G1;NPX-1.5;Y-1.5;)F0.7|ATTR_epsilon(D6G1;NPX-4;Y1.5;)F0.0010|ATTR_gate_cap(D6G1;NPX-4;Y-0.5;)F0.19|ATTR_keeper_ratio(D5G1;NPY-2.5;)F0.1|ATTR_max_iter(D6G1;NPX-4;Y0.5;)I30|ATTR_su(D6G1;NPX-4;Y3.5;)S3.7|ATTR_wire_ratio(D6G1;NPX-4;Y2.5;)F0.16
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||-9.5|12|||||ART_message(D6G1;)S[this is the diffusion effort of PMOS gates (Cdiffp/Cgate)]
-Ngeneric:Invisible-Pin|pin@1||-9.5|13|||||ART_message(D6G1;)S[this is the diffusion effort of NMOS gates (Cdiffn/Cgate)]
-Ngeneric:Invisible-Pin|pin@2||-9.5|14|||||ART_message(D6G1;)S[gate cap. is used to convert cap loads to gate loads (fF/lambda)]
-Ngeneric:Invisible-Pin|pin@3||-9.5|15|||||ART_message(D6G1;)S[this sets the maximum number of iterations]
-Ngeneric:Invisible-Pin|pin@4||-9.5|16|||||ART_message(D6G1;)S[epsilon is the convergence criterion]
-Ngeneric:Invisible-Pin|pin@5||-9.5|17|||||ART_message(D6G1;)S[wire ratio is the default wire ratio: Cwire/Cgate]
-Ngeneric:Invisible-Pin|pin@6||-9.5|18|||||ART_message(D6G1;)S[su is the global step-up (fan-out)]
-Ngeneric:Invisible-Pin|pin@7||-24|21|||||ART_message(D6G2;)S[This Facet is used to set Logical Effort Settings]
-X
-
-# Cell aChangeRecord;1{doc}
-CaChangeRecord;1{doc}||mocmos|1021415734000|1021421067000||FACET_message()S[This is a change record for the purpleOne library.,"",9 March 02,Ivan added alternate icons for four types of NAND gates.,Ivan fixed output port location on one of the NAND gates.,Ivan set the scale of the pass gate be normalized to minimum transistor.,Ivan checked that all internal expressions are in Java.,Making a new icon copies the form of the icon in the schematic but,    DOES NOT MAKE ITS PARAMETER BE Java type.,Ivan updated the dates on the libraries to 9 March 2002,"",14 Apr 2002,"JKG: Minor fixes on text, etc","",14 May 2002,"JKG: Added nmos, nmos4, pmos, pmos4 primitives to allow Monte Carlo simulations","JKG: Added pmos0, invKV, made invK allow longer than minimum lengths","","",""]
-X
-
-# Cell branchfactor;1{ic}
-Cbranchfactor;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_BF(D5G1.5;HNPY3;)I1|ATTR_Delay(D5G1;HNPX2;Y-2.25;)I0|ATTR_LEGATE(D5G1;HNPX5.75;Y3.75;)I1|ATTR_LEPARALLGRP(D5G1;HNPX4.75;Y1.5;)I-1|ATTR_M(D5G1;HNPX2;Y-1.25;)I1|ATTR_S(D5G1;HOJPT)SLE.getdrive()|ATTR_su(D5G1;HNPX2;Y-5.25;)I1|prototype_center()I[6000,0]
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-NOpened-Thicker-Polygon|art@1||0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0,0.25/0,-0.25/0,-0.25/0.5,0.25/0.5]
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-Iinv_passgate;1{ic}|inv_pass@0||145|-32|||D5G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-0.5;Y3;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-IredFour:mullerC_sy;1{ic}|mullerC_@0||57|-28|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-ImullerC_sy;1{ic}|mullerC_@1||57|-18|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:mux21_tri;1{ic}|mux21_tr@0||129|-80|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-4.5;)I100|ATTR_X(D5G1.5;NPX4;Y2;)I1
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-Imux1;1{ic}|mux21_tr@2||162|-21|||D5G4;|ATTR_Delay(D5G1;PX3.5;Y-4.5;)I100|ATTR_M(D5G1;NPX3;Y-2.75;)I1|ATTR_S(D5G1.5;NPX2.5;Y1.75;)SLE.getdrive()|ATTR_su(D5G1;P)I-1|ATTR_LEGATE()I1|ATTR_LEPARALLGRP()I-1|ATTR_X(D5G1;OJX4;Y2;)SLE.getdrive()|ATTR_drive0()Sstrong0|ATTR_drive1()Sstrong1
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-Inand2;1{ic}|nand2@1||-104|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2HLT_sy;1{ic}|nand2HLT@0||24|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2HLT_sy;1{ic}|nand2HLT@1||24|-43|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2HT;1{ic}|nand2HT@0||-8|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE()I1|ATTR_LEPARALLGRP()I-1|ATTR_su()I-1
-Inand2HT;1{ic}|nand2HT@1||-8|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2HTen;1{ic}|nand2HTe@0||8|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2HTen;1{ic}|nand2HTe@1||8|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2LT;1{ic}|nand2LT@0||-56|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2LT;1{ic}|nand2LT@1||-56|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2LT_sy;1{ic}|nand2LT_@0||-40|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-IredFour:nand2LTen;1{ic}|nand2LTe@0||-24|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2LTen;1{ic}|nand2LTe@1||-24|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inand2PH;1{ic}|nand2PH@0||163|-32|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inand2PHfk;1{ic}|nand2PHf@0||163|-41|||D5G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inand2Schmitt;1{ic}|nand2PHf@1||163|-50|||D5G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;P)I1|ATTR_M(D5G1;NPX2.5;Y-2;)I1|ATTR_S(D5G1.5;NPX2;Y4;)SLE.getdrive()|ATTR_drive0(D5G1;P)Sstrong0|ATTR_drive1(D5G1;P)Sstrong1|ATTR_su(D5G1;P)I-1|ATTR_LEPARALLGRP()I-1|ATTR_X(D5G1.5;NOJX2.5;Y2.5;)SLE.getdrive()
-IredFour:nand2_sy;1{ic}|nand2_sy@0||-88|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-IredFour:nand2en;1{ic}|nand2en@0||-72|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Inand2n;1{ic}|nand2n@1||105.5|-43|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2.5;)I100|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S"LE.subdrive(\"nand2\", \"X\")"|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand2n_sy;1{ic}|nand2n_s@0||121|-54|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2.5;)I100|ATTR_X(D5G1.5;NPX2;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2n_sy;1{ic}|nand2n_s@1||121|-43|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2.5;)I100|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2;Y2.5;)S"LE.subdrive(\"nand2_sy\", \"X\")"|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Inand3LT;1{ic}|nand3LT@1||-4|-68|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand3LT_sy3;1{ic}|nand3LT_@0||54|-80|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand3LT_sy3;1{ic}|nand3LT_@1||54|-68|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inand3LT_sy6;1{ic}|nand3LT_@2||74|-68|||D5G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y3.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand3LT_sy6;1{ic}|nand3LT_@3||74|-80|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-IredFour:nand3LTen_sy;1{ic}|nand3LTe@1||34|-80|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand3LTen;1{ic}|nand3LTe@2||14|-68|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inand3LTen_sy;1{ic}|nand3LTe@3||34|-68|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Inand3MLT;1{ic}|nand3MLT@1||-24|-68|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Inand3en;1{ic}|nand3en@1||-64|-68|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Inand3en_sy;1{ic}|nand3en_@1||-44|-68|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nand3_sy6;1{ic}|nand3en_@2||-84|-80|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand3_sy6;1{ic}|nand3en_@3||-84|-68|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Inms1K;1{ic}|nms1K@0||0|55|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)SLE.getdrive()|ATTR_drive0(D5G1;NPX3;Y-5;)Sweak0|ATTR_su(P)I-1
-IredFour:nms2;1{ic}|nms2@0||29|42|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)S1|ATTR_LEGATE()I1|ATTR_LEPARALLGRP()I-1
-Inms2;1{ic}|nms2@1||29|54|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)SLE.getdrive()|ATTR_su(P)I-1
-Inms2K;1{ic}|nms2K@0||11|55|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2.5;)I100|ATTR_LEKEEPER(D5G1;NPX3.5;Y-4.5;)I1|ATTR_SN(D5G1.5;NPX3.5;Y-1.5;)I1|ATTR_su(D5G1;NPX3.5;Y-3.5;)S""
-IredFour:nms2_sy;1{ic}|nms2_sy@0||43|42|||D0G4;|ATTR_Delay(D5G1;NPX5.5;Y-0.5;)I100|ATTR_X(D5G1.5;NOJPX-3.75;Y2.5;)S1|ATTR_LEGATE()I1|ATTR_LEPARALLGRP()I-1|ATTR_su()I-1
-Inms2_sy;3{ic}|nms2_sy@1||43|54|||D0G4;|ATTR_Delay(D5G1;NPX5.5;Y-0.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-3.75;Y2.5;)SLE.getdrive()|ATTR_su(P)I-1
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-Inms3_sy3;1{ic}|nms3_sy3@1||81|54|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-2;Y0.5;)SLE.getdrive()|ATTR_su(P)S""
-IredFour:nor2;1{ic}|nor2@0||56|-54|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su()I-1
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-Inor2_sy;2{ic}|nor2_sy@1||72|-43|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Inor2en;1{ic}|nor2en@0||40|-43|||D5G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nor2en;1{ic}|nor2en@1||40|-54|||D5G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Inor2kresetV;1{ic}|nor2kres@0||163|-60.5|||D5G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEGATE(D5G1;NPX-92.75;Y-19.75;)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:nor2n;1{ic}|nor2n@0||88|-54|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Inor2n_sy;1{ic}|nor2n_sy@0||163.5|-72|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-3.5;)I100|ATTR_S(D5G1.5;NPX2;Y4;)I1|ATTR_drive0(D5G1;NPX3.5;Y-4.5;)Sstrong0|ATTR_drive1(D5G1;NPX3.5;Y-5.5;)Sstrong1|ATTR_su(D5G1;NPY-3;)I-1
-IredFour:nor2n_sy;1{ic}|nor2n_sy@1||165|-82|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.25;Y2.25;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:passF;1{ic}|passF@0||121|17|||D5G4;|ATTR_XN(D5G1;NPX-3.25;Y-0.5;)I1|ATTR_XP(D5G1;NPX3.25;Y-0.5;)I1|ATTR_Xinv(D5G1;NPY2.5;)I1
-IredFour:passT;1{ic}|passT@0||109|17|||D5G4;|ATTR_XN(D5G1;NPX-3.25;Y-0.5;)I1|ATTR_XP(D5G1;NPX3.25;Y-0.5;)I1|ATTR_Xinv(D5G1;NPY2.5;)I1
-IredFour:passTF;1{ic}|passTF@0||134|17|||D5G4;|ATTR_XN(D5G1;NPX-3.25;Y-0.5;)I1|ATTR_XP(D5G1;NPX3.25;Y-0.5;)I1
-Ngeneric:Invisible-Pin|pin@0||127|10.5|||||ART_message(D5G2;)S[no PURPLE gates for these]
-Ngeneric:Invisible-Pin|pin@1||41|33|||||ART_message(D5G2;)S[lambda-based for fixed size,technology-dependant]
-Ngeneric:Invisible-Pin|pin@2||153|-12|||||ART_message(D5G2;)Sno RED gates for these
-Ngeneric:Invisible-Pin|pin@3||39.5|-0.5|||||ART_message(D5G2;)S[lambda-based for fixed size,technology-dependant]
-Ngeneric:Invisible-Pin|pin@4||128.5|42|||||ART_message(D5G2;)S[strength-based fixed-size,technology-independant]
-Ngeneric:Invisible-Pin|pin@5||-39|20||||
-Ngeneric:Invisible-Pin|pin@7||103.5|56.5|||||ART_message(D5G2;)S[strength-based for LE,technology-independant]
-Ngeneric:Invisible-Pin|pin@8||74.5|22.5|||||ART_message(D5G2;)S[strength-based for LE,technology-independant]
-Ngeneric:Invisible-Pin|pin@9||74|8|||||ART_message(D5G2;)S[strength-based fixed-size,technology-independant]
-Ipms1;1{ic}|pms1@0||-48|21|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;)SLE.getdrive()|ATTR_su(P)I-1
-Ipms1K;1{ic}|pms1K@0||0|21|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;)SLE.getdrive()|ATTR_drive1(P)Sweak1|ATTR_su(P)I-1
-IredFour:pms2;1{ic}|pms2@0||26.5|11|||D0G4;|ATTR_Delay(D5G1;NPX-3;Y-1.5;)I100|ATTR_X(D5G1.5;NOLPX2.25;Y1;)S1
-Ipms2;1{ic}|pms2@1||27|23|||D0G4;|ATTR_Delay(D5G1;NPX-3;Y-1.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y1;)SLE.getdrive()|ATTR_su(P)I-1
-Ipms2K;1{ic}|pms2K@0||11|23|||D0G4;|ATTR_Delay(D5G1;NPX3.5;)I100|ATTR_LEKEEPER(D5G1;NPX3.5;Y-2;)I1|ATTR_SP(D5G1.5;NPX3.5;Y1;)I1|ATTR_su(D5G1;NPX3.5;Y-1;)S""|ATTR_M(D5G1;NX2;)I1
-IredFour:pms2_sy;1{ic}|pms2_sy@0||40|11.5|||D0G4;|ATTR_Delay(D5G1;NPX-5;Y-1.5;)I100|ATTR_X(D5G1.5;NOLPX4;Y2;)S1
-Ipms2_sy;1{ic}|pms2_sy@1||40|23|||D0G4;|ATTR_Delay(D5G1;NPX-5;Y-1.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX4;Y2;)SLE.getdrive()|ATTR_su(P)I-1
-Ipms3;1{ic}|pms3@0||55|25.5|||D5G4;|ATTR_Delay(D5G1;NPX-3.5;Y-1;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.75;Y3;)SLE.getdrive()|ATTR_su(P)I-1
-IredFour:pms3;1{ic}|pms3@1||55|11.5|||D5G4;|ATTR_Delay(D5G1;NPX-3;Y-1;)I100|ATTR_X(D5G1.5;NPX2.75;Y3;)I1
-IorangeTSMC090nm:R110;1{ic}|polyResi@1||133|50|||D5G1;T|ATTR_L(D5G1;NPX-2;Y-2.25;)I40|ATTR_W(D5G1;NPX2.25;Y-2.25;)D8.8
-IredFour:triInv;1{ic}|triInv@0||115|-80|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-1.5;)I100|ATTR_X(D5G1.5;NPX2.5;Y2;)I1
-ItriInv;1{ic}|triInv@1||115|-68|||D5G4;|ATTR_Delay(D5G1;NPX4;Y-1.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IorangeTSMC090nm:wire90xcpl2;1{ic}|wire90xc@0||161|35|||D5G4;|ATTR_L(D5G1;PUDY1;)I100|ATTR_layer(D5G1;NPY-0.5;)S2|ATTR_width(D5G1;NPY-1.5;)S2.8
-IorangeTSMC090nm:wire90xcpl3;1{ic}|wire90xc@1||161|27|||D5G4;|ATTR_L(D5G1;PUDY1;)I100|ATTR_layer(D5G1;NPY-0.5;)S2|ATTR_width(D5G1;NPY-1.5;)S2.8
-IorangeTSMC090nm:wire90;1{ic}|wire180@0||106|33|||D0G4;|ATTR_L(D5G1;PUD)I100|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-Iwire350;1{ic}|wire350@0||144|33|||D0G4;|ATTR_L(D5G1;P)I16666|ATTR_LEWIRE(D5G1;NPY-3.25;)I1|ATTR_layer(D5G1;NPY-1.25;)I1|ATTR_width(D5G1;NPY-2.25;)I3
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-IorangeTSMC090nm:wireC;1{ic}|wireC@0||129|31|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S100|ATTR_layer(D5G1;NPX3;Y-1.5;)I1|ATTR_width(D5G1;NPX3;Y-0.5;)I3
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-X
-
-# Cell inv;1{doc}
-Cinv;1{doc}||mocmos|1012171260000|1012171294000||FACET_message()S[This is the one parameter inverter.,Drawn by Ivan Sutherland 27 January 2002,""]
-X
-
-# Cell inv;1{ic}
-Cinv;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
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-NPin|pin@2||-1.5|0|1|1||
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-AThicker|net@1|||FS337|pin@0||1.5|0|pin@6||-1.5|-2|ART_color()I78
-AThicker|net@2|||FS0|pin@2||-1.5|0|pin@3||-2.5|0|ART_color()I78
-AThicker|net@3|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
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-X
-
-# Cell inv;2{sch}
-Cinv;2{sch}||schematic|1021415734000|1159375611590||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6.5;)I-1|ATTR_X(D5G1;HNOJPX-12.5;Y-4.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-7.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-8.5;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-9.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-14|0||||
-IredFour:inv;1{ic}|inv@0||0.5|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv;1{ic}|inv@1||20|13.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)S""
-Ngeneric:Invisible-Pin|pin@0||-2|14.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
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-X
-
-# Cell inv2i;1{ic}
-Cinv2i;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-1|1|1|1|||ART_color()I78
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-AThicker|net@2|||FS337|pin@2||1.5|0|pin@6||-1.5|-2|ART_color()I78
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-AThicker|net@4|||FS0|pin@3||-1.5|1|pin@4||-2.5|1|ART_color()I78
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-Ein[p]||D5G1;|pin@8||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell inv2i;1{sch}
-Cinv2i;1{sch}||schematic|1021415734000|1159375631875||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||12|0||||
-NOff-Page|conn@1||-10.5|1|||Y|
-NOff-Page|conn@2||-10.5|-1|||Y|
-IredFour:inv2i;1{ic}|inv2i@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2i;1{ic}|inv2i@1||13.5|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||14.5|-12.5|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
-Ngeneric:Invisible-Pin|pin@1||-4|18|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@2||-4|25|||||ART_message(D5G6;)S[inv2i]
-Ngeneric:Invisible-Pin|pin@3||-4|20|||||ART_message(D5G2;)S[two-input inverter]
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-Awire|net@1|||0|inv2i@0|in[p]|-2.5|1|conn@1|y|-8.5|1
-Awire|net@2|||0|conn@0|a|10|0|inv2i@0|out|2.5|0
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-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NY2;)I1
-X
-
-# Cell inv2iHT;1{ic}
-Cinv2iHT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
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-NThick-Circle|art@3||-1|1|1|1|||ART_color()I78
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-AThicker|net@2|||FS337|pin@2||1.5|0|pin@6||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS3263|pin@2||1.5|0|pin@5||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@3||-1.5|1|pin@4||-2.5|1|ART_color()I78
-Ein[n]||D5G1;|pin@9||I
-Ein[p]||D5G1;|pin@8||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell inv2iHT;1{sch}
-Cinv2iHT;1{sch}||schematic|1021415734000|1159375639594||ATTR_Delay(D5G1;HNPX-11;Y-7.5;)I100|ATTR_LEGATE(D5G1;HNPTX-11;Y-12.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-11;Y-8.5;)I-1|ATTR_X(D5G1;HNOJPX-11;Y-6.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-11;Y-9.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-11;Y-10.5;)Sstrong1|ATTR_su(D5G1;HNPTX-11;Y-11.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||12|0||||
-NOff-Page|conn@1||-10|1|||Y|
-NOff-Page|conn@2||-10|-1|||Y|
-IredFour:inv2iHT;1{ic}|inv2iHT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2iHT;1{ic}|inv2iHT@1||23|12.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||13|-11|||||ART_message(D5G2;)S[X is drive strength,P drive strength is twice N strength]
-Ngeneric:Invisible-Pin|pin@1||-3.5|13.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 1]
-Ngeneric:Invisible-Pin|pin@2||-3.5|20.5|||||ART_message(D5G6;)S[inv2iHT]
-Ngeneric:Invisible-Pin|pin@3||-3.5|15.5|||||ART_message(D5G2;)S[two-input HI-threshold inverter]
-Awire|net@0|||0|inv2iHT@0|in[p]|-2.5|1|conn@1|y|-8|1
-Awire|net@1|||0|inv2iHT@0|in[n]|-2.5|-1|conn@2|y|-8|-1
-Awire|net@2|||0|conn@0|a|10|0|inv2iHT@0|out|2.5|0
-Ein[n]||D5G2;|conn@2|a|I|ATTR_le(D5G1;NX0.5;Y2;)F0.33
-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NY2;)F1.67
-X
-
-# Cell inv2iK;1{ic}
-Cinv2iK;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1|1|1|1|||ART_color()I78
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-Ngeneric:Invisible-Pin|pin@0||0|-0.12|||||ART_message(D5G2;)S[K]
-Nschematic:Bus_Pin|pin@1||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@2||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@3||2.5|0|-2|-2||
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-NPin|pin@10||-2.5|-1||||
-AThicker|net@0|||FS0|pin@7||-1.5|1|pin@6||-2.5|1|ART_color()I78
-AThicker|net@1|||FS3263|pin@8||1.5|0|pin@5||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@8||1.5|0|pin@4||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS0|pin@9||-1.5|-1|pin@10||-2.5|-1|ART_color()I78
-AThicker|net@4|||FS2700|pin@4||-1.5|-2|pin@5||-1.5|2|ART_color()I78
-Ein[n]||D5G1;|pin@1||I
-Ein[p]||D5G1;|pin@2||I
-Eout||D5G1;|pin@3||O
-X
-
-# Cell inv2iK;1{sch}
-Cinv2iK;1{sch}||schematic|1021415734000|1159376928498||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-10.5|-1|||Y|
-NOff-Page|conn@1||-10.5|1|||Y|
-NOff-Page|conn@2||24|0||||
-IredFour:inv2i;1{ic}|inv2i@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2iK;1{ic}|inv2iK@0||24|17|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:invK;1{ic}|invK@0||8|6|R||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X/20.|ATTR_drive0(P)Sweak0|ATTR_drive1(P)Sweak1
-IredFour:invK;1{ic}|invK@1||14.5|6|YR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X/20.|ATTR_drive0(P)Sweak0|ATTR_drive1(P)Sweak1
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-Awire|net@1|||1800|conn@1|y|-8.5|1|inv2i@0|in[p]|-2.5|1
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-Awire|net@6|||2700|pin@2||14.5|0|invK@1|out|14.5|3.5
-Awire|net@7|||1800|pin@0||8|10.5|pin@1||14.5|10.5
-Awire|net@8|||1800|pin@3||8|0|pin@2||14.5|0
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-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
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-X
-
-# Cell inv2iKn;1{ic}
-Cinv2iKn;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-Ein[p]||D5G1;|pin@8||I
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-X
-
-# Cell inv2iKn;1{sch}
-Cinv2iKn;1{sch}||schematic|1021415734000|1159376541802||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
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-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-10.5|1|||Y|
-NOff-Page|conn@2||-10.5|-1|||Y|
-IredFour:inv2i;1{ic}|inv2i@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2iKn;1{ic}|inv2iKn@0||28|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Awire|net@7|||900|pin@1||-4.5|-1|pin@2||-4.5|-5.5
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-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
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-X
-
-# Cell inv2iKnD;1{ic}
-Cinv2iKnD;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-X
-
-# Cell inv2iKnD;1{sch}
-Cinv2iKnD;1{sch}||schematic|1021415734000|1159376976699||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
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-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-10.5|1|||Y|
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-NOff-Page|conn@3||-4|6||||
-IredFour:inv2iCTLn;1{ic}|inv2iCTL@0||0|0|||D0G4;|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X
-Iinv2iKnD;1{ic}|inv2iKnD@0||28|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||1|9|||||ART_message(D5G2;)S["Set input in N, reset input is P"]
-Ngeneric:Invisible-Pin|pin@1||26.5|3|||||SIM_spice_card(D6G1;)S[.ic v(out) 'vhi']
-Ngeneric:Invisible-Pin|pin@2||0|15|||||ART_message(D5G2;)S[degradable two-input inverter with n-side keeper]
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-Ngeneric:Invisible-Pin|pin@4||0|13|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@5||21.5|-14.5|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
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-Awire|net@3|||1800|conn@1|y|-8.5|1|inv2iCTL@0|inP|-2.5|1
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-Awire|net@6|||1800|pin@8||-4.5|-1|inv2iCTL@0|inN|-2.5|-1
-Awire|net@7|||1800|conn@0|y|-8.5|-1|pin@8||-4.5|-1
-Awire|net@8|||900|pin@8||-4.5|-1|pin@7||-4.5|-5.5
-Awire|net@9|||0|conn@2|a|13|0|pin@6||4.5|0
-Awire|net@10|||0|pin@10||0|6|conn@3|y|-2|6
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-Ein[n]||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY2;)F0.67
-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)D1.33
-X
-
-# Cell inv2iKp;1{ic}
-Cinv2iKp;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1|1|1|1|||ART_color()I78
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-Ngeneric:Invisible-Pin|pin@0||0|-0.12|||||ART_message(D5G2;)S[Kp]
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-Nschematic:Bus_Pin|pin@2||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@3||2.5|0|-2|-2||
-NPin|pin@4||-1.5|-2|1|1||
-NPin|pin@5||-1.5|2|1|1||
-NPin|pin@6||-2.5|1||||
-NPin|pin@7||-1.5|1|1|1||
-NPin|pin@8||1.5|0|1|1||
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-NPin|pin@10||-2.5|-1||||
-AThicker|net@0|||FS0|pin@7||-1.5|1|pin@6||-2.5|1|ART_color()I78
-AThicker|net@1|||FS3263|pin@8||1.5|0|pin@5||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@8||1.5|0|pin@4||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS0|pin@9||-1.5|-1|pin@10||-2.5|-1|ART_color()I78
-AThicker|net@4|||FS2700|pin@4||-1.5|-2|pin@5||-1.5|2|ART_color()I78
-Ein[n]||D5G1;|pin@1||I
-Ein[p]||D5G1;|pin@2||I
-Eout||D5G1;|pin@3||O
-X
-
-# Cell inv2iKp;1{sch}
-Cinv2iKp;1{sch}||schematic|1021415734000|1159376567086||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||4.5|5.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/10.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-10.5|-1|||Y|
-NOff-Page|conn@1||-10.5|1|||Y|
-NOff-Page|conn@2||15|0||||
-NGround|gnd@0||4.5|11||-1|Y|
-IredFour:inv2i;1{ic}|inv2i@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2iKp;1{ic}|inv2iKp@0||28|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||24.5|0|||||VERILOG_code(D6G1;)S[initial begin,   force out = 0;, #30000 release out;,end]
-NWire_Pin|pin@1||-4.5|1||||
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-Ngeneric:Invisible-Pin|pin@3||0|19|||||ART_message(D5G2;)S[two-input inverter with p-side keeper]
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-Ngeneric:Invisible-Pin|pin@5||0|17|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@6||21.5|-8|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
-NWire_Pin|pin@7||4.5|0||||
-NWire_Pin|pin@8||-4.5|5.5||||
-Awire|net@0|||1800|conn@0|y|-8.5|-1|inv2i@0|in[n]|-2.5|-1
-Awire|net@1|||1800|pin@1||-4.5|1|inv2i@0|in[p]|-2.5|1
-Awire|net@2|||1800|inv2i@0|out|2.5|0|pin@7||4.5|0
-Awire|net@3|||2700|pin@7||4.5|0|NMOSwk@0|s|4.5|3.5
-Awire|net@4|||2700|NMOSwk@0|d|4.5|7.5|gnd@0||4.5|9.5
-Awire|net@5|||1800|pin@8||-4.5|5.5|NMOSwk@0|g|1.5|5.5
-Awire|net@6|||2700|pin@1||-4.5|1|pin@8||-4.5|5.5
-Awire|net@7|||1800|conn@1|y|-8.5|1|pin@1||-4.5|1
-Awire|net@8|||0|conn@2|a|13|0|pin@7||4.5|0
-Ein[n]||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY2;)F0.33
-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NX-0.5;Y2;)I1
-X
-
-# Cell inv2iKpD;1{ic}
-Cinv2iKpD;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-1|1|1|1|||ART_color()I78
-NThick-Circle|art@3||0|1.5|1|1|||ART_color()I78
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-NPin|pin@6||-1.5|-2|1|1||
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-Nschematic:Bus_Pin|pin@9||-2.5|-1|-2|-2||
-Ngeneric:Invisible-Pin|pin@10||0|-0.12|||||ART_message(D5G2;)S[Kp]
-Ngeneric:Invisible-Pin|pin@11||0|2||||
-AThicker|net@0|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
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-AThicker|net@3|||FS3263|pin@2||1.5|0|pin@5||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@3||-1.5|1|pin@4||-2.5|1|ART_color()I78
-Ectl||D5G2;|pin@11||I
-Ein[n]||D5G1;|pin@9||I
-Ein[p]||D5G1;|pin@8||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell inv2iKpD;1{sch}
-Cinv2iKpD;1{sch}||schematic|1021415734000|1159376918981||ATTR_Delay(D5G1;HNPX-13.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-13.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-13.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-13.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-13.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-13.5;Y-10;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||4.5|5.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/10.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||15|0||||
-NOff-Page|conn@1||-10.5|1|||Y|
-NOff-Page|conn@2||-10.5|-1|||Y|
-NOff-Page|conn@3||-4|-6||||
-NGround|gnd@0||4.5|11||-1|Y|
-IredFour:inv2iCTLp;1{ic}|inv2iCTL@0||0|0|||D0G4;|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X
-Iinv2iKpD;1{ic}|inv2iKpD@0||28|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||1|14|||||ART_message(D5G2;)S["set input is P, reset input is N"]
-NWire_Pin|pin@1||-4.5|5.5||||
-NWire_Pin|pin@2||4.5|0||||
-Ngeneric:Invisible-Pin|pin@3||21.5|-8|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
-Ngeneric:Invisible-Pin|pin@4||0|17|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@5||0|24|||||ART_message(D5G6;)S[inv2iKpD]
-Ngeneric:Invisible-Pin|pin@6||0|19|||||ART_message(D5G2;)S[degradable two-input inverter with p-side keeper]
-Ngeneric:Invisible-Pin|pin@7||23.5|5.5|||||SIM_spice_card(D6G1;)S[.ic v(out) 'vlo']
-NWire_Pin|pin@8||-4.5|1||||
-Ngeneric:Invisible-Pin|pin@9||24.5|0|||||VERILOG_code(D6G1;)S[initial begin,   force out = 0;, #30000 release out;,end]
-NWire_Pin|pin@10||0|-6||||
-Awire|net@0|||2700|pin@2||4.5|0|NMOSwk@0|s|4.5|3.5
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-Awire|net@2|||1800|pin@1||-4.5|5.5|NMOSwk@0|g|1.5|5.5
-Awire|net@3|||1800|pin@8||-4.5|1|inv2iCTL@0|inP|-2.5|1
-Awire|net@4|||900|inv2iCTL@0|ctl|0|-2|pin@10||0|-6
-Awire|net@5|||1800|inv2iCTL@0|out|2.5|0|pin@2||4.5|0
-Awire|net@6|||1800|conn@2|y|-8.5|-1|inv2iCTL@0|inN|-2.5|-1
-Awire|net@7|||0|conn@0|a|13|0|pin@2||4.5|0
-Awire|net@8|||1800|conn@1|y|-8.5|1|pin@8||-4.5|1
-Awire|net@9|||2700|pin@8||-4.5|1|pin@1||-4.5|5.5
-Awire|net@10|||0|pin@10||0|-6|conn@3|y|-2|-6
-Ectl||D4G2;|conn@3|a|I|ATTR_le(D5G1;NX1;Y-2;)F1.33
-Ein[n]||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2;)F0.33
-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F1.33
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NY2;)D1.67
-X
-
-# Cell inv2iLT;2{ic}
-Cinv2iLT;2{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-1|1|1|1|||ART_color()I78
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NPin|pin@0||-2.5|-1||||
-NPin|pin@1||-1.5|-1|1|1||
-NPin|pin@2||1.5|0|1|1||
-NPin|pin@3||-1.5|1|1|1||
-NPin|pin@4||-2.5|1||||
-NPin|pin@5||-1.5|2|1|1||
-NPin|pin@6||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@7||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@8||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@9||2.5|0|-2|-2||
-AThicker|net@0|||FS0|pin@1||-1.5|-1|pin@0||-2.5|-1|ART_color()I78
-AThicker|net@1|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@2||1.5|0|pin@6||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS3263|pin@2||1.5|0|pin@5||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@3||-1.5|1|pin@4||-2.5|1|ART_color()I78
-Ein[n]||D5G1;|pin@7||I
-Ein[p]||D5G1;|pin@8||I
-Eout||D5G1;|pin@9||O
-X
-
-# Cell inv2iLT;2{sch}
-Cinv2iLT;2{sch}||schematic|1021415734000|1159375635930||ATTR_Delay(D5G1;HNPX-11.5;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-11.5;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-11.5;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-11.5;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-11.5;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-11.5;Y-10.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-10|-1|||Y|
-NOff-Page|conn@1||-10|1|||Y|
-NOff-Page|conn@2||12.5|0||||
-IredFour:inv2iLT;1{ic}|inv2iLT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv2iLT;2{ic}|inv2iLT@1||21|10|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||16|-12.5|||||ART_message(D5G2;)S[X is drive strength,N drive strength is twice P strength]
-Ngeneric:Invisible-Pin|pin@1||0.5|11.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2]
-Ngeneric:Invisible-Pin|pin@2||-3.5|16|||||ART_message(D5G2;)S[two-input LO-threshold inverter]
-Ngeneric:Invisible-Pin|pin@3||0.5|18.5|||||ART_message(D5G6;)S[inv2iLT]
-Awire|net@0|||0|inv2iLT@0|in[n]|-2.5|-1|conn@0|y|-8|-1
-Awire|net@1|||0|inv2iLT@0|in[p]|-2.5|1|conn@1|y|-8|1
-Awire|net@2|||0|conn@2|a|10.5|0|inv2iLT@0|out|2.5|0
-Ein[n]||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY2.5;)F0.67
-Ein[p]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.67
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)F1.33
-X
-
-# Cell inv2o;1{ic}
-Cinv2o;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_DelayH(D5G1;HNPX2;Y-4.5;)I100|ATTR_DelayL(D5G1;HNPX2;Y-3.5;)I100|ATTR_X(D5G1.5;HNOJPX2;Y3;)S"LE.subdrive(\"invHT1\", \"X\")"|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|-1|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NOpened-Thicker-Polygon|art@2||-0.5|1|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@3||1|1|1|1|1200||ART_color()I78|ART_degrees()F[0.0,2.0943952]
-NThick-Circle|art@4||2|-1|1|1|||ART_color()I78
-NThick-Circle|art@5||2|1|1|1|||ART_color()I78
-NPin|pin@0||1.5|-1|1|1||
-NPin|pin@1||0|0|1|1||
-NPin|pin@2||-1.5|-3|1|1||
-NPin|pin@3||1.5|1|1|1||
-NPin|pin@4||-1.5|3|1|1||
-NPin|pin@5||0|0|1|1||
-NPin|pin@6||-2.5|0|1|1||
-NPin|pin@7||-1.5|0|1|1||
-Nschematic:Wire_Pin|pin@8||2.5|-1|-0.5|-0.5||
-Nschematic:Bus_Pin|pin@9||-2.5|0|-2|-2||
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-AThicker|net@0|||FS2700|pin@2||-1.5|-3|pin@4||-1.5|3|ART_color()I78
-AThicker|net@1|||FS337|pin@0||1.5|-1|pin@2||-1.5|-3|ART_color()I78
-AThicker|net@2|||FS3263|pin@0||1.5|-1|pin@1||0|0|ART_color()I78
-AThicker|net@3|||FS337|pin@3||1.5|1|pin@5||0|0|ART_color()I78
-AThicker|net@4|||FS3263|pin@3||1.5|1|pin@4||-1.5|3|ART_color()I78
-AThicker|net@5|||FS0|pin@7||-1.5|0|pin@6||-2.5|0|ART_color()I78
-Ein||D5G1;|pin@9||I
-Eout[n]||D5G1;|pin@8||O
-Eout[p]||D5G1;HN|pin@10||O
-X
-
-# Cell inv2o;1{sch}
-Cinv2o;1{sch}||schematic|1021415734000|1197016374252||ATTR_DelayH(D5G1;HNPX-18;Y-5.5;)I100|ATTR_DelayL(D5G1;HNPX-18;Y-6.5;)I100|ATTR_X(D5G1;HNOJPX-18;Y-3.5;)S"LE.subdrive(\"invHT1\", \"X\")"|ATTR_su(D5G1;HNPTX-18;Y-4.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||16|-2||||
-NOff-Page|conn@1||-16|0||||
-NOff-Page|conn@2||16|2||||
-Iinv2o;1{ic}|inv2o@0||26.5|19|||D0G4;|ATTR_DelayH(D5G1;NPX2;Y-4.5;)I100|ATTR_DelayL(D5G1;NPX2;Y-3.5;)I100|ATTR_X(D5G1.5;NOJPX2;Y3;)S"LE.subdrive(\"invHT1\", \"X\")"|ATTR_su(P)I-1
-IinvHT;1{ic}|invHT@0||-2.5|2|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@DelayH|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(OJP)S@su|ATTR_S(D5G1;ILNRRX1.75;Y-8.5;)SLE.getdrive()
-IinvLT;1{ic}|invLT@0||5|-2|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@DelayL|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(OJP)S@su
-Ngeneric:Invisible-Pin|pin@0||6.5|-7.5|||||ART_message(D5G2;)S[simply reports size of HT gate]
-NWire_Pin|pin@1||-9|-2||||
-NWire_Pin|pin@2||-9|2||||
-Ngeneric:Invisible-Pin|pin@3||-3|15|||||ART_message(D5G2;)S[these are width ratios]
-Ngeneric:Invisible-Pin|pin@4||2.5|12.5|||||ART_message(D5G2;)S[P:N=2:2]
-Ngeneric:Invisible-Pin|pin@5||-9|12.5|||||ART_message(D5G2;)S[P:N=4:1]
-NWire_Pin|pin@6||-9|0||||
-Ngeneric:Invisible-Pin|pin@7||-1|19|||||ART_message(D5G2;)S[with two outputs]
-Ngeneric:Invisible-Pin|pin@8||-1|21|||||ART_message(D5G2;)S[HI-LO-threshold inverters]
-Ngeneric:Invisible-Pin|pin@9||0|25.5|||||ART_message(D5G6;)S[inv2o]
-Awire|net@0|||900|pin@6||-9|0|pin@1||-9|-2
-Awire|net@1|||1800|pin@1||-9|-2|invLT@0|in|2.5|-2
-Awire|net@2|||0|conn@0|a|14|-2|invLT@0|out|7.5|-2
-Awire|net@3|||1800|pin@2||-9|2|invHT@0|in|-5|2
-Awire|net@4|||900|pin@2||-9|2|pin@6||-9|0
-Awire|net@5|||0|conn@2|a|14|2|invHT@0|out|0|2
-Awire|net@6|||0|pin@6||-9|0|conn@1|y|-14|0
-Ein||D5G2;|conn@1|a|I
-Eout[n]||D5G2;|conn@0|y|O
-Eout[p]||D5G2;|conn@2|y|O
-X
-
-# Cell invCLK;1{ic}
-CinvCLK;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[0.25/-0.5,-0.25/-0.5,-0.25/0.5]
-NOpened-Thicker-Polygon|art@2||-1|0|0.5|1|||ART_color()I78|trace()V[0.25/-0.5,-0.25/-0.5,-0.25/0.5,0.25/0.5]
-NOpened-Thicker-Polygon|art@3||0.5|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||-2.5|0|-2|-2||
-NPin|pin@2||-1.5|-2|1|1||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-2.5|0||||
-NPin|pin@5||-1.5|0|1|1||
-NPin|pin@6||1.5|0|1|1||
-AThicker|net@0|||FS0|pin@5||-1.5|0|pin@4||-2.5|0|ART_color()I78
-AThicker|net@1|||FS3263|pin@6||1.5|0|pin@3||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@6||1.5|0|pin@2||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS2700|pin@2||-1.5|-2|pin@3||-1.5|2|ART_color()I78
-Ein||D5G1;|pin@1||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell invCLK;1{sch}
-CinvCLK;1{sch}||schematic|1021415734000|1159375628155||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6;)I-1|ATTR_X(D5G1;HNOJPX-12;Y-4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-7;)I-1|ATTR_verilog_template(D5G1;NTX6.5;Y-13;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||9.5|0||||
-NOff-Page|conn@1||-10|0||||
-IredFour:invCLK;1{ic}|invCLK@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-IinvCLK;1{ic}|invCLK@1||24|19|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-2|11.5|||||ART_message(D5G2;)S[should give equal R/F Delay]
-Ngeneric:Invisible-Pin|pin@1||-1|20.5|||||ART_message(D5G6;)S[inv3to1]
-Ngeneric:Invisible-Pin|pin@2||-2|15.5|||||ART_message(D5G2;)S[higher-threshold inverter]
-Ngeneric:Invisible-Pin|pin@3||13.5|-10|||||ART_message(D5G2;)S[X is drive strength,P drive strength is 1.5x N strength]
-Ngeneric:Invisible-Pin|pin@4||-2.5|13.5|||||ART_message(D5G2;)S[P to N width ratio is 3 to 1]
-Awire|net@0|||0|invCLK@0|in|-2.5|0|conn@1|y|-8|0
-Awire|net@1|||1800|invCLK@0|out|2.5|0|conn@0|a|7.5|0
-Ein||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NY2;)F1.33
-X
-
-# Cell invCTLn;1{ic}
-CinvCTLn;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HNPX2;Y-8;)I1|ATTR_LEPARALLGRP(D5G1;HNPX2;Y-4;)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HNPX2;Y-6;)Sstrong0|ATTR_drive1(D5G1;HNPX2;Y-7;)Sstrong1|ATTR_sloDelay(D5G1;HNPX1.75;Y-3;)I175|ATTR_su(D5G1;HNPX2;Y-5;)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[0/-0.5,0/0.5,-0.25/0.5,0.25/0.5]
-NOpened-Thicker-Polygon|art@2||-1|0|0.5|1|||ART_color()I78|trace()V[0.25/0.5,-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NOpened-Thicker-Polygon|art@4||0.5|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NPin|pin@0||0|-1|1|1|R|
-NPin|pin@1||0|-2|||R|
-Ngeneric:Invisible-Pin|pin@2||0|-2||||
-Nschematic:Bus_Pin|pin@3||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||-2.5|0|-2|-2||
-NPin|pin@5||-1.5|-2|1|1||
-NPin|pin@6||-1.5|2|1|1||
-NPin|pin@7||-2.5|0||||
-NPin|pin@8||-1.5|0|1|1||
-NPin|pin@9||1.5|0|1|1||
-AThicker|net@0|||FS900|pin@0||0|-1|pin@1||0|-2|ART_color()I78
-AThicker|net@1|||FS3263|pin@9||1.5|0|pin@6||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@9||1.5|0|pin@5||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS2700|pin@5||-1.5|-2|pin@6||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@8||-1.5|0|pin@7||-2.5|0|ART_color()I78
-Ectl||D5G1;|pin@2||I
-Ein||D5G1;|pin@4||I
-Eout||D5G1;|pin@3||O
-X
-
-# Cell invCTLn;1{sch}
-CinvCTLn;1{sch}||schematic|1021415734000|1159375665094||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-12;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-8;)I-1|ATTR_X(D5G1;HNOJPX-12;Y-4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-10;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-11;)Sstrong1|ATTR_sloDelay(D5G1;HNPX-12.5;Y-6.25;)I175|ATTR_su(D5G1;HNPTX-12;Y-9;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||0|-7.5|||R|
-NOff-Page|conn@1||12.5|0||||
-NOff-Page|conn@2||-8.5|0||||
-IredFour:invCTLn;1{ic}|invCTLn@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4.5;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_sloDelay(D5G1;NOJPX4.5;Y-3;)S@sloDelay
-IinvCTLn;1{ic}|invCTLn@1||27.5|11.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(D5G1;NPX2;Y-8;)I1|ATTR_LEPARALLGRP(D5G1;NPX2;Y-4;)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;NPX2;Y-6;)Sstrong0|ATTR_drive1(D5G1;NPX2;Y-7;)Sstrong1|ATTR_sloDelay(D5G1;NPX1.75;Y-3;)I175|ATTR_su(D5G1;NPX2;Y-5;)I-1
-Ngeneric:Invisible-Pin|pin@0||-1|24|||||ART_message(D5G6;)S[invCTLn]
-Ngeneric:Invisible-Pin|pin@1||0|19|||||ART_message(D5G2;)S[current starved inverter]
-Ngeneric:Invisible-Pin|pin@2||0.5|17|||||ART_message(D5G2;)S[only low-going output transition is affected]
-Ngeneric:Invisible-Pin|pin@3||21|-8.5|||||ART_message(D5G2;)S[X is drive strength]
-Awire|net@0|||900|invCTLn@0|ctl|0|-2|conn@0|y|0|-5.5
-Awire|net@1|||0|conn@1|a|10.5|0|invCTLn@0|out|2.5|0
-Awire|net@2|||1800|conn@2|y|-6.5|0|invCTLn@0|in|-2.5|0
-Ectl||D5G2;|conn@0|a|I|ATTR_le(D5G1;NX-0.5;Y-1.5;)F0.666
-Ein||D5G2;|conn@2|a|I|ATTR_le(D5G1;NX-0.5;Y-1.5;)F1.33
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NX-0.5;Y2;)F1.33
-X
-
-# Cell invCTLp;1{ic}
-CinvCTLp;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0.5|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-NOpened-Thicker-Polygon|art@3||-1|0|0.5|1|||ART_color()I78|trace()V[0.25/0.5,-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NOpened-Thicker-Polygon|art@4||-0.25|0|0.5|1|||ART_color()I78|trace()V[0/-0.5,0/0.5,-0.25/0.5,0.25/0.5]
-Ngeneric:Invisible-Pin|pin@0||0.5|1.25|||||ART_message(D5G1;)S[p]
-NPin|pin@1||1.5|0|1|1||
-NPin|pin@2||-1.5|0|1|1||
-NPin|pin@3||-2.5|0||||
-NPin|pin@4||-1.5|2|1|1||
-NPin|pin@5||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@6||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
-Ngeneric:Invisible-Pin|pin@8||0|2||||
-NPin|pin@9||0|1|||R|
-NPin|pin@10||0|2|1|1|R|
-AThicker|net@0|||FS0|pin@2||-1.5|0|pin@3||-2.5|0|ART_color()I78
-AThicker|net@1|||FS2700|pin@5||-1.5|-2|pin@4||-1.5|2|ART_color()I78
-AThicker|net@2|||FS337|pin@1||1.5|0|pin@5||-1.5|-2|ART_color()I78
-AThicker|net@3|||FS3263|pin@1||1.5|0|pin@4||-1.5|2|ART_color()I78
-AThicker|net@4|||FS900|pin@10||0|2|pin@9||0|1|ART_color()I78
-Ectl||D5G1;|pin@8||I
-Ein||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell invCTLp;1{sch}
-CinvCTLp;1{sch}||schematic|1021415734000|1159377383524||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6;)I-1|ATTR_X(D5G1;HNOJPX-12;Y-4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-7;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-8.5|0||||
-NOff-Page|conn@1||8|0||||
-NOff-Page|conn@2||0|-7.5|||R|
-IredFour:invCTLp;1{ic}|invCTLp@0||0|0|||D0G4;|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X
-IinvCTLp;1{ic}|invCTLp@1||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||21|-8.5|||||ART_message(D5G2;)S[X is drive strength]
-Ngeneric:Invisible-Pin|pin@1||0.5|17|||||ART_message(D5G2;)S[only high-going output transition is affected]
-Ngeneric:Invisible-Pin|pin@2||0|19|||||ART_message(D5G2;)S[current starved inverter]
-Ngeneric:Invisible-Pin|pin@3||-1|24|||||ART_message(D5G6;)S[invCTLp]
-Awire|net@0|||900|invCTLp@0|ctl|0|-2|conn@2|y|0|-5.5
-Awire|net@1|||0|conn@1|a|6|0|invCTLp@0|out|2.5|0
-Awire|net@2|||1800|conn@0|y|-6.5|0|invCTLp@0|in|-2.5|0
-Ectl||D5G2;|conn@2|a|I|ATTR_le(D5G1;NX-0.5;Y-1.5;)F0.666
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-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-2;)S1.67
-X
-
-# Cell invHT;1{ic}
-CinvHT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-NPin|pin@0||1.5|0|1|1||
-NPin|pin@1||-1.5|0|1|1||
-NPin|pin@2||-2.5|0||||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@5||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@6||2.5|0|-2|-2||
-AThicker|net@0|||FS2700|pin@4||-1.5|-2|pin@3||-1.5|2|ART_color()I78
-AThicker|net@1|||FS337|pin@0||1.5|0|pin@4||-1.5|-2|ART_color()I78
-AThicker|net@2|||FS3263|pin@0||1.5|0|pin@3||-1.5|2|ART_color()I78
-AThicker|net@3|||FS0|pin@1||-1.5|0|pin@2||-2.5|0|ART_color()I78
-Ein||D5G1;|pin@5||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell invHT;2{sch}
-CinvHT;2{sch}||schematic|1021415734000|1159375620196||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6;)I-1|ATTR_X(D5G1;HNOJPX-12;Y-4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-7;)I-1|ATTR_verilog_template(D5G1;NTX6.5;Y-13;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-10|0||||
-NOff-Page|conn@1||9.5|0||||
-IredFour:invHT;1{ic}|invHT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-IinvHT;1{ic}|invHT@1||15|10|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-2.5|13.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 1]
-Ngeneric:Invisible-Pin|pin@1||13.5|-10|||||ART_message(D5G2;)S[X is drive strength,P drive strength is twice N strength]
-Ngeneric:Invisible-Pin|pin@2||-2|15.5|||||ART_message(D5G2;)S[HI-threshold inverter]
-Ngeneric:Invisible-Pin|pin@3||-1|20.5|||||ART_message(D5G6;)S[invHT]
-Awire|net@0|||0|invHT@0|in|-2.5|0|conn@0|y|-8|0
-Awire|net@1|||1800|invHT@0|out|2.5|0|conn@1|a|7.5|0
-Ein||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F1.67
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY1.5;)F1.67
-X
-
-# Cell invK;1{ic}
-CinvK;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEKEEPER(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sweak0|ATTR_drive1(D5G1;HPT)Sweak1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[2000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-NThick-Circle|art@2||-2|0|1|1|||ART_color()I78
-NPin|pin@0||1.5|0|1|1||
-NPin|pin@1||-1.5|2|1|1||
-NPin|pin@2||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@3||-2.5|0|-2|-2||
-NPin|pin@4||2.5|0||||
-NPin|pin@5||1.5|0|1|1||
-Nschematic:Bus_Pin|pin@6||2.5|0|-2|-2||
-AThicker|net@0|||FS2700|pin@2||-1.5|-2|pin@1||-1.5|2|ART_color()I78
-AThicker|net@1|||FS337|pin@0||1.5|0|pin@2||-1.5|-2|ART_color()I78
-AThicker|net@2|||FS3263|pin@0||1.5|0|pin@1||-1.5|2|ART_color()I78
-AThicker|net@3|||FS0|pin@4||2.5|0|pin@5||1.5|0|ART_color()I78
-Ein||D5G1;|pin@3||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell invK;1{sch}
-CinvK;1{sch}||schematic|1021415734000|1159375623973||ATTR_Delay(D5G1;HNPX-14;Y-7.5;)I100|ATTR_LEKEEPER(D5G1;HNPTX-14;Y-11.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-14;Y-6.5;)I-1|ATTR_X(D5G1;HNOJPX-14;Y-5.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-14;Y-9.5;)Sweak0|ATTR_drive1(D5G1;HNPTX-14;Y-10.5;)Sweak1|ATTR_su(D5G1;HNPTX-14;Y-8.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-11|0||||
-NOff-Page|conn@1||8|0||||
-IredFour:invK;1{ic}|invK@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-IinvK;1{ic}|invK@1||18.5|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sweak0|ATTR_drive1(P)Sweak1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||24.5|-8.5|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
-Ngeneric:Invisible-Pin|pin@1||-2|16|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@2||-1|23.5|||||ART_message(D5G6;)S[invK]
-Ngeneric:Invisible-Pin|pin@3||-1|18|||||ART_message(D5G2;)S[LO threshold keeper inverter]
-Awire|net@0|||1800|conn@0|y|-9|0|invK@0|in|-2.5|0
-Awire|net@1|||0|conn@1|a|6|0|invK@0|out|2.5|0
-Ein||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)I1
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY2;)I1
-X
-
-# Cell invLT;1{ic}
-CinvLT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-NPin|pin@0||1.5|0|1|1||
-NPin|pin@1||-1.5|0|1|1||
-NPin|pin@2||-2.5|0||||
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-Ein||D5G1;|pin@5||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell invLT;2{sch}
-CinvLT;2{sch}||schematic|1021415734000|1159375615839||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6;)I-1|ATTR_X(D5G1;HNOJPX-12;Y-4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-7;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-8.5|0||||
-NOff-Page|conn@1||8|0||||
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-IinvLT;1{ic}|invLT@1||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Ngeneric:Invisible-Pin|pin@2||0|19|||||ART_message(D5G2;)S[LO-threshold inverter]
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-X
-
-# Cell inv_passgate;1{ic}
-Cinv_passgate;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX-0.5;Y3;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
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-NPin|pin@1||-1.5|2|1|1||
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-Nschematic:Bus_Pin|pin@5||-2.5|0|-2|-2||
-NPin|pin@6||1.5|0|1|1||
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-AThicker|net@7|||FS0|pin@11||4.75|1|pin@10||3.25|1|ART_color()I78
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-AThicker|net@10|||FS0|pin@16||4|1.25|pin@15||3.25|1.25|ART_color()I78
-AThicker|net@11|||FS0|pin@14||4.75|1.25|pin@16||4|1.25|ART_color()I78
-AThicker|net@12|||FS900|pin@17||4|2|pin@16||4|1.25|ART_color()I78
-Een||D5G2;|pin@7||I
-Ein||D5G1;|pin@5||I
-Eout||D5G1;|pin@2||O
-X
-
-# Cell inv_passgate;1{sch}
-Cinv_passgate;1{sch}||schematic|1021415734000|1159377687524||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6.5;)I-1|ATTR_X(D5G1;HNOJPX-12.5;Y-4.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-7.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-8.5;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-9.5;)I-1|prototype_center()I[0,0]
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-NOff-Page|conn@1||18|0||||
-NOff-Page|conn@2||4|7||||
-IredFour:invLT;1{ic}|invLT@0||0.5|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Iinv_passgate;1{ic}|inv_pass@0||20|13.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-0.5;Y3;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)S""
-Ngeneric:Invisible-Pin|pin@0||-1.5|20|||||ART_message(D5G6;)S[inv_passgate]
-Ngeneric:Invisible-Pin|pin@1||-2|14.5|||||ART_message(D5G2;)S[one-parameter inverter]
-Ngeneric:Invisible-Pin|pin@2||11|-12|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
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-Awire|net@3|||1800|conn@0|y|-12|0|invLT@0|in|-2|0
-Awire|net@4|||0|pin@4||10|7|conn@2|y|6|7
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-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;N)D1.33
-X
-
-# Cell mullerC;1{ic}
-CmullerC;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.75|1.25|||ART_color()I78|trace()V[0.375/-0.625,-0.375/-0.625,-0.375/0.625,0.375/0.625]
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-NPin|pin@9||-1.5|-1|1|1||
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-AThicker|net@4|||FS0|pin@9||-1.5|-1|pin@8||-2.5|-1|ART_color()I78
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-X
-
-# Cell mullerC;1{sch}
-CmullerC;1{sch}||schematic|1021415734000|1159375649419||ATTR_Delay(D5G1;HNPX-16.5;Y-11;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-14;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-8;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-12;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-13;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-10;)I-1|prototype_center()I[0,0]
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-NOff-Page|conn@0||10|0|||Y|
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-NOff-Page|conn@2||-14.5|-2.5||||
-IredFour:mullerC;1{ic}|mullerC@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-ImullerC;1{ic}|mullerC@1||20.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-3.5|20.5|||||ART_message(D5G6;)S[mullerC]
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-NWire_Pin|pin@7||-7|2.5||||
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-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY-1.5;)I2
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)I2
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NX-1;Y-2.5;)I2
-X
-
-# Cell mullerC_sy;1{ic}
-CmullerC_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-NOpened-Thicker-Polygon|art@3||0|0|0.75|1.25|||ART_color()I78|trace()V[0.375/-0.625,-0.375/-0.625,-0.375/0.625,0.375/0.625]
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-AThicker|net@1|||FS0|pin@3||-1.5|-1|pin@4||-2.5|-1|ART_color()I78
-AThicker|net@2|||FS0|pin@5||-0.5|2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@9||-1.5|-2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@10||-0.5|-2|pin@9||-1.5|-2|ART_color()I78
-AThicker|net@5|||FS0|pin@12||-1.5|1|pin@11||-2.5|1|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell mullerC_sy;1{sch}
-CmullerC_sy;1{sch}||schematic|1021415734000|1159375644961||ATTR_Delay(D5G1;HNPX-16.5;Y-11;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-14;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-8;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-12;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-13;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-14.5|2.5||||
-NOff-Page|conn@2||10|0|||Y|
-IredFour:mullerC_sy;1{ic}|mullerC_@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-ImullerC_sy;1{ic}|mullerC_@1||20.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-7|2.5||||
-NWire_Pin|pin@1||-7|1||||
-NWire_Pin|pin@2||-7|-1||||
-NWire_Pin|pin@3||-7|-2.5||||
-Ngeneric:Invisible-Pin|pin@4||16.5|-11.5|||||ART_message(D5G2;)S[X is drive strength,Pull-up and pull-down have the same strength]
-Ngeneric:Invisible-Pin|pin@5||-3.5|13|||||ART_message(D5G2;)S[P to N width ratio is 4 to 2]
-Ngeneric:Invisible-Pin|pin@6||-3.5|15.5|||||ART_message(D5G2;)S[one-parameter symmetric muller C-element]
-Ngeneric:Invisible-Pin|pin@7||-3.5|20.5|||||ART_message(D5G6;)S[mullerC_sy]
-Awire|net@0|||0|mullerC_@0|ina|-2.5|-1|pin@2||-7|-1
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-Awire|net@4|||900|pin@0||-7|2.5|pin@1||-7|1
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-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)I2
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)I2
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NX-0.5;Y-2;)I2
-X
-
-# Cell mux1;1{ic}
-Cmux1;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-3.75;)I100|ATTR_M(D5G1;HNPX3;Y-2.75;)I1|ATTR_S(D5G1.5;HNOJPX2.5;Y1.75;)SLE.getdrive()|ATTR_su(D5G1;HNPX2.75;Y-6.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||0|2|1|1|||ART_color()I78
-NThick-Circle|art@2||1.5|0|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@0||-2|0|-2|-2||
-NPin|pin@1||-1|0|1|1||
-NPin|pin@2||-2|0|1|1||
-NPin|pin@3||0|3|1|1|RRR|
-NPin|pin@4||0|2.5|1|1|RRR|
-NPin|pin@5||1|1|1|1||
-NPin|pin@6||0|-1.5|1|1|RRR|
-NPin|pin@7||0|-3|1|1|RRR|
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-NPin|pin@9||1|-1|1|1||
-Nschematic:Bus_Pin|pin@10||0|3|-2|-2||
-Nschematic:Bus_Pin|pin@11||2|0|-2|-2||
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-NPin|pin@13||-1|-2|1|1||
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-AThicker|net@6|||FS2700|pin@13||-1|-2|pin@12||-1|2|ART_color()I78
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-Ec[p]||D5G1;|pin@10||I
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-X
-
-# Cell mux1;1{sch}
-Cmux1;1{sch}||schematic|1021415734000|1159378523994||ATTR_Delay(D5G1;HNPX-15;Y-3.5;)I100|ATTR_M(D5G1;HNPX-15;Y-2.5;)I1|ATTR_S(D5G1;HNOJPX-15;Y-1.5;)SLE.getdrive()|ATTR_su(D5G1;HNPX-15;Y-4.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@2||9.5|5|||YRR|
-NOff-Page|conn@3||16.5|1||||
-Imux1;1{ic}|mux1@0||10|16.5|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3.75;)I100|ATTR_M(D5G1;NPX3;Y-2.75;)I1|ATTR_S(D5G1.5;NPX2.5;Y1.75;)I1|ATTR_su(D5G1;NPX2.75;Y-6.5;)I-1
-Inms2;1{ic}|nms2@0||2|-7|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX-2.25;Y1.5;)SLE.getdrive()|ATTR_su(P)I-1|ATTR_M(D5G1;NOJTX1.5;Y-0.5;)S@M
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-Ngeneric:Invisible-Pin|pin@4||-6.5|21|||||ART_message(D5G6;)S[mux1]
-NWire_Pin|pin@5||2|1||||
-Ipms2;1{ic}|pms2@0||2|9|||D0G4;|ATTR_Delay(D5G1;NOJPX-3;Y-1.5;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX2.25;Y1;)SLE.getdrive()|ATTR_su(P)I-1|ATTR_M(D5G1;NOJTX2;)S@M
-Awire|net@0|||0|pin@0||-6|1|conn@0|y|-8.5|1
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-Awire|net@3|||0|pms2@0|g|-1|9|pin@1||-6|9
-Awire|net@4|||1800|pin@2||-6|-7|nms2@0|g|-1|-7
-Awire|net@5|||1800|nms2@0|g2|5|-3|conn@1|y|7.5|-3
-Awire|net@6|||1800|pms2@0|g2|5|5|conn@2|y|7.5|5
-Awire|net@7|||900|pms2@0|d|2|3|pin@5||2|1
-Awire|net@8|||2700|nms2@0|d|2|-1|pin@5||2|1
-Awire|net@9|||0|conn@3|a|14.5|1|pin@5||2|1
-Ec[n]||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.667
-Ec[p]||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2;)F1.333
-Ein||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-2;)I2
-Eout||D5G2;|conn@3|y|O|ATTR_le(D5G1;NY-2;)I2
-X
-
-# Cell mux21_tri;1{ic}
-Cmux21_tri;1{ic}||artwork|1092163151000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-4.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX4;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@3||2.5|0|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@0||-2|2||||
-Nschematic:Bus_Pin|pin@2||-2|-2||||
-Nschematic:Bus_Pin|pin@4||3|0||||
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-Ngeneric:Invisible-Pin|pin@14||0|2|||||ART_message(D5G1;)S0
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-NPin|pin@29||-1|4|1|1||
-NPin|pin@30||2|-2.5|1|1||
-NPin|pin@31||2|2.5|1|1||
-NPin|pin@32||-1|-4|1|1||
-NPin|pin@33||2|-2.5|1|1||
-NPin|pin@34||2|2.5|1|1||
-NPin|pin@35||-1|4|1|1||
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-NPin|pin@39||-2|-2||||
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-NPin|pin@41||0.5|3.25||||
-AThicker|net@11|||FS2700|pin@28||-1|-4|pin@29||-1|4|ART_color()I78
-AThicker|net@12|||FS2700|pin@30||2|-2.5|pin@31||2|2.5|ART_color()I78
-AThicker|net@13|||FS2066|pin@32||-1|-4|pin@33||2|-2.5|ART_color()I78
-AThicker|net@14|||FS3334|pin@34||2|2.5|pin@35||-1|4|ART_color()I78
-AThicker|net@15|||FS0|pin@36||-1|2|pin@37||-2|2|ART_color()I78
-AThicker|net@16|||FS0|pin@38||-1|-2|pin@39||-2|-2|ART_color()I78
-AThicker|net@17|||FS900|pin@40||0.5|4.5|pin@41||0.5|3.25|ART_color()I78
-Ein0||D5G2;|pin@0||I
-Ein1||D5G2;|pin@2||I
-Eout||D5G2;|pin@4||O
-Esel||D5G2;|pin@6||I
-X
-
-# Cell mux21_tri;1{sch}
-Cmux21_tri;1{sch}||schematic|1092161401000|1159376025241||ATTR_Delay(D5G1;HNPX-5;Y-7;)I100|ATTR_LEGATE(D5G1;HNPTX-5;Y-12;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-5;Y-8;)I-1|ATTR_X(D5G1;HNOJPX-5;Y-6;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-5;Y-9;)Sstrong0|ATTR_drive1(D5G1;HNPTX-5;Y-10;)Sstrong1|ATTR_su(D5G1;HNPTX-5;Y-11;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-12|2||||
-NOff-Page|conn@1||-12|-2||||
-NOff-Page|conn@2||14|0||||
-NOff-Page|conn@3||-12|7||||
-IredFour:mux21_tri;1{ic}|mux21_tr@0||0|0|||D5G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-4.5;)S@Delay|ATTR_X(D5G1.5;NOJPX4;Y2;)S@X
-Imux21_tri;1{ic}|mux21_tr@1||19|16|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-4.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX4;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||0.5|7||||
-Ngeneric:Invisible-Pin|pin@1||-2|15|||||ART_message(D5G5;)Smux21_tri
-Ngeneric:Invisible-Pin|pin@2||0|11|||||ART_message(D5G2;)Sa slow one-parameter 2:1 mux made of tristates
-Awire|net@0|||1800|conn@3|y|-10|7|pin@0||0.5|7
-Awire|net@1|||900|pin@0||0.5|7|mux21_tr@0|sel|0.5|4.5
-Awire|net@2|||1800|conn@0|y|-10|2|mux21_tr@0|in0|-2|2
-Awire|net@3|||1800|conn@1|y|-10|-2|mux21_tr@0|in1|-2|-2
-Awire|net@4|||1800|mux21_tr@0|out|3|0|conn@2|a|12|0
-Ein0||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-2;)I2
-Ein1||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)I2
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)I4
-Esel||D5G2;|conn@3|a|I|ATTR_le(D5G1;NY-2;)F2.5
-X
-
-# Cell nand2;1{ic}
-Cnand2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
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-NPin|pin@1||-1.5|-0.75|1|1||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-NPin|pin@3||-1.5|-1|1|1||
-NPin|pin@4||-2.5|-1||||
-NPin|pin@5||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@6||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
-NPin|pin@8||-1.5|2|1|1||
-NPin|pin@9||-1.5|-2|1|1||
-NPin|pin@10||-0.5|-2|1|1||
-NPin|pin@11||-2.5|1||||
-NPin|pin@12||-1.5|1|1|1||
-AThicker|net@0|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I78
-AThicker|net@1|||FS0|pin@3||-1.5|-1|pin@4||-2.5|-1|ART_color()I78
-AThicker|net@2|||FS0|pin@5||-0.5|2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@9||-1.5|-2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@10||-0.5|-2|pin@9||-1.5|-2|ART_color()I78
-AThicker|net@5|||FS0|pin@12||-1.5|1|pin@11||-2.5|1|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell nand2;1{sch}
-Cnand2;1{sch}||schematic|1021415734000|1159375675453||ATTR_Delay(D5G1;HNPX-16.5;Y-11;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-14;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-8;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-12;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-13;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14.5|-2.5||||
-NOff-Page|conn@1||-14.5|2.5||||
-NOff-Page|conn@2||10|0|||Y|
-IredFour:nand2;1{ic}|nand2@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand2;1{ic}|nand2@1||20.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-7|2.5||||
-NWire_Pin|pin@1||-7|1||||
-NWire_Pin|pin@2||-7|-1||||
-NWire_Pin|pin@3||-7|-2.5||||
-Ngeneric:Invisible-Pin|pin@4||16.5|-11.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@5||-3.5|13|||||ART_message(D5G2;)S[P to N width ratio is 1 to 1]
-Ngeneric:Invisible-Pin|pin@6||-3.5|15.5|||||ART_message(D5G2;)S[one-parameter NAND]
-Ngeneric:Invisible-Pin|pin@7||-3.5|20.5|||||ART_message(D5G6;)S[nand2]
-Awire|net@0|||0|nand2@0|ina|-2.5|-1|pin@2||-7|-1
-Awire|net@1|||1800|nand2@0|out|2.5|0|conn@2|a|8|0
-Awire|net@2|||1800|pin@1||-7|1|nand2@0|inb|-2.5|1
-Awire|net@3|||0|pin@0||-7|2.5|conn@1|y|-12.5|2.5
-Awire|net@4|||900|pin@0||-7|2.5|pin@1||-7|1
-Awire|net@5|||900|pin@2||-7|-1|pin@3||-7|-2.5
-Awire|net@6|||0|pin@3||-7|-2.5|conn@0|y|-12.5|-2.5
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)F1.33
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY-2;)I2
-X
-
-# Cell nand2HLT_sy;1{ic}
-Cnand2HLT_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-NThick-Circle|art@3||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NOpened-Thicker-Polygon|art@4||0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-NPin|pin@3||-1.5|1|1|1||
-NPin|pin@4||-2.5|1||||
-NPin|pin@5||-0.5|-2|1|1||
-NPin|pin@6||-1.5|-2|1|1||
-NPin|pin@7||-1.5|2|1|1||
-NPin|pin@8||-0.5|2|1|1||
-NPin|pin@9||-2.5|-1||||
-NPin|pin@10||-1.5|-1|1|1||
-AThicker|net@0|||FS0|pin@5||-0.5|-2|pin@6||-1.5|-2|ART_color()I78
-AThicker|net@1|||FS0|pin@3||-1.5|1|pin@4||-2.5|1|ART_color()I78
-AThicker|net@2|||FS2700|pin@6||-1.5|-2|pin@7||-1.5|2|ART_color()I78
-AThicker|net@3|||FS0|pin@8||-0.5|2|pin@7||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@10||-1.5|-1|pin@9||-2.5|-1|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@1||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell nand2HLT_sy;1{sch}
-Cnand2HLT_sy;1{sch}||schematic|1021415734000|1159375725680||ATTR_Delay(D5G1;HNPX-17;Y-10.5;)I100|ATTR_LEGATE(D5G1;HNPTX-17;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-17;Y-8.5;)I-1|ATTR_X(D5G1;HNOJPX-17;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-17;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-17;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-17;Y-9.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-15|-2.5|||Y|
-NOff-Page|conn@1||9|0|||Y|
-NOff-Page|conn@2||-14.75|2.5||||
-IredFour:nand2HLT_sy;1{ic}|nand2HLT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2HLT_sy;1{ic}|nand2HLT@1||25.75|17.25|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-2|25|||||ART_message(D5G6;)S[nand2HLT_sy]
-Ngeneric:Invisible-Pin|pin@1||-2|20|||||ART_message(D5G2;)S[symetric LO-threshold NAND]
-Ngeneric:Invisible-Pin|pin@2||-2|18|||||ART_message(D5G2;)S[P to N width ratio is 1.5 to 2]
-Ngeneric:Invisible-Pin|pin@3||17|-11.5|||||ART_message(D5G2;)S[X is drive strength,The pull-down is twice as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-Ngeneric:Invisible-Pin|pin@4||-2|16|||||ART_message(D5G2;)S[Sized assuming inputs go low together]
-NWire_Pin|pin@5||-7.5|-2.5||||
-NWire_Pin|pin@6||-7.5|-1||||
-NWire_Pin|pin@7||-7.5|2.5||||
-NWire_Pin|pin@8||-7.5|1||||
-Awire|net@0|||0|nand2HLT@0|ina|-2.5|-1|pin@6||-7.5|-1
-Awire|net@1|||1800|nand2HLT@0|out|2.5|0|conn@1|a|7|0
-Awire|net@2|||0|nand2HLT@0|inb|-2.5|1|pin@8||-7.5|1
-Awire|net@3|||0|pin@7||-7.5|2.5|conn@2|y|-12.75|2.5
-Awire|net@4|||1800|conn@0|y|-13|-2.5|pin@5||-7.5|-2.5
-Awire|net@5|||900|pin@6||-7.5|-1|pin@5||-7.5|-2.5
-Awire|net@6|||2700|pin@8||-7.5|1|pin@7||-7.5|2.5
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY2;)F1.166
-Einb||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2;)F1.166
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-2;)F1.67
-X
-
-# Cell nand2HT;1{ic}
-Cnand2HT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
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-NPin|pin@1||-2.5|1||||
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-Nschematic:Bus_Pin|pin@10||-2.5|-1|-2|-2||
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-AThicker|net@5|||FS3150|pin@12||-0.25|-2|pin@11||-1.5|-0.75|ART_color()I78
-Eina||D5G1;|pin@10||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@5||O
-X
-
-# Cell nand2HT;1{sch}
-Cnand2HT;1{sch}||schematic|1021415734000|1159375717292||ATTR_Delay(D5G1;HNPX-16.5;Y-7;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-12;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-8;)I-1|ATTR_X(D5G1;HNOJPX-21;Y-6;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-10;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-11;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-9;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||13|0|||Y|
-NOff-Page|conn@1||-12|3||||
-NOff-Page|conn@2||-12|-3||||
-IredFour:nand2HT;1{ic}|nand2HT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2HT;1{ic}|nand2HT@1||25.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-6|3||||
-NWire_Pin|pin@1||-6|1||||
-NWire_Pin|pin@2||-6|-1||||
-NWire_Pin|pin@3||-6|-3||||
-Ngeneric:Invisible-Pin|pin@4||0.5|25|||||ART_message(D5G6;)S[nand2HT]
-Ngeneric:Invisible-Pin|pin@5||-0.5|20|||||ART_message(D5G2;)S[one-parameter high-threshold NAND]
-Ngeneric:Invisible-Pin|pin@6||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 2]
-Ngeneric:Invisible-Pin|pin@7||16.5|-11.5|||||ART_message(D5G2;)S[X is drive strength,Pull-up has twice the strength,of the pull-down]
-Awire|net@0|||0|nand2HT@0|ina|-2.5|-1|pin@2||-6|-1
-Awire|net@1|||1800|nand2HT@0|out|2.5|0|conn@0|a|11|0
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-Awire|net@5|||900|pin@2||-6|-1|pin@3||-6|-3
-Awire|net@6|||0|pin@3||-6|-3|conn@2|y|-10|-3
-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY-1.5;)I2
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)I2
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NY-2;)F3.33
-X
-
-# Cell nand2HTen;1{ic}
-Cnand2HTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
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-NPin|pin@1||-1.5|-0.75|1|1||
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-NPin|pin@5||-0.5|2|1|1||
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-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
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-NPin|pin@9||-1.5|-2|1|1||
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-Ngeneric:Invisible-Pin|pin@13||-0.5|-1.25|||||ART_message(D5G1.5;)S[en]
-AThicker|net@0|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I78
-AThicker|net@1|||FS0|pin@3||-1.5|-1|pin@4||-2.5|-1|ART_color()I78
-AThicker|net@2|||FS0|pin@5||-0.5|2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@9||-1.5|-2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@10||-0.5|-2|pin@9||-1.5|-2|ART_color()I78
-AThicker|net@5|||FS0|pin@12||-1.5|1|pin@11||-2.5|1|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell nand2HTen;1{sch}
-Cnand2HTen;1{sch}||schematic|1021415734000|1159375721547||ATTR_Delay(D5G1;HNPX-16.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14.5|-2.5||||
-NOff-Page|conn@1||-14.5|2.5||||
-NOff-Page|conn@2||15|0||||
-IredFour:nand2HTen;1{ic}|nand2HTe@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2HTen;1{ic}|nand2HTe@1||30|13|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-6|2.5||||
-NWire_Pin|pin@1||-6|1||||
-NWire_Pin|pin@2||-6|-1||||
-NWire_Pin|pin@3||-6|-2.5||||
-Ngeneric:Invisible-Pin|pin@4||28.5|-11|||||ART_message(D5G2;)S[X is drive strength,Pull-up has twice the strength,of the pull-down]
-Ngeneric:Invisible-Pin|pin@5||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 2 (4/10 for enable)]
-Ngeneric:Invisible-Pin|pin@6||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND where ina is DC signal (enable)]
-Ngeneric:Invisible-Pin|pin@7||0.5|25|||||ART_message(D5G6;)S[nand2HTen]
-Awire|net@0|||0|nand2HTe@0|ina|-2.5|-1|pin@2||-6|-1
-Awire|net@1|||1800|nand2HTe@0|out|2.5|0|conn@2|a|13|0
-Awire|net@2|||1800|pin@1||-6|1|nand2HTe@0|inb|-2.5|1
-Awire|net@3|||1800|conn@1|y|-12.5|2.5|pin@0||-6|2.5
-Awire|net@4|||900|pin@0||-6|2.5|pin@1||-6|1
-Awire|net@5|||900|pin@2||-6|-1|pin@3||-6|-2.5
-Awire|net@6|||0|pin@3||-6|-2.5|conn@0|y|-12.5|-2.5
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F0.8
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)I2
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NX-0.5;Y2;)I2
-X
-
-# Cell nand2LT;1{ic}
-Cnand2LT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NPin|pin@0||-0.25|-2|1|1||
-NPin|pin@1||-1.5|-0.75|1|1||
-NPin|pin@2||-1.5|-1|1|1||
-NPin|pin@3||-2.5|-1||||
-NPin|pin@4||-0.5|2|1|1||
-NPin|pin@5||-1.5|2|1|1||
-NPin|pin@6||-1.5|-2|1|1||
-NPin|pin@7||-0.5|-2|1|1||
-NPin|pin@8||-2.5|1||||
-NPin|pin@9||-1.5|1|1|1||
-Nschematic:Bus_Pin|pin@10||2.5|0|-2|-2||
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-Nschematic:Bus_Pin|pin@12||-2.5|-1|-2|-2||
-AThicker|net@0|||FS0|pin@2||-1.5|-1|pin@3||-2.5|-1|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I78
-AThicker|net@2|||FS0|pin@4||-0.5|2|pin@5||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@9||-1.5|1|pin@8||-2.5|1|ART_color()I78
-AThicker|net@5|||FS0|pin@7||-0.5|-2|pin@6||-1.5|-2|ART_color()I78
-Eina||D5G1;|pin@12||I
-Einb||D5G1;|pin@11||I
-Eout||D5G1;|pin@10||O
-X
-
-# Cell nand2LT;1{sch}
-Cnand2LT;1{sch}||schematic|1021415734000|1159375693945||ATTR_Delay(D5G1;HNPX-17;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-17;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-17;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-17;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-17;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-17;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-17.5;Y-10.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-2.5||||
-NOff-Page|conn@1||-14|2.5||||
-NOff-Page|conn@2||14|0||||
-IredFour:nand2LT;1{ic}|nand2LT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2LT;1{ic}|nand2LT@1||25|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-6.5|-2.5||||
-NWire_Pin|pin@1||-6.5|-1||||
-NWire_Pin|pin@2||-6.5|1||||
-NWire_Pin|pin@3||-6.5|2.5||||
-Ngeneric:Invisible-Pin|pin@4||-1|16|||||ART_message(D5G2;)S[Sized assuming both inputs go low together]
-Ngeneric:Invisible-Pin|pin@5||22|-13|||||ART_message(D5G2;)S[X is drive strength,The pull-down is twice as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-Ngeneric:Invisible-Pin|pin@6||-1.5|18|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@7||-2|25|||||ART_message(D5G6;)S[nand2LT]
-Ngeneric:Invisible-Pin|pin@8||-2|20|||||ART_message(D5G2;)S[LO-threshold NAND]
-Awire|net@0|||1800|pin@1||-6.5|-1|nand2LT@0|ina|-2.5|-1
-Awire|net@1|||1800|nand2LT@0|out|2.5|0|conn@2|a|12|0
-Awire|net@2|||0|nand2LT@0|inb|-2.5|1|pin@2||-6.5|1
-Awire|net@3|||900|pin@1||-6.5|-1|pin@0||-6.5|-2.5
-Awire|net@4|||0|pin@0||-6.5|-2.5|conn@0|y|-12|-2.5
-Awire|net@5|||2700|pin@2||-6.5|1|pin@3||-6.5|2.5
-Awire|net@6|||0|pin@3||-6.5|2.5|conn@1|y|-12|2.5
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)I1
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY2;)I1
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NX-0.5;Y2;)F1.33
-X
-
-# Cell nand2LT_sy;1{ic}
-Cnand2LT_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NPin|pin@0||-1.5|-1|1|1||
-NPin|pin@1||-2.5|-1||||
-NPin|pin@2||-0.5|2|1|1||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-1.5|-2|1|1||
-NPin|pin@5||-0.5|-2|1|1||
-NPin|pin@6||-2.5|1||||
-NPin|pin@7||-1.5|1|1|1||
-Nschematic:Bus_Pin|pin@8||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@9||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@10||2.5|0|-2|-2||
-AThicker|net@0|||FS0|pin@0||-1.5|-1|pin@1||-2.5|-1|ART_color()I78
-AThicker|net@1|||FS0|pin@2||-0.5|2|pin@3||-1.5|2|ART_color()I78
-AThicker|net@2|||FS2700|pin@4||-1.5|-2|pin@3||-1.5|2|ART_color()I78
-AThicker|net@3|||FS0|pin@7||-1.5|1|pin@6||-2.5|1|ART_color()I78
-AThicker|net@4|||FS0|pin@5||-0.5|-2|pin@4||-1.5|-2|ART_color()I78
-Eina||D5G1;|pin@8||I
-Einb||D5G1;|pin@9||I
-Eout||D5G1;|pin@10||O
-X
-
-# Cell nand2LT_sy;1{sch}
-Cnand2LT_sy;1{sch}||schematic|1021415734000|1159375698504||ATTR_Delay(D5G1;HNPX-17;Y-10.5;)I100|ATTR_LEGATE(D5G1;HNPTX-17;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-17;Y-8.5;)I-1|ATTR_X(D5G1;HNOJPX-17;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-17;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-17;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-17;Y-9.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-17.25|2.5||||
-NOff-Page|conn@1||16.5|0|||Y|
-NOff-Page|conn@2||-17.5|-2.5|||Y|
-IredFour:nand2LT_sy;1{ic}|nand2LT_@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2LT_sy;1{ic}|nand2LT_@1||33.25|20.75|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@12||-7.5|1||||
-NWire_Pin|pin@13||-7.5|2.5||||
-NWire_Pin|pin@14||-7.5|-1||||
-NWire_Pin|pin@15||-7.5|-2.5||||
-Ngeneric:Invisible-Pin|pin@26||-2|16|||||ART_message(D5G2;)S[Sized assuming inputs go low together]
-Ngeneric:Invisible-Pin|pin@27||15|-14.5|||||ART_message(D5G2;)S[X is drive strength,The pull-down is twice as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-Ngeneric:Invisible-Pin|pin@28||-2|18|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@29||-2|20|||||ART_message(D5G2;)S[symetric LO-threshold NAND]
-Ngeneric:Invisible-Pin|pin@30||-2|25|||||ART_message(D5G6;)S[nand2LT_sy]
-Awire|net@0|||0|nand2LT_@0|ina|-2.5|-1|pin@14||-7.5|-1
-Awire|net@2|||0|nand2LT_@0|inb|-2.5|1|pin@12||-7.5|1
-Awire|net@27|||2700|pin@12||-7.5|1|pin@13||-7.5|2.5
-Awire|net@28|||900|pin@14||-7.5|-1|pin@15||-7.5|-2.5
-Awire|net@38|||0|conn@1|a|14.5|0|nand2LT_@0|out|2.5|0
-Awire|net@43|||0|pin@13||-7.5|2.5|conn@0|y|-15.25|2.5
-Awire|net@44|||1800|conn@2|y|-15.5|-2.5|pin@15||-7.5|-2.5
-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2;)I1
-Einb||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY2;)I1
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-2;)F1.33
-X
-
-# Cell nand2LTen;1{ic}
-Cnand2LTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-NPin|pin@1||-0.25|-2|1|1||
-NPin|pin@2||-1.5|-0.75|1|1||
-Nschematic:Bus_Pin|pin@3||-2.5|-1|-2|-2||
-NPin|pin@4||-1.5|-1|1|1||
-NPin|pin@5||-2.5|-1||||
-NPin|pin@6||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@7||-2.5|1|-2|-2||
-NPin|pin@8||-1.5|2|1|1||
-NPin|pin@9||-1.5|-2|1|1||
-NPin|pin@10||-0.5|-2|1|1||
-NPin|pin@11||-2.5|1||||
-NPin|pin@12||-1.5|1|1|1||
-Ngeneric:Invisible-Pin|pin@13||-0.5|-1.25|||||ART_message(D5G1.5;)S[en]
-AThicker|net@0|||FS3150|pin@1||-0.25|-2|pin@2||-1.5|-0.75|ART_color()I78
-AThicker|net@1|||FS0|pin@4||-1.5|-1|pin@5||-2.5|-1|ART_color()I78
-AThicker|net@2|||FS0|pin@6||-0.5|2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@9||-1.5|-2|pin@8||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@10||-0.5|-2|pin@9||-1.5|-2|ART_color()I78
-AThicker|net@5|||FS0|pin@12||-1.5|1|pin@11||-2.5|1|ART_color()I78
-Eina||D5G1;|pin@3||I
-Einb||D5G1;|pin@7||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell nand2LTen;1{sch}
-Cnand2LTen;1{sch}||schematic|1021415734000|1159375713300||ATTR_Delay(D5G1;HNPX-16.5;Y-9;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-14;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-10;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-8;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-12;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-13;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-11;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-3||||
-NOff-Page|conn@1||-14|3||||
-NOff-Page|conn@2||12.5|0||||
-IredFour:nand2LTen;1{ic}|nand2LTe@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2LTen;1{ic}|nand2LTe@1||30.5|13|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-NWire_Pin|pin@0||-6.5|3||||
-NWire_Pin|pin@1||-6.5|1||||
-NWire_Pin|pin@2||-6.5|-1||||
-NWire_Pin|pin@3||-6.5|-3||||
-Ngeneric:Invisible-Pin|pin@4||31|-10|||||ART_message(D5G2;)S[X is drive strength,Pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@5||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@6||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND where ina is DC signal (enable)]
-Ngeneric:Invisible-Pin|pin@7||-0.5|25|||||ART_message(D5G6;)S[nand2LTen]
-Awire|net@0|||0|nand2LTe@0|ina|-2.5|-1|pin@2||-6.5|-1
-Awire|net@1|||1800|nand2LTe@0|out|2.5|0|conn@2|a|10.5|0
-Awire|net@2|||1800|pin@1||-6.5|1|nand2LTe@0|inb|-2.5|1
-Awire|net@3|||1800|conn@1|y|-12|3|pin@0||-6.5|3
-Awire|net@4|||900|pin@0||-6.5|3|pin@1||-6.5|1
-Awire|net@5|||900|pin@2||-6.5|-1|pin@3||-6.5|-3
-Awire|net@6|||0|pin@3||-6.5|-3|conn@0|y|-12|-3
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F0.7
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)I1
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NX-1;Y2;)F1.033
-X
-
-# Cell nand2PH;1{ic}
-Cnand2PH;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-4.25|0|6|6|3200||ART_color()I78|ART_degrees()I800
-NThick-Circle|art@2||-2|2|8|7|RRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@3||-2|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||-2|-1|1|1|||ART_color()I78
-NThick-Circle|art@5||-2|1|1|1|||ART_color()I78
-NOpened-Thicker-Polygon|art@6||-0.75|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,0.25/0.5,0.25/0,-0.25/0]
-NOpened-Thicker-Polygon|art@7||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/-0.5,0.25/0.5]
-NPin|pin@0||1.5|0|1|1|R|
-NPin|pin@1||1|0|||R|
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@3||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@4||1.5|0|-2|-2||
-NPin|pin@5||-0.5|2.5||||
-NPin|pin@6||-0.5|1.62|1|1||
-Ngeneric:Invisible-Pin|pin@7||-0.5|2.5||||
-AThicker|net@0|||FS0|pin@0||1.5|0|pin@1||1|0|ART_color()I78
-AThicker|net@1|||FS2700|pin@6||-0.5|1.62|pin@5||-0.5|2.5|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@3||I
-Eout||D5G1;|pin@4||O
-EresetN||D5G2;|pin@7||I
-X
-
-# Cell nand2PH;1{sch}
-Cnand2PH;1{sch}||schematic|1021415734000|1159375653663||ATTR_Delay(D5G1;HNPX-15.5;Y-14.5;)I100|ATTR_LEGATE(D5G1;HNPTX-15.5;Y-18.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-15.5;Y-13.5;)I-1|ATTR_X(D5G1;HNOJPX-15.5;Y-12.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-15.5;Y-16.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-15.5;Y-17.5;)Sstrong1|ATTR_su(D5G1;HNPTX-15.5;Y-15.5;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||1|-10|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||6|-3|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/10.
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@1||-5|-3|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/10.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||6|6|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||14.5|6|||YRR|
-NOff-Page|conn@1||19.5|1|||Y|
-NOff-Page|conn@2||-13.5|6||||
-NOff-Page|conn@3||-15|-10||||
-NGround|gnd@0||1|-16||||
-NGround|gnd@1||-5|-7||||
-NGround|gnd@2||6|-7||||
-Inand2PH;1{ic}|nand2PH@0||26.75|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-2|16|||||ART_message(D5G2;)S[PH is Pulse High - This is a pulse control logic Nand,that has a high-going pulsed output,(inputs are low-going pulses)]
-Ngeneric:Invisible-Pin|pin@1||-2|23|||||ART_message(D5G6;)S[nand2PH]
-Ngeneric:Invisible-Pin|pin@2||16|-14.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-NWire_Pin|pin@3||6|1||||
-NWire_Pin|pin@4||-5|1||||
-NWire_Pin|pin@5||1|1||||
-NWire_Pin|pin@6||11|-3||||
-NWire_Pin|pin@7||11|6||||
-NWire_Pin|pin@8||-10|-3||||
-NWire_Pin|pin@9||-10|6||||
-NPower|pwr@0||-5|11||||
-NPower|pwr@1||6|11||||
-Awire|net@0|||2700|NMOSwk@0|s|6|-5|gnd@2||6|-5
-Awire|net@1|||900|pin@3||6|1|NMOSwk@0|d|6|-1
-Awire|net@2|||0|pin@6||11|-3|NMOSwk@0|g|9|-3
-Awire|net@3|||2700|NMOSwk@1|s|-5|-5|gnd@1||-5|-5
-Awire|net@4|||900|pin@4||-5|1|NMOSwk@1|d|-5|-1
-Awire|net@5|||1800|pin@8||-10|-3|NMOSwk@1|g|-8|-3
-Awire|net@6|||900|NMOS@0|s|1|-12|gnd@0||1|-14
-Awire|net@7|||900|pin@5||1|1|NMOS@0|d|1|-8
-Awire|net@8|||0|NMOS@0|g|-2|-10|conn@3|y|-13|-10
-Awire|net@9|||2700|PMOS@0|s|6|8|pwr@1||6|11
-Awire|net@10|||1800|PMOS@0|g|9|6|pin@7||11|6
-Awire|net@11|||2700|pin@3||6|1|PMOS@0|d|6|4
-Awire|net@12|||2700|PMOS@1|s|-5|8|pwr@0||-5|11
-Awire|net@13|||0|PMOS@1|g|-8|6|pin@9||-10|6
-Awire|net@14|||900|PMOS@1|d|-5|4|pin@4||-5|1
-Awire|net@15|||1800|pin@3||6|1|conn@1|a|17.5|1
-Awire|net@16|||1800|pin@5||1|1|pin@3||6|1
-Awire|net@17|||1800|pin@4||-5|1|pin@5||1|1
-Awire|net@18|||1800|pin@7||11|6|conn@0|y|12.5|6
-Awire|net@19|||900|pin@7||11|6|pin@6||11|-3
-Awire|net@20|||0|pin@9||-10|6|conn@2|y|-11.5|6
-Awire|net@21|||900|pin@9||-10|6|pin@8||-10|-3
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NX0.5;Y2;)F0.667
-Einb||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY1.5;)F0.667
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-1.5;)F1.67
-EresetN||D4G2;|conn@3|a|I|ATTR_le(D5G1;NX-2;Y2;)F0.333
-X
-
-# Cell nand2PHfk;1{ic}
-Cnand2PHfk;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/-0.5,0.25/0.5]
-NOpened-Thicker-Polygon|art@2||-0.75|0|0.5|1|||ART_color()I78|trace()V[-0.25/-0.5,-0.25/0.5,0.25/0.5,0.25/0,-0.25/0]
-NThick-Circle|art@3||-2|1|1|1|||ART_color()I78
-NThick-Circle|art@4||-2|-1|1|1|||ART_color()I78
-NThick-Circle|art@5||-2|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@6||-2|2|8|7|RRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@7||-4.25|0|6|6|3200||ART_color()I78|ART_degrees()I800
-Ngeneric:Invisible-Pin|pin@0||1|0.5|||||ART_message(D5G1.5;)S[keep]
-Ngeneric:Invisible-Pin|pin@1||-0.5|2.5||||
-NPin|pin@2||-0.5|1.62|1|1||
-NPin|pin@3||-0.5|2.5||||
-Nschematic:Bus_Pin|pin@4||1.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@5||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@6||-2.5|-1|-2|-2||
-NPin|pin@7||1|0|||R|
-NPin|pin@8||1.5|0|1|1|R|
-AThicker|net@0|||FS2700|pin@2||-0.5|1.62|pin@3||-0.5|2.5|ART_color()I78
-AThicker|net@1|||FS0|pin@8||1.5|0|pin@7||1|0|ART_color()I78
-Eina||D5G1;|pin@6||I
-Einb||D5G1;|pin@5||I
-Eout||D5G1;|pin@4||O
-EresetN||D5G2;|pin@1||I
-X
-
-# Cell nand2PHfk;1{sch}
-Cnand2PHfk;1{sch}||schematic|1021415734000|1159378861202||ATTR_Delay(D5G1;HNPX-15.5;Y-14.5;)I100|ATTR_LEGATE(D5G1;HNPTX-15.5;Y-18.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-15.5;Y-13.5;)I-1|ATTR_X(D5G1;HNOJPX-15.5;Y-12.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-15.5;Y-16.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-15.5;Y-17.5;)Sstrong1|ATTR_su(D5G1;HNPTX-15.5;Y-15.5;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||1|-10|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|6|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||6|6|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-13.5|6||||
-NOff-Page|conn@2||25|1|||Y|
-NOff-Page|conn@3||14.5|6|||YRR|
-NGround|gnd@0||1|-16||||
-IredFour:inv;1{ic}|inv@0||15.5|-4|RRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:invK;1{ic}|invK@0||10|-4|YRRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NOJPX1.5;Y2;)S@X/10.|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inand2PHfk;1{ic}|nand2PHf@0||27|13.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||24.5|-6|||||SIM_spice_card(D6G1;)S[.ic v(out) 0]
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-NWire_Pin|pin@2||15.5|-9||||
-NWire_Pin|pin@3||10|-9||||
-NWire_Pin|pin@4||15.5|1||||
-NWire_Pin|pin@5||1|1||||
-NWire_Pin|pin@6||-5|1||||
-NWire_Pin|pin@7||6|1||||
-Ngeneric:Invisible-Pin|pin@8||16|-14.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@9||0|26|||||ART_message(D5G6;)S[nand2PHfk]
-Ngeneric:Invisible-Pin|pin@10||0|19|||||ART_message(D5G2;)S[PH is Pulse High - This is a pulse control logic Nand,that has a high-going pulsed output,(inputs are low-going pulses),this version has a full keeper on the output]
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-NPower|pwr@1||-5|11||||
-Awire|net@0|||2700|PMOS@0|s|-5|8|pwr@1||-5|11
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-Awire|net@2|||900|PMOS@0|d|-5|4|pin@6||-5|1
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-Awire|net@5|||2700|pin@7||6|1|PMOS@1|d|6|4
-Awire|net@6|||900|NMOS@0|s|1|-12|gnd@0||1|-14
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-Awire|net@8|||0|NMOS@0|g|-2|-10|conn@0|y|-13|-10
-Awire|net@9|||900|pin@4||15.5|1|inv@0|in|15.5|-1.5
-Awire|net@10|||900|inv@0|out|15.5|-6.5|pin@2||15.5|-9
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-Awire|net@15|||0|pin@2||15.5|-9|pin@3||10|-9
-Awire|net@16|||1800|pin@4||15.5|1|conn@2|a|23|1
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-Awire|net@18|||1800|pin@5||1|1|pin@7||6|1
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-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)F0.667
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)D1.67
-EresetN||D4G2;|conn@0|a|I|ATTR_le(D5G1;NX-2;Y2;)F0.333
-X
-
-# Cell nand2Schmitt;1{ic}
-Cnand2Schmitt;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;HNPX-19.75;Y-15.5;)I1|ATTR_M(D5G1;HNPX2.5;Y-2;)I1|ATTR_S(D5G1.5;HNOJPX2;Y4;)SLE.getdrive()|ATTR_drive0(D5G1;HNPX2.5;Y-4;)Sstrong0|ATTR_drive1(D5G1;HNPX2.5;Y-5;)Sstrong1|ATTR_su(D5G1;HNPX-30.75;Y-20;)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NThick-Circle|art@4||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
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-AThicker|net@8|||FS3150|pin@19||-0.25|-2|pin@18||-1.5|-0.75|ART_color()I78
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-Einb||D5G1;|pin@13||I
-Eout||D5G1;|pin@12||O
-X
-
-# Cell nand2Schmitt;1{sch}
-Cnand2Schmitt;1{sch}||schematic|1021415734000|1159378938131||ATTR_Delay(D5G1;HNPX-27.5;Y-11.5;)I100|ATTR_LEGATE(D5G1;HNPX-16.5;Y-5;)I1|ATTR_M(D5G1;HNPX-27.5;Y-10.5;)I1|ATTR_S(D5G1;HNOJPX-27.5;Y-14.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPX-27.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPX-27.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPX-27.5;Y-9.5;)I-1|ATTR_verilog_template(D5G1;NTX6;Y-16;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||20|-2.5|||RR|
-NOff-Page|conn@1||20|11.5||||
-NOff-Page|conn@2||-23.5|9||||
-NOff-Page|conn@3||-23.5|3||||
-Inand2Schmitt;1{ic}|nand2Sch@0||29|22|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_LEGATE(D5G1;NPX-19.75;Y-15.5;)I1|ATTR_M(D5G1;NPX2.5;Y-2;)I1|ATTR_S(D5G1.5;NPX2;Y4;)I1|ATTR_drive0(D5G1;NPX2.5;Y-4;)Sstrong0|ATTR_drive1(D5G1;NPX2.5;Y-5;)Sstrong1|ATTR_su(D5G1;NPX-30.75;Y-20;)I-1
-IorangeTSMC090nm:NMOSx;1{ic}|nms0@0||-4|6|RRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1|ATTR_M(D5G1;NTY1;)I1
-IorangeTSMC090nm:NMOSx;1{ic}|nms0@1||-9.5|0|RRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1|ATTR_M(D5G1;NTY1;)I1
-Inms1;1{ic}|nms1@0||9.5|-6.5|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(P)I-1
-Inms1;1{ic}|nms1@1||0.5|-6.5|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(P)I-1
-Inms1;1{ic}|nms1@2||-11.5|-6.5|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(P)I-1
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-NWire_Pin|pin@2||-7.5|6||||
-NWire_Pin|pin@3||-6|6||||
-Ngeneric:Invisible-Pin|pin@4||16.5|-8.5|||||ART_message(D6G2;)S[inC should be tied,to out externally]
-NWire_Pin|pin@5||14.5|-2.5||||
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-NWire_Pin|pin@18||5|-6.5||||
-Ngeneric:Invisible-Pin|pin@19||-1|30.5|||||ART_message(D5G6;)S[nand2Schmitt]
-Ngeneric:Invisible-Pin|pin@20||-1|25.5|||||ART_message(D5G2;)S[schmitt trigger with enable on pull-down (inb)]
-Ngeneric:Invisible-Pin|pin@21||-1|23|||||ART_message(D5G2;)S["hysteresis on ina, NOTE connect out to inC externally"]
-Ipms1;1{ic}|pms1@0||9.5|1.5|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3;)SLE.getdrive()|ATTR_su(P)I-1
-Ipms1;1{ic}|pms1@1||0.5|1.5|YRR||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3;)SLE.getdrive()|ATTR_su(P)I-1
-Ipms1;1{ic}|pms1@2||-2|15.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3;)SLE.getdrive()|ATTR_su(P)I-1
-Awire|net@0|||900|pin@3||-6|6|pin@1||-6|6
-Awire|net@1|||0|pin@1||-6|6|pin@0||-7.5|6
-Awire|net@2|||2700|pin@0||-7.5|6|pin@2||-7.5|6
-Awire|net@3|||0|pin@3||-6|6|nms0@0|s|-6|6
-Awire|net@4|||2700|nms0@1|d|-7.5|0|pin@2||-7.5|6
-Awire|net@5|||1800|pin@8||-2|11.5|conn@1|a|18|11.5
-Awire|net@6|||1800|pin@5||14.5|-2.5|conn@0|y|18|-2.5
-Awire|net@7|||2700|pin@6||14.5|-6.5|pin@5||14.5|-2.5
-Awire|net@8|||2700|pin@5||14.5|-2.5|pin@7||14.5|1.5
-Awire|net@9|||1800|nms1@0|g|12.5|-6.5|pin@6||14.5|-6.5
-Awire|net@10|||0|pin@7||14.5|1.5|pms1@0|g|12.5|1.5
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-Awire|net@15|||0|pin@9||-14.5|3|conn@3|y|-21.5|3
-Awire|net@16|||1800|pin@10||-14.5|15.5|pms1@2|g|-5|15.5
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-Awire|net@28|||900|pin@15||5|-2.5|pin@18||5|-6.5
-Awire|net@29|||2700|nms1@0|d|9.5|-4.5|pin@16||9.5|-2.5
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-Awire|net@31|||1800|pms1@1|g|3.5|1.5|pin@17||5|1.5
-Awire|net@32|||0|pin@18||5|-6.5|nms1@1|g|3.5|-6.5
-EinC||D5G2;|conn@0|y|I|ATTR_le(D5G1;NY-2;)F1.17
-Eina||D5G2;|conn@3|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-Einb||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY1.5;)F0.67
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY2;)D1.33
-X
-
-# Cell nand2V;1{ic}
-Cnand2V;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1.5;Y-4.5;)I100|ATTR_M(D5G1;HNPX3;Y1.5;)I1|ATTR_WN(D5G1.5;HNPX0.5;Y-3.5;)I1|ATTR_WP(D5G1.5;HNPX0.5;Y3;)I1|ATTR_drive0(D5G1;HNPX2;Y-5.5;)Sstrong0|ATTR_drive1(D5G1;HNPX2;Y-6.5;)Sstrong1|ATTR_su(D5G1;HNPX-16.25;Y-13.75;)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
-NPin|pin@0||-0.25|-2|1|1||
-NPin|pin@1||-1.5|-0.75|1|1||
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-NPin|pin@3||-2.5|-1||||
-NPin|pin@4||-0.5|2|1|1||
-NPin|pin@5||-1.5|2|1|1||
-NPin|pin@6||-1.5|-2|1|1||
-NPin|pin@7||-0.5|-2|1|1||
-NPin|pin@8||-2.5|1||||
-NPin|pin@9||-1.5|1|1|1||
-Nschematic:Bus_Pin|pin@10||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@11||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@12||2.5|0|-2|-2||
-AThicker|net@0|||FS0|pin@2||-1.5|-1|pin@3||-2.5|-1|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I78
-AThicker|net@2|||FS0|pin@4||-0.5|2|pin@5||-1.5|2|ART_color()I78
-AThicker|net@3|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
-AThicker|net@4|||FS0|pin@9||-1.5|1|pin@8||-2.5|1|ART_color()I78
-AThicker|net@5|||FS0|pin@7||-0.5|-2|pin@6||-1.5|-2|ART_color()I78
-Eina||D5G1;|pin@10||I
-Einb||D5G1;|pin@11||I
-Eout||D5G1;|pin@12||O
-X
-
-# Cell nand2V;1{sch}
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-NOff-Page|conn@2||-14|-1||||
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-X
-
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-Cnand2V_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-5.5;)I100|ATTR_M(D5G1;HNPX2;Y-4.5;)I1|ATTR_WN(D5G1.5;HNPX1;Y-3.5;)I1|ATTR_WP(D5G1.5;HNPX1;Y3;)I1|ATTR_drive0(D5G1;HNPX2;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPX2;Y-7.5;)Sstrong1|ATTR_su(D5G1;HNPX-19.5;Y-10.25;)I-1|prototype_center()I[6000,0]
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-X
-
-# Cell nand2V_sy;1{sch}
-Cnand2V_sy;1{sch}||schematic|1021415734000|1084377390000||ATTR_Delay(D5G1;HNPX-17.5;Y-7;)I100|ATTR_M(D5G1;HNPX-17.5;Y-3;)I1|ATTR_WN(D5G1;HNPX-17.5;Y-5;)I1|ATTR_WP(D5G1;HNPX-17.5;Y-4;)I1|ATTR_drive0(D5G1;HNPX-17.5;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPX-17.5;Y-9;)Sstrong1|ATTR_su(D5G1;HNPX-17.5;Y-6;)I-1|ATTR_verilog_template(D5G1;NTX2;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-NOff-Page|conn@1||0|11|||R|
-NOff-Page|conn@2||-14|-1||||
-Inand2V_sy;1{ic}|nand2V_s@0||17.5|13|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-5.5;)I100|ATTR_M(D5G1;NPX2;Y-4.5;)I1|ATTR_WN(D5G1.5;NPX1;Y-3.5;)I1|ATTR_WP(D5G1.5;NPX1;Y3;)I1|ATTR_drive0(D5G1;NPX2;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;NPX2;Y-7.5;)Sstrong1|ATTR_su(D5G1;NPX-19.5;Y-10.25;)I-1
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-Ipms1;1{ic}|pms1@1||5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3;)SLE.getdrive()|ATTR_su(OJP)S@su
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-Awire|net@1|||0|pin@3||9|-4.25|nms2_sy@0|g2|3|-4.25
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-Awire|net@4|||900|pin@5||-9|-1|pin@2||-9|-8.25
-Awire|net@5|||900|conn@1|a|0|9|pin@7||0|0
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-X
-
-# Cell nand2Vn;1{ic}
-Cnand2Vn;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1.5;Y-5.5;)I100|ATTR_M(D5G1;HNPX1.5;Y-4.5;)I1|ATTR_WN(D5G1.5;HNPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;HNPX0.5;Y3;)I1|ATTR_drive0(D5G1;HNPX1.5;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPX1.5;Y-7.5;)Sstrong1|ATTR_su(D5G1;HNPX-19;Y-4;)I-1|prototype_center()I[6000,0]
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-X
-
-# Cell nand2Vn;1{sch}
-Cnand2Vn;1{sch}||schematic|1021415734000|1025280871000||ATTR_Delay(D5G1;HNPX-14;Y1.5;)I100|ATTR_M(D5G1;HNPX-14;Y5.5;)I1|ATTR_WN(D5G1;HNPX-14;Y3.5;)I1|ATTR_WP(D5G1;HNPX-14;Y4.5;)I1|ATTR_drive0(D5G1;HNPX-14;Y0.5;)Sstrong0|ATTR_drive1(D5G1;HNPX-14;Y-0.5;)Sstrong1|ATTR_su(D5G1;HNPX-14;Y2.5;)I-1|prototype_center()I[0,0]
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-Inand2Vn;1{ic}|nand2Vn@0||14.5|11|||D0G4;|ATTR_Delay(D5G1;NPX1.5;Y-5.5;)I100|ATTR_M(D5G1;NPX1.5;Y-4.5;)I1|ATTR_WN(D5G1.5;NPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;NPX0.5;Y3;)I1|ATTR_drive0(D5G1;NPX1.5;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;NPX1.5;Y-7.5;)Sstrong1|ATTR_su(D5G1;NPX-19;Y-4;)I-1
-NWire_Pin|pin@0||-6|-1||||
-NWire_Pin|pin@1||-6|1||||
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-X
-
-# Cell nand2Vn_sy;1{ic}
-Cnand2Vn_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1;Y-5;)I100|ATTR_M(D5G1;HNPX1;Y-4;)I1|ATTR_WN(D5G1.5;HNPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;HNPX0.5;Y3;)I1|ATTR_drive0(D5G1;HNPX1;Y-6;)Sstrong0|ATTR_drive1(D5G1;HNPX1;Y-7;)Sstrong1|ATTR_su(D5G1;HNPX-21.75;Y-2.5;)I-1|prototype_center()I[6000,0]
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-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-NThick-Circle|art@2||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
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-NThick-Circle|art@5||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@6||-1.5|1|1|1|||ART_color()I78
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-Eina||D5G1;|pin@9||I
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-X
-
-# Cell nand2Vn_sy;1{sch}
-Cnand2Vn_sy;1{sch}||schematic|1021415734000|1025280871000||ATTR_Delay(D5G1;HNPX-16.5;Y3.5;)I100|ATTR_M(D5G1;HNPX-16.5;Y7.5;)I1|ATTR_WN(D5G1;HNPX-16.5;Y5.5;)I1|ATTR_WP(D5G1;HNPX-16.5;Y6.5;)I1|ATTR_drive0(D5G1;HNPX-16.5;Y2.5;)Sstrong0|ATTR_drive1(D5G1;HNPX-16.5;Y1.5;)Sstrong1|ATTR_su(D5G1;HNPX-16.5;Y4.5;)I-1|prototype_center()I[0,0]
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-Inand2Vn_sy;1{ic}|nand2Vn_@0||15|10.5|||D0G4;|ATTR_Delay(D5G1;NPX1;Y-5;)I100|ATTR_M(D5G1;NPX1;Y-4;)I1|ATTR_WN(D5G1.5;NPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;NPX0.5;Y3;)I1|ATTR_drive0(D5G1;NPX1;Y-6;)Sstrong0|ATTR_drive1(D5G1;NPX1;Y-7;)Sstrong1|ATTR_su(D5G1;NPX-21.75;Y-2.5;)I-1
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-X
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-Cnand2_sy;1{sch}||schematic|1021415734000|1159375680290||ATTR_Delay(D5G1;HNPX-16.5;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-12.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-7.5;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-6.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-10.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-11.5;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-9.5;)I-1|prototype_center()I[0,0]
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-X
-
-# Cell nand2en;1{ic}
-Cnand2en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-3;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-X
-
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-Cnand2en;1{sch}||schematic|1021415734000|1159375684491||ATTR_Delay(D5G1;HNPX-16.5;Y-10;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-8;)I-1|ATTR_X(D5G1;HNPX-16.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-9;)I-1|prototype_center()I[0,0]
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-X
-
-# Cell nand2k;1{ic}
-Cnand2k;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEKEEPER(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sweak0|ATTR_drive1(D5G1;HPT)Sweak1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-
-# Cell nand2k;1{sch}
-Cnand2k;1{sch}||schematic|1021415734000|1159379778053||ATTR_Delay(D5G1;HNPX-16.5;Y-11;)I100|ATTR_LEKEEPER(D5G1;HNPX-16.5;Y-14;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-16.5;Y-8;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16.5;Y-12;)Sweak0|ATTR_drive1(D5G1;HNPTX-16.5;Y-13;)Sweak1|ATTR_su(D5G1;HNPTX-16.5;Y-10;)I-1|prototype_center()I[0,0]
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-IredFour:nand2;1{ic}|nand2@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand2k;1{ic}|nand2k@0||18.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.5;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-3.5|20.5|||||ART_message(D5G6;)S[nand2k]
-Ngeneric:Invisible-Pin|pin@1||-3.5|15.5|||||ART_message(D5G2;)S[one-parameter NAND]
-Ngeneric:Invisible-Pin|pin@2||-3.5|13|||||ART_message(D5G2;)S[P to N width ratio is 1 to 1]
-Ngeneric:Invisible-Pin|pin@3||16.5|-11.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
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-X
-
-# Cell nand2n;1{ic}
-Cnand2n;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2.5;)I100|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.5;Y2.5;)S"LE.subdrive(\"nand2\", \"X\")"|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
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-NThick-Circle|art@4||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@5||-1.5|1|1|1|||ART_color()I78
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-X
-
-# Cell nand2n;1{sch}
-Cnand2n;1{sch}||schematic|1021415734000|1197016374252||ATTR_Delay(D5G1;HNPX-19;Y-0.5;)I100|ATTR_LEPARALLGRP(D5G1;HNPTX-19;Y-1.5;)I-1|ATTR_X(D5G1;HNOJPX-19;Y0.75;)S"LE.subdrive(\"nand2\", \"X\")"|ATTR_drive0(D5G1;HNPTX-19;Y-2.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-19;Y-3.5;)Sstrong1|ATTR_su(D5G1;HNPTX-19;Y-4.5;)I-1|prototype_center()I[0,0]
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-X
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-# Cell nand2n_sy;1{ic}
-Cnand2n_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2.5;)I100|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2;Y2.5;)S"LE.subdrive(\"nand2_sy1\", \"X\")"|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-X
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-# Cell nand2n_sy;1{sch}
-Cnand2n_sy;1{sch}||schematic|1021415734000|1100128351213||ATTR_Delay(D5G1;HNPX-20;Y4;)I100|ATTR_LEPARALLGRP(D5G1;HNPTX-20;Y5;)I-1|ATTR_X(D5G1;HNOJPX-20;Y6;)S"LE.subdrive(\"nand2_sy1\", \"X\")"|ATTR_drive0(D5G1;HNPTX-20;Y3;)Sstrong0|ATTR_drive1(D5G1;HNPTX-20;Y2;)Sstrong1|ATTR_su(D5G1;HNPTX-20;Y1;)I-1|prototype_center()I[0,0]
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-Inand2n_sy;1{ic}|nand2n_s@0||12.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2.5;)I100|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2;Y2.5;)S"LE.subdrive(\"nand2_sy1\", \"X\")"|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-X
-
-# Cell nand3;1{ic}
-Cnand3;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
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-AThicker|net@6|||FS3150|pin@15||-0.25|-3|pin@14||-1.5|-1.75|ART_color()I78
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-X
-
-# Cell nand3;1{sch}
-Cnand3;1{sch}||schematic|1021415734000|1159379591711||ATTR_Delay(D5G1;HNPX-14.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-15;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-14.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-14.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-14.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-14.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-14.5;Y-10;)I-1|prototype_center()I[0,0]
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-IredFour:nand3;1{ic}|nand3@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3;1{ic}|nand3@1||27.5|19|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Ngeneric:Invisible-Pin|pin@1||0|16.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 3]
-Ngeneric:Invisible-Pin|pin@2||0|19|||||ART_message(D5G2;)S["three input, fixed-size NAND"]
-Ngeneric:Invisible-Pin|pin@3||-0.5|25|||||ART_message(D5G6;)S[nand3]
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-Awire|net@3|||0|nand3@0|inb|-2.5|0|conn@2|y|-7|0
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-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY2;)I3
-X
-
-# Cell nand3LT;1{ic}
-Cnand3LT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
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-NThick-Circle|art@3||2|0|1|1|||ART_color()I78
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-NPin|pin@1||-1.5|-1.75|1|1||
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-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
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-Eina||D5G1;|pin@2||I
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-X
-
-# Cell nand3LT;1{sch}
-Cnand3LT;1{sch}||schematic|1021415734000|1159376000942||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-22.5|-2||||
-NOff-Page|conn@1||-11|0|||Y|
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-NOff-Page|conn@3||-19.5|2||||
-IredFour:nand3LT;1{ic}|nand3LT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3LT;1{ic}|nand3LT@1||27.5|12|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-1|15.5|||||ART_message(D5G2;)S[Sized assuming that all 3 inputs go low together]
-Ngeneric:Invisible-Pin|pin@1||28|-11|||||ART_message(D5G2;)S[X is drive strength,Three pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@2||-0.5|18|||||ART_message(D5G2;)S[P to N width ratio is 2/3 to 3]
-Ngeneric:Invisible-Pin|pin@3||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND]
-Ngeneric:Invisible-Pin|pin@4||-0.5|25|||||ART_message(D5G6;)S[nand3LT]
-Awire|net@0|||0|nand3LT@0|inc|-2.5|2|conn@3|y|-17.5|2
-Awire|net@1|||1800|conn@0|y|-20.5|-2|nand3LT@0|ina|-2.5|-2
-Awire|net@2|||1800|nand3LT@0|out|2.5|0|conn@2|a|10.5|0
-Awire|net@3|||0|nand3LT@0|inb|-2.5|0|conn@1|y|-9|0
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-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)F1.22
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-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY-2.5;)F1.67
-X
-
-# Cell nand3LT_sy3;1{ic}
-Cnand3LT_sy3;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NOpened-Thicker-Polygon|art@3||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-Ngeneric:Invisible-Pin|pin@0||-0.5|-2.5|||||ART_message(D5G1;)S[sy3]
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-NPin|pin@4||-1.5|0|1|1||
-NPin|pin@5||-2.5|0||||
-NPin|pin@6||-0.5|-3|1|1||
-NPin|pin@7||-1.5|-3|1|1||
-NPin|pin@8||-1.5|3|1|1||
-Nschematic:Bus_Pin|pin@9||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@10||-2.5|0|-2|-2||
-NPin|pin@11||-0.5|3|1|1||
-NPin|pin@12||-2.5|-2||||
-NPin|pin@13||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@14||-2.5|-2|-2|-2||
-AThicker|net@0|||FS0|pin@2||-1.5|2|pin@1||-2.5|2|ART_color()I78
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-Eina||D5G1;|pin@14||I
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-X
-
-# Cell nand3LT_sy3;1{sch}
-Cnand3LT_sy3;1{sch}||schematic|1021415734000|1159376011909||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
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-X
-
-# Cell nand3LT_sy6;1{ic}
-Cnand3LT_sy6;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
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-X
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-# Cell nand3LT_sy6;1{sch}
-Cnand3LT_sy6;1{sch}||schematic|1021415734000|1159379295448||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
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-X
-
-# Cell nand3LTen;1{ic}
-Cnand3LTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
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-
-# Cell nand3LTen;1{sch}
-Cnand3LTen;1{sch}||schematic|1021415734000|1159376004533||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
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-Inand3LTen;1{ic}|nand3LTe@1||27.5|12|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-Ngeneric:Invisible-Pin|pin@3||28|-11|||||ART_message(D5G2;)S[X is drive strength,Three pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@4||-1|15.5|||||ART_message(D5G2;)S[Sized assuming that all 3 inputs go low together]
-Awire|net@0|||0|nand3LTe@0|inc|-2.5|2|conn@0|y|-17.5|2
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-X
-
-# Cell nand3LTen_sy;1{ic}
-Cnand3LTen_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
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-# Cell nand3LTen_sy;1{sch}
-Cnand3LTen_sy;1{sch}||schematic|1021415734000|1159376008564||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-IredFour:nand3LTen_sy;1{ic}|nand3LTe@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3LTen_sy;1{ic}|nand3LTe@1||27.5|12|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-1|15.5|||||ART_message(D5G2;)S[Sized assuming that all 3 inputs go low together]
-Ngeneric:Invisible-Pin|pin@1||28|-11|||||ART_message(D5G2;)S[X is drive strength,Three pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@2||-0.5|18|||||ART_message(D5G2;)S[P to N width ratio is 2/3 to 3]
-Ngeneric:Invisible-Pin|pin@3||-0.5|20|||||ART_message(D5G2;)S[one-parameter low-threshold NAND where ina is DC signal (enable) and inb/c are symmetric]
-Ngeneric:Invisible-Pin|pin@4||-0.5|25|||||ART_message(D5G6;)S[nand3LTen_sy]
-Awire|net@0|||0|nand3LTe@0|inc|-2.5|2|conn@3|y|-17.5|2
-Awire|net@1|||1800|conn@0|y|-20.5|-2|nand3LTe@0|ina|-2.5|-2
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-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F1.033
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-X
-
-# Cell nand3MLT;1{ic}
-Cnand3MLT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|0|1|1|||ART_color()I78|trace()V[-0.5/-0.5,-0.5/0.5,0/-0.5,0.5/0.5,0.5/-0.5]
-NOpened-Thicker-Polygon|art@2||0.75|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@3||-0.5|0|6|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I78
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-NPin|pin@1||-1.5|-1.75|1|1||
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-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
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-AThicker|net@1|||FS0|pin@3||-1.5|-2|pin@4||-2.5|-2|ART_color()I78
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-Eina||D5G1;|pin@2||I
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-Eout||D5G1;|pin@7||O
-X
-
-# Cell nand3MLT;1{sch}
-Cnand3MLT;1{sch}||schematic|1021415734000|1159375997206||ATTR_Delay(D5G1;HNPX-15.5;Y-7.5;)I100|ATTR_LEGATE(D5G1;HNPTX-16.5;Y-12.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-16;Y-8.5;)I-1|ATTR_X(D5G1;HNOJPX-16;Y-6.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-16;Y-10.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-11.5;)Sstrong1|ATTR_su(D5G1;HNPTX-16.5;Y-9.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-21|-2|||Y|
-NOff-Page|conn@1||-9|0|||Y|
-NOff-Page|conn@2||13.5|0|||Y|
-NOff-Page|conn@3||-17.5|2||||
-IredFour:nand3MLT;1{ic}|nand3MLT@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3MLT;1{ic}|nand3MLT@1||30|17|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||1|11|||||ART_message(D5G2;)S[Sized assuming at least 2 of 3 inputs go low together]
-Ngeneric:Invisible-Pin|pin@1||23.5|-10|||||ART_message(D5G2;)S[X is drive strength,Two pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@2||-0.5|13|||||ART_message(D5G2;)S[P to N width ratio is 1 to 3]
-Ngeneric:Invisible-Pin|pin@3||-0.5|15.5|||||ART_message(D5G2;)S[one-parameter NAND]
-Ngeneric:Invisible-Pin|pin@4||-0.5|20.5|||||ART_message(D5G6;)S[nand3LT]
-Awire|net@0|||0|nand3MLT@0|inc|-2.5|2|conn@3|y|-15.5|2
-Awire|net@1|||0|nand3MLT@0|ina|-2.5|-2|conn@0|y|-19|-2
-Awire|net@2|||1800|nand3MLT@0|out|2.5|0|conn@2|a|11.5|0
-Awire|net@3|||0|nand3MLT@0|inb|-2.5|0|conn@1|y|-7|0
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY1.5;)F1.33
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)F1.33
-Einc||D5G2;|conn@3|y|I|ATTR_le(D5G1;NX-1;Y-2;)F1.33
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY-2.5;)I2
-X
-
-# Cell nand3_sy6;1{ic}
-Cnand3_sy6;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-Ngeneric:Invisible-Pin|pin@0||-0.5|-2.5|||||ART_message(D5G1;)Ssy6
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-Nschematic:Bus_Pin|pin@14||-2.5|-2|-2|-2||
-AThicker|net@0|||FS1800|pin@1||-2.5|2|pin@2||-1.5|2|ART_color()I78
-AThicker|net@1|||FS1800|pin@5||-2.5|0|pin@4||-1.5|0|ART_color()I78
-AThicker|net@2|||FS1800|pin@7||-1.5|-3|pin@6||-0.5|-3|ART_color()I78
-AThicker|net@3|||FS900|pin@8||-1.5|3|pin@7||-1.5|-3|ART_color()I78
-AThicker|net@4|||FS1800|pin@8||-1.5|3|pin@11||-0.5|3|ART_color()I78
-AThicker|net@5|||FS1800|pin@12||-2.5|-2|pin@13||-1.5|-2|ART_color()I78
-Eina||D5G1;|pin@14||I
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-Einc||D5G1;|pin@3||I
-Eout||D5G1;|pin@9||O
-X
-
-# Cell nand3_sy6;1{sch}
-Cnand3_sy6;1{sch}||schematic|1021415734000|1159379441239||ATTR_Delay(D5G1;HNPX-25.5;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-26;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-25.75;Y-10.5;)I-1|ATTR_X(D5G1;HNOJPX-25.5;Y-8.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-25.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-25.5;Y-13.5;)Sstrong1|ATTR_su(D5G1;HNPTX-26.5;Y-11.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-19.5|2||||
-NOff-Page|conn@1||12.5|0|||Y|
-NOff-Page|conn@2||-11|0|||Y|
-NOff-Page|conn@3||-22.5|-2||||
-IredFour:nand3_sy6;1{ic}|nand3LT_@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-4;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3_sy6;1{ic}|nand3LT_@1||27.5|12|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-0.5|25|||||ART_message(D5G6;)Snand3_sy6
-Ngeneric:Invisible-Pin|pin@1||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND]
-Ngeneric:Invisible-Pin|pin@2||-0.5|18|||||ART_message(D5G2;)SP to N width ratio is 2 to 3
-Ngeneric:Invisible-Pin|pin@3||28|-11|||||ART_message(D5G2;)S[X is drive strength,Three pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@4||-1|15.5|||||ART_message(D5G2;)SSized assuming that only 1 input goes low at a time
-Awire|net@0|||0|nand3LT_@0|inc|-2.5|2|conn@0|y|-17.5|2
-Awire|net@1|||1800|conn@3|y|-20.5|-2|nand3LT_@0|ina|-2.5|-2
-Awire|net@2|||1800|nand3LT_@0|out|2.5|0|conn@1|a|10.5|0
-Awire|net@3|||0|nand3LT_@0|inb|-2.5|0|conn@2|y|-9|0
-Eina||D5G2;|conn@3|a|I|ATTR_le(D5G1;NY-1.5;)S1.67
-Einb||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY1.5;)S1.67
-Einc||D5G2;|conn@0|y|I|ATTR_le(D5G1;NX-1;Y-2;)S1.67
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-2.5;)S3
-X
-
-# Cell nand3en;1{ic}
-Cnand3en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|6|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I78
-Ngeneric:Invisible-Pin|pin@0||-0.5|-2.25|||||ART_message(D5G1.5;)S[en]
-NPin|pin@1||-0.25|-3|1|1||
-NPin|pin@2||-1.5|-1.75|1|1||
-Nschematic:Bus_Pin|pin@3||-2.5|-2|-2|-2||
-NPin|pin@4||-1.5|-2|1|1||
-NPin|pin@5||-2.5|-2||||
-NPin|pin@6||-0.5|3|1|1||
-Nschematic:Bus_Pin|pin@7||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@8||2.5|0|-2|-2||
-NPin|pin@9||-1.5|3|1|1||
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-NPin|pin@13||-1.5|0|1|1||
-Ngeneric:Invisible-Pin|pin@14||-2.5|2||||
-NPin|pin@15||-1.5|2|1|1||
-NPin|pin@16||-2.5|2||||
-AThicker|net@0|||FS3150|pin@1||-0.25|-3|pin@2||-1.5|-1.75|ART_color()I78
-AThicker|net@1|||FS0|pin@4||-1.5|-2|pin@5||-2.5|-2|ART_color()I78
-AThicker|net@2|||FS0|pin@6||-0.5|3|pin@9||-1.5|3|ART_color()I78
-AThicker|net@3|||FS2700|pin@10||-1.5|-3|pin@9||-1.5|3|ART_color()I78
-AThicker|net@4|||FS0|pin@11||-0.5|-3|pin@10||-1.5|-3|ART_color()I78
-AThicker|net@5|||FS0|pin@13||-1.5|0|pin@12||-2.5|0|ART_color()I78
-AThicker|net@6|||FS0|pin@15||-1.5|2|pin@16||-2.5|2|ART_color()I78
-Eina||D5G1;|pin@3||I
-Einb||D5G1;|pin@7||I
-Einc||D5G1;|pin@14||I
-Eout||D5G1;|pin@8||O
-X
-
-# Cell nand3en;1{sch}
-Cnand3en;1{sch}||schematic|1021415734000|1159375988991||ATTR_Delay(D5G1;HNPX-14.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-15;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-14.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-14.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-14.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-14.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-14.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-23.5|-2||||
-NOff-Page|conn@1||-9|0|||Y|
-NOff-Page|conn@2||15.5|0|||Y|
-NOff-Page|conn@3||-18|2||||
-IredFour:nand3en;1{ic}|nand3en@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3en;1{ic}|nand3en@1||31.5|13|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-0.5|19|||||ART_message(D5G2;)S["three input, fixed-size NAND where ina is DC signal (enable)"]
-Ngeneric:Invisible-Pin|pin@1||-0.5|25|||||ART_message(D5G6;)S[nand3en]
-Ngeneric:Invisible-Pin|pin@2||0|16.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 3]
-Ngeneric:Invisible-Pin|pin@3||30.5|-13|||||ART_message(D5G2;)S[X is drive strength,Each pull-up has the same strength,as the pull-down]
-Awire|net@0|||0|nand3en@0|inc|-2.5|2|conn@3|y|-16|2
-Awire|net@1|||0|nand3en@0|ina|-2.5|-2|conn@0|y|-21.5|-2
-Awire|net@2|||1800|nand3en@0|out|2.5|0|conn@2|a|13.5|0
-Awire|net@3|||0|nand3en@0|inb|-2.5|0|conn@1|y|-7|0
-Eina||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F1.067
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY1.5;)F1.67
-Einc||D5G2;|conn@3|y|I|ATTR_le(D5G1;NX-1;Y-2;)F1.67
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY-2.5;)F2.33
-X
-
-# Cell nand3en_sy;1{ic}
-Cnand3en_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I78
-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I78|ART_degrees()F[0.0,3.1415927]
-Ngeneric:Invisible-Pin|pin@0||-0.5|1|||||ART_message(D5G1;)S[sy2]
-NPin|pin@1||-2.5|2||||
-NPin|pin@2||-1.5|2|1|1||
-Ngeneric:Invisible-Pin|pin@3||-2.5|2||||
-NPin|pin@4||-1.5|0|1|1||
-NPin|pin@5||-2.5|0||||
-NPin|pin@6||-0.5|-3|1|1||
-NPin|pin@7||-1.5|-3|1|1||
-NPin|pin@8||-1.5|3|1|1||
-Nschematic:Bus_Pin|pin@9||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@10||-2.5|0|-2|-2||
-NPin|pin@11||-0.5|3|1|1||
-NPin|pin@12||-2.5|-2||||
-NPin|pin@13||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@14||-2.5|-2|-2|-2||
-NPin|pin@15||-1.5|-1.75|1|1||
-NPin|pin@16||-0.25|-3|1|1||
-Ngeneric:Invisible-Pin|pin@17||-0.5|-2.25|||||ART_message(D5G1.5;)S[en]
-AThicker|net@0|||FS0|pin@2||-1.5|2|pin@1||-2.5|2|ART_color()I78
-AThicker|net@1|||FS0|pin@4||-1.5|0|pin@5||-2.5|0|ART_color()I78
-AThicker|net@2|||FS0|pin@6||-0.5|-3|pin@7||-1.5|-3|ART_color()I78
-AThicker|net@3|||FS2700|pin@7||-1.5|-3|pin@8||-1.5|3|ART_color()I78
-AThicker|net@4|||FS0|pin@11||-0.5|3|pin@8||-1.5|3|ART_color()I78
-AThicker|net@5|||FS0|pin@13||-1.5|-2|pin@12||-2.5|-2|ART_color()I78
-AThicker|net@6|||FS3150|pin@16||-0.25|-3|pin@15||-1.5|-1.75|ART_color()I78
-Eina||D5G1;|pin@14||I
-Einb||D5G1;|pin@10||I
-Einc||D5G1;|pin@3||I
-Eout||D5G1;|pin@9||O
-X
-
-# Cell nand3en_sy;1{sch}
-Cnand3en_sy;1{sch}||schematic|1021415734000|1159375992880||ATTR_Delay(D5G1;HNPX-14.5;Y-8;)I100|ATTR_LEGATE(D5G1;HNPTX-15;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-14.5;Y-9;)I-1|ATTR_X(D5G1;HNOJPX-14.5;Y-7;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-14.5;Y-11;)Sstrong0|ATTR_drive1(D5G1;HNPTX-14.5;Y-12;)Sstrong1|ATTR_su(D5G1;HNPTX-14.5;Y-10;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-18|2||||
-NOff-Page|conn@1||15.5|0|||Y|
-NOff-Page|conn@2||-9|0|||Y|
-NOff-Page|conn@3||-23.5|-2||||
-IredFour:nand3en_sy;1{ic}|nand3en_@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX4;Y-2.5;)S@Delay|ATTR_X(D5G1.5;NOJPX3;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand3en_sy;1{ic}|nand3en_@1||31.5|13|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;Y2.5;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||-0.5|19.5|||||ART_message(D5G2;)S["three input, fixed-size NAND where ina is DC signal (enable) and inb/c are symmetric"]
-Ngeneric:Invisible-Pin|pin@1||30.5|-13|||||ART_message(D5G2;)S[X is drive strength,Each pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@2||0|16.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 3]
-Ngeneric:Invisible-Pin|pin@3||-0.5|25|||||ART_message(D5G6;)S[nand3en_sy]
-Awire|net@0|||0|nand3en_@0|inc|-2.5|2|conn@0|y|-16|2
-Awire|net@1|||0|nand3en_@0|ina|-2.5|-2|conn@3|y|-21.5|-2
-Awire|net@2|||1800|nand3en_@0|out|2.5|0|conn@1|a|13.5|0
-Awire|net@3|||0|nand3en_@0|inb|-2.5|0|conn@2|y|-7|0
-Eina||D5G2;|conn@3|a|I|ATTR_le(D5G1;NY-1.5;)F1.067
-Einb||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY1.5;)F1.67
-Einc||D5G2;|conn@0|y|I|ATTR_le(D5G1;NX-1;Y-2;)F1.67
-Eout||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY-2.5;)F2.33
-X
-
-# Cell nms1;1{ic}
-Cnms1;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-AThicker|net@3|||FS1800|pin@3||-0.75|-1|pin@4||0|-1|ART_color()I78
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-AThicker|net@7|||FS0|pin@10||0|-2|pin@7||-1|-2|ART_color()I78
-AThicker|net@8|||FS1350|pin@7||-1|-2|pin@8||0|-3|ART_color()I78
-AThicker|net@9|||FS0|pin@9||1|-2|pin@10||0|-2|ART_color()I78
-AThicker|net@10|||FS1800|pin@13||-3|0|pin@14||-1.5|0|ART_color()I78
-Ed||D5G1;|pin@11||O
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-X
-
-# Cell nms1;2{sch}
-Cnms1;2{sch}||schematic|1021415734000|1159375552613||ATTR_Delay(D5G1;HNPX-8.5;Y-13.5;)I100|ATTR_LEGATE(D5G1;HNPTX-8.5;Y-15.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-8.5;Y-14.5;)I-1|ATTR_X(D5G1;HNOJPX-8.5;Y-12.5;)SLE.getdrive()|ATTR_su(D5G1;HNPTX-8.5;Y-16.5;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||23|0||||
-NOff-Page|conn@1||-17|-8||||
-NGround|gnd@0||0|-16||||
-Inms1;1{ic}|nms1@0||24|10|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||0|8.5|||||ART_message(D5G6;)S[nms1]
-Ngeneric:Invisible-Pin|pin@1||-0.5|5.5|||||ART_message(D5G2;)S[N-type transistor to GND]
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-Awire|net@3|||1800|pin@2||0|0|conn@0|a|21|0
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-Eg||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY-2;)F0.33
-X
-
-# Cell nms1K;1{ic}
-Cnms1K;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_LEKEEPER(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3.5;Y0.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPX3;Y-5;)Sweak0|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-2|-2|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
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-Nschematic:Bus_Pin|pin@14||0|2|-2|-2||
-AThicker|net@0|||FS900|pin@6||-1.5|1|pin@5||-1.5|-1|ART_color()I78
-AThicker|net@1|||FS1800|pin@11||-3|0|pin@12||-1.5|0|ART_color()I78
-AThicker|net@2|||FS2250|pin@8||0|-3|pin@9||1|-2|ART_color()I78
-AThicker|net@3|||FS900|pin@4||0|-1|pin@10||0|-2|ART_color()I78
-AThicker|net@4|||FS1350|pin@7||-1|-2|pin@8||0|-3|ART_color()I78
-AThicker|net@5|||FS0|pin@9||1|-2|pin@10||0|-2|ART_color()I78
-AThicker|net@6|||FS900|pin@0||0|2|pin@1||0|1|ART_color()I78
-AThicker|net@7|||FS0|pin@1||0|1|pin@2||-0.75|1|ART_color()I78
-AThicker|net@8|||FS900|pin@2||-0.75|1|pin@3||-0.75|-1|ART_color()I78
-AThicker|net@9|||FS1800|pin@3||-0.75|-1|pin@4||0|-1|ART_color()I78
-AThicker|net@10|||FS0|pin@10||0|-2|pin@7||-1|-2|ART_color()I78
-Ed||D5G1;|pin@14||O
-Eg||D5G1;|pin@13||I
-X
-
-# Cell nms1K;1{sch}
-Cnms1K;1{sch}||schematic|1021415734000|1159375557527||ATTR_Delay(D5G1;HNPX-11;Y-14;)I100|ATTR_LEKEEPER(D5G1;HNPTX-11;Y-17;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-11;Y-15;)I-1|ATTR_X(D5G1;HNOJPX-11;Y-13;)SLE.getdrive()|ATTR_drive0(D5G1;HNPX-11;Y-18;)Sweak0|ATTR_su(D5G1;HNPTX-11;Y-16;)I-1|ATTR_verilog_template(D5G1;NTX9.5;Y-22.5;)Snot ($(drive0), highz1) #($(Delay)) $(node_name) ($(d), $(g));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||5|0||||
-NOff-Page|conn@1||-10|-8||||
-NGround|gnd@0||0|-17||||
-Inms1K;1{ic}|nms1K@0||28|5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)SLE.getdrive()|ATTR_drive0(D5G1;NPX3;Y-5;)Sweak0|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||0|8.5|||||ART_message(D5G6;)S[nms1K]
-Ngeneric:Invisible-Pin|pin@1||0.5|5|||||ART_message(D5G2;)S[N-type keeper transistor to GND]
-NWire_Pin|pin@2||0|0||||
-Awire|net@0|||2700|gnd@0||0|-15|NMOSwk@0|s|0|-10
-Awire|net@1|||900|pin@2||0|0|NMOSwk@0|d|0|-6
-Awire|net@2|||1800|conn@1|y|-8|-8|NMOSwk@0|g|-3|-8
-Awire|net@3|||1800|pin@2||0|0|conn@0|a|3|0
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-Eg||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY2;)F0.33
-X
-
-# Cell nms2;1{ic}
-Cnms2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-0.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX-2.25;Y1.5;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NPin|pin@5||0|3|1|1|YRR|
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-AThicker|net@0|||FS0|pin@1||3|4|pin@0||1.5|4|ART_color()I78
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-AThicker|net@2|||FS900|pin@3||1.5|5|pin@4||1.5|3|ART_color()I78
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-AThicker|net@5|||FS0|pin@6||0.75|3|pin@5||0|3|ART_color()I78
-AThicker|net@6|||FS900|pin@5||0|3|pin@2||0|2|ART_color()I78
-AThicker|net@7|||FS1800|pin@21||-3|0|pin@22||-1.5|0|ART_color()I78
-AThicker|net@8|||FS2250|pin@18||0|-3|pin@19||1|-2|ART_color()I78
-AThicker|net@9|||FS0|pin@20||0|-2|pin@17||-1|-2|ART_color()I78
-AThicker|net@10|||FS1350|pin@17||-1|-2|pin@18||0|-3|ART_color()I78
-AThicker|net@11|||FS0|pin@19||1|-2|pin@20||0|-2|ART_color()I78
-AThicker|net@12|||FS0|pin@11||0|1|pin@12||-0.75|1|ART_color()I78
-AThicker|net@13|||FS900|pin@12||-0.75|1|pin@13||-0.75|-1|ART_color()I78
-AThicker|net@14|||FS900|pin@10||0|2|pin@11||0|1|ART_color()I78
-AThicker|net@15|||FS900|pin@14||0|-1|pin@20||0|-2|ART_color()I78
-AThicker|net@16|||FS1800|pin@13||-0.75|-1|pin@14||0|-1|ART_color()I78
-AThicker|net@17|||FS900|pin@16||-1.5|1|pin@15||-1.5|-1|ART_color()I78
-Ed||D5G1;|pin@25||O
-Eg||D5G1;|pin@24||I
-Eg2||D5G1;|pin@23||I
-X
-
-# Cell nms2;1{sch}
-Cnms2;1{sch}||schematic|1021415734000|1159375566278||ATTR_Delay(D5G1;HNPX-9;Y-13.5;)I100|ATTR_LEGATE(D5G1;HNPTX-9;Y-16.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-9;Y-14.5;)I-1|ATTR_X(D5G1;HNOJPX-9;Y-12.5;)SLE.getdrive()|ATTR_su(D5G1;HNPTX-9;Y-15.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||8|-4|||YRR|
-NOff-Page|conn@1||5|0||||
-NOff-Page|conn@2||-10|-8||||
-IredFour:nms2;1{ic}|nms2@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)S@X
-Inms2;1{ic}|nms2@1||27|0|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)SLE.getdrive()|ATTR_su(P)I-1
-Ngeneric:Invisible-Pin|pin@0||0|10.5|||||ART_message(D5G6;)S[nms2]
-Ngeneric:Invisible-Pin|pin@1||0|6|||||ART_message(D5G2;)S[two N-type transistors to GND]
-NWire_Pin|pin@2||0|0||||
-Awire|net@0|||0|conn@0|y|6|-4|nms2@0|g2|3|-4
-Awire|net@1|||900|pin@2||0|0|nms2@0|d|0|-2
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-Awire|net@3|||1800|pin@2||0|0|conn@1|a|3|0
-Ed||D5G2;|conn@1|y|O|ATTR_le(D5G1;NX0.5;Y2.5;)F0.67
-Eg||D5G2;|conn@2|a|I|ATTR_le(D5G1;NX0.5;Y2;)F0.67
-Eg2||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F0.67
-X
-
-# Cell nms2K;1{ic}
-Cnms2K;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2.5;)I100|ATTR_LEKEEPER(D5G1;HNPX3.5;Y-4.5;)I1|ATTR_SN(D5G1.5;HNPX3.5;Y-1.5;)I1|ATTR_su(D5G1;HNPX3.5;Y-3.5;)I-1|prototype_center()I[0,-24000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0.75|4|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-NPin|pin@0||-3|4||||
-NPin|pin@1||-1.5|4|1|1|Y|
-NPin|pin@2||0|2|1|1|YRR|
-NPin|pin@3||-1.5|5|1|1|YRR|
-NPin|pin@4||-1.5|3|1|1|YRR|
-NPin|pin@5||0|3|1|1|YRR|
-NPin|pin@6||-0.75|3|1|1|YRR|
-NPin|pin@7||-0.75|5|1|1|YRR|
-NPin|pin@8||0|5|1|1|YRR|
-NPin|pin@9||0|6|||RR|
-NPin|pin@10||0|2|1|1||
-NPin|pin@11||0|1|1|1||
-NPin|pin@12||-0.75|1|1|1||
-NPin|pin@13||-0.75|-1|1|1||
-NPin|pin@14||0|-1|1|1||
-NPin|pin@15||-1.5|-1|1|1||
-NPin|pin@16||-1.5|1|1|1||
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-Nschematic:Bus_Pin|pin@20||0|-2|-2|-2||
-NPin|pin@21||-3|1|1|1||
-NPin|pin@22||-2.5|0.5|1|1||
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-NPin|pin@24||-3|0|1|1|RR|
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-Nschematic:Bus_Pin|pin@26||-3|4|-2|-2||
-AThicker|net@0|||FS1800|pin@18||-3|0|pin@19||-1.5|0|ART_color()I78
-AThicker|net@1|||FS0|pin@1||-1.5|4|pin@0||-3|4|ART_color()I78
-AThicker|net@2|||FS900|pin@3||-1.5|5|pin@4||-1.5|3|ART_color()I78
-AThicker|net@3|||FS900|pin@9||0|6|pin@8||0|5|ART_color()I78
-AThicker|net@4|||FS0|pin@11||0|1|pin@12||-0.75|1|ART_color()I78
-AThicker|net@5|||FS900|pin@12||-0.75|1|pin@13||-0.75|-1|ART_color()I78
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-X
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-Cnms3;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX-2;Y0.5;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
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-Einc||D5G2;|conn@0|y|I|ATTR_le(D5G1;NY-2;)I1
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)I1
-X
-
-# Cell nms3_sy3;1{ic}
-Cnms3_sy3;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.25;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX-2;Y0.5;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
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-AThicker|net@19|||FS1800|pin@29||-3|8|pin@28||-1.5|8|ART_color()I78
-AThicker|net@20|||FS900|pin@33||0|7|pin@30||0|6|ART_color()I78
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-AThicker|net@24|||FS900|pin@31||-1.5|9|pin@32||-1.5|7|ART_color()I78
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-X
-
-# Cell nms3_sy3;1{sch}
-Cnms3_sy3;1{sch}||schematic|1021415734000|1159375578755||ATTR_Delay(D5G1;HNPX-20;Y-11.5;)I100|ATTR_LEGATE(D5G1;HNPTX-20;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-20;Y-12.5;)I-1|ATTR_X(D5G1;HNOJPX-20;Y-10.5;)SLE.getdrive()|ATTR_su(D5G1;HNPTX-20;Y-13.5;)I-1|prototype_center()I[0,0]
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-NOff-Page|conn@3||-14.5|4||||
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-Inms3_sy3;1{ic}|nms3_sy3@1||32|11|||D0G4;|ATTR_Delay(D5G1;NPX3.25;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX-2;Y0.5;)SLE.getdrive()|ATTR_su(P)I-1
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-Ngeneric:Invisible-Pin|pin@1||-2|21.5|||||ART_message(D5G6;)S[nms3_sy3]
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-Awire|net@4|||1800|pin@0||1|9|conn@1|a|13|9
-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NX1.5;Y-2.5;)I1
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-X
-
-# Cell nor2;1{ic}
-Cnor2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NThick-Circle|art@3||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I78
-NPin|pin@0||-0.5|-1.75|1|1||
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-NPin|pin@2||-1|1|1|1||
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-Nschematic:Bus_Pin|pin@8||-2.5|-1|-2|-2||
-AThicker|net@0|||FS2700|pin@1||-1|-1.25|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||-0.5|-1.75|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@2|||FS0|pin@2||-1|1|pin@3||-2.5|1|ART_color()I78
-AThicker|net@3|||FS0|pin@7||-1|-1|pin@6||-2.5|-1|ART_color()I78
-Eina||D5G1;|pin@8||I
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-Eout||D5G1;|pin@4||O
-X
-
-# Cell nor2;1{sch}
-Cnor2;1{sch}||schematic|1021415734000|1159375948527||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-18;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-18;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-18;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-18;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-18;Y-10.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||14|0|||Y|
-NOff-Page|conn@1||-15.5|2.5||||
-NOff-Page|conn@2||-15.5|-2.5|||Y|
-IredFour:nor2;1{ic}|nor2@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inor2;1{ic}|nor2@1||19.5|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-NWire_Pin|pin@1||-7.5|-1||||
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-NWire_Pin|pin@3||-7.5|2.5||||
-Ngeneric:Invisible-Pin|pin@4||17|-9|||||ART_message(D5G2;)S[X is drive strength,One pull-down is as strong,as the pull-up]
-Ngeneric:Invisible-Pin|pin@5||-2|15|||||ART_message(D5G6;)S[nor2]
-Ngeneric:Invisible-Pin|pin@6||-2|10|||||ART_message(D5G2;)S[one-parameter NOR]
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-Awire|net@1|||0|conn@0|a|12|0|nor2@0|out|2.5|0
-Awire|net@2|||0|nor2@0|inb|-2.5|1|pin@2||-7.5|1
-Awire|net@3|||900|pin@1||-7.5|-1|pin@0||-7.5|-2.5
-Awire|net@4|||0|pin@0||-7.5|-2.5|conn@2|y|-13.5|-2.5
-Awire|net@5|||2700|pin@2||-7.5|1|pin@3||-7.5|2.5
-Awire|net@6|||0|pin@3||-7.5|2.5|conn@1|y|-13.5|2.5
-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2.5;)F1.67
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY2;)F1.67
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NX0.5;Y-2;)I2
-X
-
-# Cell nor2V;1{ic}
-Cnor2V;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1.5;Y-5;)I100|ATTR_M(D5G1;HNPX1.5;Y-4;)I1|ATTR_WN(D5G1.5;HNPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;HNPX0.5;Y3;)I1|ATTR_drive0(D5G1;HNPX1.5;Y-6;)Sstrong0|ATTR_drive1(D5G1;HNPX1.5;Y-7;)Sstrong1|ATTR_su(D5G1;HNPX-18.25;Y-14.5;)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-NThick-Circle|art@2||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
-NThick-Circle|art@3||-1.5|2|8|7|RRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@5||2|0|1|1|||ART_color()I78
-NPin|pin@0||-0.5|-1.75|1|1||
-NPin|pin@1||-1|-1.25|1|1||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-NPin|pin@3||-1|-1|1|1||
-NPin|pin@4||-2.5|-1||||
-Nschematic:Bus_Pin|pin@5||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@6||2.5|0|-2|-2||
-NPin|pin@7||-2.5|1||||
-NPin|pin@8||-1|1|1|1||
-AThicker|net@0|||FS2700|pin@1||-1|-1.25|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||-0.5|-1.75|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@2|||FS0|pin@3||-1|-1|pin@4||-2.5|-1|ART_color()I78
-AThicker|net@3|||FS0|pin@8||-1|1|pin@7||-2.5|1|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@5||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell nor2V;1{sch}
-Cnor2V;1{sch}||schematic|1021415734000|1084377212000||ATTR_Delay(D5G1;HNPX-15.5;Y-11;)I100|ATTR_M(D5G1;HNPX-15.5;Y-10;)I1|ATTR_WN(D5G1;HNPX-15.5;Y-9;)I1|ATTR_WP(D5G1;HNPX-15.5;Y-8;)I1|ATTR_drive0(D5G1;HNPX-15.5;Y-12;)Sstrong0|ATTR_drive1(D5G1;HNPX-15.5;Y-13;)Sstrong1|ATTR_su(D5G1;HNPX-15;Y-14;)I-1|ATTR_verilog_template(D5G1;NTX7;Y-19;)Snor ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-4||||
-NOff-Page|conn@1||14|-4|||RR|
-NOff-Page|conn@2||14|0||||
-Inms1;1{ic}|nms1@0||-4|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(OJP)S@su
-Inms1;1{ic}|nms1@1||4|-8|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX3.5;Y0.5;)SLE.getdrive()|ATTR_su(OJP)S@su
-Inor2V;1{ic}|nor2V@0||20|9.5|||D0G4;|ATTR_Delay(D5G1;NPX1.5;Y-5;)I100|ATTR_M(D5G1;NPX1.5;Y-4;)I1|ATTR_WN(D5G1.5;NPX0.5;Y-3;)I1|ATTR_WP(D5G1.5;NPX0.5;Y3;)I1|ATTR_drive0(D5G1;NPX1.5;Y-6;)Sstrong0|ATTR_drive1(D5G1;NPX1.5;Y-7;)Sstrong1|ATTR_su(D5G1;NPX-18.25;Y-14.5;)I-1
-Ngeneric:Invisible-Pin|pin@0||11.5|-15.5|||||ART_message(D5G2;)S[S is drive strength,"P and N drive strengths are WP, WN"]
-NWire_Pin|pin@1||-9|-8||||
-Ngeneric:Invisible-Pin|pin@2||-1.5|11.5|||||ART_message(D5G2;)S[two-parameter NOR]
-NWire_Pin|pin@3||-9|-4||||
-NWire_Pin|pin@4||9|3||||
-NWire_Pin|pin@5||9|-4||||
-Ngeneric:Invisible-Pin|pin@6||-1.5|16.5|||||ART_message(D5G6;)S[nor2V]
-NWire_Pin|pin@7||-9|7||||
-NWire_Pin|pin@8||0|0||||
-NWire_Pin|pin@9||4|0||||
-NWire_Pin|pin@10||-4|0||||
-NWire_Pin|pin@11||9|-8||||
-Ipms2;1{ic}|pms2@0||0|7|||D0G4;|ATTR_Delay(D5G1;NOJPX-3;Y-1.5;)S@Delay|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NPX2.25;Y1;)SLE.getdrive()|ATTR_su(OJP)S@su|ATTR_M(D5G1;NTX2;)I1
-Awire|net@0|||2700|pin@1||-9|-8|pin@3||-9|-4
-Awire|net@1|||0|pin@3||-9|-4|conn@0|y|-12|-4
-Awire|net@2|||2700|pin@5||9|-4|pin@4||9|3
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-Awire|net@6|||2700|pin@8||0|0|pms2@0|d|0|1
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-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nor2_sy;2{ic}
-Cnor2_sy;2{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-X
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-Cnor2_sy;2{sch}||schematic|1021415734000|1159375955602||ATTR_Delay(D5G1;HNPX-15;Y-9.5;)I100|ATTR_LEGATE(D5G1;HNPTX-15;Y-13;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-15;Y-14;)I-1|ATTR_X(D5G1;HNOJPX-15;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-15;Y-10.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-15;Y-11.5;)Sstrong1|ATTR_su(D5G1;HNPTX-15;Y-8.5;)I-1|prototype_center()I[0,0]
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-Inor2_sy;2{ic}|nor2_sy@1||23.5|12.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-X
-
-# Cell nor2en;1{ic}
-Cnor2en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-X
-
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-Cnor2en;1{sch}||schematic|1021415734000|1159377045073||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-18;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-18;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-18;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-18;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-18;Y-10.5;)I-1|prototype_center()I[0,0]
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-X
-
-# Cell nor2k;1{ic}
-Cnor2k;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_LEKEEPER(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
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-NThick-Circle|art@4||-1.5|2|8|7|RRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@5||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
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-X
-
-# Cell nor2k;1{sch}
-Cnor2k;1{sch}||schematic|1021415734000|1159375660125||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_LEKEEPER(D5G1;HNPX-18;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-18;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-18;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-18;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-18;Y-10.5;)I-1|prototype_center()I[0,0]
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-Inor2k;1{ic}|nor2k@0||19.5|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
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-X
-
-# Cell nor2kresetV;1{ic}
-Cnor2kresetV;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_LEGATE(D5G1;HNPX-18;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
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-NThick-Circle|art@3||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I78
-NOpened-Thicker-Polygon|art@5||0|0|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
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-Eina||D5G1;|pin@11||I
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-
-# Cell nor2kresetV;1{sch}
-Cnor2kresetV;1{sch}||schematic|1021415734000|1159379793908||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPX-18;Y-14.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-18;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-18;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-18;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-18;Y-10.5;)I-1|prototype_center()I[0,0]
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-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||-4.12|-11.25|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/10.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||4|-17|||R|
-NOff-Page|conn@1||15|-5||||
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-NOff-Page|conn@3||14.5|4|||YRR|
-NGround|gnd@0||-4.12|-18.25||||
-Inor2kresetV;1{ic}|nor2kres@0||19.5|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1|ATTR_LEKEEPER()I1
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-Ngeneric:Invisible-Pin|pin@8||21|-18|||||ART_message(D5G2;)S[X is drive strength,One pull-down is as strong,as the pull-up]
-Ngeneric:Invisible-Pin|pin@9||-2|15|||||ART_message(D5G6;)S[nor2kresetV]
-Ngeneric:Invisible-Pin|pin@10||-2|10|||||ART_message(D5G2;)S[one-parameter NOR]
-IredFour:pms2;1{ic}|pms2@0||0|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX-3;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX2.25;Y1;)S@X/10.0
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-Cpms1;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
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-Cpms1K;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_LEKEEPER(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX3;)SLE.getdrive()|ATTR_drive1(D5G1;HPT)Sweak1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
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-Cpms1K;1{sch}||schematic|1021415734000|1159375602079||ATTR_Delay(D5G1;HNPX-10.5;Y1.5;)I100|ATTR_LEKEEPER(D5G1;HNPTX-10.5;Y-1.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-10.5;Y0.5;)I-1|ATTR_X(D5G1;HNOJPX-10.5;Y2.5;)SLE.getdrive()|ATTR_drive1(D5G1;HNPTX-10.5;Y-2.5;)Sweak1|ATTR_su(D5G1;HNPTX-10.5;Y-0.5;)I-1|ATTR_verilog_template(D5G1;NTX-4;Y17;)Snot (highz0, $(drive1)) #($(Delay)) $(node_name) ($(d), $(g));|prototype_center()I[0,0]
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-Ipms1K;1{ic}|pms1K@0||10|13|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_LEKEEPER(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX3;)SLE.getdrive()|ATTR_drive1(P)Sweak1|ATTR_su(P)I-1
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-# Cell pms2;1{ic}
-Cpms2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX-3;Y-1.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y1;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|-4|1|1|||ART_color()I78
-NThick-Circle|art@2||-2|0|1|1|||ART_color()I78
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-NPin|pin@1||0.75|-3|1|1|YRR|
-NPin|pin@2||0.75|-5|1|1|YRR|
-NPin|pin@3||0|-5|1|1|YRR|
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-NPin|pin@7||0|-2|1|1|YRR|
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-NPin|pin@12||0.5|1.5|1|1||
-NPin|pin@13||-0.5|2.5||||
-NPin|pin@14||0|2|1|1||
-NPin|pin@15||-2.5|0|1|1|RR|
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-Nschematic:Bus_Pin|pin@24||-3|0|-2|-2||
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-AThicker|net@1|||FS900|pin@3||0|-5|pin@4||0|-6|ART_color()I78
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-AThicker|net@9|||FS900|pin@18||0|-1|pin@17||0|-2|ART_color()I78
-AThicker|net@10|||FS1800|pin@19||-0.75|-1|pin@18||0|-1|ART_color()I78
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-AThicker|net@12|||FS2700|pin@21||0|1|pin@14||0|2|ART_color()I78
-AThicker|net@13|||FS0|pin@21||0|1|pin@20||-0.75|1|ART_color()I78
-AThicker|net@14|||FS900|pin@10||-1.5|1|pin@11||-1.5|-1|ART_color()I78
-Ed||D5G1;|pin@23||O
-Eg||D5G1;|pin@24||I
-Eg2||D5G1;|pin@22||I
-X
-
-# Cell pms2;1{sch}
-Cpms2;1{sch}||schematic|1021415734000|1159375592265||ATTR_Delay(D5G1;HNPX-12;Y8;)I100|ATTR_LEGATE(D5G1;HNPTX-12.5;Y5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y7;)I-1|ATTR_X(D5G1;HNOJPX-12.25;Y9;)SLE.getdrive()|ATTR_su(D5G1;HNPTX-12.5;Y6;)I-1|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||0|7|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||8.5|7|||YRR|
-NOff-Page|conn@1||8|0||||
-NOff-Page|conn@2||-8.5|15||||
-Ngeneric:Invisible-Pin|pin@0||-1|26|||||ART_message(D5G2;)S[two P-type transistors to VDD]
-Ngeneric:Invisible-Pin|pin@1||-1|31|||||ART_message(D5G6;)S[pms2]
-NWire_Pin|pin@2||0|0||||
-Ipms2;1{ic}|pms2@0||20.25|21.75|||D0G4;|ATTR_Delay(D5G1;NPX-3;Y-1.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y1;)SLE.getdrive()|ATTR_su(P)I-1
-NPower|pwr@0||0|22||||
-Awire|net@0|||900|pwr@0||0|22|PMOS@0|s|0|17
-Awire|net@1|||1800|conn@2|y|-6.5|15|PMOS@0|g|-3|15
-Awire|net@2|||900|PMOS@0|d|0|13|PMOS@1|s|0|9
-Awire|net@3|||0|conn@0|y|6.5|7|PMOS@1|g|3|7
-Awire|net@4|||2700|pin@2||0|0|PMOS@1|d|0|5
-Awire|net@5|||1800|pin@2||0|0|conn@1|a|6|0
-Ed||D5G2;|conn@1|y|O|ATTR_le(D5G1;NY2;)F1.33
-Eg||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-Eg2||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-1.5;)F1.33
-X
-
-# Cell pms2K;1{ic}
-Cpms2K;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;)I100|ATTR_LEKEEPER(D5G1;HNPX3.5;Y-2;)I1|ATTR_SP(D5G1.5;HNOJPX3.5;Y1;)SLE.getdrive()|ATTR_su(D5G1;HNPX3.5;Y-1;)I-1|prototype_center()I[0,24000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0.75|-4|0.5|1|||ART_color()I78|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-NThick-Circle|art@2||-2|-4|1|1|||ART_color()I78
-NThick-Circle|art@3||-2|0|1|1|||ART_color()I78
-Nschematic:Wire_Pin|pin@0||0|2|-0.5|-0.5||
-NPin|pin@1||-3|-1|1|1||
-NPin|pin@2||-3|-4|1|1||
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-NPin|pin@9||0|-5|1|1|YRR|
-NPin|pin@10||0|-6|||RR|
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-NPin|pin@24||-4|-1||||
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-Nschematic:Bus_Pin|pin@26||0|-6|-2|-2||
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-AThicker|net@1|||FS1800|pin@24||-4|-1|pin@1||-3|-1|ART_color()I78
-AThicker|net@2|||FS1800|pin@1||-3|-1|pin@22||-2|-1|ART_color()I78
-AThicker|net@3|||FS0|pin@3||-2.5|-4|pin@2||-3|-4|ART_color()I78
-AThicker|net@4|||FS0|pin@4||-2.5|0|pin@5||-3|0|ART_color()I78
-AThicker|net@5|||FS900|pin@9||0|-5|pin@10||0|-6|ART_color()I78
-AThicker|net@6|||FS900|pin@20||-0.75|1|pin@19||-0.75|-1|ART_color()I78
-AThicker|net@7|||FS1800|pin@19||-0.75|-1|pin@18||0|-1|ART_color()I78
-AThicker|net@8|||FS2700|pin@21||0|1|pin@16||0|2|ART_color()I78
-AThicker|net@9|||FS0|pin@21||0|1|pin@20||-0.75|1|ART_color()I78
-AThicker|net@10|||FS900|pin@14||-1.5|1|pin@15||-1.5|-1|ART_color()I78
-AThicker|net@11|||FS900|pin@13||-1.5|-3|pin@12||-1.5|-5|ART_color()I78
-AThicker|net@12|||FS900|pin@7||-0.75|-3|pin@8||-0.75|-5|ART_color()I78
-AThicker|net@13|||FS2700|pin@6||0|-3|pin@11||0|-2|ART_color()I78
-AThicker|net@14|||FS1800|pin@8||-0.75|-5|pin@9||0|-5|ART_color()I78
-AThicker|net@15|||FS0|pin@6||0|-3|pin@7||-0.75|-3|ART_color()I78
-AThicker|net@16|||FS900|pin@18||0|-1|pin@17||0|-2|ART_color()I78
-AThicker|net@17|||FS1350|pin@24||-4|-1|pin@23||-3|-2|ART_color()I78
-AThicker|net@18|||FS2250|pin@23||-3|-2|pin@22||-2|-1|ART_color()I78
-Ein||D5G1;|pin@25||I
-Eout||D5G1;|pin@26||O
-Esrc||D5G1;|pin@0||I
-X
-
-# Cell pms2K;1{sch}
-Cpms2K;1{sch}||schematic|1021415734000|1159375596600||ATTR_Delay(D5G1;HNPX-9;Y1;)I100|ATTR_LEKEEPER(D5G1;HNPX-9;Y-1;)I1|ATTR_SP(D5G1;HNOJPX-9;Y2;)SLE.getdrive()|ATTR_su(D5G1;HNPX-9;)I-1|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOS4f;1{ic}|PMOS4f@0||0|14|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5G1;NOJPX3.5;)S@SP==0?0:@SP<0.25?(0.25*(2-0.4)/@SP + 0.4):2|ATTR_W(D6G1;NOJPX2;Y1;)S@SP>1?3*@SP:3
-IorangeTSMC090nm:PMOS4f;1{ic}|PMOS4f@1||0|7|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5G1;NPX3.5;)I2|ATTR_W(D6G1;NPX2;Y1;)I3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14.25|18.75||||
-NOff-Page|conn@1||-14|7||||
-NOff-Page|conn@2||8|0||||
-NGround|gnd@0||-6|10||||
-NWire_Pin|pin@0||2|7.5||||
-NWire_Pin|pin@1||2|14.5||||
-NWire_Pin|pin@2||0|18.75||||
-NWire_Pin|pin@3||-6|14||||
-Ngeneric:Invisible-Pin|pin@4||-1|31|||||ART_message(D5G6;)S[pms2K]
-Ngeneric:Invisible-Pin|pin@5||-1|26|||||ART_message(D5G2;)S[min P-type with resistor to pin]
-NWire_Pin|pin@6||0|0||||
-Ipms2K;1{ic}|pms2K@0||11|19|||D0G4;|ATTR_Delay(D5G1;NPX3.5;)I100|ATTR_LEKEEPER(D5G1;NPX3.5;Y-2;)I1|ATTR_SP(D5G1.5;NPX3.5;Y1;)I1|ATTR_su(D5G1;NPX3.5;Y-1;)I-1
-NPower|pwr@0||2|21||||
-Awire|net@0|||900|pin@1||2|14.5|pin@0||2|7.5
-Awire|net@1|||900|pin@2||0|18.75|PMOS4f@0|s|0|16
-Awire|net@2|||0|pin@1||2|14.5|PMOS4f@0|b|0|14.5
-Awire|net@3|||1800|pin@3||-6|14|PMOS4f@0|g|-3|14
-Awire|net@4|||900|PMOS4f@0|d|0|12|PMOS4f@1|s|0|9
-Awire|net@5|||0|pin@0||2|7.5|PMOS4f@1|b|0|7.5
-Awire|net@6|||1800|conn@1|y|-12|7|PMOS4f@1|g|-3|7
-Awire|net@7|||2700|pin@6||0|0|PMOS4f@1|d|0|5
-Awire|net@8|||900|pwr@0||2|21|pin@1||2|14.5
-Awire|net@9|||0|pin@2||0|18.75|conn@0|y|-12.25|18.75
-Awire|net@10|||900|pin@3||-6|14|gnd@0||-6|12
-Awire|net@11|||0|conn@2|a|6|0|pin@6||0|0
-Ein||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY2;)I0
-Eout||D5G2;|conn@2|y|O|ATTR_le(D5G1;NY2;)F0.33
-Esrc||D5G2;|conn@0|a|I|ATTR_le(D5G1;NY-2;)I1
-X
-
-# Cell pms2_sy;1{ic}
-Cpms2_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX-5;Y-1.5;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX4;Y2;)SLE.getdrive()|ATTR_su(D5G1;HPT)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1.75|-4|1|1|||ART_color()I78
-NThick-Circle|art@2||1.75|0|1|1|||ART_color()I78
-NThick-Circle|art@3||1.75|-4|1|1|||ART_color()I78
-NThick-Circle|art@4||-1.75|0|1|1|||ART_color()I78
-NPin|pin@0||-2.25|0|1|1||
-NPin|pin@1||-2.25|-4|1|1||
-NPin|pin@2||2.25|-4|1|1||
-NPin|pin@3||2.25|0|1|1||
-NPin|pin@4||2.5|0|1|1||
-NPin|pin@5||2.5|-4|1|1|RR|
-NPin|pin@6||3|-4|||RR|
-NPin|pin@7||-2.5|-4|1|1||
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-NPin|pin@27||0|-6|||RR|
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-NPin|pin@30||-1.25|1|1|1||
-NPin|pin@31||-1.25|-1|1|1||
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-NPin|pin@34||0|2|1|1||
-NPin|pin@35||-0.75|-1|1|1||
-NPin|pin@36||-0.75|1|1|1||
-NPin|pin@37||0|1|1|1||
-Nschematic:Bus_Pin|pin@38||0|-6|-2|-2||
-Nschematic:Bus_Pin|pin@39||-3|0|-2|-2||
-Nschematic:Bus_Pin|pin@40||3|-4|-2|-2||
-AThicker|net@0|||FS0|pin@0||-2.25|0|pin@8||-2.5|0|ART_color()I78
-AThicker|net@1|||FS0|pin@1||-2.25|-4|pin@7||-2.5|-4|ART_color()I78
-AThicker|net@2|||FS1800|pin@2||2.25|-4|pin@5||2.5|-4|ART_color()I78
-AThicker|net@3|||FS1800|pin@3||2.25|0|pin@4||2.5|0|ART_color()I78
-AThicker|net@4|||FS900|pin@4||2.5|0|pin@5||2.5|-4|ART_color()I78
-AThicker|net@5|||FS1800|pin@5||2.5|-4|pin@6||3|-4|ART_color()I78
-AThicker|net@6|||FS2700|pin@7||-2.5|-4|pin@8||-2.5|0|ART_color()I78
-AThicker|net@7|||FS1800|pin@9||-3|0|pin@8||-2.5|0|ART_color()I78
-AThicker|net@8|||FS2560|pin@16||-0.25|-3|pin@20||0.25|-1|ART_color()I78
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-X
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-Cpms3;1{sch}||schematic|1021415734000|1159379854786||ATTR_Delay(D5G1;HNPX-17;Y1;)I100|ATTR_LEGATE(D5G1;HNPTX-17.5;Y-2;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-17;)I-1|ATTR_X(D5G1;HNOJPX-17.25;Y2;)SLE.getdrive()|ATTR_su(D5G1;HNPTX-17.5;Y-1;)I-1|prototype_center()I[0,0]
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-X
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-Eout||D5G1;|pin@8||O
-X
-
-# Cell triInv;1{sch}
-CtriInv;1{sch}||schematic|1021415734000|1159376021331||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6.5;)I-1|ATTR_X(D5G1;HNOJPX-12.5;Y-4.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-7.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-8.5;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-9.5;)I-1|prototype_center()I[0,0]
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-IredFour:triInv;1{ic}|triInv@0||0.5|0|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX2.5;Y2;)S@X
-ItriInv;1{ic}|triInv@1||28.5|17|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-1.5;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)S""
-Awire|net@0|||2700|triInv@0|enB|0.5|2|conn@0|y|0.5|6
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-Een||D5G2;|conn@1|a|I|ATTR_le(D5G1;NX-1;)F0.6667
-EenB||D5G2;|conn@0|a|I|ATTR_le(D5G1;NX-2;Y2;)F1.333
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-X
-
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-Cwire350;1{ic}||artwork|1012169520000|1204140525662|E|ATTR_L(D5G1;HP)I100|ATTR_LEWIRE(D5G1;HNPY-3.25;)I1|ATTR_layer(D5G1;HNPY-1.25;)I1|ATTR_width(D5G1;HNPY-2.25;)I3|prototype_center()I[2000,0]
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-Nschematic:Bus_Pin|pin@1||2.25|0|-2|-2||
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-Eb||D5G1;|pin@1||U
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-
-# Cell wire350;1{sch}
-Cwire350;1{sch}||schematic|1012169378000|1056433201000||ATTR_L(D5G1;HNPX-17;Y-11.5;)I100|ATTR_LEWIRE(D5G1;HNPX-17;Y-13.5;)I1|ATTR_layer(D5G1;HNPX-17;Y-12.5;)I1|ATTR_width(D5G1;HNPX-17;Y-13.5;)I3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Invisible-Pin|pin@0||-4|22|||||ART_message(D5G6;)S[wire350]
-Ngeneric:Invisible-Pin|pin@1||-16|14.5|||||ART_message(D6G2;)S["wire in layer 'layer',","L lambda long,","'width' lambda wide,",for the 350nm tech]
-Ngeneric:Invisible-Pin|pin@2||-13|7|||||ART_message(D5G1;)S[1/4 of the length]
-Ngeneric:Invisible-Pin|pin@3||-1|7|||||ART_message(D5G1;)S[1/2 of the length]
-Ngeneric:Invisible-Pin|pin@4||13|7|||||ART_message(D5G1;)S[1/4 of the length]
-NWire_Pin|pin@5||-7|3||||
-NWire_Pin|pin@6||7|3||||
-Iwire350;1{ic}|wire350@0||26|19|||D0G4;|ATTR_L(D5G1;P)I100|ATTR_LEWIRE(D5G1;NPY-3.25;)I1|ATTR_layer(D5G1;NPY-1.25;)I1|ATTR_width(D5G1;NPY-2.25;)I3
-IwireC350;1{ic}|wireC350@0||-7|-6|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S"P(\"L\")/2.0"|ATTR_layer(D5G1;NOJPX3;Y-1.5;)S@layer|ATTR_width(D5G1;NOJPX3;Y-0.5;)S@width
-IwireC350;1{ic}|wireC350@1||7|-6|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S"P(\"L\")/2.0"|ATTR_layer(D5G1;NOJPX3;Y-1.5;)S@layer|ATTR_width(D5G1;NOJPX3;Y-0.5;)S@width
-IwireR350;1{ic}|wireR350@0||13|3|||D0G4;|ATTR_L(D5G1.5;NOJPY1;)S@L/4.0|ATTR_layer(D5G1;NOJPY-2.5;)S@layer|ATTR_width(D5G1;NOJPY-1.5;)S@width
-IwireR350;1{ic}|wireR350@1||-0.5|3|||D0G4;|ATTR_L(D5G1.5;NOJPY1;)S@L/2.0|ATTR_layer(D5G1;NOJPY-2.5;)S@layer|ATTR_width(D5G1;NOJPY-1.5;)S@width
-IwireR350;1{ic}|wireR350@2||-13|3|||D0G4;|ATTR_L(D5G1.5;NOJPY1;)S@L/4.0|ATTR_layer(D5G1;NOJPY-2.5;)S@layer|ATTR_width(D5G1;NOJPY-1.5;)S@width
-Awire|net@0|||1800|pin@5||-7|3|wireR350@1|a|-4.5|3
-Awire|net@1|||1800|wireR350@1|b|3.5|3|pin@6||7|3
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-Eb||D5G2;|conn@1|a|U
-X
-
-# Cell wireC350;1{ic}
-CwireC350;1{ic}||artwork|1014599103000|1204140525662|E|ATTR_L(D6G1.5;HNPX1.5;Y0.5;)I100|ATTR_layer(D5G1;HNPX3;Y-1.5;)I1|ATTR_width(D5G1;HNPX3;Y-0.5;)I3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||0|-3|1|1||
-NPin|pin@1||-1|-2|1|1|||ART_color()I78
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-NPin|pin@3||0|-2|1|1||
-NPin|pin@4||0|-0.25|1|1|||ART_color()I78
-NPin|pin@5||0|2|1|1||
-NPin|pin@6||0|0.25|1|1|||ART_color()I78
-NPin|pin@7||-1|0.25|1|1|||ART_color()I78
-NPin|pin@8||1|0.25|1|1|||ART_color()I78
-NPin|pin@9||1|-0.25|1|1|||ART_color()I78
-NPin|pin@10||-1|-0.25|1|1|||ART_color()I78
-Nschematic:Bus_Pin|pin@11||0|2|-2|-2||
-AThicker|net@0|||FS450|pin@2||1|-2|pin@0||0|-3|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||0|-3|pin@1||-1|-2|ART_color()I78
-AThicker|net@2|||FS0|pin@2||1|-2|pin@1||-1|-2|ART_color()I78
-AThicker|net@4|||FS900|pin@5||0|2|pin@6||0|0.25|ART_color()I78
-AThicker|net@5|||FS0|pin@8||1|0.25|pin@7||-1|0.25|ART_color()I78
-AThicker|net@6|||FS0|pin@9||1|-0.25|pin@10||-1|-0.25|ART_color()I78
-Ea||D5G1;|pin@11||I
-X
-
-# Cell wireC350;1{sch}
-CwireC350;1{sch}||schematic|1014598612000|1025280871000||ATTR_L(D5G1;HNPX-16;Y-4;)I100|ATTR_layer(D5G1;HNPX-16;Y-5;)I1|ATTR_width(D5G1;HNPX-16;Y-6;)I3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NCapacitor|cap@0||0|0|||||SCHEM_capacitance(D5G1;OJUC)S(@layer<4?0.04:0.056) * @L * 1e-15
-NOff-Page|conn@0||0|7|||RRR|
-NGround|gnd@0||0|-6||||
-Ngeneric:Invisible-Pin|pin@0||0|-9|||||ART_message(D5G1;)S["(P(\"M\")<4?0.04:0.056)*P(\"L\")"]
-Ngeneric:Invisible-Pin|pin@1||-20|9|||||ART_message(D6G2;)S[the capacitance in fF of,a layer 'layer' wire,L lambda long and,'width' lambda wide]
-Ngeneric:Invisible-Pin|pin@2||-2|18|||||ART_message(D5G6;)S[wireC350]
-IwireC350;1{ic}|wireC350@0||9|9|||D0G4;|ATTR_L(D6G1.5;NOJPX1.5;Y0.5;)S100|ATTR_layer(D5G1;NPX3;Y-1.5;)I1|ATTR_width(D5G1;NPX3;Y-0.5;)I3
-Awire|net@0|||2700|cap@0|a|0|2|conn@0|y|0|5
-Awire|net@1|||2700|gnd@0||0|-4|cap@0|b|0|-2
-Ea||D5G2;|conn@0|a|I
-X
-
-# Cell wireR350;1{ic}
-CwireR350;1{ic}||artwork|1012169520000|1204140525662|E|ATTR_L(D5G1.5;HNPY1;)I100|ATTR_layer(D5G1;HNPY-2.5;)I1|ATTR_width(D5G1;HNPY-1.5;)I3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NPin|pin@0||-4|0|1|1||
-NPin|pin@1||4|0|1|1||
-NPin|pin@2||2.5|0|1|1||
-NPin|pin@3||2|-1|1|1||
-NPin|pin@4||1|1|1|1||
-NPin|pin@5||0|-1|1|1||
-NPin|pin@6||-1|1|1|1||
-NPin|pin@7||-2|-1|1|1||
-NPin|pin@8||-2.5|0|1|1||
-Nschematic:Bus_Pin|pin@9||-4|0|-2|-2||
-Nschematic:Bus_Pin|pin@10||4|0|-2|-2||
-AThicker|net@0|||FS1800|pin@0||-4|0|pin@8||-2.5|0|ART_color()I78
-AThicker|net@1|||FS0|pin@1||4|0|pin@2||2.5|0|ART_color()I78
-AThicker|net@2|||FS634|pin@2||2.5|0|pin@3||2|-1|ART_color()I78
-AThicker|net@3|||FS2966|pin@3||2|-1|pin@4||1|1|ART_color()I78
-AThicker|net@4|||FS634|pin@4||1|1|pin@5||0|-1|ART_color()I78
-AThicker|net@5|||FS2966|pin@5||0|-1|pin@6||-1|1|ART_color()I78
-AThicker|net@6|||FS634|pin@6||-1|1|pin@7||-2|-1|ART_color()I78
-AThicker|net@7|||FS2966|pin@7||-2|-1|pin@8||-2.5|0|ART_color()I78
-Ea||D5G1;|pin@9||U
-Eb||D5G1;|pin@10||U
-X
-
-# Cell wireR350;1{sch}
-CwireR350;1{sch}||schematic|1012169378000|1025280871000||ATTR_L(D5G1;HNPX-5.5;Y-5;)I100|ATTR_layer(D5G1;HNPX-5.5;Y-6;)I1|ATTR_width(D5G1;HNPX-5.5;Y-7;)I3|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|0||||
-NOff-Page|conn@1||14|0|||RR|
-Ngeneric:Invisible-Pin|pin@0||-16|12|||||ART_message(D6G2;)S[the resistance in ohms of,a layer 'layer' wire,L lambda long and,'width' lambda wide]
-Ngeneric:Invisible-Pin|pin@1||0|5|||||ART_message(D5G1;)S["(P(\"M\")==0?6.5:P(\"M\")<4?0.084:0.0504)*P(\"L\")/P(\"W\")"]
-Ngeneric:Invisible-Pin|pin@2||-4|20.5|||||ART_message(D5G6;)S[wireR350]
-NResistor|res@0||0|0|||||SCHEM_resistance(D5G1;OJURY1.5;)S(@layer==0?6.5:@layer<4?0.084:0.0504)*@L/@width
-IwireR350;1{ic}|wireR350@0||11|10|||D0G4;|ATTR_L(D5G1.5;NOJPY1;)S100|ATTR_layer(D5G1;NPY-2.5;)I1|ATTR_width(D5G1;NPY-1.5;)I3
-Awire|net@0|||0|conn@1|y|12|0|res@0|b|2|0
-Awire|net@1|||0|res@0|a|-2|0|conn@0|y|-12|0
-Ea||D5G2;|conn@0|a|U
-Eb||D5G2;|conn@1|a|U
-X
-
-# Cell xor2;1{ic}
-Cxor2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-3.75|0|6|6|3200||ART_color()I78|ART_degrees()I800
-NThick-Circle|art@2||-1.5|2|8|7|RRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@3||-1.5|-2|8|7|YRRR||ART_color()I78|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||-4.5|0|6|6|3200||ART_color()I78|ART_degrees()I800
-NThick-Circle|art@5||-2|0.5|1|1|||ART_color()I78
-NThick-Circle|art@6||-2.5|-1.5|1|1|||ART_color()I78
-NPin|pin@0||-0.5|-1.75|1|1||
-NPin|pin@1||-1|-1.25|1|1||
-NPin|pin@2||-2|1.5|1|1||
-NPin|pin@3||-3.5|1.5||||
-Nschematic:Bus_Pin|pin@4||1.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@5||-3.5|1.5|-2|-2||
-NPin|pin@6||-3.5|-0.5||||
-NPin|pin@7||-1.5|-0.5|1|1||
-Nschematic:Bus_Pin|pin@8||-3.5|-0.5|-2|-2||
-Ngeneric:Invisible-Pin|pin@9||-3.5|-1.5||||
-Ngeneric:Invisible-Pin|pin@10||-3.5|0.5||||
-NPin|pin@11||-3.5|0.5||||
-NPin|pin@12||-2.5|0.5|1|1||
-NPin|pin@13||-3|-1.5|1|1||
-NPin|pin@14||-3.5|-1.5||||
-AThicker|net@0|||FS2700|pin@1||-1|-1.25|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@1|||FS3150|pin@0||-0.5|-1.75|pin@1||-1|-1.25|ART_color()I78
-AThicker|net@2|||FS0|pin@2||-2|1.5|pin@3||-3.5|1.5|ART_color()I78
-AThicker|net@3|||FS0|pin@7||-1.5|-0.5|pin@6||-3.5|-0.5|ART_color()I78
-AThicker|net@4|||FS0|pin@12||-2.5|0.5|pin@11||-3.5|0.5|ART_color()I78
-AThicker|net@5|||FS0|pin@13||-3|-1.5|pin@14||-3.5|-1.5|ART_color()I78
-Eina||D5G1;|pin@8||I
-EinaB||D5G1;|pin@9||I
-Einb||D5G1;|pin@5||I
-EinbB||D5G1;|pin@10||I
-Eout||D5G1;|pin@4||O
-X
-
-# Cell xor2;1{sch}
-Cxor2;1{sch}||schematic|1021415734000|1159376016515||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_LEGATE(D5G1;HNPTX-18;Y-13.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-18;Y-9.5;)I-1|ATTR_X(D5G1;HNOJPX-18;Y-7.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-18;Y-11.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-12.5;)Sstrong1|ATTR_su(D5G1;HNPTX-18;Y-10.5;)I-1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||14|0|||Y|
-NOff-Page|conn@1||-34|1.5||||
-NOff-Page|conn@2||-18|-0.5|||Y|
-NOff-Page|conn@3||-10.5|-1.5|||Y|
-NOff-Page|conn@4||-25.5|0.5||||
-Ngeneric:Invisible-Pin|pin@0||-2|15|||||ART_message(D5G6;)S[xor2]
-Ngeneric:Invisible-Pin|pin@1||-2|10|||||ART_message(D5G2;)S[one-parameter XOR]
-Ixor2;1{ic}|xor2@0||20.48|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)I-1
-IredFour:xor2;1{ic}|xor2@1||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX2.25;Y2.25;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Awire|net@0|||0|conn@0|a|12|0|xor2@1|out|1.5|0
-Awire|net@1|||1800|conn@2|y|-16|-0.5|xor2@1|ina|-3.5|-0.5
-Awire|net@2|||0|xor2@1|inb|-3.5|1.5|conn@1|y|-32|1.5
-Awire|net@3|||0|xor2@1|inaB|-3.5|-1.5|conn@3|y|-8.5|-1.5
-Awire|net@4|||0|xor2@1|inbB|-3.5|0.5|conn@4|y|-23.5|0.5
-Eina||D5G2;|conn@2|a|I|ATTR_le(D5G1;NY2.5;)I2
-EinaB||D5G2;|conn@3|a|I|ATTR_le(D5G1;NY2.5;)I2
-Einb||D5G2;|conn@1|a|I|ATTR_le(D5G1;NY2;)I2
-EinbB||D5G2;|conn@4|a|I|ATTR_le(D5G1;NY2;)I2
-Eout||D5G2;|conn@0|y|O|ATTR_le(D5G1;NX0.5;Y-2;)I4
-X

diff --git a/electric/redFour.jelib b/electric/redFour.jelib
deleted file mode 100755 (executable)
index cd24d30..0000000
--- a/electric/redFour.jelib
+++ /dev/null
@@ -1,5348 +0,0 @@
-# header information:
-HredFour|8.08j|USER_electrical_units()I70464
-
-# Views:
-Vicon|ic
-Vschematic|sch
-
-# External Libraries:
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-Lspiceparts|spiceparts
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell NMOS;1{ic}
-CNMOS;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5G1.5;HNPX3.5;Y0.5;)I1|prototype_center()I[0,-8000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Ngeneric:Invisible-Pin|pin@0||0|-2||||
-NPin|pin@1||-1.5|0|1|1|RR|
-NPin|pin@2||-3|0|||RR|
-Nschematic:Bus_Pin|pin@3||-3|0|-2|-2||
-Nschematic:Bus_Pin|pin@4||0|2|-2|-2||
-NPin|pin@5||0|-2||||
-NPin|pin@6||-1.5|1|1|1||
-NPin|pin@7||-1.5|-1|1|1||
-NPin|pin@8||0|-1||||
-NPin|pin@9||-0.75|-1|1|1||
-NPin|pin@10||-0.75|1|1|1||
-NPin|pin@11||0|1||||
-NPin|pin@12||0|2||||
-AThicker|net@0|||FS900|pin@10||-0.75|1|pin@9||-0.75|-1|ART_color()I10
-AThicker|net@1|||FS1800|pin@2||-3|0|pin@1||-1.5|0|ART_color()I10
-AThicker|net@2|||FS900|pin@6||-1.5|1|pin@7||-1.5|-1|ART_color()I10
-AThicker|net@3|||FS900|pin@8||0|-1|pin@5||0|-2|ART_color()I10
-AThicker|net@4|||FS1800|pin@9||-0.75|-1|pin@8||0|-1|ART_color()I10
-AThicker|net@5|||FS0|pin@11||0|1|pin@10||-0.75|1|ART_color()I10
-AThicker|net@6|||FS900|pin@12||0|2|pin@11||0|1|ART_color()I10
-Ed||D5G1;|pin@4||B
-Eg||D5G1;|pin@3||I
-Es||D5G1;|pin@0||B
-X
-
-# Cell NMOS;1{sch}
-CNMOS;1{sch}||schematic|1021415734000|1161733390263||ATTR_Delay(D5G1;HNPX-8.5;Y-12.75;)I100|ATTR_X(D5G1;HNPX-8.5;Y-11.25;)I1|prototype_center()I[0,0]
-INMOS;1{ic}|NMOS@0||17|-1|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-IorangeTSMC090nm:NMOSf;1{ic}|NMOSf@0||0|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5G1;NOJPX3.5;)S@X == 0 ? 0 : (@X<1) ? (1.0 * (2-0.4) / @X + 0.4) : 2|ATTR_W(D6G1;NOJPX2;Y1;)S@X > 1 ? 3.0*@X : 3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||6|-16.5||||
-NOff-Page|conn@1||5.5|0||||
-NOff-Page|conn@2||-18.5|-8||||
-Ngeneric:Invisible-Pin|pin@0||-13|-2|||||ART_message(D5G1;)S[Note: Gate Resistor removed for,NCC in miniheater chip]
-NWire_Pin|pin@1||0|-16.5||||
-NWire_Pin|pin@2||0|0||||
-Ngeneric:Invisible-Pin|pin@3||0|11.5|||||ART_message(D5G6;)S[NMOS]
-Ngeneric:Invisible-Pin|pin@4||-8.5|-4.5|||||ART_message(D5G1;)S[model,gate,resistance]
-Ngeneric:Invisible-Pin|pin@5||-0.5|6|||||ART_message(D5G2;)Sstandard-threshold strength-based NMOS device
-Awire|net@3|||1800|pin@1||0|-16.5|conn@0|a|4|-16.5
-Awire|net@4|||1800|pin@2||0|0|conn@1|a|3.5|0
-Awire|net@5|||900|pin@2||0|0|NMOSf@0|d|0|-6
-Awire|net@6|||1800|conn@2|y|-16.5|-8|NMOSf@0|g|-3|-8
-Awire|net@7|||2700|pin@1||0|-16.5|NMOSf@0|s|0|-10
-Ed||D5G2;|conn@1|y|B
-Eg||D5G2;|conn@2|a|I
-Es||D5G2;|conn@0|y|B
-X
-
-# Cell PMOS;1{ic}
-CPMOS;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-2;)I100|ATTR_X(D5G1.5;HNPX3.5;Y0.5;)I1|prototype_center()I[-8000,16000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-2|0|1|1|RR||ART_color()I10
-Ngeneric:Invisible-Pin|pin@0||0|2||||
-Nschematic:Bus_Pin|pin@1||0|-2|-2|-2||
-Nschematic:Bus_Pin|pin@2||-3|0|-2|-2||
-NPin|pin@3||0|1||||
-NPin|pin@4||-0.75|1|1|1||
-NPin|pin@5||-0.75|-1|1|1||
-NPin|pin@6||0|-1||||
-NPin|pin@7||0|-2||||
-NPin|pin@8||-3|0|||RR|
-NPin|pin@9||-2.5|0|1|1|RRR|
-NPin|pin@10||0|2||||
-NPin|pin@11||-1.5|1|1|1|Y|
-NPin|pin@12||-1.5|-1|1|1|Y|
-AThicker|net@0|||FS0|pin@3||0|1|pin@4||-0.75|1|ART_color()I10
-AThicker|net@1|||FS1800|pin@5||-0.75|-1|pin@6||0|-1|ART_color()I10
-AThicker|net@2|||FS1800|pin@8||-3|0|pin@9||-2.5|0|ART_color()I10
-AThicker|net@3|||FS2700|pin@3||0|1|pin@10||0|2|ART_color()I10
-AThicker|net@4|||FS900|pin@6||0|-1|pin@7||0|-2|ART_color()I10
-AThicker|net@5|||FS900|pin@4||-0.75|1|pin@5||-0.75|-1|ART_color()I10
-AThicker|net@6|||FS2700|pin@12||-1.5|-1|pin@11||-1.5|1|ART_color()I10
-Ed||D8G1;|pin@1||B
-Eg||D6G1;|pin@2||I
-Es||D2G1;|pin@0||B
-X
-
-# Cell PMOS;1{sch}
-CPMOS;1{sch}||schematic|1021415734000|1161733431808||ATTR_Delay(D5G1;HNPX-8.5;Y-0.25;)I100|ATTR_X(D5G1;HNPX-8.5;Y1.25;)I1|prototype_center()I[0,0]
-IPMOS;1{ic}|PMOS@0||15.25|12.5|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I100|ATTR_X(D5G1.5;NPX3.5;Y0.5;)I1
-IorangeTSMC090nm:PMOSf;1{ic}|PMOSf@0||0|7|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_L(D5G1;NOJPX3.5;)S@X == 0 ? 0 : @X < 0.5 ? (0.5 * (2 - 0.4) / @X + 0.4) : 2|ATTR_W(D6G1;NOJPX2;Y1;)S@X > 0.5 ? 6.0*@X : 3
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||5|11.5||||
-NOff-Page|conn@1||-9.5|7||||
-NOff-Page|conn@2||5|1||||
-Ngeneric:Invisible-Pin|pin@0||-10|10||||
-NWire_Pin|pin@1||0|11.5||||
-NWire_Pin|pin@2||0|1||||
-Ngeneric:Invisible-Pin|pin@3||-0.5|23.5|||||ART_message(D5G6;)S[PMOS]
-Ngeneric:Invisible-Pin|pin@4||-0.5|18.5|||||ART_message(D5G2;)S3 terminal standard-threshold strength-based PMOS device
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-Cinv2iCTLn;1{ic}||artwork|993434516000|1204140525662|E|ATTR_X(D5G1.5;HNPX1.5;Y2;)I1|prototype_center()I[0,0]
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-# Cell inv2iCTLp;1{ic}
-Cinv2iCTLp;1{ic}||artwork|993434516000|1204140525662|E|ATTR_X(D5G1.5;HNPX1.5;Y2;)I1|prototype_center()I[0,0]
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-Ectl||D5G2;|pin@6||I
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-X
-
-# Cell inv2iCTLp;1{sch}
-Cinv2iCTLp;1{sch}||schematic|993433994000|1158010267102||ATTR_X(D5G2;HNPX-19;Y-5;)I1|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSxwk;1{ic}|PMOSwk@0||0|15|||D0G4;|ATTR_Delay(D5G1;NPX3.5;Y-2;)I175|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell inv2iHT;1{ic}
-Cinv2iHT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@3||-0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
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-X
-
-# Cell inv2iHT;1{sch}
-Cinv2iHT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-14.5;Y-11.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-14.5;Y-10.5;)S1|ATTR_drive0(D5G1;HNPTX-14.5;Y-12.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-14.5;Y-13.5;)Sstrong1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-13|-6||||
-NOff-Page|conn@1||-13.5|6||||
-NOff-Page|conn@2||8|0||||
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-Ngeneric:Invisible-Pin|pin@5||0|19|||||ART_message(D5G2;)S[two-input HI-threshold inverter]
-NWire_Pin|pin@6||0|0||||
-Ngeneric:Invisible-Pin|pin@7||1|17|||||ART_message(D5G2;)S[P to N width ratio is 4 to 1]
-Ngeneric:Invisible-Pin|pin@8||25|-9|||||ART_message(D5G2;)S[X is drive strength,P drive strength is twice N strength]
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-Awire|net@18|||1800|conn@0|y|-11|-6|NMOS@0|g|-3|-6
-Ein[n]||D5G2;|conn@0|a|I
-Ein[p]||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell inv2iLT;1{ic}
-Cinv2iLT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1|1|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@2||-0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I10
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-NPin|pin@1||-1.5|-1|1|1||
-Nschematic:Bus_Pin|pin@2||-2.5|-1||||
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-NPin|pin@5||-2.5|1||||
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-NPin|pin@7||-1.5|-2|1|1||
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-AThicker|net@2|||FS2700|pin@7||-1.5|-2|pin@6||-1.5|2|ART_color()I10
-AThicker|net@3|||FS337|pin@3||1.5|0|pin@7||-1.5|-2|ART_color()I10
-AThicker|net@4|||FS3263|pin@3||1.5|0|pin@6||-1.5|2|ART_color()I10
-Ein[n]||D5G1;|pin@2||I
-Ein[p]||D5G1;|pin@8||I
-Eout||D5G1;|pin@9||O
-X
-
-# Cell inv2iLT;1{sch}
-Cinv2iLT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-13;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-12;Y-12;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-14;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-15;)Sstrong1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*2.0
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-6||||
-NOff-Page|conn@1||-14.5|6||||
-NOff-Page|conn@2||8|0||||
-NGround|gnd@0||0|-12.5||||
-Iinv2iLT;1{ic}|inv2iLT@0||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-NWire_Pin|pin@2||-3|6||||
-Ngeneric:Invisible-Pin|pin@4||25|-10|||||ART_message(D5G2;)S[X is drive strength,N drive strength is twice P strength]
-Ngeneric:Invisible-Pin|pin@5||0.5|17|||||ART_message(D5G2;)S[This is a 2 to 2 width ratio inverter]
-NWire_Pin|pin@6||0|0||||
-Ngeneric:Invisible-Pin|pin@7||0|19|||||ART_message(D5G2;)S[two-input LO-threshold inverter]
-Ngeneric:Invisible-Pin|pin@8||-1|24|||||ART_message(D5G6;)S[inv2iLT]
-NPower|pwr@0||0|12.5||||
-Awire|net@5|||1800|pin@2||-3|6|PMOS@0|g|-3|6
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-Awire|net@9|||2700|pin@6||0|0|PMOS@0|d|0|4
-Awire|net@10|||2700|gnd@0||0|-10.5|NMOS@0|s|0|-8
-Awire|net@11|||900|pin@6||0|0|NMOS@0|d|0|-4
-Awire|net@12|||0|conn@2|a|6|0|pin@6||0|0
-Awire|net@16|||1800|conn@1|y|-12.5|6|PMOS@0|g|-3|6
-Awire|net@17|||1800|conn@0|y|-12|-6|NMOS@0|g|-3|-6
-Ein[n]||D5G2;|conn@0|a|I
-Ein[p]||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell inv2iV;1{ic}
-Cinv2iV;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1.5;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;HNOLPX1.5;Y-2.5;)S1|ATTR_XP(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NThick-Circle|art@2||-1|1|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@3||-0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-Nschematic:Bus_Pin|pin@0||-2.5|-1|-2|-2||
-Nschematic:Bus_Pin|pin@1||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@2||-2.5|1|-2|-2||
-NPin|pin@3||-1.5|-2|1|1||
-NPin|pin@4||-1.5|2|1|1||
-NPin|pin@5||-2.5|-1||||
-NPin|pin@6||-1.5|-1|1|1||
-NPin|pin@7||1.5|0|1|1||
-NPin|pin@8||-1.5|1|1|1||
-NPin|pin@9||-2.5|1||||
-AThicker|net@0|||FS0|pin@6||-1.5|-1|pin@5||-2.5|-1|ART_color()I10
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-Ein[n]||D5G1;|pin@0||I
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-Eout||D5G1;|pin@1||O
-X
-
-# Cell inv2iV;1{sch}
-Cinv2iV;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-16;Y-12;)I100|ATTR_XN(D5FLeave alone;G1;HNOLPX-16;Y-10;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX-16;Y-11;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-13;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-14;)Sstrong1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XN
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XP
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-12|-6||||
-NOff-Page|conn@1||7|0||||
-NOff-Page|conn@2||-12|6||||
-NGround|gnd@0||0|-12||||
-Iinv2iV;1{ic}|inv2iV@0||18.5|9.5|||D0G4;|ATTR_Delay(D5G1;NPX1.5;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;NOLPX1.5;Y-2.5;)S1|ATTR_XP(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-NWire_Pin|pin@0||0|0||||
-Ngeneric:Invisible-Pin|pin@1||-1.5|21|||||ART_message(D5G6;)S[inv2iV]
-Ngeneric:Invisible-Pin|pin@2||-0.5|16.5|||||ART_message(D5G2;)S[two-parameter two-input variable ratio inverter]
-Ngeneric:Invisible-Pin|pin@3||25|-12.5|||||ART_message(D5G2;)S[X is drive strength,"P and N drive strengths are XP, XN"]
-NPower|pwr@0||0|10.5||||
-Awire|net@0|||0|NMOS@0|g|-3|-6|conn@0|y|-10|-6
-Awire|net@1|||0|PMOS@0|g|-3|6|conn@2|y|-10|6
-Awire|net@2|||0|conn@1|a|5|0|pin@0||0|0
-Awire|net@3|||900|pin@0||0|0|NMOS@0|d|0|-4
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-Awire|net@5|||900|NMOS@0|s|0|-8|gnd@0||0|-10
-Awire|net@6|||2700|PMOS@0|s|0|8|pwr@0||0|10.5
-Ein[n]||D5G2;|conn@0|a|I
-Ein[p]||D5G2;|conn@2|a|I
-Eout||D5G2;|conn@1|y|O
-X
-
-# Cell invCLK;1{ic}
-CinvCLK;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I10|trace()V[0.25/-0.5,-0.25/-0.5,-0.25/0.5]
-NOpened-Thicker-Polygon|art@2||-1|0|0.5|1|||ART_color()I10|trace()V[0.25/-0.5,-0.25/-0.5,-0.25/0.5,0.25/0.5]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@4||0.5|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||-2.5|0|-2|-2||
-NPin|pin@2||-1.5|-2|1|1||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-2.5|0||||
-NPin|pin@5||-1.5|0|1|1||
-NPin|pin@6||1.5|0|1|1||
-AThicker|net@0|||FS3263|pin@6||1.5|0|pin@3||-1.5|2|ART_color()I10
-AThicker|net@1|||FS337|pin@6||1.5|0|pin@2||-1.5|-2|ART_color()I10
-AThicker|net@2|||FS2700|pin@2||-1.5|-2|pin@3||-1.5|2|ART_color()I10
-AThicker|net@3|||FS0|pin@5||-1.5|0|pin@4||-2.5|0|ART_color()I10
-Ein||D5G1;|pin@1||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell invCLK;1{sch}
-CinvCLK;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-12;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-7.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX28.5;Y-15;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*1.5
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||8|0||||
-NOff-Page|conn@1||-11|0||||
-NGround|gnd@0||0|-12.5||||
-IinvCLK;1{ic}|invCLK@0||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||-0.5|19|||||ART_message(D5G2;)S[intended for driving clock circuits - gives nearly equal rise/fall]
-Ngeneric:Invisible-Pin|pin@1||-1|28|||||ART_message(D5G6;)S[invCLK]
-Ngeneric:Invisible-Pin|pin@2||0|23|||||ART_message(D5G2;)S[medium HI-threshold fixed-size (non-LE) inverter]
-NWire_Pin|pin@3||0|0||||
-NWire_Pin|pin@4||-4|6||||
-NWire_Pin|pin@5||-4|-6||||
-NWire_Pin|pin@6||-4|0||||
-Ngeneric:Invisible-Pin|pin@7||1|21|||||ART_message(D5G2;)S[P to N width ratio is 3 to 1]
-Ngeneric:Invisible-Pin|pin@8||28|-10.5|||||ART_message(D5G2;)S[X is drive strength,P drive strength is twice N strength]
-NPower|pwr@0||0|12.5||||
-Awire|net@0|||0|conn@0|a|6|0|pin@3||0|0
-Awire|net@1|||2700|pin@6||-4|0|pin@4||-4|6
-Awire|net@2|||2700|pin@5||-4|-6|pin@6||-4|0
-Awire|net@3|||0|pin@6||-4|0|conn@1|y|-9|0
-Awire|net@4|||1800|pin@5||-4|-6|NMOS@0|g|-3|-6
-Awire|net@5|||900|pin@3||0|0|NMOS@0|d|0|-4
-Awire|net@6|||2700|gnd@0||0|-10.5|NMOS@0|s|0|-8
-Awire|net@7|||2700|pin@3||0|0|PMOS@0|d|0|4
-Awire|net@8|||1800|pin@4||-4|6|PMOS@0|g|-3|6
-Awire|net@9|||900|pwr@0||0|12.5|PMOS@0|s|0|8
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell invCTLn;1{ic}
-CinvCTLn;1{ic}||artwork|993434516000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.5;Y-1.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_sloDelay(D5G1;HNPX4.5;Y-3;)I175|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-Ngeneric:Invisible-Pin|pin@0||-2.5|0||||
-Ngeneric:Invisible-Pin|pin@1||2.5|0||||
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-NPin|pin@3||-1.5|-2|0.5|0.5||
-NPin|pin@4||1.5|0|0.5|0.5||
-Ngeneric:Invisible-Pin|pin@5||0|0|||||ART_message(D5G1.5;)S[CTLn]
-Ngeneric:Invisible-Pin|pin@6||0|-2||||
-NPin|pin@7||0|-2|1|1||
-NPin|pin@8||0|-1|1|1||
-NPin|pin@9||-2.5|0|1|1|R|
-NPin|pin@10||-1.5|0|1|1|R|
-AThicker|net@0|||FS900|pin@2||-1.5|2|pin@3||-1.5|-2|ART_color()I10
-AThicker|net@1|||FS3263|pin@4||1.5|0|pin@2||-1.5|2|ART_color()I10
-AThicker|net@2|||FS2137|pin@3||-1.5|-2|pin@4||1.5|0|ART_color()I10
-AThicker|net@3|||FS900|pin@8||0|-1|pin@7||0|-2|ART_color()I10
-AThicker|net@4|||FS1800|pin@9||-2.5|0|pin@10||-1.5|0|ART_color()I10
-Ectl||D5G2;|pin@6||I
-Ein||D5G2;|pin@0||I
-Eout||D5G2;|pin@1||O
-X
-
-# Cell invCTLn;1{sch}
-CinvCTLn;1{sch}||schematic|993433994000|1158010267102||ATTR_Delay(D5G2;HNPX-21.5;Y1;)I100|ATTR_X(D5FLeave alone;G2;HNOLPX-21.5;Y4;)S1|ATTR_sloDelay(D5G2;HNPX-22;Y-1.5;)I175|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|0.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@sloDelay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*2.0
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||0|9.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@sloDelay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*2.0
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|22|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||12.5|16||||
-NOff-Page|conn@1||-12|16||||
-NOff-Page|conn@2||-13|9.5||||
-NGround|gnd@0||0|-6.5||||
-IinvCTLn;1{ic}|invCTLn@0||15|27.75|||D0G4;|ATTR_Delay(D5G1;NPX4.5;Y-1.5;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S2|ATTR_sloDelay(D5G1;NPX4.5;Y-3;)I175
-NWire_Pin|pin@0||-5|16||||
-NWire_Pin|pin@1||0|16||||
-Ngeneric:Invisible-Pin|pin@2||0|33|||||ART_message(D5G3;)S[invCTLn]
-NWire_Pin|pin@3||-5|22||||
-NWire_Pin|pin@4||-2.5|22||||
-NWire_Pin|pin@5||0|20.5||||
-NWire_Pin|pin@6||-5|0.5||||
-NPower|pwr@0||0|28||||
-Awire|net@0|||0|pin@0||-5|16|conn@1|y|-10|16
-Awire|net@1|||1800|pin@1||0|16|conn@0|a|10.5|16|SIM_verilog_wire_type(D5G1;)Strireg
-Awire|net@2|||900|pin@3||-5|22|pin@0||-5|16
-Awire|net@3|||1800|pin@3||-5|22|pin@4||-2.5|22
-Awire|net@4|||2700|PMOS@0|d|0|20|pin@5||0|20.5
-Awire|net@5|||900|pwr@0||0|28|PMOS@0|s|0|24
-Awire|net@6|||1800|PMOS@0|g|-3|22|pin@4||-2.5|22
-Awire|net@7|||1800|pin@6||-5|0.5|NMOS@0|g|-3|0.5
-Awire|net@8|||900|NMOS@0|s|0|-1.5|gnd@0||0|-4.5
-Awire|net@9|||2700|pin@6||-5|0.5|pin@0||-5|16
-Awire|net@10|||900|pin@1||0|16|NMOSwk@0|d|0|11.5
-Awire|net@11|||2700|NMOS@0|d|0|2.5|NMOSwk@0|s|0|7.5
-Awire|net@12|||2700|pin@1||0|16|PMOS@0|d|0|20
-Awire|net@13|||0|NMOSwk@0|g|-3|9.5|conn@2|y|-11|9.5
-Ectl||D5G2;X-4;|conn@2|y|I
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell invCTLp;1{ic}
-CinvCTLp;1{ic}||artwork|993434516000|1204140525662|E|ATTR_Delay(D5G1;HNPX4.25;Y-1.75;)I100|ATTR_X(D5G1.5;HNPX1.5;Y2;)I1|ATTR_sloDelay(D5G1;HNPX4.75;Y-3.25;)I175|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||0|-1.5|1|1|||ART_color()I10
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-NPin|pin@0||-1.5|0|1|1|R|
-NPin|pin@1||-2.5|0|1|1|R|
-Ngeneric:Invisible-Pin|pin@2||0|-2||||
-Ngeneric:Invisible-Pin|pin@3||0|0|||||ART_message(D5G1.5;)S[CTLp]
-NPin|pin@4||1.5|0|0.5|0.5||
-NPin|pin@5||-1.5|-2|0.5|0.5||
-NPin|pin@6||-1.5|2|0.5|0.5||
-Ngeneric:Invisible-Pin|pin@7||2.5|0||||
-Ngeneric:Invisible-Pin|pin@8||-2.5|0||||
-AThicker|net@0|||FS1800|pin@1||-2.5|0|pin@0||-1.5|0|ART_color()I10
-AThicker|net@1|||FS2137|pin@5||-1.5|-2|pin@4||1.5|0|ART_color()I10
-AThicker|net@2|||FS3263|pin@4||1.5|0|pin@6||-1.5|2|ART_color()I10
-AThicker|net@3|||FS900|pin@6||-1.5|2|pin@5||-1.5|-2|ART_color()I10
-Ectl||D5G2;|pin@2||I
-Ein||D5G2;|pin@8||I
-Eout||D5G2;|pin@7||O
-X
-
-# Cell invCTLp;1{sch}
-CinvCTLp;1{sch}||schematic|993433994000|1159377323484||ATTR_Delay(D5G2;HNPX-21;Y-1;)I100|ATTR_X(D5G2;HNPX-21;Y1.5;)I1|ATTR_sloDelay(D5G2;HNPX-21;Y-3.5;)I175|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|0.5|||D0G4;|ATTR_Delay(D5G1;NOLPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|22|||D0G4;|ATTR_Delay(D5G1;NOLPX3.5;Y-2;)S@sloDelay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-IorangeTSMC090nm:PMOSxwk;1{ic}|PMOSwk@0||0|15|||D0G4;|ATTR_Delay(D5G1;NOLPX3.5;Y-2;)S@sloDelay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-13|15||||
-NOff-Page|conn@1||-12|8||||
-NOff-Page|conn@2||12.5|8||||
-NGround|gnd@0||0|-6.5||||
-IinvCTLp;1{ic}|invCTLp@0||15|27.75|||D0G4;|ATTR_Delay(D5G1;NPX4.25;Y-1.75;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)I2|ATTR_sloDelay(D5G1;NPX4.75;Y-3.25;)I175
-NWire_Pin|pin@0||-5|0.5||||
-NWire_Pin|pin@1||0|20.5||||
-NWire_Pin|pin@2||-2.5|22||||
-NWire_Pin|pin@3||-5|22||||
-Ngeneric:Invisible-Pin|pin@4||0|33|||||ART_message(D5G3;)S[invCTLp]
-NWire_Pin|pin@5||0|8||||
-NWire_Pin|pin@6||-5|8||||
-NPower|pwr@0||0|28||||
-Awire|net@0|||0|PMOSwk@0|g|-3|15|conn@0|y|-11|15
-Awire|net@1|||2700|pin@5||0|8|PMOSwk@0|d|0|13
-Awire|net@2|||900|PMOS@0|d|0|20|PMOSwk@0|s|0|17
-Awire|net@3|||900|pin@5||0|8|NMOS@0|d|0|2.5
-Awire|net@4|||2700|pin@0||-5|0.5|pin@6||-5|8
-Awire|net@5|||900|NMOS@0|s|0|-1.5|gnd@0||0|-4.5
-Awire|net@6|||1800|pin@0||-5|0.5|NMOS@0|g|-3|0.5
-Awire|net@7|||1800|PMOS@0|g|-3|22|pin@2||-2.5|22
-Awire|net@8|||900|pwr@0||0|28|PMOS@0|s|0|24
-Awire|net@9|||2700|PMOS@0|d|0|20|pin@1||0|20.5
-Awire|net@10|||1800|pin@3||-5|22|pin@2||-2.5|22
-Awire|net@11|||900|pin@3||-5|22|pin@6||-5|8
-Awire|net@12|||1800|pin@5||0|8|conn@2|a|10.5|8|SIM_verilog_wire_type(D5G1;)Strireg
-Awire|net@13|||0|pin@6||-5|8|conn@1|y|-10|8
-Ectl||D5G2;X-4;|conn@0|y|I
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell invHT;1{ic}
-CinvHT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-NPin|pin@0||1.5|0|1|1||
-NPin|pin@1||-1.5|0|1|1||
-NPin|pin@2||-2.5|0||||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@5||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@6||2.5|0|-2|-2||
-AThicker|net@0|||FS0|pin@1||-1.5|0|pin@2||-2.5|0|ART_color()I10
-AThicker|net@1|||FS2700|pin@4||-1.5|-2|pin@3||-1.5|2|ART_color()I10
-AThicker|net@2|||FS337|pin@0||1.5|0|pin@4||-1.5|-2|ART_color()I10
-AThicker|net@3|||FS3263|pin@0||1.5|0|pin@3||-1.5|2|ART_color()I10
-Ein||D5G1;|pin@5||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell invHT;1{sch}
-CinvHT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-12;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-7.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX25.5;Y-15;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-11|0||||
-NOff-Page|conn@1||8|0||||
-NGround|gnd@0||0|-12.5||||
-IinvHT;1{ic}|invHT@0||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||26.5|-10|||||ART_message(D5G2;)S[X is drive strength,P drive strength is twice N strength]
-Ngeneric:Invisible-Pin|pin@1||1|17|||||ART_message(D5G2;)S[P to N width ratio is 4 to 1]
-NWire_Pin|pin@2||-4|0||||
-NWire_Pin|pin@3||-4|-6||||
-NWire_Pin|pin@4||-4|6||||
-NWire_Pin|pin@5||0|0||||
-Ngeneric:Invisible-Pin|pin@6||0|19|||||ART_message(D5G2;)S[HI-threshold fixed-size (non-LE) inverter]
-Ngeneric:Invisible-Pin|pin@7||-1|24|||||ART_message(D5G6;)S[invHT]
-NPower|pwr@0||0|12.5||||
-Awire|net@0|||900|pwr@0||0|12.5|PMOS@0|s|0|8
-Awire|net@1|||1800|pin@4||-4|6|PMOS@0|g|-3|6
-Awire|net@2|||2700|pin@5||0|0|PMOS@0|d|0|4
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-Awire|net@4|||900|pin@5||0|0|NMOS@0|d|0|-4
-Awire|net@5|||1800|pin@3||-4|-6|NMOS@0|g|-3|-6
-Awire|net@6|||0|pin@2||-4|0|conn@0|y|-9|0
-Awire|net@7|||2700|pin@3||-4|-6|pin@2||-4|0
-Awire|net@8|||2700|pin@2||-4|0|pin@4||-4|6
-Awire|net@9|||0|conn@1|a|6|0|pin@5||0|0
-Ein||D5G2;|conn@0|a|I
-Eout||D5G2;|conn@1|y|O
-X
-
-# Cell invK;1{ic}
-CinvK;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNOJPX2;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sweak0|ATTR_drive1(D5G1;HPT)Sweak1|prototype_center()I[2000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@2||-0.5|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-NPin|pin@1||1.5|0|1|1||
-NPin|pin@2||2.5|0||||
-Nschematic:Bus_Pin|pin@3||-2.5|0|-2|-2||
-NPin|pin@4||-1.5|-2|1|1||
-NPin|pin@5||-1.5|2|1|1||
-NPin|pin@6||1.5|0|1|1||
-AThicker|net@0|||FS0|pin@2||2.5|0|pin@1||1.5|0|ART_color()I10
-AThicker|net@1|||FS3263|pin@6||1.5|0|pin@5||-1.5|2|ART_color()I10
-AThicker|net@2|||FS337|pin@6||1.5|0|pin@4||-1.5|-2|ART_color()I10
-AThicker|net@3|||FS2700|pin@4||-1.5|-2|pin@5||-1.5|2|ART_color()I10
-Ein||D5G1;|pin@3||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell invK;1{sch}
-CinvK;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNOJPX-14;Y-6.5;)S@Delay|ATTR_X(D5FLeave alone;G1;HNOLPX-14;Y-5.5;)S1|ATTR_drive0(D5G1;HNPTX-14;Y-7.5;)Sweak0|ATTR_drive1(D5G1;HNPTX-14;Y-8.5;)Sweak1|ATTR_verilog_template(D5G1;NTX30;Y-15;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||2|-5|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSxwk;1{ic}|PMOSwk@0||2|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||8|0||||
-NOff-Page|conn@1||-11|0||||
-NGround|gnd@0||2|-12||||
-IinvK;1{ic}|invK@0||18.5|12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sweak0|ATTR_drive1(P)Sweak1|ATTR_LEKEEPER(T)I1|ATTR_LEPARALLGRP()I-1|ATTR_su()I-1
-Ngeneric:Invisible-Pin|pin@0||-1|18|||||ART_message(D5G2;)S[LO threshold fixed-size keeper inverter]
-Ngeneric:Invisible-Pin|pin@1||-1|23.5|||||ART_message(D5G6;)S[invK]
-Ngeneric:Invisible-Pin|pin@2||-2|16|||||ART_message(D5G2;)S[P to N width ratio is 2 to 1]
-Ngeneric:Invisible-Pin|pin@3||28.5|-10.5|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
-NWire_Pin|pin@4||-2|-5|0.5|0.5||
-NWire_Pin|pin@5||-2|6|0.5|0.5||
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-Awire|net@9|||1800|conn@1|y|-9|0|pin@6||-2|0
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell invKV;1{ic}
-CinvKV;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;HNOLPX1.5;Y-2.25;)S1|ATTR_XP(D5FLeave alone;G1.5;HNOLPX1.5;Y1.75;)S1|ATTR_drive0(D5G1;HPT)Sweak0|ATTR_drive1(D5G1;HPT)Sweak1|prototype_center()I[2000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|0.5|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,-0.25/0,0.25/0.5,-0.25/0,0.25/-0.5]
-NThick-Circle|art@2||-2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@3||-0.5|-0.75|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
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-NPin|pin@2||-1.5|-2|1|1||
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-Nschematic:Bus_Pin|pin@6||-2.5|0|-2|-2||
-AThicker|net@0|||FS2700|pin@2||-1.5|-2|pin@1||-1.5|2|ART_color()I10
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-Ein||D5G1;|pin@6||I
-Eout||D5G1;|pin@5||O
-X
-
-# Cell invKV;1{sch}
-CinvKV;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-11.5;Y-5.5;)I100|ATTR_XN(D5FLeave alone;G1;HNOLPX-11.5;Y-3.5;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX-11.5;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-11;Y-6.5;)Sweak0|ATTR_drive1(D5G1;HNPTX-11;Y-7.5;)Sweak1|ATTR_verilog_template(D5G1;NTX24.5;Y-13;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSxwk;1{ic}|NMOSwk@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XN
-IorangeTSMC090nm:PMOSxwk;1{ic}|PMOSwk@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XP
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-11|0||||
-NOff-Page|conn@1||8|0||||
-NGround|gnd@0||0|-11||||
-IinvKV;1{ic}|invKV@0||21.5|9|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;NOLPX1.5;Y-2.25;)S1|ATTR_XP(D5FLeave alone;G1.5;NOLPX1.5;Y1.75;)S1|ATTR_drive0(P)Sweak0|ATTR_drive1(P)Sweak1
-Ngeneric:Invisible-Pin|pin@0||26|-7.5|||||ART_message(D5G2;)S[X is drive strength,"P and N drive strengths are XP, XN"]
-NWire_Pin|pin@1||-4|-6||||
-NWire_Pin|pin@2||-4|6||||
-NWire_Pin|pin@3||0|0||||
-NWire_Pin|pin@4||-4|0||||
-Ngeneric:Invisible-Pin|pin@5||-0.5|17|||||ART_message(D5G6;)S[invKV]
-Ngeneric:Invisible-Pin|pin@6||-1|13.5|||||ART_message(D5G2;)S[Two parameter variable ratio keeper]
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-Awire|net@2|||1800|pin@2||-4|6|PMOSwk@0|g|-3|6
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-Awire|net@6|||1800|conn@0|y|-9|0|pin@4||-4|0
-Awire|net@7|||0|conn@1|a|6|0|pin@3||0|0
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-Awire|net@9|||2700|pin@4||-4|0|pin@2||-4|6
-Ein||D5G2;|conn@0|a|I
-Eout||D5G2;|conn@1|y|O
-X
-
-# Cell invLT;1{ic}
-CinvLT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@2||-0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
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-Nschematic:Bus_Pin|pin@1||-2.5|0|-2|-2||
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-NPin|pin@3||-1.5|2|1|1||
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-NPin|pin@5||-1.5|0|1|1||
-NPin|pin@6||1.5|0|1|1||
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-AThicker|net@2|||FS2700|pin@2||-1.5|-2|pin@3||-1.5|2|ART_color()I10
-AThicker|net@3|||FS0|pin@5||-1.5|0|pin@4||-2.5|0|ART_color()I10
-Ein||D5G1;|pin@1||I
-Eout||D5G1;|pin@0||O
-X
-
-# Cell invLT;1{sch}
-CinvLT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-12;Y-4;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-6;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-7;)Sstrong1|ATTR_verilog_template(D5G1;NTX23;Y-13;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||11|0||||
-NOff-Page|conn@1||-11.5|0||||
-NGround|gnd@0||0|-12.5||||
-IinvLT;1{ic}|invLT@0||16|10.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-NWire_Pin|pin@0||-4|0||||
-NWire_Pin|pin@1||0|0||||
-Ngeneric:Invisible-Pin|pin@2||-1|24|||||ART_message(D5G6;)S[invLT]
-Ngeneric:Invisible-Pin|pin@3||0|19|||||ART_message(D5G2;)S[LO-threshold fixed-size (non-LE) inverter]
-NWire_Pin|pin@4||-4|6||||
-NWire_Pin|pin@5||-4|-6||||
-Ngeneric:Invisible-Pin|pin@6||0.5|17|||||ART_message(D5G2;)S[This is a 2 to 2 width ratio inverter]
-Ngeneric:Invisible-Pin|pin@7||24|-9|||||ART_message(D5G2;)S[X is drive strength,N drive strength is twice P strength]
-NPower|pwr@0||0|12.5||||
-Awire|net@0|||0|pin@0||-4|0|conn@1|y|-9.5|0
-Awire|net@1|||900|pin@4||-4|6|pin@0||-4|0
-Awire|net@2|||900|pin@0||-4|0|pin@5||-4|-6
-Awire|net@3|||1800|pin@1||0|0|conn@0|a|9|0
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-Awire|net@5|||2700|pin@1||0|0|PMOS@0|d|0|4
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-Awire|net@8|||2700|gnd@0||0|-10.5|NMOS@0|s|0|-8
-Awire|net@9|||1800|pin@5||-4|-6|NMOS@0|g|-3|-6
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell invV;1{ic}
-CinvV;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX1.5;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;HNOLPX1.75;Y-2.5;)S1|ATTR_XP(D5FLeave alone;G1.5;HNOLPX1.75;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@2||-0.5|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-Nschematic:Bus_Pin|pin@0||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||2.5|0|-2|-2||
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-AThicker|net@3|||FS2700|pin@2||-1.5|-2|pin@3||-1.5|2|ART_color()I10
-Ein||D5G1;|pin@0||I
-Eout||D5G1;|pin@1||O
-X
-
-# Cell invV;1{sch}
-CinvV;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-7;)I100|ATTR_XN(D5FLeave alone;G1;HNOLPX-12;Y-5;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX-12;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX19.5;Y-16;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XN
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@XP
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||7|0||||
-NOff-Page|conn@1||-12|0||||
-NGround|gnd@0||0|-12||||
-IinvV;1{ic}|invV@0||24|10.5|||D0G4;|ATTR_Delay(D5G1;NPX1.5;Y-4;)I100|ATTR_XN(D5FLeave alone;G1.5;NOLPX1.75;Y-2.5;)S1|ATTR_XP(D5FLeave alone;G1.5;NOLPX1.75;Y2;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||0.5|17.5|||||ART_message(D5G2;)S[two-parameter variable ratio inverter]
-Ngeneric:Invisible-Pin|pin@1||-0.5|21.5|||||ART_message(D5G6;)S[invV]
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-NWire_Pin|pin@4||-5|-6||||
-NWire_Pin|pin@5||-5|6||||
-Ngeneric:Invisible-Pin|pin@6||28|-11.5|||||ART_message(D5G2;)S[X is drive strength,"P and N drive strengths are XP, XN"]
-NPower|pwr@0||0|10.5||||
-Awire|net@0|||900|NMOS@0|s|0|-8|gnd@0||0|-10
-Awire|net@1|||900|pin@2||0|0|NMOS@0|d|0|-4
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-Awire|net@3|||2700|PMOS@0|s|0|8|pwr@0||0|10.5
-Awire|net@4|||1800|pin@5||-5|6|PMOS@0|g|-3|6
-Awire|net@5|||2700|pin@2||0|0|PMOS@0|d|0|4
-Awire|net@6|||1800|pin@2||0|0|conn@0|a|5|0
-Awire|net@7|||0|pin@3||-5|0|conn@1|y|-10|0
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-Awire|net@9|||2700|pin@3||-5|0|pin@5||-5|6
-Ein||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell invVn;1{ic}
-CinvVn;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-3;)I100|ATTR_NPdrvR(D5FLeave alone;G1;HNOLPX2;Y-2;)S1|ATTR_X(D5FLeave alone;G1.5;HNOLPX1.5;Y2;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@2||-0.5|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,0/-0.5,0.25/0.5]
-NOpened-Thicker-Polygon|art@3||0.25|-0.12|0.5|0.75|||ART_color()I10|trace()V[-0.25/-0.375,-0.25/0.375,0.25/-0.375,0.25/0.375]
-Nschematic:Bus_Pin|pin@0||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||2.5|0|-2|-2||
-NPin|pin@2||-1.5|-2|1|1||
-NPin|pin@3||-1.5|2|1|1||
-NPin|pin@4||-2.5|0||||
-NPin|pin@5||-1.5|0|1|1||
-NPin|pin@6||1.5|0|1|1||
-AThicker|net@0|||FS0|pin@5||-1.5|0|pin@4||-2.5|0|ART_color()I10
-AThicker|net@1|||FS3263|pin@6||1.5|0|pin@3||-1.5|2|ART_color()I10
-AThicker|net@2|||FS337|pin@6||1.5|0|pin@2||-1.5|-2|ART_color()I10
-AThicker|net@3|||FS2700|pin@2||-1.5|-2|pin@3||-1.5|2|ART_color()I10
-Ein||D5G1;|pin@0||I
-Eout||D5G1;|pin@1||O
-X
-
-# Cell invVn;1{sch}
-CinvVn;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-15.5;Y-7.5;)I100|ATTR_NPdrvR(D5FLeave alone;G1;HNOLPX-15.5;Y-6.5;)S1|ATTR_X(D5FLeave alone;G1;HNOLPX-15.5;Y-5.5;)S1|ATTR_drive0(D5G1;HNPTX-15.5;Y-8.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-15.5;Y-9.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX18.5;Y-19.5;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X*@NPdrvR
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||0|6|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3;)S@X
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-X
-
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-X
-
-# Cell invVp;1{sch}
-CinvVp;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-12;Y-7;)I100|ATTR_PNdrvR(D5FLeave alone;G1;HNOLPX-12;Y-6;)S1|ATTR_X(D5FLeave alone;G1;HNOLPX-12.5;Y-5;)S1|ATTR_drive0(D5G1;HNPTX-12;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX22;Y-15.5;)Snot ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(in));|prototype_center()I[0,0]
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-CmullerC;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-
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-CmullerC;1{sch}||schematic|1021415734000|1157995398986||ATTR_Delay(D5G1;HNPX-16;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-7.5;)Sstrong1|prototype_center()I[0,0]
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-X
-
-# Cell mullerC_sy;1{ic}
-CmullerC_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-
-# Cell mullerC_sy;1{sch}
-CmullerC_sy;1{sch}||schematic|1021415734000|1157995387844||ATTR_Delay(D5G1;HNPX-16;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-7.5;)Sstrong1|prototype_center()I[0,0]
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-Eina||D5G2;|conn@2|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell mux21_tri;1{ic}
-Cmux21_tri;1{ic}||artwork|1092084237000|1204140525662|E|ATTR_Delay(D5G1;HNPX3.5;Y-4.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX4;Y2;)S1|prototype_center()I[0,0]
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-AThicker|net@12|||FS2700|pin@22||0.5|3.25|pin@21||0.5|4.5|ART_color()I10
-Ein0||D5G1;|pin@0||I
-Ein1||D5G1;|pin@2||I
-Eout||D5G1;|pin@4||O
-Esel||D5G1;|pin@6||I
-X
-
-# Cell mux21_tri;1{sch}
-Cmux21_tri;1{sch}||schematic|1092081747000|1157998412989||ATTR_Delay(D5G1;HNPX-20;Y-11.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-20;Y-10;)S1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-16|0||||
-NOff-Page|conn@2||-16|6||||
-NOff-Page|conn@3||10|0||||
-Iinv;1{ic}|inv@0||-4|0|||D5G4;|ATTR_Delay(D5G1;NOJPX2;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y2;)S@X/2.0|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Imux21_tri;1{ic}|mux2@0||22|13|||D5G4;|ATTR_Delay(D5G1;NPX3.5;Y-4.5;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX4;Y2;)S1
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-NWire_Pin|pin@3||0|0||||
-NWire_Pin|pin@4||0|10||||
-NWire_Pin|pin@5||-8|10||||
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-NWire_Pin|pin@7||-8|-10||||
-NWire_Pin|pin@8||0|-10||||
-Ngeneric:Invisible-Pin|pin@10||-5|19|||||ART_message(D5G5;)Smux21_tri
-Ngeneric:Invisible-Pin|pin@11||-5|15|||||ART_message(D5G2;)Sa 2:1 mux using tristate inverters
-NWire_Pin|pin@12||5|0||||
-ItriInv;1{ic}|triInv@5||0|6|||D5G4;|ATTR_Delay(D5G1;NOJPX4.5;Y-1.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3;Y2;)S@X
-ItriInv;1{ic}|triInv@6||0|-6|||D5G4;|ATTR_Delay(D5G1;NOJPX4.5;Y-1.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3;Y2;)S@X
-Awire|net@0|||1800|conn@0|y|-14|-6|triInv@6|in|-2.5|-6
-Awire|net@1|||1800|conn@2|y|-14|6|triInv@5|in|-2.5|6
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-Awire|net@6|||0|pin@2||5|6|triInv@5|out|2.5|6
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-Ein1||D5G2;|conn@0|a|I
-Eout||D5G2;|conn@3|y|O
-Esel||D5G2;|conn@1|a|I
-X
-
-# Cell nand2;1{ic}
-Cnand2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-NPin|pin@1||-2.5|1||||
-NPin|pin@2||-0.5|-2|1|1||
-NPin|pin@3||-1.5|-2|1|1||
-NPin|pin@4||-1.5|2|1|1||
-Nschematic:Bus_Pin|pin@5||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@6||-2.5|1|-2|-2||
-NPin|pin@7||-0.5|2|1|1||
-NPin|pin@8||-2.5|-1||||
-NPin|pin@9||-1.5|-1|1|1||
-Nschematic:Bus_Pin|pin@10||-2.5|-1|-2|-2||
-NPin|pin@11||-1.5|-0.75|1|1||
-NPin|pin@12||-0.25|-2|1|1||
-AThicker|net@0|||FS0|pin@0||-1.5|1|pin@1||-2.5|1|ART_color()I10
-AThicker|net@1|||FS0|pin@2||-0.5|-2|pin@3||-1.5|-2|ART_color()I10
-AThicker|net@2|||FS2700|pin@3||-1.5|-2|pin@4||-1.5|2|ART_color()I10
-AThicker|net@3|||FS0|pin@7||-0.5|2|pin@4||-1.5|2|ART_color()I10
-AThicker|net@4|||FS0|pin@9||-1.5|-1|pin@8||-2.5|-1|ART_color()I10
-AThicker|net@5|||FS3150|pin@12||-0.25|-2|pin@11||-1.5|-0.75|ART_color()I10
-Eina||D5G1;|pin@10||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@5||O
-X
-
-# Cell nand2;1{sch}
-Cnand2;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-16;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-7.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX21;Y-18.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||15.5|0||||
-NOff-Page|conn@1||19.5|-5|||RR|
-NOff-Page|conn@2||-21.5|-1||||
-Inand2;1{ic}|nand2@0||15.5|12.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2.25;Y1.5;)S@X
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-NWire_Pin|pin@16||-5|7.5||||
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-NWire_Pin|pin@18||9|4||||
-NWire_Pin|pin@19||4.5|0||||
-Ngeneric:Invisible-Pin|pin@20||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND]
-NWire_Pin|pin@21||-5|0||||
-NWire_Pin|pin@22||9|-5||||
-NWire_Pin|pin@23||-9|4||||
-Ngeneric:Invisible-Pin|pin@24||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2]
-Ngeneric:Invisible-Pin|pin@25||22.5|-13.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-NWire_Pin|pin@26||-9|-1||||
-NPower|pwr@0||-5|10.5||||
-Awire|net@14|||900|pin@2||0|0|nms2@0|d|0|-3
-Awire|net@15|||0|pin@19||4.5|0|pin@2||0|0
-Awire|net@16|||0|pin@2||0|0|pin@21||-5|0
-Awire|net@17|||1800|nms2@0|g2|3|-5|pin@22||9|-5
-Awire|net@18|||1800|pin@3||-9|-9|nms2@0|g|-3|-9
-Awire|net@20|||900|pin@16||-5|7.5|PMOS@0|s|-5|6
-Awire|net@21|||1800|pin@23||-9|4|PMOS@0|g|-8|4
-Awire|net@22|||2700|pin@21||-5|0|PMOS@0|d|-5|2
-Awire|net@23|||2700|PMOS@1|s|4.5|6|pin@15||4.5|7.5
-Awire|net@24|||1800|PMOS@1|g|7.5|4|pin@18||9|4
-Awire|net@25|||2700|pin@19||4.5|0|PMOS@1|d|4.5|2
-Awire|net@36|||2700|pin@22||9|-5|pin@18||9|4
-Awire|net@38|||2700|pin@16||-5|7.5|pwr@0||-5|10.5
-Awire|net@39|||0|pin@15||4.5|7.5|pin@16||-5|7.5
-Awire|net@42|||1800|pin@22||9|-5|conn@1|y|17.5|-5
-Awire|net@43|||2700|pin@3||-9|-9|pin@26||-9|-1
-Awire|net@44|||2700|pin@26||-9|-1|pin@23||-9|4
-Awire|net@45|||1800|conn@2|y|-19.5|-1|pin@26||-9|-1
-Awire|net@46|||0|conn@0|a|13.5|0|pin@19||4.5|0
-Eina||D5G2;|conn@2|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell nand2HLT_sy;1{ic}
-Cnand2HLT_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||-0.5|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@4||0.25|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-Nschematic:Bus_Pin|pin@0||-2.5|-1|-2|-2||
-NPin|pin@1||-1.5|-1|1|1||
-NPin|pin@2||-2.5|-1||||
-NPin|pin@3||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@4||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@5||2.5|0|-2|-2||
-NPin|pin@6||-1.5|2|1|1||
-NPin|pin@7||-1.5|-2|1|1||
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-NPin|pin@9||-2.5|1||||
-NPin|pin@10||-1.5|1|1|1||
-AThicker|net@0|||FS0|pin@1||-1.5|-1|pin@2||-2.5|-1|ART_color()I10
-AThicker|net@1|||FS0|pin@3||-0.5|2|pin@6||-1.5|2|ART_color()I10
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-AThicker|net@4|||FS0|pin@10||-1.5|1|pin@9||-2.5|1|ART_color()I10
-Eina||D5G1;|pin@0||I
-Einb||D5G1;|pin@4||I
-Eout||D5G1;|pin@5||O
-X
-
-# Cell nand2HLT_sy;1{sch}
-Cnand2HLT_sy;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-13.5;Y-16;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-13.5;Y-15;)S1|ATTR_drive0(D5G1;HNPTX-13.5;Y-17;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-18;)Sstrong1|ATTR_verilog_template(D5G1;NTX24.5;Y-20;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||6|3.25|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S3.*@X/4.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S3.*@X/4.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-17|-9.75||||
-NOff-Page|conn@1||21|-5.75|||RR|
-NOff-Page|conn@2||22.5|0||||
-Inand2HLT_sy;1{ic}|nand2HLT@0||38|18.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2_sy;1{ic}|nms2_sy@0||0|-9.75|||D0G4;|ATTR_Delay(D5G1;NOJPX5.5;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-Ngeneric:Invisible-Pin|pin@18||32|-14|||||ART_message(D5G2;)S[X is drive strength,The pull-down is 1.5 times as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-NWire_Pin|pin@19||-9.5|4||||
-NWire_Pin|pin@20||-5|0||||
-NWire_Pin|pin@21||-9.5|-9.75||||
-NWire_Pin|pin@22||6|0||||
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-NWire_Pin|pin@24||10.25|-5.75||||
-Ngeneric:Invisible-Pin|pin@25||3.5|25|||||ART_message(D5G6;)S[nand2HLT_sy]
-NWire_Pin|pin@26||-5|7.5||||
-NWire_Pin|pin@27||6|7.5||||
-Ngeneric:Invisible-Pin|pin@28||2|20|||||ART_message(D5G2;)S[high-LO-threshold NAND]
-Ngeneric:Invisible-Pin|pin@29||2.5|18|||||ART_message(D5G2;)S[P to N width ratio is 1.5 to 2]
-Ngeneric:Invisible-Pin|pin@30||3|16|||||ART_message(D5G2;)S[Sized assuming both inputs go low together]
-NWire_Pin|pin@31||0|0||||
-NPower|pwr@0||-5|10.5||||
-Awire|net@30|||2700|pin@21||-9.5|-9.75|pin@19||-9.5|4
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-Awire|net@40|||0|pin@31||0|0|pin@20||-5|0
-Awire|net@41|||0|pin@22||6|0|pin@31||0|0
-Awire|net@42|||900|pin@31||0|0|nms2_sy@0|d|0|-3.75
-Awire|net@43|||0|pin@24||10.25|-5.75|nms2_sy@0|g2|3|-5.75
-Awire|net@44|||0|nms2_sy@0|g|-3|-9.75|pin@21||-9.5|-9.75
-Awire|net@45|||0|conn@2|a|20.5|0|pin@22||6|0
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-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand2HT;1{ic}
-Cnand2HT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I10
-NPin|pin@0||-0.25|-2|1|1||
-NPin|pin@1||-1.5|-0.75|1|1||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-NPin|pin@3||-1.5|-1|1|1||
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-NPin|pin@5||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@6||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
-NPin|pin@8||-1.5|2|1|1||
-NPin|pin@9||-1.5|-2|1|1||
-NPin|pin@10||-0.5|-2|1|1||
-NPin|pin@11||-2.5|1||||
-NPin|pin@12||-1.5|1|1|1||
-AThicker|net@0|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I10
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-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell nand2HT;1{sch}
-Cnand2HT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-16.5;Y-7;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16.5;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-16.5;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX6;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S2.*@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S2.*@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-1||||
-NOff-Page|conn@1||16.5|-5|||RR|
-NOff-Page|conn@2||21|0|||Y|
-Inand2HT;1{ic}|nand2HT@0||30|13|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE(T)I1|ATTR_LEPARALLGRP()I-1|ATTR_su(T)I-1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2.25;Y1.5;)S@X|ATTR_LEGATE(OJT)S@LEGATE|ATTR_LEPARALLGRP(T)I-1
-NWire_Pin|pin@0||0|8||||
-NWire_Pin|pin@1||-5|8||||
-NWire_Pin|pin@2||4.5|8||||
-Ngeneric:Invisible-Pin|pin@3||31.5|-12.5|||||ART_message(D5G2;)S[X is drive strength,Pull-up has twice the strength,of the pull-down]
-Ngeneric:Invisible-Pin|pin@4||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 2]
-NWire_Pin|pin@5||-9|4||||
-NWire_Pin|pin@6||0|0||||
-NWire_Pin|pin@7||-5|0||||
-Ngeneric:Invisible-Pin|pin@8||-0.5|20|||||ART_message(D5G2;)S[one-parameter high-threshold NAND]
-NWire_Pin|pin@9||-9|-1||||
-NWire_Pin|pin@10||4.5|0||||
-NWire_Pin|pin@11||9|4||||
-NWire_Pin|pin@12||9|-5||||
-Ngeneric:Invisible-Pin|pin@13||0.5|25|||||ART_message(D5G6;)S[nand2HT]
-NWire_Pin|pin@14||-9|-9||||
-NPower|pwr@0||0|11.5||||
-Awire|net@0|||0|nms2@0|g|-3|-9|pin@14||-9|-9
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-Awire|net@18|||1800|pin@12||9|-5|conn@1|y|14.5|-5
-Awire|net@19|||2700|pin@14||-9|-9|pin@9||-9|-1
-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand2HTen;1{ic}
-Cnand2HTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NOpened-Thicker-Polygon|art@3||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/-0.5,-0.25/0.5,-0.25/0,0.25/0,0.25/0.5,0.25/-0.5]
-Ngeneric:Invisible-Pin|pin@0||-0.38|-1.25|||||ART_message(D5G1.5;)S[en]
-NPin|pin@1||-1.5|1|1|1||
-NPin|pin@2||-2.5|1||||
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-NPin|pin@5||-1.5|2|1|1||
-Nschematic:Bus_Pin|pin@6||2.5|0|-2|-2||
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-NPin|pin@9||-2.5|-1||||
-NPin|pin@10||-1.5|-1|1|1||
-Nschematic:Bus_Pin|pin@11||-2.5|-1|-2|-2||
-NPin|pin@12||-1.5|-0.75|1|1||
-NPin|pin@13||-0.25|-2|1|1||
-AThicker|net@0|||FS0|pin@1||-1.5|1|pin@2||-2.5|1|ART_color()I10
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-AThicker|net@2|||FS2700|pin@4||-1.5|-2|pin@5||-1.5|2|ART_color()I10
-AThicker|net@3|||FS0|pin@8||-0.5|2|pin@5||-1.5|2|ART_color()I10
-AThicker|net@4|||FS0|pin@10||-1.5|-1|pin@9||-2.5|-1|ART_color()I10
-AThicker|net@5|||FS3150|pin@13||-0.25|-2|pin@12||-1.5|-0.75|ART_color()I10
-Eina||D5G1;|pin@11||I
-Einb||D5G1;|pin@7||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell nand2HTen;1{sch}
-Cnand2HTen;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-16.5;Y-7;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16.5;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-16.5;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX6;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S2.*@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)Smax(@X/5., 5./6.)
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||21|0|||Y|
-NOff-Page|conn@1||16.5|-5|||RR|
-NOff-Page|conn@2||-14|-1||||
-Inand2HTen;1{ic}|nand2HTe@0||30|13|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE(T)I1|ATTR_LEPARALLGRP()I-1|ATTR_su(T)I-1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2.25;Y1.5;)S@X|ATTR_LEGATE(OJT)S@LEGATE|ATTR_LEPARALLGRP(T)I-1
-NWire_Pin|pin@0||-9|-9||||
-Ngeneric:Invisible-Pin|pin@1||9|6|||||ART_message(D5G1;)S[fixed size]
-Ngeneric:Invisible-Pin|pin@2||0.5|25|||||ART_message(D5G6;)S[nand2HTen]
-NWire_Pin|pin@3||9|-5||||
-NWire_Pin|pin@4||9|4||||
-NWire_Pin|pin@5||4.5|0||||
-NWire_Pin|pin@6||-9|-1||||
-Ngeneric:Invisible-Pin|pin@7||-0.5|20|||||ART_message(D5G2;)S[one-parameter high-threshold NAND where ina is enable (DC) input]
-NWire_Pin|pin@8||-5|0||||
-NWire_Pin|pin@9||0|0||||
-NWire_Pin|pin@10||-9|4||||
-Ngeneric:Invisible-Pin|pin@11||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 4 to 2]
-Ngeneric:Invisible-Pin|pin@12||31.5|-12.5|||||ART_message(D5G2;)S[X is drive strength,Pull-up has twice the strength,of the pull-down]
-NWire_Pin|pin@13||4.5|8||||
-NWire_Pin|pin@14||-5|8||||
-NWire_Pin|pin@15||0|8||||
-NPower|pwr@0||0|11.5||||
-Awire|net@0|||2700|pin@0||-9|-9|pin@6||-9|-1
-Awire|net@1|||1800|pin@3||9|-5|conn@1|y|14.5|-5
-Awire|net@2|||2700|pin@3||9|-5|pin@4||9|4
-Awire|net@3|||0|pin@6||-9|-1|conn@2|y|-12|-1
-Awire|net@4|||0|pin@9||0|0|pin@8||-5|0
-Awire|net@5|||0|pin@5||4.5|0|pin@9||0|0
-Awire|net@6|||900|pin@9||0|0|nms2@0|d|0|-3
-Awire|net@7|||2700|pin@6||-9|-1|pin@10||-9|4
-Awire|net@8|||0|pin@4||9|4|PMOS@0|g|7.5|4
-Awire|net@9|||2700|pin@5||4.5|0|PMOS@0|d|4.5|2
-Awire|net@10|||2700|pin@8||-5|0|PMOS@1|d|-5|2
-Awire|net@11|||1800|pin@10||-9|4|PMOS@1|g|-8|4
-Awire|net@12|||900|pin@13||4.5|8|PMOS@0|s|4.5|6
-Awire|net@13|||2700|PMOS@1|s|-5|6|pin@14||-5|8
-Awire|net@14|||1800|pin@5||4.5|0|conn@0|a|19|0
-Awire|net@15|||1800|pin@15||0|8|pin@13||4.5|8
-Awire|net@16|||1800|pin@14||-5|8|pin@15||0|8
-Awire|net@17|||2700|pin@15||0|8|pwr@0||0|11.5
-Awire|net@18|||1800|nms2@0|g2|3|-5|pin@3||9|-5
-Awire|net@19|||0|nms2@0|g|-3|-9|pin@0||-9|-9
-Eina||D5G2;|conn@2|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell nand2LT;1{ic}
-Cnand2LT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-NOpened-Thicker-Polygon|art@3||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NPin|pin@0||-0.25|-2|0.5|0.5||
-NPin|pin@1||-1.5|-0.75|0.5|0.5||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
-NPin|pin@3||-1.5|-1|1|1||
-NPin|pin@4||-2.5|-1||||
-NPin|pin@5||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@6||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@7||2.5|0|-2|-2||
-NPin|pin@8||-1.5|2|1|1||
-NPin|pin@9||-1.5|-2|1|1||
-NPin|pin@10||-0.5|-2|1|1||
-NPin|pin@11||-2.5|1||||
-NPin|pin@12||-1.5|1|1|1||
-AThicker|net@0|||FS3150|pin@0||-0.25|-2|pin@1||-1.5|-0.75|ART_color()I10
-AThicker|net@1|||FS0|pin@3||-1.5|-1|pin@4||-2.5|-1|ART_color()I10
-AThicker|net@2|||FS0|pin@5||-0.5|2|pin@8||-1.5|2|ART_color()I10
-AThicker|net@3|||FS2700|pin@9||-1.5|-2|pin@8||-1.5|2|ART_color()I10
-AThicker|net@4|||FS0|pin@10||-0.5|-2|pin@9||-1.5|-2|ART_color()I10
-AThicker|net@5|||FS0|pin@12||-1.5|1|pin@11||-2.5|1|ART_color()I10
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@6||I
-Eout||D5G1;|pin@7||O
-X
-
-# Cell nand2LT;1{sch}
-Cnand2LT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-13.5;Y-16;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-13.5;Y-15;)S1|ATTR_drive0(D5G1;HNPTX-13.5;Y-17;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-18;)Sstrong1|ATTR_verilog_template(D5G1;NTX26.5;Y-17;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||6|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S@X/2.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14.5|-9||||
-NOff-Page|conn@1||17|-5|||RR|
-NOff-Page|conn@2||17|0||||
-Inand2LT;1{ic}|nand2LT@0||29|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX5.5;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-Ngeneric:Invisible-Pin|pin@0||36.5|-10|||||ART_message(D5G2;)S[X is drive strength,The pull-down is twice as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-NWire_Pin|pin@1||-9.5|4||||
-NWire_Pin|pin@2||-5|0||||
-NWire_Pin|pin@3||-9.5|-9||||
-NWire_Pin|pin@4||6|0||||
-NWire_Pin|pin@5||11|4||||
-NWire_Pin|pin@6||11|-5||||
-Ngeneric:Invisible-Pin|pin@7||3.5|25|||||ART_message(D5G6;)S[nand2LT]
-NWire_Pin|pin@8||-5|7.5||||
-NWire_Pin|pin@9||6|7.5||||
-Ngeneric:Invisible-Pin|pin@10||2|20|||||ART_message(D5G2;)S[LO-threshold NAND]
-Ngeneric:Invisible-Pin|pin@11||2.5|18|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@12||3|16|||||ART_message(D5G2;)S[Sized assuming both inputs go low together]
-NWire_Pin|pin@13||0|0||||
-NPower|pwr@0||-5|10.5||||
-Awire|net@0|||0|pin@6||11|-5|nms2@0|g2|3|-5
-Awire|net@1|||900|pin@13||0|0|nms2@0|d|0|-3
-Awire|net@2|||0|nms2@0|g|-3|-9|pin@3||-9.5|-9
-Awire|net@3|||2700|pin@3||-9.5|-9|pin@1||-9.5|4
-Awire|net@4|||0|pin@3||-9.5|-9|conn@0|y|-12.5|-9
-Awire|net@5|||2700|pin@6||11|-5|pin@5||11|4
-Awire|net@6|||1800|pin@6||11|-5|conn@1|y|15|-5
-Awire|net@7|||0|pin@9||6|7.5|pin@8||-5|7.5
-Awire|net@8|||2700|pin@8||-5|7.5|pwr@0||-5|10.5
-Awire|net@9|||1800|pin@4||6|0|conn@2|a|15|0
-Awire|net@10|||2700|pin@4||6|0|PMOS@0|d|6|2
-Awire|net@11|||1800|PMOS@0|g|9|4|pin@5||11|4
-Awire|net@12|||2700|PMOS@0|s|6|6|pin@9||6|7.5
-Awire|net@13|||2700|pin@2||-5|0|PMOS@1|d|-5|2
-Awire|net@14|||1800|pin@1||-9.5|4|PMOS@1|g|-8|4
-Awire|net@15|||900|pin@8||-5|7.5|PMOS@1|s|-5|6
-Awire|net@16|||0|pin@13||0|0|pin@2||-5|0
-Awire|net@17|||0|pin@4||6|0|pin@13||0|0
-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand2LT_sy;1{ic}
-Cnand2LT_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-NThick-Circle|art@3||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NPin|pin@0||-1.5|1|1|1||
-NPin|pin@1||-2.5|1||||
-NPin|pin@2||-0.5|-2|1|1||
-NPin|pin@3||-1.5|-2|1|1||
-NPin|pin@4||-1.5|2|1|1||
-Nschematic:Bus_Pin|pin@5||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@6||-2.5|1|-2|-2||
-NPin|pin@7||-0.5|2|1|1||
-NPin|pin@8||-2.5|-1||||
-NPin|pin@9||-1.5|-1|1|1||
-Nschematic:Bus_Pin|pin@10||-2.5|-1|-2|-2||
-AThicker|net@0|||FS0|pin@0||-1.5|1|pin@1||-2.5|1|ART_color()I10
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-AThicker|net@2|||FS2700|pin@3||-1.5|-2|pin@4||-1.5|2|ART_color()I10
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-Eina||D5G1;|pin@10||I
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-X
-
-# Cell nand2LT_sy;1{sch}
-Cnand2LT_sy;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-13.5;Y-16;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-13.5;Y-15;)S1|ATTR_drive0(D5G1;HNPTX-13.5;Y-17;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-18;)Sstrong1|ATTR_verilog_template(D5G1;NTX26.5;Y-17;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||6|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||17|0||||
-NOff-Page|conn@1||17|-5|||RR|
-NOff-Page|conn@2||-14.5|-9||||
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-Inms2_sy;1{ic}|nms2_sy@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX5.5;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-NWire_Pin|pin@0||0|0||||
-Ngeneric:Invisible-Pin|pin@1||3|16|||||ART_message(D5G2;)S[Sized assuming both inputs go low together]
-Ngeneric:Invisible-Pin|pin@2||2.5|18|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@3||2|20|||||ART_message(D5G2;)S[LO-threshold NAND]
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-NWire_Pin|pin@5||-5|7.5||||
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-
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-Cnand2LTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-X
-
-# Cell nand2LTen;1{sch}
-Cnand2LTen;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-13.5;Y-16;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-13.5;Y-15;)S1|ATTR_drive0(D5G1;HNPTX-13.5;Y-17;)Sstrong0|ATTR_drive1(D5G1;HNPTX-13.5;Y-18;)Sstrong1|ATTR_verilog_template(D5G1;NTX26.5;Y-17;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)Smax(@X/20., 0.5)
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||6|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||17|0||||
-NOff-Page|conn@1||17|-5|||RR|
-NOff-Page|conn@2||-14.5|-9||||
-Inand2LTen;1{ic}|nand2LTe@0||42|18|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX5.5;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-NWire_Pin|pin@0||0|0||||
-Ngeneric:Invisible-Pin|pin@1||3|16|||||ART_message(D5G2;)S[Sized assuming both inputs go low together]
-Ngeneric:Invisible-Pin|pin@2||2.5|18|||||ART_message(D5G2;)S[P to N width ratio is 1 to 2]
-Ngeneric:Invisible-Pin|pin@3||2|20|||||ART_message(D5G2;)S[LO-threshold NAND where ina is enable (DC) input]
-NWire_Pin|pin@4||6|7.5||||
-NWire_Pin|pin@5||-5|7.5||||
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-NWire_Pin|pin@12||-9.5|4||||
-Ngeneric:Invisible-Pin|pin@13||36.5|-10|||||ART_message(D5G2;)S[X is drive strength,The pull-down is twice as strong as,one pull-up; or both pull-ups together,are as strong as the pull-down]
-NPower|pwr@0||-5|10.5||||
-Awire|net@0|||0|pin@9||6|0|pin@0||0|0
-Awire|net@1|||0|pin@0||0|0|pin@11||-5|0
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-Awire|net@8|||1800|pin@9||6|0|conn@0|a|15|0
-Awire|net@9|||2700|pin@5||-5|7.5|pwr@0||-5|10.5
-Awire|net@10|||0|pin@4||6|7.5|pin@5||-5|7.5
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-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell nand2_sy;1{ic}
-Cnand2_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
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-NPin|pin@10||-1.5|1|1|1||
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-AThicker|net@3|||FS0|pin@8||-0.5|-2|pin@7||-1.5|-2|ART_color()I10
-AThicker|net@4|||FS0|pin@10||-1.5|1|pin@9||-2.5|1|ART_color()I10
-Eina||D5G1;|pin@0||I
-Einb||D5G1;|pin@4||I
-Eout||D5G1;|pin@5||O
-X
-
-# Cell nand2_sy;1{sch}
-Cnand2_sy;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-17.5;Y-16;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-17.5;Y-15;)S1|ATTR_drive0(D5G1;HNPTX-17.5;Y-17;)Sstrong0|ATTR_drive1(D5G1;HNPTX-17.5;Y-18;)Sstrong1|ATTR_verilog_template(D5G1;NTX25;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||5.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-23.5|-9||||
-NOff-Page|conn@1||19.5|-5|||RR|
-NOff-Page|conn@2||19.5|0||||
-Inand2_sy;1{ic}|nand2_sy@0||29|14.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2_sy;1{ic}|nms2_sy@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX5.5;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-NWire_Pin|pin@4||13.5|-5||||
-NWire_Pin|pin@5||0|0||||
-Ngeneric:Invisible-Pin|pin@6||35|-11|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@7||3.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2]
-NWire_Pin|pin@8||-9.5|4||||
-NWire_Pin|pin@9||-5|0||||
-Ngeneric:Invisible-Pin|pin@10||3.5|20|||||ART_message(D5G2;)S[one-parameter symmetric NAND]
-NWire_Pin|pin@11||-9.5|-9||||
-NWire_Pin|pin@12||5.5|0||||
-NWire_Pin|pin@13||13.5|4||||
-Ngeneric:Invisible-Pin|pin@14||3.5|25|||||ART_message(D5G6;)S[nand2_sy]
-NWire_Pin|pin@15||-5|7.5||||
-NWire_Pin|pin@16||5.5|7.5||||
-NPower|pwr@0||-5|10.5||||
-Awire|net@8|||1800|pin@12||5.5|0|conn@2|a|17.5|0
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-Awire|net@10|||0|conn@1|y|17.5|-5|pin@4||13.5|-5
-Awire|net@11|||0|nms2_sy@0|g|-3|-9|pin@11||-9.5|-9
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-Awire|net@13|||1800|pin@9||-5|0|pin@5||0|0
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-Awire|net@16|||1800|PMOS@0|g|8.5|4|pin@13||13.5|4
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-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand2en;1{ic}
-Cnand2en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-Ngeneric:Invisible-Pin|pin@0||-0.5|-1.25|||||ART_message(D5G1.5;)S[en]
-NPin|pin@1||-0.25|-2|1|1||
-NPin|pin@2||-1.5|-0.75|1|1||
-Nschematic:Bus_Pin|pin@3||-2.5|-1|-2|-2||
-NPin|pin@4||-1.5|-1|1|1||
-NPin|pin@5||-2.5|-1||||
-NPin|pin@6||-0.5|2|1|1||
-Nschematic:Bus_Pin|pin@7||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@8||2.5|0|-2|-2||
-NPin|pin@9||-1.5|2|1|1||
-NPin|pin@10||-1.5|-2|1|1||
-NPin|pin@11||-0.5|-2|1|1||
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-AThicker|net@5|||FS0|pin@13||-1.5|1|pin@12||-2.5|1|ART_color()I10
-Eina||D5G1;|pin@3||I
-Einb||D5G1;|pin@7||I
-Eout||D5G1;|pin@8||O
-X
-
-# Cell nand2en;1{sch}
-Cnand2en;1{sch}||schematic|1021415734000|1200387280976||ATTR_Delay(D5G1;HNPX-16;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-7.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX25.5;Y-14;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)Smax(@X/10., 5.2/6.)
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-14|-1||||
-NOff-Page|conn@1||14|-5|||RR|
-NOff-Page|conn@2||14|0||||
-Inand2en;1{ic}|nand2en@0||25|12.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms2;1{ic}|nms2@0||0|-9|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2.25;Y1.5;)S@X
-NWire_Pin|pin@0||4.5|0||||
-NWire_Pin|pin@1||-9|-9||||
-NWire_Pin|pin@2||0|0||||
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-Ngeneric:Invisible-Pin|pin@4||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2 (2/10 for enable input)]
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-NWire_Pin|pin@6||-5|0||||
-Ngeneric:Invisible-Pin|pin@7||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND where ina is DC signal (enable)]
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-NPower|pwr@0||-5|10.5||||
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-X
-
-# Cell nand2en_3n;1{ic}
-Cnand2en_3n;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5G1.5;HNPX2.5;Y2.5;)I1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||2|0|1|1|||ART_color()I10
-NThick-Circle|art@2||-0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-Ngeneric:Invisible-Pin|pin@0||0|0.5|||||ART_message(D5G1;)S[3n]
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-Nschematic:Bus_Pin|pin@7||-2.5|1|-2|-2||
-NPin|pin@8||-0.5|2|1|1||
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-NPin|pin@10||-1.5|-1|1|1||
-Nschematic:Bus_Pin|pin@11||-2.5|-1|-2|-2||
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-Eina||D5G1;|pin@11||I
-Einb||D5G1;|pin@7||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell nand2en_3n;1{sch}
-Cnand2en_3n;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-20;Y-5.5;)I100|ATTR_X(D5G1;HNPX-20;Y-4.5;)I1|ATTR_drive0(D5G1;HNPTX-20;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-20;Y-7.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX25.5;Y-14;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||5.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-9|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)SMath.max(((Number)@X).doubleValue()/10., 5./6.)
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||15|0||||
-NOff-Page|conn@1||15|-5|||RR|
-NOff-Page|conn@2||-18|-1||||
-Inand2en_3n;1{ic}|nand2en_@0||25|12.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Inms2;1{ic}|nms2@1||5.5|-9|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)S@X/3.
-Inms2;1{ic}|nms2@2||-9|-9|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_X(D5G1.5;NOJPX-2.25;Y1.5;)S@X/3.
-NWire_Pin|pin@0||-2|0||||
-Ngeneric:Invisible-Pin|pin@1||-0.5|15|||||ART_message(D5G2;)S[3 n-stacks for larger sizes]
-NWire_Pin|pin@2||5.5|7.5||||
-NWire_Pin|pin@3||-9|7.5||||
-Ngeneric:Invisible-Pin|pin@4||-0.5|25|||||ART_message(D5G6;)S[nand2en_3n]
-NWire_Pin|pin@5||10|-5||||
-NWire_Pin|pin@6||10|4||||
-NWire_Pin|pin@7||-13|-1||||
-Ngeneric:Invisible-Pin|pin@8||-0.5|20|||||ART_message(D5G2;)S[one-parameter NAND where ina is DC signal (enable)]
-NWire_Pin|pin@9||-9|0||||
-NWire_Pin|pin@10||-13|4||||
-Ngeneric:Invisible-Pin|pin@11||-0.5|17.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2 (2/10 for enable input)]
-Ngeneric:Invisible-Pin|pin@12||31.5|-8|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-NWire_Pin|pin@13||-13|-9||||
-NWire_Pin|pin@14||5.5|0||||
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-Awire|net@2|||1800|nms2@0|g2|1|-5|nms2@1|g2|8.5|-5
-Awire|net@3|||900|pin@0||-2|0|nms2@0|d|-2|-3
-Awire|net@4|||0|pin@14||5.5|0|pin@0||-2|0
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-Awire|net@6|||1800|nms2@2|g2|-6|-5|nms2@0|g2|1|-5
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-Eina||D5G2;|conn@2|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell nand2n;1{ic}
-Cnand2n;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.5;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1|-1|1|1|||ART_color()I10
-NThick-Circle|art@2||-1|-2|8|7|YRRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@3||-1|2|8|7|RRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||-3.25|0|6|6|3200||ART_color()I10|ART_degrees()I800
-NThick-Circle|art@5||-1|1|1|1|||ART_color()I10
-NPin|pin@0||2|0||||
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-NPin|pin@2||-0.5|-1.25|1|1||
-NPin|pin@3||0|-1.75|1|1||
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-NPin|pin@5||-1.5|-1|1|1||
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-Nschematic:Bus_Pin|pin@7||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@8||2.5|0|-2|-2||
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-NPin|pin@10||-1.5|1|1|1||
-AThicker|net@0|||FS0|pin@1||2.5|0|pin@0||2|0|ART_color()I10
-AThicker|net@1|||FS3150|pin@3||0|-1.75|pin@2||-0.5|-1.25|ART_color()I10
-AThicker|net@2|||FS0|pin@5||-1.5|-1|pin@6||-2.5|-1|ART_color()I10
-AThicker|net@3|||FS0|pin@10||-1.5|1|pin@9||-2.5|1|ART_color()I10
-Eina||D5G1;|pin@4||I
-Einb||D5G1;|pin@7||I
-Eout||D5G1;|pin@8||O
-X
-
-# Cell nand2n;1{sch}
-Cnand2n;1{sch}||schematic|1021415734000|1157998157812||ATTR_Delay(D5G1;HNPX-16;Y-5.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-16;Y-4.5;)S1|ATTR_drive0(D5G1;HNPTX-16;Y-6.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16;Y-7.5;)Sstrong1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-9.5|-1||||
-NOff-Page|conn@1||-9.5|1||||
-NOff-Page|conn@2||9|0||||
-Inand2;1{ic}|nand2@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-3;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1
-Inand2n;1{ic}|nand2n@0||24|14|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.5;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||22|-9.5|||||ART_message(D5G2;)S[X is drive strength,One pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@1||-2.5|11|||||ART_message(D5G2;)S[P to N width ratio is 2 to 2]
-Ngeneric:Invisible-Pin|pin@2||-2.5|13.5|||||ART_message(D5G2;)S[one-parameter NAND (NOR rep)]
-Ngeneric:Invisible-Pin|pin@3||-2.5|18.5|||||ART_message(D5G6;)S[nand2n]
-Awire|net@0|||1800|nand2@0|out|2.5|0|conn@2|a|7|0
-Awire|net@1|||0|nand2@0|inb|-2.5|1|conn@1|y|-7.5|1
-Awire|net@2|||1800|conn@0|y|-7.5|-1|nand2@0|ina|-2.5|-1
-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand2n_sy;1{ic}
-Cnand2n_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNPX2;Y2.5;)I1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1.5|1|1|1|||ART_color()I10
-NThick-Circle|art@2||-1.5|-2|8|7|YRRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@3||-1.5|2|8|7|RRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||-1.5|-1|1|1|||ART_color()I10
-NThick-Circle|art@5||-3.75|0|6|6|3200||ART_color()I10|ART_degrees()I800
-Nschematic:Bus_Pin|pin@0||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@1||-2.5|1|-2|-2||
-Nschematic:Bus_Pin|pin@2||-2.5|-1|-2|-2||
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-NPin|pin@4||-2.5|1||||
-NPin|pin@5||1.5|0|1|1||
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-NPin|pin@7||-2.5|-1||||
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-NPin|pin@9||-1|-1.25|1|1||
-AThicker|net@0|||FS0|pin@3||-2|1|pin@4||-2.5|1|ART_color()I10
-AThicker|net@1|||FS0|pin@6||2.5|0|pin@5||1.5|0|ART_color()I10
-AThicker|net@2|||FS0|pin@8||-2|-1|pin@7||-2.5|-1|ART_color()I10
-AThicker|net@3|||FS2700|pin@9||-1|-1.25|pin@9||-1|-1.25|ART_color()I78
-Eina||D5G1;|pin@2||I
-Einb||D5G1;|pin@1||I
-Eout||D5G1;|pin@0||O
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-
-# Cell nand2n_sy;1{sch}
-Cnand2n_sy;1{sch}||schematic|1021415734000|1224793363940||ATTR_Delay(D5G1;HNPX-16.5;Y-6.5;)I100|ATTR_X(D5FLeave alone;G1;HNPX-16.5;Y-5.5;)I1|ATTR_drive0(D5G1;HNPTX-16.5;Y-7.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-16.5;Y-8.5;)Sstrong1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-11.5|-1||||
-NOff-Page|conn@1||10|0||||
-NOff-Page|conn@2||-11.5|1||||
-Inand2_sy;1{ic}|nand2_sy@0||0|0|||D0G4;|ATTR_Delay(D5G1;NOJPX2.5;Y-2.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOJPX2.5;Y2.5;)S@X|ATTR_drive0(OJP)S@drive0|ATTR_drive1(OJP)S@drive1|ATTR_LEPARALLGRP()I-1|ATTR_su(OJT)S@su
-Inand2n_sy;1{ic}|nand2n_s@0||12.5|14|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;NPX2;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||-9|18.5|||||ART_message(D5G6;)S[nand2n_sy]
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-X
-
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-
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
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-X
-
-# Cell nand3LT;1{ic}
-Cnand3LT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
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-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-X
-
-# Cell nand3LT;1{sch}
-Cnand3LT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-30;Y-11.5;)S1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-23;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/3.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/3.
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Inms3;1{ic}|nms3@0||-5|-16.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2;Y0.5;)S@X
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-Ngeneric:Invisible-Pin|pin@10||-1|15.5|||||ART_message(D5G2;)S[Sized assuming that all 3 inputs go low together]
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-X
-
-# Cell nand3LT_sy3;1{ic}
-Cnand3LT_sy3;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-Nschematic:Bus_Pin|pin@5||2.5|0|-2|-2||
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-NPin|pin@7||-1.5|-3|1|1||
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-Eina||D5G1;|pin@0||I
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-
-# Cell nand3LT_sy3;1{sch}
-Cnand3LT_sy3;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-30;Y-11.5;)S1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-24;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/3.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/3.
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-NOff-Page|conn@3||-35|4||||
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-X
-
-# Cell nand3LT_sy6;1{ic}
-Cnand3LT_sy6;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5G1.5;HNPX3;Y2.5;)I1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
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-X
-
-# Cell nand3LT_sy6;1{sch}
-Cnand3LT_sy6;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5G1;HNPX-30;Y-11.5;)I1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-24;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/3.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X/3.
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-Inand3LT_sy6;1{ic}|nand3LT_@0||35|19.5|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE()I1|ATTR_su()I-1
-Inms3_sy6;1{ic}|nms3_sy3@0||-10|-16.5|||D0G4;|ATTR_Delay(D5G1;NOJPX-8.5;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX-8.5;Y2;)S@X
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-Ngeneric:Invisible-Pin|pin@20||28.5|-19|||||ART_message(D5G2;)S[X is drive strength,Three pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@21||-0.5|18|||||ART_message(D5G2;)S[P to N width ratio is 2/3 to 3]
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-Eina||D5G2;|conn@4|y|I
-Einb||D5G2;|conn@1|a|I
-Einc||D5G2;|conn@3|y|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nand3LTen;1{ic}
-Cnand3LTen;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOpened-Thicker-Polygon|art@1||0|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-Eina||D5G1;|pin@1||I
-Einb||D5G1;|pin@5||I
-Einc||D5G1;|pin@12||I
-Eout||D5G1;|pin@6||O
-X
-
-# Cell nand3LTen;1{sch}
-Cnand3LTen;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-30;Y-11.5;)S1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-23;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX1.5;Y2.5;)Smax(@X/20., 5./6.)
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-27.5|-2.5||||
-NOff-Page|conn@1||17|4|||RR|
-NOff-Page|conn@2||0|11|||R|
-NOff-Page|conn@3||-28|4||||
-Inand3LTen;1{ic}|nand3LTe@0||44|9|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX3;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE()I1|ATTR_su()I-1
-Inms3;1{ic}|nms3@0||-5|-16.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2;Y0.5;)S@X
-Ngeneric:Invisible-Pin|pin@0||0|20.5|||||ART_message(D5G2;)S["three input, fixed-size low-threshold NAND where ina is DC signal (enable)"]
-NWire_Pin|pin@1||-19.5|-8.5||||
-NWire_Pin|pin@2||-21.5|-16.5||||
-NWire_Pin|pin@3||10.5|-12.5||||
-NWire_Pin|pin@4||-19.5|4||||
-NWire_Pin|pin@5||-21.5|-2.5||||
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-
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-Cnand3LTen_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
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-X
-
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-Cnand3LTen_sy;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-30;Y-11.5;)S1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-23;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@2||17|4|||RR|
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-Ngeneric:Invisible-Pin|pin@8||28.5|-16|||||ART_message(D5G2;)S[X is drive strength,Two pull-ups have the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@9||-1|15.5|||||ART_message(D5G2;)S[Sized assuming that all 3 inputs go low together (but one p/u is weak)]
-NWire_Pin|pin@10||-14|7.5||||
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-X
-
-# Cell nand3MLT;1{ic}
-Cnand3MLT;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOpened-Thicker-Polygon|art@2||0.75|0|0.5|1|||ART_color()I10|trace()V[-0.25/0.5,-0.25/-0.5,0.25/-0.5]
-NThick-Circle|art@3||2|0|1|1|||ART_color()I10
-NThick-Circle|art@4||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-AThicker|net@6|||FS3150|pin@15||-0.25|-3|pin@14||-1.5|-1.75|ART_color()I10
-Eina||D5G1;|pin@13||I
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-Eout||D5G1;|pin@8||O
-X
-
-# Cell nand3MLT;1{sch}
-Cnand3MLT;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-29;Y-7;)I100|ATTR_X(D5G1;HNOLPX-29;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-29;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-29;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX20.5;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-34.5|4||||
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-Ngeneric:Invisible-Pin|pin@27||0|21|||||ART_message(D5G2;)S[Sized assuming at least 2 of 3 inputs go low together]
-Ngeneric:Invisible-Pin|pin@28||-0.5|23|||||ART_message(D5G2;)S[P to N width ratio is 1 to 3]
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-
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-Cnand3_sy6;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5G1.5;HNPX3;Y2.5;)I1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
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-X
-
-# Cell nand3_sy6;1{sch}
-Cnand3_sy6;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-30;Y-12.5;)I100|ATTR_X(D5G1;HNPX-30;Y-11.5;)I1|ATTR_drive0(D5G1;HNPTX-30;Y-13.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-30;Y-14.5;)Sstrong1|ATTR_verilog_template(D5G1;NTX19;Y-24;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
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-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
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-NOff-Page|conn@4||-35|-2.5||||
-Inand3_sy6;1{ic}|nand3LT_@0||35|19.5|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5G1.5;NPX3;Y2.5;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_LEGATE()I1|ATTR_su()I-1
-Inms3_sy6;1{ic}|nms3_sy3@0||-10|-16.5|||D0G4;|ATTR_Delay(D5G1;NOJPX-8.5;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX-8.5;Y2;)S@X
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-Ngeneric:Invisible-Pin|pin@21||-0.5|18|||||ART_message(D5G2;)SP to N width ratio is 2 to 3
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-Awire|net@26|||2700|pin@10||-19.5|-8.5|pin@13||-19.5|4
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-Awire|net@28|||2700|pin@11||-21.5|-16.5|pin@14||-21.5|-2.5
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-Awire|net@31|||900|pin@23||-5|0|nms3_sy3@0|d|-5|-5.5
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-Awire|net@45|||1800|pin@18||-14|7.5|pin@16||-5|7.5
-Awire|net@46|||1800|pin@28||-14|0|pin@23||-5|0
-Awire|net@47|||1800|pin@25||4.5|0|conn@2|a|25|0
-Awire|net@48|||1800|pin@12||10.5|-12.5|conn@1|y|22|-12.5
-Awire|net@49|||1800|conn@3|y|-33|4|pin@13||-19.5|4
-Awire|net@50|||1800|conn@4|y|-33|-2.5|pin@14||-21.5|-2.5
-Eina||D5G2;|conn@4|y|I
-Einb||D5G2;|conn@1|a|I
-Einc||D5G2;|conn@3|y|I
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-X
-
-# Cell nand3en;1{ic}
-Cnand3en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
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-NThick-Circle|art@2||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
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-NPin|pin@5||-2.5|0||||
-NPin|pin@6||-0.5|-3|1|1||
-NPin|pin@7||-1.5|-3|1|1||
-NPin|pin@8||-1.5|3|1|1||
-Nschematic:Bus_Pin|pin@9||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@10||-2.5|0|-2|-2||
-NPin|pin@11||-0.5|3|1|1||
-NPin|pin@12||-2.5|-2||||
-NPin|pin@13||-1.5|-2|1|1||
-Nschematic:Bus_Pin|pin@14||-2.5|-2|-2|-2||
-NPin|pin@15||-1.5|-1.75|1|1||
-NPin|pin@16||-0.25|-3|1|1||
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-AThicker|net@1|||FS0|pin@4||-1.5|0|pin@5||-2.5|0|ART_color()I10
-AThicker|net@2|||FS0|pin@6||-0.5|-3|pin@7||-1.5|-3|ART_color()I10
-AThicker|net@3|||FS2700|pin@7||-1.5|-3|pin@8||-1.5|3|ART_color()I10
-AThicker|net@4|||FS0|pin@11||-0.5|3|pin@8||-1.5|3|ART_color()I10
-AThicker|net@5|||FS0|pin@13||-1.5|-2|pin@12||-2.5|-2|ART_color()I10
-AThicker|net@6|||FS3150|pin@16||-0.25|-3|pin@15||-1.5|-1.75|ART_color()I10
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-Einb||D5G1;|pin@10||I
-Einc||D5G1;|pin@3||I
-Eout||D5G1;|pin@9||O
-X
-
-# Cell nand3en;1{sch}
-Cnand3en;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-29;Y-7;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-29;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-29;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-29;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX20.5;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX2;Y2;)Smax(@X/10., 5./6.)
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-22|4||||
-NOff-Page|conn@1||0|14.5|||R|
-NOff-Page|conn@2||14|-1|||RR|
-NOff-Page|conn@3||-15|-12||||
-Inand3en;1{ic}|nand3en@0||29|14|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX3;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms3;1{ic}|nms3@0||0|-12|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-2;Y0.5;)S@X
-NWire_Pin|pin@0||9|-8||||
-NWire_Pin|pin@1||-18|-4||||
-NWire_Pin|pin@2||-18|4||||
-NWire_Pin|pin@3||-14|0||||
-Ngeneric:Invisible-Pin|pin@4||-0.5|27|||||ART_message(D5G6;)S[nand3en]
-NWire_Pin|pin@5||9|-1||||
-NWire_Pin|pin@6||9|4||||
-NWire_Pin|pin@7||4.5|0||||
-NWire_Pin|pin@8||-9|-12||||
-Ngeneric:Invisible-Pin|pin@9||-0.5|22|||||ART_message(D5G2;)S["three input, fixed-size NAND where ina is DC signal (enable)"]
-NWire_Pin|pin@10||-5|0||||
-NWire_Pin|pin@11||0|0||||
-NWire_Pin|pin@12||-9|4||||
-Ngeneric:Invisible-Pin|pin@13||-0.5|19.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 3]
-Ngeneric:Invisible-Pin|pin@14||30|-10|||||ART_message(D5G2;)S[X is drive strength,Each pull-up has the same strength,as the pull-down]
-NWire_Pin|pin@15||4.5|7.5||||
-NWire_Pin|pin@16||-14|7.5||||
-NWire_Pin|pin@17||-5|7.5||||
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-Awire|net@5|||0|pin@0||9|-8|nms3@0|g2|3|-8
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-Awire|net@8|||0|pin@2||-18|4|conn@0|y|-20|4
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-Eina||D5G2;|conn@3|a|I
-Einb||D5G2;|conn@2|a|I
-Einc||D5G2;|conn@0|y|I
-Eout||D5G2;|conn@1|y|O
-X
-
-# Cell nand3en_sy;1{ic}
-Cnand3en_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX3;Y2.5;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,4000]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-0.5|0|6|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@2||2|0|1|1|||ART_color()I10
-Ngeneric:Invisible-Pin|pin@0||-0.5|1|||||ART_message(D5G1;)S[sy2]
-NPin|pin@1||-0.25|-3|1|1||
-NPin|pin@2||-1.5|-1.75|1|1||
-Nschematic:Bus_Pin|pin@3||-2.5|-2|-2|-2||
-NPin|pin@4||-1.5|-2|1|1||
-NPin|pin@5||-2.5|-2||||
-NPin|pin@6||-0.5|3|1|1||
-Nschematic:Bus_Pin|pin@7||-2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@8||2.5|0|-2|-2||
-NPin|pin@9||-1.5|3|1|1||
-NPin|pin@10||-1.5|-3|1|1||
-NPin|pin@11||-0.5|-3|1|1||
-NPin|pin@12||-2.5|0||||
-NPin|pin@13||-1.5|0|1|1||
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-NPin|pin@15||-1.5|2|1|1||
-NPin|pin@16||-2.5|2||||
-Ngeneric:Invisible-Pin|pin@17||-0.5|-2.25|||||ART_message(D5G1.5;)S[en]
-AThicker|net@0|||FS3150|pin@1||-0.25|-3|pin@2||-1.5|-1.75|ART_color()I10
-AThicker|net@1|||FS0|pin@4||-1.5|-2|pin@5||-2.5|-2|ART_color()I10
-AThicker|net@2|||FS0|pin@6||-0.5|3|pin@9||-1.5|3|ART_color()I10
-AThicker|net@3|||FS2700|pin@10||-1.5|-3|pin@9||-1.5|3|ART_color()I10
-AThicker|net@4|||FS0|pin@11||-0.5|-3|pin@10||-1.5|-3|ART_color()I10
-AThicker|net@5|||FS0|pin@13||-1.5|0|pin@12||-2.5|0|ART_color()I10
-AThicker|net@6|||FS0|pin@15||-1.5|2|pin@16||-2.5|2|ART_color()I10
-Eina||D5G1;|pin@3||I
-Einb||D5G1;|pin@7||I
-Einc||D5G1;|pin@14||I
-Eout||D5G1;|pin@8||O
-X
-
-# Cell nand3en_sy;1{sch}
-Cnand3en_sy;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-29;Y-7;)I100|ATTR_X(D5G1;HNOLPX-29;Y-6;)S1|ATTR_drive0(D5G1;HNPTX-29;Y-8;)Sstrong0|ATTR_drive1(D5G1;HNPTX-29;Y-9;)Sstrong1|ATTR_verilog_template(D5G1;NTX20.5;Y-17.5;)Snand ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb), $(inc));|prototype_center()I[0,0]
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@0||-5|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX2;Y2.5;)Smax(@X/10., 5./6.)
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@1||-14|4|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-IorangeTSMC090nm:PMOSx;1{ic}|PMOS@2||4.5|4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-15|-13||||
-NOff-Page|conn@1||14|-1|||RR|
-NOff-Page|conn@2||0|14.5|||R|
-NOff-Page|conn@3||-22|4||||
-Inand3en_sy;1{ic}|nand3en_@0||29|14|||D0G4;|ATTR_Delay(D5G1;NPX4;Y-2.5;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX3;Y2.5;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Inms3_2sy;1{ic}|nms3_2sy@0||0|-13|||D0G4;|ATTR_Delay(D5G1;NOJPX5;Y-1.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-Inms3_2sy;1{ic}|nms3_2sy@1||0|-13|||D0G4;|ATTR_Delay(D5G1;NOJPX5;Y-1.5;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX-3.75;Y2.5;)S@X
-NWire_Pin|pin@0||-18|-5||||
-NWire_Pin|pin@1||-5|7.5||||
-NWire_Pin|pin@2||-14|7.5||||
-NWire_Pin|pin@3||4.5|7.5||||
-Ngeneric:Invisible-Pin|pin@4||30|-10|||||ART_message(D5G2;)S[X is drive strength,Each pull-up has the same strength,as the pull-down]
-Ngeneric:Invisible-Pin|pin@5||-0.5|19.5|||||ART_message(D5G2;)S[P to N width ratio is 2 to 3]
-NWire_Pin|pin@6||-9|4||||
-NWire_Pin|pin@7||0|0||||
-NWire_Pin|pin@8||-5|0||||
-Ngeneric:Invisible-Pin|pin@9||-0.5|22|||||ART_message(D5G2;)S["three input, fixed-size NAND where ina is DC signal (enable) and inb/c are symmetric"]
-NWire_Pin|pin@10||-9|-13||||
-NWire_Pin|pin@11||4.5|0||||
-NWire_Pin|pin@12||9|4||||
-NWire_Pin|pin@13||9|-1||||
-Ngeneric:Invisible-Pin|pin@14||-0.5|27|||||ART_message(D5G6;)S[nand3en_sy]
-NWire_Pin|pin@15||-14|0||||
-NWire_Pin|pin@16||-18|4||||
-NWire_Pin|pin@17||9|-9||||
-NPower|pwr@0||-5|11.5||||
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-Awire|net@8|||900|pin@7||0|0|nms3_2sy@0|d|0|-3
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-Awire|net@11|||1800|pin@1||-5|7.5|pin@3||4.5|7.5
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-Awire|net@16|||1800|PMOS@2|g|7.5|4|pin@12||9|4
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-Awire|net@18|||2700|pin@10||-9|-13|pin@6||-9|4
-Awire|net@19|||2700|pin@7||0|0|conn@2|a|0|12.5
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-Awire|net@23|||2700|pin@13||9|-1|pin@12||9|4
-Awire|net@24|||1800|pin@13||9|-1|conn@1|y|12|-1
-Awire|net@25|||0|pin@8||-5|0|pin@15||-14|0
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-Awire|net@27|||0|nms3_2sy@1|g3|-3|-5|pin@0||-18|-5
-Eina||D5G2;|conn@0|a|I
-Einb||D5G2;|conn@1|a|I
-Einc||D5G2;|conn@3|y|I
-Eout||D5G2;|conn@2|y|O
-X
-
-# Cell nms2;1{ic}
-Cnms2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-0.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNPX-2.25;Y1.5;)I1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NPin|pin@1||0|-3||||
-NPin|pin@2||1|-2|1|1||
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-Nschematic:Bus_Pin|pin@7||3|4|-2|-2||
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-NPin|pin@17||0|6|||RR|
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-NPin|pin@21||0|3|1|1|YRR|
-NPin|pin@22||1.5|3|1|1|YRR|
-NPin|pin@23||1.5|5|1|1|YRR|
-NPin|pin@24||0|2|1|1|YRR|
-NPin|pin@25||3|4||||
-NPin|pin@26||1.5|4|1|1|Y|
-AThicker|net@0|||FS0|pin@3||0|-2|pin@0||-1|-2|ART_color()I10
-AThicker|net@1|||FS0|pin@2||1|-2|pin@3||0|-2|ART_color()I10
-AThicker|net@2|||FS1350|pin@0||-1|-2|pin@1||0|-3|ART_color()I10
-AThicker|net@3|||FS2250|pin@1||0|-3|pin@2||1|-2|ART_color()I10
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-AThicker|net@5|||FS900|pin@10||-1.5|1|pin@11||-1.5|-1|ART_color()I10
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-AThicker|net@8|||FS900|pin@14||-0.75|1|pin@13||-0.75|-1|ART_color()I10
-AThicker|net@9|||FS0|pin@15||0|1|pin@14||-0.75|1|ART_color()I10
-AThicker|net@10|||FS1800|pin@9||-3|0|pin@8||-1.5|0|ART_color()I10
-AThicker|net@11|||FS900|pin@21||0|3|pin@24||0|2|ART_color()I10
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-AThicker|net@14|||FS1800|pin@18||0|5|pin@19||0.75|5|ART_color()I10
-AThicker|net@15|||FS900|pin@23||1.5|5|pin@22||1.5|3|ART_color()I10
-AThicker|net@16|||FS900|pin@19||0.75|5|pin@20||0.75|3|ART_color()I10
-AThicker|net@17|||FS0|pin@25||3|4|pin@26||1.5|4|ART_color()I10
-Ed||D5G1;|pin@5||O
-Eg||D5G1;|pin@6||I
-Eg2||D5G1;|pin@7||I
-X
-
-# Cell nms2;1{sch}
-Cnms2;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-9;Y-15.5;)I100|ATTR_X(D5G1;HNPX-9;Y-14.5;)I1|prototype_center()I[0,0]
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@0||0|-4|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||0|-11|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOJPX3.5;Y0.5;)S@X*2.0
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-10|-11||||
-NOff-Page|conn@1||8|0|||Y|
-NOff-Page|conn@2||8|-4|||YRR|
-NGround|gnd@0||0|-19||||
-Inms2;1{ic}|nms2@0||29|0|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-0.5;)I100|ATTR_X(D5FLeave alone;G1.5;NPX-2.25;Y1.5;)I1
-NWire_Pin|pin@0||0|0||||
-Ngeneric:Invisible-Pin|pin@1||-0.5|4|||||ART_message(D5G2;)S[two fixed-size N-type transistors to GND]
-Ngeneric:Invisible-Pin|pin@2||0|8.5|||||ART_message(D5G6;)S[nms2]
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-Awire|net@1|||900|pin@0||0|0|NMOS@0|d|0|-2
-Awire|net@2|||0|conn@2|y|6|-4|NMOS@0|g|3|-4
-Awire|net@3|||2700|gnd@0||0|-17|NMOS@1|s|0|-13
-Awire|net@4|||1800|conn@0|y|-8|-11|NMOS@1|g|-3|-11
-Awire|net@5|||1800|pin@0||0|0|conn@1|a|6|0
-Ed||D5G2;|conn@1|y|O
-Eg||D5G2;|conn@0|a|I
-Eg2||D5G2;|conn@2|a|I
-X
-
-# Cell nms2_sy;1{ic}
-Cnms2_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX5.5;Y-0.5;)I100|ATTR_X(D5G1.5;HNOLPX-3.75;Y2.5;)S1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||0|6|-2|-2||
-Nschematic:Bus_Pin|pin@1||-3|0|-2|-2||
-Nschematic:Bus_Pin|pin@2||3|4|-2|-2||
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-AThicker|net@0|||FS900|pin@13||-0.75|1|pin@12||-0.75|-1|ART_color()I10
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-AThicker|net@4|||FS900|pin@9||-1.5|1|pin@10||-1.5|-1|ART_color()I10
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-AThicker|net@6|||FS1800|pin@12||-0.75|-1|pin@11||0|-1|ART_color()I10
-AThicker|net@7|||FS900|pin@11||0|-1|pin@5||0|-2|ART_color()I10
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-AThicker|net@29|||FS2700|pin@40||-2.25|0|pin@26||-2.25|4|ART_color()I10
-Ed||D5G1;|pin@0||O
-Eg||D5G1;|pin@1||I
-Eg2||D5G1;|pin@2||I
-X
-
-# Cell nms2_sy;1{sch}
-Cnms2_sy;1{sch}||schematic|1021415734000|1157998666994||ATTR_Delay(D5G1;HNPX-17;Y-12.5;)I100|ATTR_X(D5G1;HNOLPX-17;Y-11.5;)S1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||16.5|0||||
-NOff-Page|conn@1||16|-5.5|||YRR|
-NOff-Page|conn@2||-15|-5.5||||
-Inms2;1{ic}|nms2@0||8|-9.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5G1.5;NOLPX-2.25;Y1.5;)S@X/2.
-Inms2;1{ic}|nms2@1||-6.5|-9.5|||D0G4;|ATTR_Delay(D5G1;NOJPX3;Y-0.5;)S@Delay|ATTR_X(D5G1.5;NOLPX-2.25;Y1.5;)S@X/2.
-Inms2_sy;1{ic}|nms2_sy@0||25|11|||D0G4;|ATTR_Delay(D5G1;NPX5.5;Y-0.5;)I100|ATTR_X(D5G1.5;NOLPX-3.75;Y2.5;)S1
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-Cnor2;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-18;Y-6;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-18;Y-5;)S1|ATTR_drive0(D5G1;HNPTX-18;Y-7;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-8;)Sstrong1|ATTR_verilog_template(D5G1;NTX5.5;Y-18.5;)Snor ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||4|-8|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-15.5|0||||
-NOff-Page|conn@1||14|-8|||RR|
-NOff-Page|conn@2||14|0||||
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-Awire|net@10|||0|pin@5||-9|0|conn@0|y|-13.5|0
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-Awire|net@17|||0|pin@10||0|0|pin@12||-4|0
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-X
-
-# Cell nor2HT_sy;1{ic}
-Cnor2HT_sy;1{ic}||artwork|1021415734000|1223674999787|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-NThick-Circle|art@3||-1.5|-2|8|7|YRRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I10
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-NPin|pin@1||-1|1|1|1||
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-Nschematic:Bus_Pin|pin@7||-2.5|-1|-2|-2||
-AThicker|net@0|||FS2700|pin@0||-1|-1.25|pin@0||-1|-1.25|ART_color()I78
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-X
-
-# Cell nor2HT_sy;1{sch}
-Cnor2HT_sy;1{sch}||schematic|1021415734000|1223674989378||ATTR_Delay(D5G1;HNPX-18;Y-6;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-18;Y-5;)S1|ATTR_drive0(D5G1;HNPTX-18;Y-7;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-8;)Sstrong1|ATTR_verilog_template(D5G1;NTX5.5;Y-18.5;)Snor ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||-4|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5FLeave alone;G1.5;NOLPY2;)S@X/2.
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||14|-8|||RR|
-NOff-Page|conn@2||-15.5|0||||
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-Ngeneric:Invisible-Pin|pin@5||-2|19.5|||||ART_message(D5G6;)Snor2HT_sy
-NWire_Pin|pin@6||9|-8||||
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-NWire_Pin|pin@12||-4|-11.5||||
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-Awire|net@0|||1800|NMOS@0|g|7|-8|pin@6||9|-8
-Awire|net@1|||0|pin@7||9|4|pms2_sy@0|g2|3|4
-Awire|net@2|||1800|pin@4||-9|8|pms2_sy@0|g|-3|8
-Awire|net@3|||2700|pin@3||0|0|pms2_sy@0|d|0|2
-Awire|net@4|||1800|pin@2||4|0|conn@0|a|12|0
-Awire|net@5|||2700|pin@8||-9|0|pin@4||-9|8
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-Awire|net@7|||0|pin@2||4|0|pin@3||0|0
-Awire|net@8|||1800|pin@6||9|-8|conn@1|y|12|-8
-Awire|net@9|||2700|pin@6||9|-8|pin@7||9|4
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-Awire|net@11|||2700|pin@10||-9|-8|pin@8||-9|0
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-Awire|net@16|||900|NMOS@1|s|-4|-10|pin@12||-4|-11.5
-Awire|net@17|||0|pin@13||0|-11.5|pin@12||-4|-11.5
-Awire|net@18|||0|pin@11||4|-11.5|pin@13||0|-11.5
-Awire|net@19|||900|pin@13||0|-11.5|gnd@0||0|-13
-Eina||D5G2;|conn@2|a|I
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-Eout||D5G2;|conn@0|y|O
-X
-
-# Cell nor2HT_sya;2{ic}
-Cnor2HT_sya;2{ic}|nor2HT_sy|artwork|1021415734000|1223675184366|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-NThick-Circle|art@6||0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@7||-1|-1|1|1|||ART_color()I10
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-NPin|pin@10||-0.5|2|1|1||
-NPin|pin@11||0.5|2|1|1||
-NPin|pin@15||-2.5|1|1|1||
-NPin|pin@16||-1.5|1|1|1||
-NPin|pin@22||-2.5|-1|1|1||
-NPin|pin@23||-1.5|-1|1|1||
-AThicker|net@3|||FS0|pin@16||-1.5|1|pin@15||-2.5|1|ART_color()I10
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-AThicker|net@5|||FS2700|pin@9||-0.5|-2|pin@10||-0.5|2|ART_color()I10
-AThicker|net@6|||FS0|pin@11||0.5|2|pin@10||-0.5|2|ART_color()I10
-AThicker|net@13|||FS0|pin@23||-1.5|-1|pin@22||-2.5|-1|ART_color()I10
-Eina||D5G1;|pin@7||I
-Einb||D5G1;|pin@4||I
-Eout||D5G1;|pin@3||O
-X
-
-# Cell nor2_sy;1{ic}
-Cnor2_sy;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NThick-Circle|art@2||-1.5|2|8|7|RRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@3||-1.5|-2|8|7|YRRR||ART_color()I10|ART_degrees()F[0.0,1.0471976]
-NThick-Circle|art@4||2|0|1|1|||ART_color()I10
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-NPin|pin@1||-1|1|1|1||
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-Nschematic:Bus_Pin|pin@7||-2.5|-1|-2|-2||
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-Eina||D5G1;|pin@7||I
-Einb||D5G1;|pin@4||I
-Eout||D5G1;|pin@3||O
-X
-
-# Cell nor2_sy;1{sch}
-Cnor2_sy;1{sch}||schematic|1021415734000|1227395980725||ATTR_Delay(D5G1;HNPX-18;Y-6;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-18;Y-5;)S1|ATTR_drive0(D5G1;HNPTX-18;Y-7;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-8;)Sstrong1|ATTR_verilog_template(D5G1;NTX5.5;Y-18.5;)Snor ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Invisible-Pin|pin@0||27|-14|||||ART_message(D5G2;)S[X is drive strength,One pull-down is as strong,as the pull-up]
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-X
-
-# Cell nor2en;1{ic}
-Cnor2en;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-X
-
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-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||-4|-8|||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOLPX4.5;Y1.5;)Smax(@X/3., 5./3.)
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-X
-
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-Cnor2en_2p;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX2.5;Y-2;)I100|ATTR_X(D5G1.5;HNPX2.25;Y2.25;)I1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-NThick-Circle|art@4||-3.75|0|6|6|3200||ART_color()I10|ART_degrees()I800
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-AThicker|net@2|||FS3150|pin@9||-0.5|-1.75|pin@8||-1|-1.25|ART_color()I10
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-X
-
-# Cell nor2en_2p;1{sch}
-Cnor2en_2p;1{sch}||schematic|1021415734000|1158010267102||ATTR_Delay(D5G1;HNPX-24;Y-6;)I100|ATTR_X(D5G1;HNPX-24;Y-5;)I1|ATTR_drive0(D5G1;HNPTX-24;Y-7;)Sstrong0|ATTR_drive1(D5G1;HNPTX-24;Y-8;)Sstrong1|ATTR_verilog_template(D5G1;NTX5.5;Y-18.5;)Snor ($(drive0), $(drive1)) #($(Delay)) $(node_name) ($(out), $(ina), $(inb));|prototype_center()I[0,0]
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-IorangeTSMC090nm:NMOSx;1{ic}|NMOS@1||1|-8|YRR||D0G4;|ATTR_Delay(D5G1;NOJPX3.5;Y-2;)S@Delay|ATTR_X(D5G1.5;NOJPX3.5;Y0.5;)S@X
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Inor2en_2p;1{ic}|nor2en_2@0||31|9.5|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-2;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)I1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Ipms2;1{ic}|pms2@1||-10|8|||D0G4;|ATTR_Delay(D5G1;NOJPX-3;Y-1.5;)S@Delay|ATTR_X(D5G1.5;NOJPX2.25;Y1;)S@X/2.
-Awire|net@0|||1800|pms2@0|g2|0.5|4|pin@8||6|4
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-X
-
-# Cell nor2n;1{ic}
-Cnor2n;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX3;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
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-NThick-Circle|art@3||-1|-1|1|1|||ART_color()I10
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-X
-
-# Cell nor2n;1{sch}
-Cnor2n;1{sch}||schematic|1021415734000|1209125237179||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-18;Y-7.5;)S1|ATTR_drive0(D5G1;HNPTX-18;Y-9.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-10.5;)Sstrong1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@2||-15.5|-2.5||||
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-Inor2n;1{ic}|nor2n@0||24.5|11.5|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;NOLPX2.25;Y2.25;)S1|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-NWire_Pin|pin@3||-7|2.5||||
-Ngeneric:Invisible-Pin|pin@4||20.5|-11|||||ART_message(D5G2;)S[X is drive strength,One pull-down is as strong,as the pull-up]
-Ngeneric:Invisible-Pin|pin@5||-2|16.5|||||ART_message(D5G6;)S[nor2n]
-Ngeneric:Invisible-Pin|pin@6||-2|11.5|||||ART_message(D5G2;)S[one-parameter fixed-size NOR (AND rep)]
-Awire|net@0|||0|pin@0||-7|-2.5|conn@2|y|-13.5|-2.5
-Awire|net@1|||2700|pin@0||-7|-2.5|pin@1||-7|-1
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-Eina||D5G2;|conn@2|a|I
-Einb||D5G2;|conn@1|a|I
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-X
-
-# Cell nor2n_sy;1{ic}
-Cnor2n_sy;1{ic}||artwork|1021415734000|1209125462708|E|ATTR_Delay(D5G1;HNPX3;Y-3;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y2.25;)S1|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|prototype_center()I[6000,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NThick-Circle|art@1||-1|1|1|1|||ART_color()I10
-NThick-Circle|art@2||0.5|0|4|4|RRR||ART_color()I10|ART_degrees()F[0.0,3.1415927]
-NThick-Circle|art@3||-1|-1|1|1|||ART_color()I10
-NPin|pin@2||0.5|-2|1|1||
-NPin|pin@3||-0.5|-2|1|1||
-NPin|pin@4||-0.5|2|1|1||
-NPin|pin@5||0.5|2|1|1||
-NPin|pin@6||-1.5|1|1|1||
-NPin|pin@7||-2.5|1||||
-Nschematic:Bus_Pin|pin@8||2.5|0|-2|-2||
-Nschematic:Bus_Pin|pin@9||-2.5|1|-2|-2||
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-AThicker|net@1|||FS0|pin@2||0.5|-2|pin@3||-0.5|-2|ART_color()I10
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-AThicker|net@5|||FS0|pin@11||-1.5|-1|pin@10||-2.5|-1|ART_color()I10
-Eina||D5G1;|pin@12||I
-Einb||D5G1;|pin@9||I
-Eout||D5G1;|pin@8||O
-X
-
-# Cell nor2n_sy;1{sch}
-Cnor2n_sy;1{sch}||schematic|1021415734000|1223674427927||ATTR_Delay(D5G1;HNPX-18;Y-8.5;)I100|ATTR_X(D5FLeave alone;G1;HNOLPX-18;Y-7.5;)S1|ATTR_drive0(D5G1;HNPTX-18;Y-9.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-18;Y-10.5;)Sstrong1|prototype_center()I[0,0]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||10.5|0||||
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-# Cell passT;1{sch}
-CpassT;1{sch}||schematic|1094080836000|1158010267102||ATTR_LEPASSGATE(D5G1;HNPTX-30.5;Y-9.5;)I1|ATTR_XN(D5FLeave alone;G1;HNOLPX-31;Y-4;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX-31;Y-6;)S1|ATTR_Xinv(D5FLeave alone;G1;HNOLPX-31;Y-8;)S1|prototype_center()I[0,0]
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-# Cell passTF;1{ic}
-CpassTF;1{ic}||artwork|1094081205000|1204140525662|E|ATTR_LEPASSGATE(D5G1;HNPTX-30.5;Y-8;)I1|ATTR_XN(D5FLeave alone;G1;HNOLPX-3.25;Y-0.5;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX3.25;Y-0.5;)S1|prototype_center()I[0,0]
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-CpassTF;1{sch}||schematic|1094080836000|1158010267102||ATTR_LEPASSGATE(D5G1;HNPTX-30.5;Y-8;)I1|ATTR_XN(D5FLeave alone;G1;HNOLPX-31;Y-4;)S1|ATTR_XP(D5FLeave alone;G1;HNOLPX-31;Y-6;)S1|prototype_center()I[0,0]
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-# Cell pms2;1{ic}
-Cpms2;1{ic}||artwork|1021415734000|1204140525662|E|ATTR_Delay(D5G1;HNPX-3;Y-1.5;)I100|ATTR_X(D5FLeave alone;G1.5;HNOLPX2.25;Y1;)S1|prototype_center()I[0,0]
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index a79bdca..0000000
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+++ /dev/null
@@ -1,15434 +0,0 @@
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-Ametal-2|net@805||6.2|S0|wellCont@3|vdd|-151.5|22|scanTwin@9|vdd_9|-155.5|22
-Ametal-2|net@806||6.2|S0|scanTwin@7|vdd_7|78|-122|dataDriv@1|vdd_2|72.5|-122
-Ametal-2|net@807||6.2|S1800|dataDriv@1|gnd_1|72.5|-72|scanTwin@7|gnd_3|78|-72
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-Eaout[T]||D5G2;|latchWsc@3|out[1]|O
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-Egnd||D5G2;|pinsVddG@1|gnd|G
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-Egnd_5||D5G2;|latchWsc@2|gnd_2|G
-Egnd_7||D5G2;|scanCell@1|gnd_1|G
-Egnd_8||D5G2;|scanTwin@6|gnd_3|G
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-Erd_1||D5G2;|pin@113||O
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-Exout[38]||D5G2;|pin@10||O
-X
-
-# Cell bitsAndDriversScan;1{sch}
-CbitsAndDriversScan;1{sch}||schematic|1188688057760|1216150269754|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||55|-2||||
-NOff-Page|conn@2||39|13.5|||RRR|
-NOff-Page|conn@7||51.5|-7||||
-NOff-Page|conn@9||-42|-23|||YRRR|
-NOff-Page|conn@10||-42|-2|||R|
-NWire_Con|conn@11||-42|-12||||
-NOff-Page|conn@12||55.5|-12||||
-NOff-Page|conn@15||55|-18||||
-NOff-Page|conn@16||30.5|-7||||
-NOff-Page|conn@17||-8.5|-7||||
-NOff-Page|conn@18||6.5|-7||||
-NOff-Page|conn@19||55.5|-15||||
-IbitsAndDriversScan;1{ic}|data1in3@0||63|18|||D5G4;
-IdriversJ:dataDriver70;1{ic}|dataDriv@0||12|9|XY||D5G4;
-IdriversJ:dataDriver70;1{ic}|dataDriv@1||-1|-22|XY||D5G4;
-IdriversJ:dataDriver70;1{ic}|dataDriv@2||29|-22|Y||D5G4;
-IlatchGroupsK:latchWscan;1{ic}|latchWsc@2||41|-4|||D5G4;
-IlatchGroupsK:latchWscan;1{ic}|latchWsc@3||-1|-4|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||6.5|41|||||ART_message(D5G6;)SbitsAndDriversScan
-Ngeneric:Invisible-Pin|pin@1||5.5|32|||||ART_message(D5G3;)Sies 24 November 2007
-Ngeneric:Invisible-Pin|pin@2||4.5|36|||||ART_message(D5G4;)Sthe center part of the data with scan
-Ngeneric:Invisible-Pin|pin@16||4.5|18|||||ART_message(D6G2;)S[Bit arrangement right:,18 17 16 15 14 13 12 11 10,01 02 03 04 05 06 07 08 09]
-Ngeneric:Invisible-Pin|pin@17||1.5|18|||||ART_message(D4G2;)S[Bit arrangement left:,09 08 07 06 05 04 03 02 01,10 11 12 13 14 15 16 17 18]
-NBus_Pin|pin@24||-1|-16|-1|-1||
-NWire_Pin|pin@31||48|-1||||
-NWire_Pin|pin@32||48|3||||
-NWire_Pin|pin@33||32|-1||||
-NWire_Pin|pin@35||32|8||||
-NWire_Pin|pin@36||39|10||||
-NWire_Pin|pin@42||35|-22|||X|
-NWire_Pin|pin@43||35|-17|||X|
-NBus_Pin|pin@45||41|-16|-1|-1||
-NBus_Pin|pin@48||-42|-17|-1|-1||
-NBus_Pin|pin@49||-42|-7|-1|-1||
-NWire_Pin|pin@50||-19|-35||||
-NWire_Pin|pin@51||-19|-30||||
-NBus_Pin|pin@54||-29|-19|-1|-1||
-Ngeneric:Invisible-Pin|pin@56||9.5|23|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NWire_Pin|pin@59||5|-23||||
-NWire_Pin|pin@61||-7|-22|||X|
-NWire_Pin|pin@62||-7|-17|||X|
-NWire_Pin|pin@65||23|-35||||
-NWire_Pin|pin@66||23|-23||||
-NWire_Pin|pin@67||14|-21||||
-NWire_Pin|pin@68||14|-26||||
-Ngeneric:Invisible-Pin|pin@69||11.5|27|||||ART_message(D5G3;)Sscan order is:  setData,setAddress,d[1:37],a[T,1:14]
-NWire_Pin|pin@72||63|-18||||
-NWire_Pin|pin@73||63|-23||||
-NBus_Pin|pin@74||-32|3|-1|-1||
-NBus_Pin|pin@75||-26|-0.5|-1|-1||
-NBus_Pin|pin@82||-10|-41|-1|-1||
-NBus_Pin|pin@84||14|-41|-1|-1||
-NBus_Pin|pin@85||5|-41|-1|-1||
-NBus_Pin|pin@86||5|-38|-1|-1||
-NWire_Pin|pin@91||5|-35||||
-NWire_Pin|pin@92||7|11||||
-NWire_Pin|pin@93||7|7||||
-NWire_Pin|pin@94||7|9||||
-NWire_Pin|pin@95||-3|11||||
-NWire_Pin|pin@96||-3|7||||
-NWire_Pin|pin@97||-10|-1||||
-NWire_Pin|pin@98||-10|4||||
-NWire_Pin|pin@99||7|-1||||
-NWire_Pin|pin@100||7|4||||
-IscanJ:scanTwinAmp;1{ic}|sa[1:4]|D5G2;X-5;Y-2;|-29|-9.5|||D5G4;
-IscanJ:scanCellE;1{ic}|scanCell@0||-10|-35|||D5G4;
-IscanJ:scanCellE;1{ic}|scanCell@1||14|-35|||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||2|11|||D0G4;|ATTR_L(D5G1;PUD)S2534|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@2||2|7|||D0G4;|ATTR_L(D5G1;PUD)S2534|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@3||1|-35|||D0G4;|ATTR_L(D5G1;PUD)D918.5999999999998|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@5||9|-21|||D0G4;|ATTR_L(D5G1;PUD)D1176.9999999999998|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-X
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-# Cell fifo13upDown;1{sch}
-Cfifo13upDown;1{sch}||schematic|1206042581923|1206049666274|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||-14|10.5|||RRR|
-NOff-Page|conn@2||-6|6|||R|
-NOff-Page|conn@3||18|6|||XRRR|
-NOff-Page|conn@4||14|-8|||XR|
-NOff-Page|conn@5||6|-6|||XRRR|
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-Ngeneric:Invisible-Pin|pin@0||0|25|||||ART_message(D5G3;)Sies 20 March 2008
-Ngeneric:Invisible-Pin|pin@1||0|29|||||ART_message(D5G4;)S2 sets of 13 latches for middle of fifo
-Ngeneric:Invisible-Pin|pin@2||0|34|||||ART_message(D5G6;)Sfifo13upDown
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-X
-
-# Cell fifo26mid;1{ic}
-Cfifo26mid;1{ic}||artwork|1204666835545|1206042528277|E
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-Nschematic:Bus_Pin|pin@4||3|0|-1|-1||
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-Ngeneric:Invisible-Pin|pin@7||0|0|||||ART_message(D5G3;)SFm
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-X
-
-# Cell fifo26mid;1{sch}
-Cfifo26mid;1{sch}||schematic|1204563205831|1206042537397||LEDRIVE_inv@0()F74.19135|LEDRIVE_inv@1()F27.964613
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-IredFour:inv;1{ic}|inv@1||-6|-15|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S30|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IlatchesK:latch1in10B;1{ic}|la[1:26]|D5G3;Y5;|0|0|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||2.5|16.5|||||ART_message(D5G3;)Sies 20 March 2008
-Ngeneric:Invisible-Pin|pin@1||1.5|20.5|||||ART_message(D5G4;)S26 latches for middle of fifo
-Ngeneric:Invisible-Pin|pin@2||3.5|25.5|||||ART_message(D5G6;)Sfifo26mid
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-X
-
-# Cell fifo26reg;1{ic}
-Cfifo26reg;1{ic}||artwork|1206053611899|1206053651497|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@1||-3|0|-1|-1||
-Nschematic:Bus_Pin|pin@2||3|0|-1|-1||
-Ngeneric:Invisible-Pin|pin@3||0|0|||||ART_message(D5G3;)S26
-NPin|pin@4||1|2|1|1||
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-NPin|pin@6||3|0|1|1||
-NPin|pin@7||1|-3|1|1||
-NPin|pin@8||1|-2|1|1||
-NPin|pin@9||-3|-2|1|1||
-NPin|pin@10||-3|2|1|1||
-NPin|pin@11||-2|-2|1|1||
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-Ehcl[1]||D5G2;|pin@0||I
-Ein[1:26]||D5G2;|pin@1||I
-Eout[1:26]||D5G2;|pin@2||O
-X
-
-# Cell fifo26reg;1{sch}
-Cfifo26reg;1{sch}||schematic|1206042581923|1206053614092|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@3||-6|6|||RRR|
-NOff-Page|conn@4||-2|-18|||R|
-NOff-Page|conn@5||6|-6|||RRR|
-Ififo26reg;1{ic}|fifo26re@0||17|15|||D5G4;
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-IlatchesK:latch1in10B;1{ic}|la[1:26]|D5G3;X3;Y5;|0|0|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0|25|||||ART_message(D5G3;)Sies 20 March 2008
-Ngeneric:Invisible-Pin|pin@1||0|29|||||ART_message(D5G4;)S26 latches for middle of fifo
-Ngeneric:Invisible-Pin|pin@2||0|34|||||ART_message(D5G6;)Sfifo26reg
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-NBus_Pin|pin@6||6|0|-1|-1||
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-NWire_Pin|pin@13||-2|-12|||X|
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-X
-
-# Cell fifo26reg2in;1{ic}
-Cfifo26reg2in;1{ic}||artwork|1206053611899|1206828448059|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||-2|-3|-1|-1||
-Nschematic:Bus_Pin|pin@1||-3|1|-1|-1||
-Nschematic:Bus_Pin|pin@2||3|0|-1|-1||
-Ngeneric:Invisible-Pin|pin@3||0|0|||||ART_message(D5G3;)S26
-NPin|pin@4||1|2|1|1||
-NPin|pin@5||1|3|1|1||
-NPin|pin@6||3|0|1|1||
-NPin|pin@7||1|-3|1|1||
-NPin|pin@8||1|-2|1|1||
-NPin|pin@9||-3|-2|1|1||
-NPin|pin@10||-3|2|1|1||
-NPin|pin@11||-2|-2|1|1||
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-Eout[1:26]||D5G2;|pin@2||O
-X
-
-# Cell fifo26reg2in;1{sch}
-Cfifo26reg2in;1{sch}||schematic|1206042581923|1206828485647|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@3||-10.5|2||||
-NOff-Page|conn@4||0|-26|||R|
-NOff-Page|conn@5||10|0||||
-NOff-Page|conn@6||-10.5|-2||||
-Ififo26reg2in;1{ic}|fifo26re@0||17|15|||D5G4;
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-IredFour:inv;1{ic}|inv@2||18|-6|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S80|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@3||9|-12|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S30|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IlatchesK:latch2in10A;1{ic}|la[1:26]|D5G3;X3;Y5;|0|0|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0|25|||||ART_message(D5G3;)Sies 29 March 2008
-Ngeneric:Invisible-Pin|pin@1||0|29|||||ART_message(D5G4;)S26 latches for middle of fifo
-Ngeneric:Invisible-Pin|pin@2||0|34|||||ART_message(D5G6;)Sfifo26reg2in
-NWire_Pin|pin@8||-24|-12||||
-NWire_Pin|pin@9||-24|6||||
-NWire_Pin|pin@13||-3|-12|||X|
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-IorangeTSMC090nm:wire90;1{ic}|wire90@3||18|-12|X||D0G4;|ATTR_L(D5G1;PUD)D817.8999999999996|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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index a35f5fe..0000000
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-Erd||D5G2;|pin@83||O
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-X
-
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-NOff-Page|conn@10||-42|-2|||R|
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-NOff-Page|conn@12||55.5|-12||||
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-NOff-Page|conn@16||30.5|-7||||
-NOff-Page|conn@17||-8.5|-7||||
-NOff-Page|conn@18||6.5|-7||||
-NOff-Page|conn@19||55.5|-15||||
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-Ngeneric:Invisible-Pin|pin@2||4.5|36|||||ART_message(D5G4;)Sthe center part of the data with scan
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-NWire_Pin|pin@36||39|10||||
-NWire_Pin|pin@42||35|-22|||X|
-NWire_Pin|pin@43||35|-17|||X|
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-NWire_Pin|pin@61||-7|-22|||X|
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-NWire_Pin|pin@100||7|4||||
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-IscanJ:scanCellE;1{ic}|scanCell@1||14|-35|||D5G4;
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-IorangeTSMC090nm:wire90;1{ic}|wire90@2||2|7|||D0G4;|ATTR_L(D5G1;PUD)S2534|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@3||1|-35|||D0G4;|ATTR_L(D5G1;PUD)D918.5999999999998|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@5||9|-21|||D0G4;|ATTR_L(D5G1;PUD)D1176.9999999999998|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-Abus|sod[6:9]|D5G2;|-0.5|IJ2700|conn@11||-42|-12|pin@49||-42|-7
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-EscanFromAddress||D4G2;|conn@15|a|I
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-X
-
-# Cell bitsAndDriversWeak;1{ic}
-CbitsAndDriversWeak;1{ic}||artwork|1189375651355|1197128246195|EI
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-X
-
-# Cell bitsAndDriversWeak;1{lay}
-CbitsAndDriversWeak;1{lay}||cmos90|1194829372523|1227290795965|I|ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1226366414126|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226366414126
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@33||156.4|10|||X|
-NX-Metal-1-Metal-2-Con|contact@34||-202.5|-22||||
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-NX-Metal-1-Metal-2-Con|contact@37||-156.4|10||||
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-NMetal-1-Metal-2-Con|contact@39||-198|68.1|||R|
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-IlatchesK:latch1in30Am1;1{lay}|latch1in@7||144|0|X||D5G4;
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-IwiresL:select60;1{lay}|select60@2||-103|0|||D5G4;
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-X
-
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-
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-X
-
-# Cell dRegDrive;1{sch}
-CdRegDrive;1{sch}||schematic|1189373179324|1227290795965|I
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-NOff-Page|conn@4||8|-9||||
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-EinB[1],ainB[T]|inB[T,1]|D4G2;|conn@3|a|I
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-X
-
-# Cell dRegSignal;1{ic}
-CdRegSignal;1{ic}||artwork|1189375651355|1227187942252|EI
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-NThick-Circle|art@3||-3.5|-6|1|1||
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-X
-
-# Cell dRegSignal;1{lay}
-CdRegSignal;1{lay}||cmos90|1227207075336|1227290795965|I|ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1227275393136|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227296377317
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-IlatchesK:latch2in20A;1{lay}|latch2in@0||36|0|X||D5G4;
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-NMetal-1-Pin|pin@7||-72|58||||
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-EinA|dataCap|D5G2;|nor10B@0|inA|I
-Ehcl[A]|dcl[M]|D5FLeave alone;G2;|latch2in@0|hcl[A]|I
-Efire[M]||D5G2;|pin@7||I
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-Evdd_1||D5G2;|inv10D@0|vdd_1|P
-Evdd_2||D5G2;|latch2in@0|vdd|P
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-X
-
-# Cell dRegSignal;1{sch}
-CdRegSignal;1{sch}||schematic|1189373179324|1227290795965|I
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-NOff-Page|conn@11||-42|8|||Y|
-IdRegSignal;1{ic}|dRegSign@1||-42|27|||D5G4;
-IredFour:inv;1{ic}|inv@0||-32|13|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IlatchesK:latch2in20A;1{ic}|latch2in@2||-5|0|||D5G4;
-IredFour:nor2n;1{ic}|nor2n@0||-19|12|||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||2|37|||||ART_message(D5G6;)SdRegSignal
-Ngeneric:Invisible-Pin|pin@1||1|28|||||ART_message(D5G3;)Sies 14 November 2008
-Ngeneric:Invisible-Pin|pin@2||0|32|||||ART_message(D5G4;)Sthe signal bit
-Ngeneric:Invisible-Pin|pin@56||0|-5|||||ART_message(D3G2;)Sthe output is flag[C].
-NWire_Pin|pin@57||-7|-12||||
-NWire_Pin|pin@62||-23|11|||X|
-NWire_Pin|pin@63||-23|8|||X|
-NWire_Pin|pin@65||-7|12||||
-NWire_Pin|pin@68||-13|1||||
-NWire_Pin|pin@70||-13|-3||||
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-NWire_Pin|pin@72||-13|3||||
-Ngeneric:Invisible-Pin|pin@73||-54|2.5|||||ART_message(D3G2;)S[sigA is the signal bit,"of input data or token,","ain[1].",OUTPUT DOCK:,sigS comes from SHIP,INPUT DOCK:,sigS tied to sigA.]
-Ngeneric:Invisible-Pin|pin@74||6|18|||||ART_message(D3G1.5;)S[Both kinds of docks set,"the signal bit, aout[1],",as part of setting the path.,Don't you want independent,control of path and signal output bit?,On 14 Nov 08  Adam said NO because,that would preclude some switch fabric,implementations.]
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-12|12|||D0G4;|ATTR_L(D5G1;PUD)D295.79999999999995|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@1||-25|13|||D0G4;|ATTR_L(D5G1;PUD)D295.79999999999995|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-Awire|net@106|||2700|pin@57||-7|-12|latch2in@2|hcl[A]|-7|-3
-Awire|net@112|||0|nor2n@0|ina|-21.5|11|pin@62||-23|11
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-Awire|net@120|||1800|conn@6|y|-13.5|-12|pin@57||-7|-12
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-EdataCap@656457084|dataCap|D4G2;|conn@11|a|I
-EdataCap|dcl[M]|D4G2;|conn@6|a|I
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-EinM[S_1]|sigA|D4G2;|conn@8|a|I
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-X
-
-# Cell data1in18scan;1{ic}
-Cdata1in18scan;1{ic}||artwork|1189375869656|1197075712218|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||-2|3|-1|-1||
-Nschematic:Bus_Pin|pin@1||-3|0|-1|-1||
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-Evdd_2||D5G2;|dataMux4@0|vdd|P
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-X
-
-# Cell dataMuxAll;1{sch}
-CdataMuxAll;1{sch}||schematic|1216087490865|1228949080096|
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-IdataMuxAll;1{ic}|dataMuxA@0||22|43.5|||D5G4;
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-IredFour:inv;1{ic}|inv@2||1.5|-8|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@5||-19|1|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S30|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@6||6|24|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S100|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@7||24|24|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S80|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@8||8.5|-8|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@9||11.5|0|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S40|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-Ngeneric:Invisible-Pin|pin@0||-11.5|49.5|||||ART_message(D5G6;)SdataMuxAll
-Ngeneric:Invisible-Pin|pin@1||-11.5|35.5|||||ART_message(D5G3;)Sies 20 November 2008
-Ngeneric:Invisible-Pin|pin@2||-11.5|44.5|||||ART_message(D5G3;)Sthe overlap part of the shadow register
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-NWire_Pin|pin@6||22|0||||
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-NWire_Pin|pin@19||15|-12.5||||
-NWire_Pin|pin@34||-5|-1||||
-Ngeneric:Invisible-Pin|pin@36||-44|24|||||ART_message(D3G2;)S["lit[20] = TRUE selects",the latched input,for shift literal.]
-NWire_Pin|pin@38||-5|-8||||
-Ngeneric:Invisible-Pin|pin@45||-28.5|13|||||ART_message(D3G2;)S[this NAND gate,for energy saving]
-NBus_Pin|pin@59||14|6|-1|-1||
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-NBus_Pin|pin@66||25|18|-1|-1||
-NWire_Pin|pin@67||-26|1||||
-NWire_Pin|pin@68||-26|6||||
-Ngeneric:Invisible-Pin|pin@69||-11.5|40.5|||||ART_message(D5G3;)Splus power drivers for selection
-Ngeneric:Invisible-Pin|pin@70||33.5|-6.5|||||ART_message(D5G3;)S[sign extension may,be inverted!]
-IorangeTSMC090nm:wire90;1{ic}|wire90@8||-10.5|1|||D0G4;|ATTR_L(D5G1;PUD)S.954|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@9||4.5|0|||D0G4;|ATTR_L(D5G1;PUD)D668.1999999999997|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@10||31.5|24|||D0G4;|ATTR_L(D5G1;PUD)S.4189|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@11||13.5|24|||D0G4;|ATTR_L(D5G1;PUD)S.6941|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-Awire|net@3|||900|pin@5||22|8|pin@6||22|0
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-Awire|net@61|||1800|inv@5|out|-16.5|1|wire90@8|a|-13|1
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-Esign_1|s[T,F]|D6G2;|conn@8|y|O
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-X
-
-# Cell ins2in20Ax18;2{ic}
-Cins2in20Ax18;2{ic}||artwork|1207331360703|1227290795965|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@4||-3|-1|-1|-1||
-Nschematic:Bus_Pin|pin@8||3|0|-1|-1||
-Ngeneric:Invisible-Pin|pin@10||0|0|||||ART_message(D5G1.5;)S18x20A
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-
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-Evdd_7||D5G2;|scanTwin@0|vdd_7|P
-Evdd_8||D5G2;|scanTwin@0|vdd_8|P
-Evdd_9||D5G2;|scanTwin@0|vdd_9|P
-Evdd_27||D5G2;|scanAmp4@6|vdd_7|P
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-Evdd_29||D5G2;|scanAmp4@6|vdd_5|P
-Evdd_30||D5G2;|scanAmp4@6|vdd_6|P
-Evdd_31||D5G2;|scanTwin@1|vdd_6|P
-Evdd_32||D5G2;|scanTwin@1|vdd_7|P
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-Evdd_35||D5G2;|pinsVddG@3|vdd|P
-Evdd_36||D5G2;|pinsVddG@3|vdd_1|P
-X
-
-# Cell scanBoost;2{sch}
-CscanBoost;2{sch}||schematic|1184793850280|1196127434824|
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-Ngeneric:Invisible-Pin|pin@1||-0.5|32.5|||||ART_message(D5G3;)Sies 23 November 07
-Ngeneric:Invisible-Pin|pin@2||4.5|27|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NBus_Pin|pin@3||0|-15|-1|-1||
-NBus_Pin|pin@4||-3|9|-1|-1||
-NBus_Pin|pin@8||-21|-7|-1|-1||
-NBus_Pin|pin@9||-21|9|-1|-1||
-NBus_Pin|pin@16||3|6|-1|-1||
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-IscanBoost;1{ic}|scanCap@0||28|14|R||D5G4;
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-Abus|so[2,3,5,9]|D5G2;|-0.5|IJ2700|a[1:4]|out[1]|-3|3|pin@4||-3|9
-Abus|so[4],si[6,7,8]|D5G2;|-0.5|IJ2700|scanAmp4@3|out|-21|6|pin@9||-21|9
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-X
-
-# Cell scanBusInM3;1{lay}
-CscanBusInM3;1{lay}||cmos90|1180628762335|1205537536702|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1209772825970
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell scanBusOutM3;1{lay}
-CscanBusOutM3;1{lay}||cmos90|1180628762335|1205537542797|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1209772825970
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell scanCap;1{ic}
-CscanCap;1{ic}||artwork|1184794003346|1194706304473|EI
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@0||0|0|-1|-1||
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-AThicker|net@8|||FS0|pin@8||1|-1.5|pin@3||-1|-1.5
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-AThicker|net@10|||FS2918|pin@9||2.4|-0.5|pin@11||2|0.5
-Esi[1:9]||D5G2;|pin@0||B
-X
-
-# Cell scanCap;1{lay}
-CscanCap;1{lay}||cmos90|1184793644771|1226322962956|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226347799796
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-2-Metal-3-Con|contact@1||-18|12||||
-NX-Metal-2-Metal-3-Con|contact@2||-12|6||||
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-NX-Metal-2-Metal-3-Con|contact@5||18|18||||
-NMetal-3-Pin|pin@0||-18|16.5||||
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-Ametal-2|net@3|||S1800|contact@4||-24|18|contact@5||18|18
-Ametal-3|net@6|||S2700|scanBusI@1|si[7]|12|0|contact@0||12|12
-Ametal-3|net@7|||S2700|contact@1||-18|12|pin@0||-18|16.5
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-Ametal-3|net@16|||S2700|scanBusI@1|si[8]|18|0|contact@5||18|18
-Esi[1]||D5G2;|scanBusI@1|si[1]|B
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-X
-
-# Cell scanCap;1{sch}
-CscanCap;1{sch}||schematic|1184793850280|1194706304473|I
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-4|-6.5|||YRRR|
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-Ngeneric:Invisible-Pin|pin@1||-0.5|20.5|||||ART_message(D5G3;)Sies 18 July 07
-Ngeneric:Invisible-Pin|pin@2||4.5|15|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NBus_Pin|pin@3||-12|-10.5|-1|-1||
-NBus_Pin|pin@4||-12|8.5|-1|-1||
-IscanCap;1{ic}|scanCap@0||18|24|||D5G4;
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-Abus|si[8:6]|D5G2;|-0.5|IJ2700|conn@1||-12|1|pin@4||-12|8.5
-Esi[1:9]||D4G2;|conn@0|a|B
-X
-
-# Cell scanCellE;1{ic}
-CscanCellE;1{ic}||artwork|1194707157688|1194707299073|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Nschematic:Bus_Pin|pin@2||0|-3|-1|-1||
-Nschematic:Bus_Pin|pin@4||-7|0|-1|-1||
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-NPin|pin@8||6|2|1|1||
-Ngeneric:Invisible-Pin|pin@11||4|0|||||ART_message(D5G4;)S10
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-NPin|pin@14||6|-2|1|1||
-NPin|pin@15||7|0|1|1||
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-NPin|pin@31||0|3|1|1||
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-AThicker|net@26|||FS2700|pin@29||1|1|pin@12||1|2
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-AThicker|net@31|||FS1800|pin@12||1|2|pin@8||6|2
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-EdIn[1]||D5G2;|pin@0||I
-Ep2p,p1p,rd||D5G2;|pin@2||I
-Esin||D5G2;|pin@4||I
-Esout||D5G2;|pin@6||O
-X
-
-# Cell scanCellE;1{lay}
-CscanCellE;1{lay}||cmos90|1194655408628|1206031209843||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1222633964222
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@1||-4|-22||||
-NMetal-1-Polysilicon-Con|contact@2||-43|26||5.2||
-NMetal-1-Polysilicon-Con|contact@3||4|30||5.2||
-IlatchesK:latch1in10Aw;1{lay}|latch1in@0||-45|0|||D5G4;
-IlatchesK:latch2in10Alo;1{lay}|latch2in@0||37|0|||D5G4;
-NPolysilicon-Pin|pin@3||4|34.5||||
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-NMetal-1-Pin|pin@6||4|31||||
-NPolysilicon-Pin|pin@11||-45|34.5||||
-NPolysilicon-Pin|pin@13||-45|28.6||||
-Ametal-2|net@2|||S0|latch2in@0|vdd_2|2|50|latch1in@0|vdd_3|2|50
-Ametal-1|net@5|||S900|latch2in@0|inA[1]|15.5|-7|contact@0||15.5|-22
-Ametal-2|net@6|||S1800|contact@1||-4|-22|contact@0||15.5|-22
-Ametal-1|net@7|||S900|latch1in@0|out[1]|-4|-10.4|contact@1||-4|-22
-APolysilicon|net@15|||S0|latch2in@0|hcl_1|20|34.5|pin@3||4|34.5
-APolysilicon|net@16|||S900|pin@3||4|34.5|contact@3||4|32.6
-Ametal-1|net@18|||S2700|contact@2||-43|25|pin@5||-43|25
-Ametal-1|net@19|||S900|contact@3||4|31|pin@6||4|31
-Ametal-2|net@26|||S0|latch1in@0|vdd_1|2|-50|latch2in@0|vdd|2|-50
-Ametal-2|net@27|||S0|latch1in@0|gnd_1|2|0|latch2in@0|gnd|2|0
-APolysilicon|net@28|||S1800|latch1in@0|hcl_1|-54|34.5|pin@11||-45|34.5
-APolysilicon|net@31|||S1800|pin@13||-45|28.6|contact@2||-43|28.6
-APolysilicon|net@32|||S900|pin@11||-45|34.5|pin@13||-45|28.6
-EinB[1]|dIn[1]|D5G2;|latch2in@0|inB[1]|I
-Egnd||D5G2;|latch1in@0|gnd|G
-Egnd_1||D5G2;|latch2in@0|gnd_1|G
-Ep2p_1|p1p|D5G2;|pin@6||I
-Ep2p||D5G2;|pin@5||I
-Ehcl[B]|rd|D5G2;|latch2in@0|hcl[B]|I
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-Eout[2]|sout|D5G2;|latch2in@0|out[1]|O
-Evdd||D5G2;|latch1in@0|vdd|P
-Evdd_1||D5G2;|latch2in@0|vdd_1|P
-Evdd_2||D5G2;|latch1in@0|vdd_2|P
-Evdd_3||D5G2;|latch2in@0|vdd_3|P
-X
-
-# Cell scanCellE;1{sch}
-CscanCellE;1{sch}||schematic|1194655242436|1206033740270|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-1|-19|||YRRR|
-NOff-Page|conn@1||16|-5||||
-NOff-Page|conn@2||0|7.5|||YR|
-NOff-Page|conn@3||-20|-6|||Y|
-IlatchesK:latch1in10A;1{ic}|latch1in@0||-12|-6|||D5G4;
-IlatchesK:latch2in10Alo;1{ic}|latch2in@0||6|-5|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0.5|32.5|||||ART_message(D5G5;)SscanCellE
-Ngeneric:Invisible-Pin|pin@1||1|28.5|||||ART_message(D5G3;)Sies 9 November 2007
-Ngeneric:Invisible-Pin|pin@2||1|23.5|||||ART_message(D5G3;)S[this is a read/write scan cell,for use with separate data registers]
-Ngeneric:Invisible-Pin|pin@3||2.5|18|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NWire_Pin|pin@5||0|-4||||
-NWire_Pin|pin@7||-13|-14||||
-NWire_Pin|pin@10||5|-14||||
-NWire_Pin|pin@11||5|5||||
-IscanCellE;1{ic}|scanCell@0||24|7|||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-3|-6|||D0G4;|ATTR_L(D5G1;PUD)D218.4|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-Awire|net@0|||1800|latch2in@0|out[1]|9|-5|conn@1|a|14|-5
-Awire|net@1|||0|latch1in@0|in[1]|-15|-6|conn@3|y|-18|-6
-Awire|net@2|||1800|latch1in@0|out[1]|-9|-6|wire90@0|a|-5.5|-6
-Awire|net@10|||1800|wire90@0|b|-0.5|-6|latch2in@0|inA[1]|3|-6
-Awire|net@11|||1800|pin@5||0|-4|latch2in@0|inB[1]|3|-4
-Awire|net@12|||2700|pin@5||0|-4|conn@2|y|0|5.5
-Awire|p1p|D5G2;||900|latch2in@0|hcl[A]|5|-8|pin@10||5|-14
-Awire|p2p|D5G2;||900|latch1in@0|hcl|-13|-9|pin@7||-13|-14
-Awire|rd|D5G2;||2700|latch2in@0|hcl[B]|5|-2|pin@11||5|5
-EdIn[1]||D4G2;|conn@2|a|I
-Ep1p,p2p,rd|p2p,p1p,rd|D4G2;|conn@0|a|I
-Esin||D4G2;|conn@3|a|I
-Esout||D6G2;|conn@1|y|O
-X
-
-# Cell scanCellF;1{ic}
-CscanCellF;1{ic}||artwork|1194707329538|1194707436825|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||0|7|-1|-1||
-Nschematic:Bus_Pin|pin@2||0|-4|-1|-1||
-Nschematic:Bus_Pin|pin@4||-7|0|-1|-1||
-Nschematic:Bus_Pin|pin@6||8|0|-1|-1||
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-Ngeneric:Invisible-Pin|pin@11||-4|0|||||ART_message(D5G4;)S10
-NPin|pin@12||-7|2|1|1||
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-X
-
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-
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-
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-X
-
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-X
-
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-X
-
-# Cell scanTwinAmp;3{lay}
-CscanTwinAmp;3{lay}||cmos90|1194893522880|1223474198202||ATTR_NCC(D5G3;NTX4;Y70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226012824409
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-X

diff --git a/electric/scanK.jelib b/electric/scanK.jelib
deleted file mode 100755 (executable)
index ac14772..0000000
--- a/electric/scanK.jelib
+++ /dev/null
@@ -1,5414 +0,0 @@
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-HscanK|8.08j
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-
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-
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-X
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-X
-
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-InoScan;1{ic}|noScan@0||20|34|||D5G4;
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-X
-
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-X
-
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-X
-
-# Cell scanBusInM3;1{lay}
-CscanBusInM3;1{lay}||cmos90|1180628762335|1205537536702|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1209772825970
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-X
-
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-X
-
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-CscanBusInM3noSin;1{lay}||cmos90|1180628762335|1226322292292|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226002623395
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-X
-
-# Cell scanBusOutM1;1{lay}
-CscanBusOutM1;1{lay}||cmos90|1180628762335|1205537538719|I
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-X
-
-# Cell scanBusOutM2;1{lay}
-CscanBusOutM2;1{lay}||cmos90|1180628762335|1205537540776|I
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-X
-
-# Cell scanBusOutM3;1{lay}
-CscanBusOutM3;1{lay}||cmos90|1180628762335|1205537542797|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1209772825970
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
-# Cell scanBusOutM3noSout;1{lay}
-CscanBusOutM3noSout;1{lay}||cmos90|1180628762335|1226002282578|I|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226002623395
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-Eso[4]||D5G2;|pin@11||B
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-Eso[7]||D5G2;|pin@14||B
-Eso[8]||D5G2;|pin@15||B
-Eso[9]||D5G2;|pin@16||B
-X
-
-# Cell scanCellKh;1{ic}
-CscanCellKh;1{ic}||artwork|1194707157688|1209771649430|E
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-X
-
-# Cell scanCellKh;1{lay}
-CscanCellKh;1{lay}||cmos90|1209767697205|1226840053029||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_area_date()G1226840101835|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226840101835
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-Ngeneric:Essential-Bounds|art@2||56|72||||A
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-IlatchesK:mlat2in10;3{lay}|mlat2in1@2||23|0|||D5G4;
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-Ametal-1|net@21|||S900|mlat1in1@1|out|-14.5|7|pin@9||-14.5|-25
-Ametal-2|net@23|||S0|mlat1in1@1|gnd_1|-10|0|mlat2in1@2|gnd_1|-10|0
-Ametal-2|net@24|||S0|mlat1in1@1|vdd_2|-10|50|mlat2in1@2|vdd_2|-10|50
-Ametal-2|net@25|||S0|mlat1in1@1|vdd_3|-10|-50|mlat2in1@2|vdd_3|-10|-50
-Ametal-1|net@27|||S1800|pin@9||-14.5|-25|mlat2in1@2|inA|-3|-25
-EclA[F]|clS[F]|D5G2;|mlat2in1@2|clA[F]|I
-EclA[T]|clS[T]|D5G2;|mlat2in1@2|clA[T]|I
-Ecl[F]||D5G2;|mlat1in1@1|cl[F]|I
-Ecl[T]||D5G2;|mlat1in1@1|cl[T]|I
-EdIn[1]|din[1]|D5G2;|mlat2in1@2|inB|I
-Egnd||D5G2;|mlat1in1@1|gnd|G
-Egnd_1||D5G2;|mlat2in1@2|gnd|G
-EclB[F]|rd[F]|D5G2;|mlat2in1@2|clB[F]|I
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-Evdd_1||D5G2;|mlat1in1@1|vdd_1|P
-Evdd_2||D5G2;|mlat2in1@2|vdd|P
-Evdd_3||D5G2;|mlat2in1@2|vdd_1|P
-X
-
-# Cell scanCellKh;1{sch}
-CscanCellKh;1{sch}||schematic|1194655242436|1224952683382|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-1|-19|||YRRR|
-NOff-Page|conn@1||16|-5||||
-NOff-Page|conn@2||-1|7.5|||YR|
-NOff-Page|conn@3||-20|-7|||Y|
-IlatchesK:mlat1in10;1{ic}|mlat1in1@1||-13|-7|||D5G4;
-IlatchesK:mlat2in10;1{ic}|mlat2in1@2||4|-5|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0.5|39.5|||||ART_message(D5G5;)SscanCellKh
-Ngeneric:Invisible-Pin|pin@1||1|34.5|||||ART_message(D5G3;)Sies 2 May 2008
-Ngeneric:Invisible-Pin|pin@2||1|28.5|||||ART_message(D5G3;)S["this is a \"horizontal\" read/write scan cell",for use with separate data registers]
-Ngeneric:Invisible-Pin|pin@3||2.5|14|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NWire_Pin|pin@5||-1|-3||||
-NBus_Pin|pin@12||4|4|-1|-1||
-NBus_Pin|pin@13||4|-14|-1|-1||
-NBus_Pin|pin@14||-13|-16|-1|-1||
-Ngeneric:Invisible-Pin|pin@15||1|20.5|||||ART_message(D5G3;)S[vertical and horizontal flavor,use different inputs to second latch]
-IscanCellKh;1{ic}|scanCell@1||24|7|||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-4|-7|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D271.1|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-Abus|clS[T,F]|D5G2;|-0.5|IJ2700|pin@13||4|-14|mlat2in1@2|clA[T,F]|4|-9
-Abus|cl[T,F]|D5G2;|-0.5|IJ2700|pin@14||-13|-16|mlat1in1@1|cl[T,F]|-13|-11
-Awire|net@12|||2700|pin@5||-1|-3|conn@2|y|-1|5.5
-Awire|net@57|||1800|conn@3|y|-18|-7|mlat1in1@1|in[1]|-15|-7
-Awire|net@58|||0|wire90@0|a|-6.5|-7|mlat1in1@1|out[1]|-11|-7
-Awire|net@69|||1800|wire90@0|b|-1.5|-7|mlat2in1@2|inA|2|-7
-Awire|net@70|||1800|pin@5||-1|-3|mlat2in1@2|inB|2|-3
-Awire|net@71|||0|conn@1|a|14|-5|mlat2in1@2|out[1]|6|-5
-Abus|rd[T,F]|D5G2;|-0.5|IJ2700|mlat2in1@2|clB[T,F]|4|-1|pin@12||4|4
-Ep2p[T,F],p1p[T,F],rd[T,F]|cl[T,F],clS[T,F],rd[T,F]|D4G2;|conn@0|a|I
-Edin[1]||D4G2;|conn@2|a|I
-Esin||D4G2;|conn@3|a|I
-Esout||D6G2;|conn@1|y|O
-X
-
-# Cell scanCellKv;1{ic}
-CscanCellKv;1{ic}||artwork|1194707157688|1209822298997|E
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-Nschematic:Bus_Pin|pin@2||0|-3|-1|-1||
-Nschematic:Bus_Pin|pin@4||-7|0|-1|-1||
-Nschematic:Bus_Pin|pin@6||7|0|-1|-1||
-NPin|pin@8||6|2|1|1||
-Ngeneric:Invisible-Pin|pin@11||4|0|||||ART_message(D5G2;)Sm10
-NPin|pin@12||1|2|1|1||
-NPin|pin@13||1|-2|1|1||
-NPin|pin@14||6|-2|1|1||
-NPin|pin@15||7|0|1|1||
-Nschematic:Bus_Pin|pin@16||0|-2|-1|-1||
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-X
-
-# Cell scanCellKv;2{lay}
-CscanCellKv;2{lay}||cmos90|1209767697205|1212099630456||ATTR_NCC(D5G3;NTY70;)S["exportsConnectedByParent vdd /vdd_[0-9]+/"]|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1213323188407
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NX-Metal-1-Metal-2-Con|contact@2||8|-10||||
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-IlatchesK:mlat2in10sc;2{lay}|mlat2in1@1||23|0|X||D5G4;
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-Ametal-1|net@40|||S900|contact@2||8|-10|pin@12||8|-25
-Ametal-1|net@41|||S0|pin@12||8|-25|mlat2in1@1|inB|6|-25
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-Ecl[T]||D5G2;|mlat1in1@1|cl[T]|I
-EinA|din[1]|D5G2;|mlat2in1@1|inA|I
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-Egnd_2||D5G2;|mlat2in1@1|gnd_1|G
-EclA[F]|rd[F]|D5G2;|mlat2in1@1|clA[F]|I
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-Eout[1]|sout|D5G2;|mlat2in1@1|out[1]|O
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-Evdd_1||D5G2;|mlat1in1@1|vdd_1|P
-Evdd_4||D5G2;|mlat2in1@1|vdd_2|P
-Evdd_5||D5G2;|mlat2in1@1|vdd_3|P
-X
-
-# Cell scanCellKv;1{sch}
-CscanCellKv;1{sch}||schematic|1194655242436|1221430809659|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@1||16|-5||||
-NOff-Page|conn@2||-1|7.5|||YR|
-NOff-Page|conn@3||-20|-7|||Y|
-IlatchesK:mlat1in10;1{ic}|mlat1in1@1||-12|-7|||D5G4;
-IlatchesK:mlat2in10;1{ic}|mlat2in1@3||4|-5|Y||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0.5|41.5|||||ART_message(D5G5;)SscanCellKv
-Ngeneric:Invisible-Pin|pin@1||1|36.5|||||ART_message(D5G3;)Sies 2 May 2008
-Ngeneric:Invisible-Pin|pin@2||1|30.5|||||ART_message(D5G3;)S["this is a \"vertical\" read/write scan cell",for use with separate data registers]
-Ngeneric:Invisible-Pin|pin@3||2.5|14|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NWire_Pin|pin@5||-1|-3||||
-NBus_Pin|pin@12||4|4|-1|-1||
-NBus_Pin|pin@13||4|-14|-1|-1||
-NBus_Pin|pin@14||-12|-16|-1|-1||
-Ngeneric:Invisible-Pin|pin@15||-1|20.5|||||ART_message(D5G3;)S[vertical and horizontal flavor,use different inputs to second latch]
-IscanCellKv;1{ic}|scanCell@0||24|7|||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-4|-7|||D0G4;|ATTR_L(D5G1;PUD)D303.40000000000003|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-Abus|clS[T,F]|D5G2;|-0.5|I2700|pin@13||4|-14|mlat2in1@3|clB[T,F]|4|-9
-Abus|cl[T,F]|D5G2;|-0.5|IJ2700|pin@14||-12|-16|mlat1in1@1|cl[T,F]|-12|-11
-Awire|net@12|||2700|pin@5||-1|-3|conn@2|y|-1|5.5
-Awire|net@47|||1800|conn@3|y|-18|-7|mlat1in1@1|in[1]|-14|-7
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-Awire|net@72|||1800|wire90@0|b|-1.5|-7|mlat2in1@3|inB|2|-7
-Awire|net@73|||1800|pin@5||-1|-3|mlat2in1@3|inA|2|-3
-Awire|net@74|||0|conn@1|a|14|-5|mlat2in1@3|out[1]|6|-5
-Abus|rd[T,F]|D5G2;|-0.5|J2700|mlat2in1@3|clA[T,F]|4|-1|pin@12||4|4
-Ep2p[T,F],p1p[T,F],rd[T,F]|cl[T,F],clS[T,F],rd[T,F]|D4G2;|conn@0|a|I
-EdIn[1]|din[1]|D4G2;|conn@2|a|I
-Esin||D4G2;|conn@3|a|I
-Esout||D6G2;|conn@1|y|O
-X
-
-# Cell scanEx1vertFdn;1{ic}
-CscanEx1vertFdn;1{ic}||artwork|1194708659731|1226335637791|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
-Nschematic:Bus_Pin|pin@0||-5|-2|-1|-1||
-Nschematic:Bus_Pin|pin@4||0|-2|-1|-1||
-Nschematic:Bus_Pin|pin@6||0|2|-1|-1||
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-Nschematic:Bus_Pin|pin@39||5|-1|-1|-1||
-Ngeneric:Invisible-Pin|pin@40||0|-1|||||ART_message(D5G2;)Sdown
-AThicker|net@16|||FS2700|pin@18||-3|-4|pin@25||-3|-2
-AThicker|net@17|||FS0|pin@25||-3|-2|pin@26||-5|-2
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-AThicker|net@30|||FS3334|pin@36||5|-1|pin@38||4|-0.5
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-AThicker|net@34|||FS2137|pin@19||-3|0|pin@15||0|2
-EdIn[1]||D5G2;|pin@0||I
-Emc||D5G2;|pin@39||O
-Esir[1:9]||D5G2;|pin@4||I
-Esor[1:9]||D5G2;|pin@6||O
-X
-
-# Cell scanEx1vertFdn;1{lay}
-CscanEx1vertFdn;1{lay}||cmos90|1194706959936|1226335897625||ATTR_NCC(D5G3;NTY65;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]|DRC_last_good_drc_area_date()G1226002623395|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1226347799796
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NX-Metal-1-Metal-2-Con|contact@0||-58.5|10||||
-NX-Metal-1-Metal-2-Con|contact@6||66|-10||||
-NMetal-1-Polysilicon-Con|contact@8||28|62||5.2||
-NX-Metal-1-Metal-2-Con|contact@9||28|60||||
-NX-Metal-2-Metal-3-Con|contact@10||0|60||||
-NX-Metal-1-Metal-2-Con|contact@15||-43|28||||
-NX-Metal-2-Metal-3-Con|contact@16||-18|28||||
-NX-Metal-2-Metal-3-Con|contact@17||-12|34||||
-NX-Metal-1-Metal-2-Con|contact@18||4|34||||
-NX-Metal-2-Metal-3-Con|contact@19||18|-10||||
-NX-Metal-2-Metal-3-Con|contact@20||18|10||||
-NMetal-3-Pin|pin@20||24|-25||||
-IscanBusInM3;1{lay}|scanBusI@2||0|-72|||D5G4;
-IscanBusOutM3;1{lay}|scanBusO@2||0|72|||D5G4;
-IscanJ:scanCellE;1{lay}|scanCell@0||0|0|||D5G4;
-Ametal-3|net@4|||S900|contact@16||-18|28|scanBusI@2|si[2]|-18|-72
-Ametal-3|net@5|||S900|contact@17||-12|34|scanBusI@2|si[3]|-12|-72
-Ametal-3|net@6|||S900|scanBusO@2|so[4]|-6|75|scanBusI@2|si[4]|-6|-69
-Ametal-3|net@7|||S900|contact@10||0|60|scanBusI@2|si[5]|0|-72
-Ametal-3|net@8|||S900|scanBusO@2|so[6]|6|72|scanBusI@2|si[6]|6|-72
-Ametal-3|net@9|||S900|scanBusO@2|so[7]|12|72|scanBusI@2|si[7]|12|-72
-Ametal-1|net@13|||S2700|scanCell@0|inA[1]|-58.5|-7|contact@0||-58.5|10
-Ametal-1|net@28|||S2700|scanCell@0|out[2]|66|-10.4|contact@6||66|-10
-Ametal-1|net@36|||S0|contact@8||28|60|contact@9||28|60
-Ametal-3|net@37|||S900|scanBusO@2|so[5]|0|72|contact@10||0|60
-Ametal-2|net@38|||S1800|contact@10||0|60|contact@9||28|60
-Ametal-1|net@53|||S2700|scanCell@0|p2p|-43|25|contact@15||-43|28
-Ametal-2|net@55|||S1800|contact@15||-43|28|contact@16||-18|28
-Ametal-2|net@58|||S1800|contact@17||-12|34|contact@18||4|34
-Ametal-1|net@59|||S2700|scanCell@0|p2p_1|4|31|contact@18||4|34
-Ametal-3|net@60|||S900|pin@20||24|-25|scanBusI@2|si[9]|24|-72
-Ametal-3|net@71|||S900|scanBusO@2|so[3]|-12|72|contact@17||-12|34
-Ametal-3|net@72|||S900|scanBusO@2|so[2]|-18|72|contact@16||-18|28
-APolysilicon|net@75|||S2700|scanCell@0|hcl[B]|28|58.5|contact@8||28|59.4
-Ametal-3|net@76|||S900|scanBusO@2|so[9]|24|72|pin@20||24|-25
-Ametal-3|net@97|||S2700|scanBusI@2|si[8]|18|-72|contact@19||18|-10
-Ametal-3|net@100|||S900|scanBusO@2|so[8]|18|72|contact@20||18|10
-Ametal-2|net@101|||S1800|contact@0||-58.5|10|contact@20||18|10
-Ametal-2|net@102|||S0|contact@6||66|-10|contact@19||18|-10
-Ametal-3|net@103|||S900|scanBusO@2|so[1]|-24|72|scanBusI@2|si[1]|-24|-72
-EdIn[1]||D5G2;|scanCell@0|inB[1]|I
-Egnd||D5G2;|scanCell@0|gnd|G
-Egnd_1||D5G2;|scanCell@0|gnd_1|G
-Emc||D5G2;|pin@20||O
-Esi[1]|sir[1]|D5G2;|scanBusI@2|si[1]|B
-Esir[2]||D5G2;|scanBusI@2|si[2]|B
-Esir[3]||D5G2;|scanBusI@2|si[3]|B
-Esir[4]||D5G2;|scanBusI@2|si[4]|B
-Esir[5]||D5G2;|scanBusI@2|si[5]|B
-Esir[6]||D5G2;|scanBusI@2|si[6]|B
-Esir[7]||D5G2;|scanBusI@2|si[7]|B
-Esi[8]|sir[8]|D5G2;|scanBusI@2|si[8]|B
-Esir[9]||D5G2;|scanBusI@2|si[9]|B
-Eso[1]|sor[1]|D5G2;|scanBusO@2|so[1]|B
-Esor[2]||D5G2;|scanBusO@2|so[2]|B
-Esor[3]||D5G2;|scanBusO@2|so[3]|B
-Esor[4]||D5G2;|scanBusO@2|so[4]|B
-Esor[5]||D5G2;|scanBusO@2|so[5]|B
-Esor[6]||D5G2;|scanBusO@2|so[6]|B
-Esor[7]||D5G2;|scanBusO@2|so[7]|B
-Eso[8]|sor[8]|D5G2;|scanBusO@2|so[8]|B
-Esor[9]||D5G2;|scanBusO@2|so[9]|B
-Evdd||D5G2;|scanCell@0|vdd|P
-Evdd_1||D5G2;|scanCell@0|vdd_1|P
-Evdd_2||D5G2;|scanCell@0|vdd_2|P
-Evdd_3||D5G2;|scanCell@0|vdd_3|P
-X
-
-# Cell scanEx1vertFdn;1{sch}
-CscanEx1vertFdn;1{sch}||schematic|1194655242436|1226335607976|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@0||-34|-11|||YRRR|
-NOff-Page|conn@2||0|7.5|||YR|
-NOff-Page|conn@5||-34|10|||R|
-NWire_Con|conn@6||-34|0||||
-NOff-Page|conn@7||-26|9|||R|
-Ngeneric:Invisible-Pin|pin@0||0.5|38.5|||||ART_message(D5G5;)SscanEx1vertFdn
-Ngeneric:Invisible-Pin|pin@1||1|34.5|||||ART_message(D5G3;)Sies 10 November 2007
-Ngeneric:Invisible-Pin|pin@2||1|23.5|||||ART_message(D5G3;)Sone scan cell for read
-Ngeneric:Invisible-Pin|pin@3||2.5|18|||||ART_message(D5G3;)Ss[1:9] = sin,phi2,phi1,wr, rd, phi1_return, phi2_return, sin_return, mc
-NBus_Pin|pin@9||0|-9|-1|-1||
-NWire_Pin|pin@10||-13|0||||
-NWire_Pin|pin@11||-13|-7||||
-NWire_Pin|pin@12||12|0||||
-NWire_Pin|pin@13||12|6||||
-NBus_Pin|pin@14||-34|-5|-1|-1||
-NBus_Pin|pin@15||-34|5|-1|-1||
-NWire_Pin|pin@16||-26|2||||
-Ngeneric:Invisible-Pin|pin@17||1|29.5|||||ART_message(D5G3;)S[up and down versions,10 November 2008]
-Ngeneric:Invisible-Pin|pin@18||8|-12.5|||||ART_message(D5G3;)Sscan is in the downward path
-IscanJ:scanCellE;1{ic}|scanCell@1||0|0|||D5G4;
-IscanEx1vertFdn;1{ic}|scanEx1v@0||27|6|||D5G4;
-Awire|net@32|||900|conn@2|y|0|5.5|scanCell@1|dIn[1]|0|3
-Awire|net@42|||0|scanCell@1|sin|-7|0|pin@10||-13|0
-Awire|net@54|||0|pin@12||12|0|scanCell@1|sout|7|0
-Abus|sir[1:7,9]|D5G2;|-0.5|IJ900|conn@6||-34|0|pin@14||-34|-5
-Abus|sir[2,3,5]|D5G2;|-0.5|IJ900|scanCell@1|p2p,p1p,rd|0|-3|pin@9||0|-9
-Awire|sir[8]|D5G2;||2700|pin@12||12|0|pin@13||12|6
-Awire|sir[9]|D5G2;||900|conn@7|a|-26|7|pin@16||-26|2
-Abus|sor[1:7,9]|D5G2;|-0.5|IJ2700|conn@6||-34|0|pin@15||-34|5
-Awire|sor[8]|D5G2;||900|pin@10||-13|0|pin@11||-13|-7
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-
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-X
-
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-X
-
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-X
-
-# Cell proposeZero;4{sch}
-CproposeZero;4{sch}||schematic|1222613482853|1227290876856|I
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-NOff-Page|conn@10||-10|18|||Y|
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-IlatchesK:latchZ10;1{ic}|latchZ10@1||10|0|||D5G4;
-IredFour:nor2n_sy;1{ic}|nor2n_sy@0||0|12|YR||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)S5|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||-0.5|29|||||ART_message(D5G4;)Sthe OLC not-zero flag
-Ngeneric:Invisible-Pin|pin@1||-0.5|25|||||ART_message(D5G3;)Sies 10 October 2008
-Ngeneric:Invisible-Pin|pin@2||-0.5|34|||||ART_message(D5G6;)SproposeZero
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-NWire_Pin|pin@10||0|7||||
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-NWire_Pin|pin@12||-1|18||||
-NWire_Pin|pin@13||22|7||||
-NWire_Pin|pin@14||12|7||||
-Ngeneric:Invisible-Pin|pin@15||-39.5|17|||||ART_message(D3G2;)S[The carry logic,in the OLC is,independent of m2.,"Does do[7] need to",be held stable,"during olc[dec]?",I think it's slow,enough so NO.]
-NWire_Pin|pin@17||18|18||||
-NWire_Pin|pin@18||18|15||||
-Ngeneric:Invisible-Pin|pin@31||-32.5|-2|||||ART_message(D3G2;)S["During olc[load],","inLO[7] gives an initial","value to flag[NZ].","Make inLO[7] HI if",input value is ZERO.]
-NWire_Pin|pin@32||43|-6||||
-NWire_Pin|pin@33||43|-10||||
-NWire_Pin|pin@34||25|-6|||X|
-NWire_Pin|pin@35||25|-10|||X|
-Ngeneric:Invisible-Pin|pin@36||31.5|7|||||ART_message(D3G2;)S["The flag[NZ] goes LO",when OLC = 0.,"So does olcNZ, but",with more delay.]
-IproposeZero;2{ic}|proposeZ@1||30|33|||D5G4;
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-IorangeTSMC090nm:wire90;1{ic}|wire90@1||3.5|7|||D0G4;|ATTR_L(D5G1;PUD)D216.3|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
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-Awire|net@2|||0|conn@5|a|16|2|latchZ10@1|out[T]|12|2
-Awire|net@3|||0|conn@6|a|16|-2|latchZ10@1|out[TT]|13|-2
-Awire|net@12|||900|nor2n_sy@0|out|0|9.5|pin@10||0|7
-Awire|net@14|||900|pin@11||8|7|latchZ10@1|c[2]|8|5
-Awire|net@17|||900|pin@12||-1|18|nor2n_sy@0|inb|-1|14.5
-Awire|net@19|||900|pin@8||1|18|nor2n_sy@0|ina|1|14.5
-Awire|net@20|||1800|pin@14||12|7|pin@13||22|7
-Awire|net@21|||2700|pin@13||22|7|conn@8|y|22|9
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-Awire|net@25|||1800|pin@8||1|18|pin@17||18|18
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-X
-
-# Cell skipAll;2{ic}
-CskipAll;2{ic}||artwork|1222616071020|1227290876856|EI
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-X
-
-# Cell skipAll;10{lay}
-CskipAll;10{lay}||cmos90|1222263471555|1227344413454||ATTR_NCC(D5G3;NTX36.75;Y350.25;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]|DRC_last_good_drc_area_date()G1227286039579|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1227344893107
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-X
-
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-IredFour:nor2n;1{ic}|nor2n@1||0|6|Y||D0G4;|ATTR_Delay(D5G1;NPX3;Y-3;)I100|ATTR_X(D5G1.5;NPX2.25;Y2.25;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-Ngeneric:Invisible-Pin|pin@0||-2|30.5|||||ART_message(D5G5;)Stwin2nor
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-X

diff --git a/electric/stageGroupsJ.jelib b/electric/stageGroupsJ.jelib
deleted file mode 100755 (executable)
index 1d3407d..0000000
--- a/electric/stageGroupsJ.jelib
+++ /dev/null
@@ -1,2153 +0,0 @@
-# header information:
-HstageGroupsJ|8.08j
-
-# Views:
-Vicon|ic
-Vschematic|sch
-
-# External Libraries:
-
-LstagesJ|stagesJ
-
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-
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell crosser;1{ic}
-Ccrosser;1{ic}||artwork|1182226366952|1197070356525|EI
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-Eso[1:9]|sod[1:9]|D5G2;|pin@75||U
-Erscnt[1:9]|sor[1:9]|D5G2;|pin@73||U
-X
-
-# Cell crosser;1{sch}
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-Ngeneric:Invisible-Pin|pin@0||-7.5|55|||||ART_message(D5FLeave alone;G5;)Scrosser
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-Ngeneric:Invisible-Pin|pin@192||-23.5|24|||X||ART_message(D5FLeave alone;G3;)S[booster,goes here?]
-Ngeneric:Invisible-Pin|pin@193||-7.5|46|||X||ART_message(D5FLeave alone;G3;)Srevised ies 7 December 2007
-NWire_Pin|pin@194||0|6||||
-NWire_Pin|pin@195||-13|2||||
-NWire_Pin|pin@196||-13|5||||
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-IproperStopper;1{ic}|ps[2]|D5G3;Y-14;|60|15|Y||D5G4;
-IrotateLObits;1{ic}|rot[1]|D5G3;Y-13;|-54|3|||D5G4;
-IrotateHIbits;1{ic}|rot[2]|D5G3;Y-12;|48|15|Y||D5G4;
-Awire|addrA[1]|D5G2;||900|pin@150||-6|0|pin@151||-6|-2
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-X
-
-# Cell rotateLObits;1{sch}
-CrotateLObits;1{sch}||schematic|1182204033246|1197071223964|
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-NBus_Pin|pin@20||6|-4|-1|-1||
-Ngeneric:Invisible-Pin|pin@21||2.5|29|||X||ART_message(D5FLeave alone;G3;)Sies 30 July 2007
-Ngeneric:Invisible-Pin|pin@22||-20|22|||||ART_message(D6FLeave alone;G2;)S["rotateLObits moves bits (1->2, 2->3,7->1)",and leaves bits 8:14 alone.,"rotateHI bits moves (14->13, 13->12,8->14)",and leaves bits 1:7 alone.]
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-X
-
-# Cell rotater;1{ic}
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-X
-
-# Cell rotater;1{sch}
-Crotater;1{sch}||schematic|1182204033246|1197071239070|
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-NOff-Page|conn@2||-30|-7|||Y|
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-NOff-Page|conn@7||30|9||||
-NOff-Page|conn@8||-30|6|||Y|
-NOff-Page|conn@9||30|6||||
-Ngeneric:Invisible-Pin|pin@0||0|27|||||ART_message(D5FLeave alone;G5;)Srotater
-Ngeneric:Invisible-Pin|pin@1||5.5|21|||X||ART_message(D5FLeave alone;G3;)Sies 18 June 2007
-Ngeneric:Invisible-Pin|pin@2||6|17|||||ART_message(D5FLeave alone;G2;)SA pair to rotate the address bits
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-Epred||D4G2;|conn@4|a|I
-EcscanIn[1:9]|sic[1:9]|D4G2;|conn@6|a|I
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-ErscanOut[1:9]|sor[1:9]|D6G2;|conn@9|y|O
-Esucc||D6G2;|conn@5|y|O
-X

diff --git a/electric/stageGroupsL.jelib b/electric/stageGroupsL.jelib
deleted file mode 100755 (executable)
index 2508799..0000000
--- a/electric/stageGroupsL.jelib
+++ /dev/null
@@ -1,8400 +0,0 @@
-# header information:
-HstageGroupsL|8.08j
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
-LcountersL|countersL
-
-LorangeTSMC090nm|orangeTSMC090nm
-
-LregistersL|registersL
-
-LscanJ|scanJ
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-LscanK|scanK
-
-LstagesL|stagesL
-
-LwiresL|wiresL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell coverFDC234;1{lay}
-CcoverFDC234;1{lay}||cmos90|1226315863693|1226316418041|
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-X
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-X

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deleted file mode 100755 (executable)
index d1119fb..0000000
--- a/electric/stagesJ.jelib
+++ /dev/null
@@ -1,3010 +0,0 @@
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
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-X
-
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-X
-
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-X
-
-# Cell crossStage;2{lay}
-CcrossStage;2{lay}||cmos90|1195253343016|1225117932189||ATTR_NCC(D5G3;NTY140;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]
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-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
-
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-X
-
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-X
-
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-
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-X
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-X
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-X
-
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-
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-X

diff --git a/electric/stagesL.jelib b/electric/stagesL.jelib
deleted file mode 100755 (executable)
index 3352058..0000000
--- a/electric/stagesL.jelib
+++ /dev/null
@@ -1,3812 +0,0 @@
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-HstagesL|8.08j
-
-# Views:
-Vicon|ic
-Vlayout|lay
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-
-# External Libraries:
-
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-
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-X
-
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-Ngeneric:Invisible-Pin|pin@1||-0.5|29.5|||||ART_message(D5G3;)Sies 7 December 2007
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-X

diff --git a/electric/stepsL.jelib b/electric/stepsL.jelib
deleted file mode 100755 (executable)
index 81cbc8b..0000000
--- a/electric/stepsL.jelib
+++ /dev/null
@@ -1,12 +0,0 @@
-# header information:
-HstepsL|8.08j
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
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-
-# Technologies:
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-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0

diff --git a/electric/stepsM.jelib b/electric/stepsM.jelib
deleted file mode 100755 (executable)
index 6dd28de..0000000
--- a/electric/stepsM.jelib
+++ /dev/null
@@ -1,7717 +0,0 @@
-# header information:
-HstepsM|8.08n
-
-# Views:
-Vicon|ic
-Vlayout|lay
-Vschematic|sch
-
-# External Libraries:
-
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-
-LfanPinsK|fanPinsK
-
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-
-LregistersL|registersL
-
-LscanJ|scanJ
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-LwiresL|wiresL
-
-# Tools:
-Ouser|DefaultTechnology()Sartwork|SchematicTechnology()Scmos90
-Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
-
-# Technologies:
-Tcmos|ScaleFORcmos()D1000.0
-Tcmos90|"GDS(ST)LayerForPad-FrameINcmos90"()S43|"GDS(ST)LayerForPassivationINcmos90"()S169|"GDS(TSMC)LayerForPad-FrameINcmos90"()S43|"GDS(TSMC)LayerForPassivationINcmos90"()S169
-Tmocmos|ScaleFORmocmos()D100.0|SelectedFoundryFormocmos()STSMC
-Trcmos|ScaleFORrcmos()D1000.0
-
-# Cell altEndStep;1{ic}
-CaltEndStep;1{ic}||artwork|1227458681883|1227533374526|E
-Ngeneric:Facet-Center|art@0||0|0||||AV
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-X
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-
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-
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-X
-
-# Cell epiStep;1{lay}
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-Egnd_2|gnd|D5G2;|short20B@1|gnd_2|G
-Egnd_2@677362830|gnd_2|D5G2;|anEpiSta@0|gnd_2|G
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-Emc_1||D5G2;|pin@0||I
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-Epred||D5G2;|anEpiSta@0|pred|I
-Esir[1]||D5G2;|scanEx1v@1|sir[1]|I
-Esir[2]||D5G2;|scanEx1v@1|sir[2]|B
-Esir[3]||D5G2;|scanEx1v@1|sir[3]|B
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-Esor[2]||D5G2;|scanEx1v@1|sor[2]|B
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-Esor[8]||D5G2;|scanEx1v@1|sor[8]|B
-Esor[9]||D5G2;|scanEx1v@1|sor[9]|B
-Esucc||D5G2;|anEpiSta@0|succA|O
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-Evdd_5|vdd|D5G2;|short20B@1|vdd_5|P
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-X
-
-# Cell epiStep;1{sch}
-CepiStep;1{sch}||schematic|1227471858866|1227528580512|
-IgaspL:anEpiStart;1{ic}|anEpiSta@0||0|0|||D5G4;
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NOff-Page|conn@2||-12|0|||XRR|
-NOff-Page|conn@3||10|0|||Y|
-NOff-Page|conn@4||10|-4|||Y|
-NOff-Page|conn@5||-26.5|-21||||
-NOff-Page|conn@6||13|-35||||
-NOff-Page|conn@7||-3|12|||XRRR|
-NOff-Page|conn@9||21|2|||YRRR|
-NOff-Page|conn@10||21|20|||R|
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-IdriversJ:latchDriver60;1{ic}|latchDri@0||-13|-18.5|RRR||D5G4;
-Ngeneric:Invisible-Pin|pin@0||1|37|||||ART_message(D5G4;)Sthe epilog stage
-Ngeneric:Invisible-Pin|pin@1||1|44.5|||||ART_message(D5G6;)SepiStep
-Ngeneric:Invisible-Pin|pin@2||0.5|30|||||ART_message(D5G3;)Sies 23 November 2008
-NWire_Pin|pin@3||-13|-8||||
-NWire_Pin|pin@4||0|-8||||
-NWire_Pin|pin@5||-20|-2||||
-NWire_Pin|pin@6||-20|-6||||
-NWire_Pin|pin@7||5|-4||||
-NWire_Pin|pin@8||5|-2||||
-NWire_Pin|pin@9||-13|-28||||
-NWire_Pin|pin@10||-1|-28||||
-NWire_Pin|pin@11||-3|7||||
-NWire_Pin|pin@12||-1|7||||
-Ngeneric:Invisible-Pin|pin@13||-41.5|1|||||ART_message(D3G2;)S["in[T] is the token",bit for the instruction,input.]
-NBus_Pin|pin@14||-8.5|-35|-1|-1||
-NBus_Pin|pin@15||-8.5|-39.5|-1|-1||
-Ngeneric:Invisible-Pin|pin@16||-46|-10.5|||||ART_message(D3G2;)S[There are 37+T bits,in the switch fabric,but only 36 in the,internal instruction ring.]
-Ngeneric:Invisible-Pin|pin@17||-46|-25.5|||||ART_message(D3G2;)S[For the marina test chip only,we'll omit bit 19 from the,external instruction ring.,This will shift the top 18 bits,"left one position, i.e.","ext[1:37,T] =","int[1:18,x,19:36,T].",For example:,"ext[20] becomes int[19]","ext[37] becomes int[36]."]
-NWire_Pin|pin@18||1|10||||
-IscanJ:scanEx1vertA;1{ic}|scanEx1v@0||21|12|||D5G4;
-IregistersL:short20Bx36;1{ic}|short20B@0||1|-35|Y||D5G4;
-IorangeTSMC090nm:wire90;1{ic}|wire90@0||-7.5|-8|||D0G4;|ATTR_L(D5G1;PUD)D372.7999999999999|ATTR_LEWIRE(P)I1|ATTR_layer(D5G1;NPY-1;)I1|ATTR_width(D5G1;NPY-2;)I3
-IorangeTSMC090nm:wire90;1{ic}|wire90@1||-7|-28|||D0G4;|ATTR_L(D5FLeave alone;G1;PUD)D3704.0508729916814|ATTR_LEWIRE(P)I1|ATTR_layer(D5FLeave alone;G1;NPY-1;)I1|ATTR_width(D5FLeave alone;G1;NPY-2;)I3
-Abus|in[1:36]|D5G2;|-0.5|IJ900|pin@14||-8.5|-35|pin@15||-8.5|-39.5
-Awire|in[T]|D5G2;||900|pin@5||-20|-2|pin@6||-20|-6
-Awire|net@0|||2700|latchDri@0|inA|-13|-14.5|pin@3||-13|-8
-Awire|net@1|||1800|pin@3||-13|-8|wire90@0|a|-10|-8
-Awire|net@2|||0|conn@4|a|8|-4|pin@7||5|-4
-Awire|net@3|||2700|pin@7||5|-4|pin@8||5|-2
-Awire|net@4|||1800|anEpiSta@0|succ_1|3|-2|pin@8||5|-2
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-Awire|net@8|||1800|conn@2|y|-10|0|anEpiSta@0|pred|-3|0
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-Awire|net@16|||900|pin@10||-1|-28|short20B@0|hcl[1]|-1|-32
-Abus|net@18||-0.5|IJ1800|short20B@0|out[1:36]|4|-35|conn@6|a|11|-35
-Awire|net@20|||900|conn@7|y|-3|10|pin@11||-3|7
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-X
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-X
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-
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-
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-X

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deleted file mode 100755 (executable)
index b1bd4df..0000000
--- a/electric/testsL.jelib
+++ /dev/null
@@ -1,2866 +0,0 @@
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-
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-X
-
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-X
-
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-
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-X
-
-# Cell skipTestOLC;1{sch}
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-IredFour:inv;1{ic}|invx[1:18]|D5G3;Y-3;|-9|-55|XRR||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
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-NWire_Pin|pin@150||25|-10||||
-Ngeneric:Invisible-Pin|pin@151||-48|-29.5|||||ART_message(D3G2;)S[bit 22 LO loads flags,bit 23 LO loads OLC,bit 24 LO counts OLC,bit 25 LO selects Dm,bit 26 LO selects Dl,bit 27 LO loads ILC,bit 17 HI is take D register,bit 20 HI is OK to interrupt,bit 30 HI selects Rq]
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-NWire_Pin|pin@179||-18|-24||||
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-NBus_Pin|pin@181||4|-60|-1|-1||
-NWire_Pin|pin@184||-18|-2||||
-NWire_Pin|pin@187||39|-42||||
-NWire_Pin|pin@188||23|-14||||
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-IgaspL:sinkCslow;1{ic}|sinkCslo@2||70.5|-31|||D5G4;
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-IgaspL:sourceA;1{ic}|sourceA@0||-67.5|0|||D5G4;
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-NBus_Pin|pin@42||-15|-12|-1|-1||
-NBus_Pin|pin@43||-15|-9|-1|-1||
-NBus_Pin|pin@44||-21|-18|-1|-1||
-NWire_Pin|pin@47||-44|12||||
-NWire_Pin|pin@59||-13|-2||||
-NWire_Pin|pin@60||-3|2||||
-NWire_Pin|pin@61||-3|7||||
-NWire_Pin|pin@62||2|11||||
-NPower|pwr@1||18|-10||||
-Awire|ilc[cnt]|D5G2;||900|pin@11||-13|12|pin@59||-13|-2
-Awire|ilc[done]|D5G2;||2700|pin@60||-3|2|pin@61||-3|7
-Awire|ilc[load]|D5G2;||900|pin@20||23|4|pin@21||23|-2
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-Awire|mc|D5G2;||2700|ilcZoo@0|mc|2|4|pin@62||2|11
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-Abus|net@50||-0.5|IJ0|pin@32||3|-18|pin@33||-3|-18
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-Awire|net@123|||1800|pin@59||-13|-2|ilcZoo@0|ilc[cnt]|0|-2
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-Abus|sel[T,F]|D5G2;|-0.5|IJ900|pin@33||-3|-18|pin@34||-3|-22
-Awire|sel[T]|D5G2;||900|conn@0||18|-14|pin@35||18|-19
-X
-
-# Cell testMove;1{sch}
-CtestMove;1{sch}||schematic|1217074352563|1225225569761|
-Ispiceparts:Pulse;1{ic}|Pulse@0||-25|4.5|||D5G4;|ATTR_DelayTime(D5G0.5;NPY0.5;)S80ps|ATTR_FallTime(D5G0.5;NPY-0.5;)S10ps|ATTR_InitialVoltage(D5G0.5;NPY1.5;)S1V|ATTR_Period(D5G0.5;NPY-1.5;)S400ms|ATTR_PulseVoltage(D5G0.5;NPY1;)S0V|ATTR_PulseWidth(D5G0.5;NPY-1;)S300ms|ATTR_RiseTime(D5G0.5;NP)S10ps
-IfifoL:aStageD;1{ic}|aStageD@0||5|0|||D5G4;
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NGround|gnd@0||-18|-1.5|||X|
-IscanK:noScan;1{ic}|noScan@0||-4|17|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0|25|||||ART_message(D5G3;)Sies 28 October 2008
-Ngeneric:Invisible-Pin|pin@1||-1|29|||||ART_message(D5G4;)Sfor test
-Ngeneric:Invisible-Pin|pin@2||1|34|||||ART_message(D5G6;)StestMove
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-NWire_Pin|pin@78||-12|15||||
-NWire_Pin|pin@80||-12|13||||
-NWire_Pin|pin@84||-11|-9||||
-NWire_Pin|pin@86||-5.5|-28||||
-NBus_Pin|pin@87||-1.5|-6|-1|-1||
-NWire_Pin|pin@89||11|-2||||
-NWire_Pin|pin@90||11|-21.5||||
-NWire_Pin|pin@91||29.5|2||||
-NWire_Pin|pin@92||29.5|6.5||||
-NBus_Pin|pin@93||14|-6|-1|-1||
-NBus_Pin|pin@94||14|-9.5|-1|-1||
-NBus_Pin|pin@95||5|17|-1|-1||
-IprogramsK:programB;2{ic}|programB@1||-3.5|-20.5|||D5G4;
-NPower|pwr@0||-2|5||||
-IgaspL:sourceA;1{ic}|sourceA@0||-11|0|||D5G4;
-IthreeStagesM;1{ic}|threeSta@2||21|0|||D5G4;
-Abus|cl[T,F],clS[T,F],rd[T,F],mc|D5G2;|-0.5|IJ2700|threeSta@2|cl[T,F],clS[T,F],rd[T,F],mc|21|7|pin@77||21|17
-Abus|dataA[1:36]|D5G2;|-0.5|IJ2700|programB@1|data[1:36]|-1.5|-17.5|pin@87||-1.5|-6
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-Awire|fireIn|D5G2;||2700|pin@84||-11|-9|sourceA@0|fire|-11|-4
-Awire|fire[0]|D5G2;||900|pin@89||11|-2|pin@90||11|-21.5
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-Awire|mc|D5G2;||900|programB@1|mc|-5.5|-23.5|pin@86||-5.5|-28
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-Awire|net@143|||900|pin@80||-12|13|sourceA@0|mc|-12|4
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-Abus|net@154||-0.5|IJ0|aStageD@0|in[1:36]|1|-6|pin@87||-1.5|-6
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-Awire|net@156|||1800|aStageD@0|full|8|0|threeSta@2|pred|18|0
-Awire|net@157|||1800|aStageD@0|fire|8|-2|pin@89||11|-2
-Awire|net@158|||0|pin@90||11|-21.5|programB@1|shift|0.5|-21.5
-Awire|net@160|||1800|pwr@0||-2|5|aStageD@0|sin|4|5
-Awire|net@161|||1800|aStageD@0|sout|7|5|threeSta@2|sin|20|5
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-Abus|net@166||-0.5|IJ0|pin@95||5|17|noScan@0|cl[T,F],clS[T,F],rd[T,F]|0|17
-Abus|net@167||-0.5|IJ2700|aStageD@0|cl[T,F],clS[T,F],rd[T,F],mc|5|7|pin@95||5|17
-X
-
-# Cell testOuter;1{sch}
-CtestOuter;1{sch}||schematic|1214647589490|1223726220739|
-Ispiceparts:Pulse;1{ic}|Pulse@0||44|-9|X||D5G4;|ATTR_DelayTime(D5G0.5;NPY0.5;)S200ps|ATTR_FallTime(D5G0.5;NPY-0.5;)S10ps|ATTR_InitialVoltage(D5G0.5;NPY1.5;)S1V|ATTR_Period(D5G0.5;NPY-1.5;)S400ms|ATTR_PulseVoltage(D5G0.5;NPY1;)S0V|ATTR_PulseWidth(D5G0.5;NPY-1;)S300ms|ATTR_RiseTime(D5G0.5;NP)S10ps
-Ispiceparts:Pulse;1{ic}|Pulse@1||-31|10|X||D5G4;|ATTR_DelayTime(D5G0.5;NPY0.5;)S500ps|ATTR_FallTime(D5G0.5;NPY-0.5;)S10ps|ATTR_InitialVoltage(D5G0.5;NPY1.5;)S0V|ATTR_Period(D5G0.5;NPY-1.5;)S250ps|ATTR_PulseVoltage(D5G0.5;NPY1;)S1V|ATTR_PulseWidth(D5G0.5;NPY-1;)S115ps|ATTR_RiseTime(D5G0.5;NP)S10ps
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NWire_Con|conn@0||18|-20||||
-NWire_Con|conn@1||26|-23||||
-NWire_Con|conn@3||18|0||||
-NWire_Con|conn@4||-9|14||||
-IprogramsK:data0;1{ic}|data0@0||3|-12|||D5G4;
-IprogramsK:data7;2{ic}|data7@0||-9|-12|||D5G4;
-NGround|gnd@0||37|-15||||
-NGround|gnd@1||-38|3||||
-NGround|gnd@2||26|-28||||
-IredFour:inv;1{ic}|inv@7||32.5|5|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NPX1.5;Y2;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@9||24.5|5|X||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NPX1.5;Y2;)S20|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:inv;1{ic}|inv@10||-13.5|21|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_X(D5FLeave alone;G1.5;NPX1.5;Y2;)S20|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IredFour:nand2;1{ic}|nand2@0||-21.5|21|||D0G4;|ATTR_Delay(D5G1;NPX2.5;Y-3;)I100|ATTR_X(D5G1.5;NPX2.5;Y2.5;)S10|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
-IloopCountL:olc;3{ic}|olc@2||0|0|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||1|38|||||ART_message(D5G6;)StestOuter
-Ngeneric:Invisible-Pin|pin@2||1|33|||||ART_message(D5G4;)Stest the Outer Loop Counter
-NBus_Pin|pin@3||-3|-12|-1|-1||
-NBus_Pin|pin@4||-3|-9|-1|-1||
-NBus_Pin|pin@5||9|-12|-1|-1||
-NBus_Pin|pin@6||9|-9|-1|-1||
-NBus_Pin|pin@7||0|-8.5|-1|-1||
-NBus_Pin|pin@30||-9|-18|-1|-1||
-NBus_Pin|pin@32||3|-18|-1|-1||
-NBus_Pin|pin@33||-3|-18|-1|-1||
-NBus_Pin|pin@34||-3|-22|-1|-1||
-NWire_Pin|pin@35||18|-25||||
-NWire_Pin|pin@36||26|-18||||
-Ngeneric:Invisible-Pin|pin@57||-11|-23|||||ART_message(D3G2;)S[complement of,the starting count.]
-NWire_Pin|pin@61||18|5||||
-NWire_Pin|pin@62||37|5||||
-Ngeneric:Invisible-Pin|pin@64||24|14|||||ART_message(D3G2;)S[master clear loads,initial value.]
-NWire_Pin|pin@80||-38|22||||
-NWire_Pin|pin@104||-26|2||||
-Ngeneric:Invisible-Pin|pin@106||1|29|||||ART_message(D5G3;)Sies 8 October 2008
-NWire_Pin|pin@128||-26|20||||
-Ngeneric:Invisible-Pin|pin@130||-1|16|||||ART_message(D3G2;)S["doLO[7] goes LO",when the next,count will produce,zeros.]
-NBus_Pin|pin@131||-10|-2|-1|-1||
-NBus_Pin|pin@132||-10|-6|-1|-1||
-NBus_Pin|pin@135||18|-6|-1|-1||
-NWire_Pin|pin@138||-9|21||||
-NBus_Pin|pin@139||-9|8|-1|-1||
-NWire_Pin|pin@140||42|-11||||
-NPower|pwr@1||18|-16||||
-Awire|count|D5G2;||900|pin@138||-9|21|conn@4||-9|14
-Awire|doLO[7]|D5G2;||2700|pin@104||-26|2|pin@128||-26|20
-Abus|in[1:3]|D5G2;|-0.5|IJ2700|pin@5||9|-12|pin@6||9|-9
-Abus|in[1:6]|D5G2;|-0.5|I2700|pin@7||0|-8.5|olc@2|inLO[1:6]|0|-5
-Abus|in[4:6]|D5G2;|-0.5|IJ2700|pin@3||-3|-12|pin@4||-3|-9
-Awire|load|D5G2;||900|pin@61||18|5|conn@3||18|-0.5
-Awire|mc|D5G2;||900|pin@62||37|5|Pulse@0|plus|37|-6
-Abus|net@2||-0.5|IJ1800|data0@0|out[1:3]|5|-12|pin@5||9|-12
-Awire|net@13|||900|Pulse@0|minus|37|-12|gnd@0||37|-13
-Awire|net@24|||2700|gnd@1||-38|5|Pulse@1|minus|-38|7
-Abus|net@43||-0.5|IJ900|data7@0|sel[1][T,F]|-9|-15|pin@30||-9|-18
-Abus|net@44||-0.5|IJ1800|pin@30||-9|-18|pin@33||-3|-18
-Abus|net@46||-0.5|IJ2700|pin@32||3|-18|data0@0|sel[2][T,F]|3|-15
-Abus|net@49||-0.5|IJ0|pin@3||-3|-12|data7@0|out[1:3]|-7|-12
-Abus|net@50||-0.5|IJ0|pin@32||3|-18|pin@33||-3|-18
-Awire|net@52|||900|pwr@1||18|-16|conn@0||18|-20
-Awire|net@53|||2700|gnd@2||26|-26|conn@1||26|-23
-Awire|net@101|||1800|inv@7|in|35|5|pin@62||37|5
-Awire|net@128|||2700|Pulse@1|plus|-38|13|pin@80||-38|22
-Awire|net@222|||1800|pin@80||-38|22|nand2@0|inb|-24|22
-Awire|net@235|||1800|pin@104||-26|2|olc@2|do[7]|-6|2
-Awire|net@240|||1800|pin@128||-26|20|nand2@0|ina|-24|20
-Abus|net@244||-0.5|IJ0|olc@2|sloDecClk[F]|-6|-2|pin@131||-10|-2
-Awire|net@249|||0|inv@9|out|22|5|pin@61||18|5
-Awire|net@250|||1800|inv@9|in|27|5|inv@7|out|30|5
-Awire|net@260|||0|inv@10|in|-16|21|nand2@0|out|-19|21
-Awire|net@261|||1800|inv@10|out|-11|21|pin@138||-9|21
-Awire|net@262|||1350|Pulse@0|plus|37|-6|pin@140||42|-11
-Abus|olc[dec][1:2]|D5G2;|-0.5|IJ900|conn@4||-9|14|pin@139||-9|8
-Abus|olc[load,dec][1:2]|D5G2;|-0.5|IJ900|pin@131||-10|-2|pin@132||-10|-6
-Abus|olc[load][1:2]|D5G2;|-0.5|IJ900|conn@3||18|0|pin@135||18|-6
-Awire|sel[F]|D5G2;||2700|conn@1||26|-23|pin@36||26|-18
-Abus|sel[T,F]|D5G2;|-0.5|IJ900|pin@33||-3|-18|pin@34||-3|-22
-Awire|sel[T]|D5G2;||900|conn@0||18|-20|pin@35||18|-25
-X
-
-# Cell testRequeue;1{sch}
-CtestRequeue;1{sch}||schematic|1217074352563|1224549680140|
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NWire_Con|conn@1||48|30||||
-NWire_Con|conn@2||36|30||||
-NWire_Con|conn@3||66|30||||
-NWire_Con|conn@4||57|20||||
-NGround|gnd@1||-3|2.5|||X|
-NGround|gnd@5||48|22.5|||X|
-NGround|gnd@6||66|22.5|||X|
-IscanK:noScan;1{ic}|noScan@0||-3|12|||D5G4;
-Ngeneric:Invisible-Pin|pin@0||0|19|||||ART_message(D5G3;)Sies 13 September 2008
-Ngeneric:Invisible-Pin|pin@1||-1|23|||||ART_message(D5G4;)Sto test the state machine
-Ngeneric:Invisible-Pin|pin@2||1|28|||||ART_message(D5G6;)StestRequeue
-NBus_Pin|pin@16||53|-18|-1|-1||
-NBus_Pin|pin@17||53|-23.5|-1|-1||
-NWire_Pin|pin@42||59|-10||||
-NWire_Pin|pin@49||-18|8.5||||
-NWire_Pin|pin@50||52|1.5||||
-NWire_Pin|pin@84||-10|10||||
-NWire_Pin|pin@85||-10|5||||
-NBus_Pin|pin@95||-7|-11.5|-1|-1||
-NBus_Pin|pin@98||21|-19|-1|-1||
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-NBus_Pin|pin@100||21|-17|-1|-1||
-NBus_Pin|pin@101||21|-6|-1|-1||
-NWire_Pin|pin@104||-18|-14.5||||
-NWire_Pin|pin@106||30|-24||||
-NWire_Pin|pin@107||30|-14||||
-NWire_Pin|pin@108||30|0||||
-NWire_Pin|pin@109||30|-10||||
-NWire_Pin|pin@114||-17|-11||||
-NWire_Pin|pin@117||18|2||||
-NBus_Pin|pin@118||12|12|-1|-1||
-NBus_Pin|pin@120||12|-14|-1|-1||
-NBus_Pin|pin@121||3|-14|-1|-1||
-NBus_Pin|pin@122||3|12|-1|-1||
-NWire_Pin|pin@123||24|5||||
-NWire_Pin|pin@129||24|-10||||
-NWire_Pin|pin@130||6|-10||||
-NWire_Pin|pin@131||6|-19||||
-NWire_Pin|pin@134||19|-22||||
-NWire_Pin|pin@141||-3|5||||
-NWire_Pin|pin@143||-17|-35||||
-NWire_Pin|pin@144||18|8||||
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-NWire_Pin|pin@148||59|-3||||
-NBus_Pin|pin@150||-7|-6|-1|-1||
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-NBus_Pin|pin@152||-6|-35|-1|-1||
-NBus_Pin|pin@156||48|35|-1|-1||
-NWire_Pin|pin@159||36|25||||
-NWire_Pin|pin@160||36|35||||
-NBus_Pin|pin@161||66|35|-1|-1||
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-
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-X
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-X

diff --git a/electric/wiresL.jelib b/electric/wiresL.jelib
deleted file mode 100755 (executable)
index d6b9467..0000000
--- a/electric/wiresL.jelib
+++ /dev/null
@@ -1,815 +0,0 @@
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-Cstrap2hGND;1{lay}||cmos90|1180220510311|1217244298059|I|DRC_last_good_drc_area_date()G1217165155588|DRC_last_good_drc_bit()I10|DRC_last_good_drc_date()G1217244450120|FACET_characteristic_spacing()D[264.0,288.0]
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