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+Oio|GDSOutputConvertsBracketsInExports()BF|GDSWritesExportPins()BT
+OSTA|GlobalSDCCommands()S"\n### 4 GHz clock setup\ncreate_clock -period 0.250 -name clk -waveform \"0 0.125\" clk\nset_clock_uncertainty -setup 0.010 clk\nset_clock_uncertainty -hold 0.010 clk\nset_propagated_clock clk\nset_clock_transition -rise 0.030 clk\nset_clock_transition -fall 0.030 clk\n#set_driving_cell -lib_cell inv_X008_0 clk\n\n### remove scan path from timing\nset_false_path -through */so\nset_false_path -from {sin}\nset_false_path -from {scanEn}\nset_false_path -to {sout}\n"
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+Tmocmos|SelectedFoundryFormocmos()STSMC
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+# Cell buf;1{doc}
+Cbuf;1{doc}||artwork|1012171260000|1012171294000||FACET_message()S[This is the one parameter inverter.,Drawn by Ivan Sutherland 27 January 2002,""]
+X
+
+# Cell buf;1{ic}
+Cbuf;1{ic}||artwork|1021415734000|1252885438357|E|ATTR_Delay(D5G1;HNPX2;Y-2;)I100|ATTR_LEGATE(D5G1;HPT)I1|ATTR_LEPARALLGRP(D5G1;HPT)I-1|ATTR_X(D5G1.5;HNOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(D5G1;HPT)Sstrong0|ATTR_drive1(D5G1;HPT)Sstrong1|ATTR_su(D5G1;HPT)I-1|prototype_center()I[6000,0]
+Ngeneric:Facet-Center|art@0||0|0||||AV
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+NPin|pin@2||-1.5|0|1|1||
+NPin|pin@3||-2.5|0||||
+Nschematic:Bus_Pin|pin@4||1.5|0|-2|-2||
+NPin|pin@5||-1.5|2|1|1||
+NPin|pin@6||-1.5|-2|1|1||
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+AThicker|net@1|||FS337|pin@0||1.5|0|pin@6||-1.5|-2|ART_color()I78
+AThicker|net@2|||FS0|pin@2||-1.5|0|pin@3||-2.5|0|ART_color()I78
+AThicker|net@3|||FS2700|pin@6||-1.5|-2|pin@5||-1.5|2|ART_color()I78
+Ein||D5G1;|pin@1||I
+Eout||D5G1;|pin@4||O
+X
+
+# Cell buf;2{sch}
+Cbuf;2{sch}||schematic|1021415734000|1253487811856||ATTR_Delay(D5G1;HNPX-12;Y-5.5;)I100|ATTR_LEGATE(D5G1;HNPTX-12;Y-10.5;)I1|ATTR_LEPARALLGRP(D5G1;HNPTX-12;Y-6.5;)I-1|ATTR_X(D5G1;HNOJPX-12.5;Y-4.5;)SLE.getdrive()|ATTR_drive0(D5G1;HNPTX-12;Y-7.5;)Sstrong0|ATTR_drive1(D5G1;HNPTX-12;Y-8.5;)Sstrong1|ATTR_su(D5G1;HNPTX-12;Y-9.5;)I-1|prototype_center()I[0,0]
+Ngeneric:Facet-Center|art@0||0|0||||AV
+NOff-Page|conn@0||11|0||||
+NOff-Page|conn@1||-14|0||||
+Ibuf;1{ic}|inv@1||20|13.5|||D0G4;|ATTR_Delay(D5G1;NPX2;Y-2;)I100|ATTR_LEGATE(P)I1|ATTR_LEPARALLGRP(P)I-1|ATTR_X(D5G1.5;NOJPX1.5;Y2;)SLE.getdrive()|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1|ATTR_su(P)S""
+IredFive:inv;1{ic}|inv@2||-4.5|0|||D5G4;|ATTR_X(D5FLeave alone;G1.5;NOLPX1.5;Y3.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
+IredFive:invI;2{ic}|invI@0||2|0|||D5G4;|ATTR_X(D5FLeave alone;G1.5;NOLPX1.25;Y3.5;)S@X|ATTR_drive0(P)Sstrong0|ATTR_drive1(P)Sstrong1
+Ngeneric:Invisible-Pin|pin@1||11|-12|||||ART_message(D5G2;)S[X is drive strength,P and N drive strengths are equal]
+Ngeneric:Invisible-Pin|pin@2||-1.5|14.5|||||ART_message(D5G2;)S[a pair of inverters,"sized to have \"one gate delay\""]
+Ngeneric:Invisible-Pin|pin@3||-1.5|20|||||ART_message(D5G6;)Sbuf
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+X
+
+# Cell contactGallery;1{lay}
+CcontactGallery;1{lay}||tsmcSun40GP|1252818322426|1252875051985|
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+X
+
+# Cell core;1{ic}
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+NThick-Circle|art@21||-2.25|-4.25|6|6|500||ART_color()I-1174339839|ART_degrees()I800
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+NThick-Circle|art@25||0.25|2.5|5|5|||ART_color()I-1174339839|ART_degrees()F[0.0,3.1415927]
+NThick-Circle|art@26||2.5|-6.5|1|1|XR||ART_color()I-1174339839
+NThick-Circle|art@27||0.5|-6.5|1|1|XR||ART_color()I-1174339839
+NThick-Circle|art@28||2.5|-5|5|5.5|X||ART_color()I-1174339839|ART_degrees()F[0.0,3.1415927]
+NThick-Circle|art@29||4.5|-6.5|1|1|XR||ART_color()I-1174339839
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+Nschematic:Bus_Pin|pin@6||-3.25|-3||||
+Nschematic:Bus_Pin|pin@16||0.25|6|||R|
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+Nschematic:Bus_Pin|pin@86||0.5|5|-2|-2|R|
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+NPin|pin@105||-0.5|-0.75|1|1|R||ART_color()I-1174339839
+Nschematic:Bus_Pin|pin@108||0.75|0|-2|-2|R|
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+Nschematic:Bus_Pin|pin@122||0.5|-8|-2|-2|XR|
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+NPin|pin@124||0.5|-8|||XR||ART_color()I-1174339839
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+Nschematic:Bus_Pin|pin@126||2.5|-8|-2|-2|XR|
+NPin|pin@128||5|-6|1|1|XR||ART_color()I-1174339839
+NPin|pin@129||0|-6|1|1|XR||ART_color()I-1174339839
+NPin|pin@130||0|-4.75|1|1|XR||ART_color()I-1174339839
+Ngeneric:Invisible-Pin|pin@131||4|-5.5|||X||ART_message(D5G3;)S*
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+Nschematic:Wire_Pin|pin@134||4.5|-8|||X|
+NPin|pin@136||2.5|-8|||XR||ART_color()I-1174339839
+NPin|pin@137||2.5|-7|1|1|XR||ART_color()I-1174339839
+NPin|pin@138||4.5|-7|1|1|XR||ART_color()I-1174339839
+NPin|pin@139||4.5|-8|||XR||ART_color()I-1174339839
+AThicker|net@36|||FS900|pin@91||-3.25|-1.5|pin@92||-3.25|-8|ART_color()I-1174339839
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+AThicker|net@52|||FS900|pin@123||0.5|-7|pin@124||0.5|-8|ART_color()I-1174339839
+AThicker|net@53|||FS900|pin@125||5|-4.75|pin@128||5|-6|ART_color()I-1174339839
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+AThicker|net@57|||FS900|pin@138||4.5|-7|pin@139||4.5|-8|ART_color()I-1174339839
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+X
+
+# Cell core;1{sch}
+Ccore;1{sch}||schematic|1253518699023|1253732122831|
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+Inor3;1{ic}|nor3@1||-14|0|X||D5G4;|ATTR_X(D5G3;NOJPX-6;Y-2;)S4
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+X
+
+# Cell fakeForDRC;1{lay}
+CfakeForDRC;1{lay}|oneCell|tsmcSun40GP|1250309607249|1250370709293||ATTR_NCC(D5G10;NTX-360;Y618.75;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/","exportsConnectedByParent disableLO /disableLO_[0-9]+/","exportsConnectedByParent disable /disable_[0-9]+/"]
+Ngeneric:Facet-Center|art@0||0|0||||AV
+IoneCell;1{lay}|oneCell@0||1.5|-164.5|R||D5G4;
+ELSN[OneOrDone]||D5G2;|oneCell@0|LSN[OneOrDone]|B
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+NP-Transistor|pmos@2||-27|74|84||R|
+APoly|net@103|||S900|pmos@0|poly-left|27|65|pin@34||27|46
+APoly|net@104|||S900|pin@34||27|46|pin@12||27|-12
+APoly|net@105|||S1800|pin@34||27|46|contact@17||30|46
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+AMetal-1|net@283|||S0|pin@56||36|-37|pin@102||0|-37
+AMetal-1|net@284|||S2700|contact@45||0|-57|pin@102||0|-37
+Egnd||D5G2;|pin@74||G
+Egnd_1||D5G2;|pin@75||G
+Egnd_2||D5G2;|pin@76||G
+Egnd_3||D5G2;|pin@77||G
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+Eina||D5G2;|contact@16||I
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+Einc||D5G2;|contact@13||I
+Eout_1|out|D5G2;|pin@66||O
+Eout_1@1030322009|out_1|D5G2;|pin@100||O
+Evdd||D5G2;|pin@71||P
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+Evdd_5||D5G2;|pin@70||P
+X
+
+# Cell nand2nand2;1{sch}
+Cnand2nand2;1{sch}||schematic|1247526811643|1253499567425||ATTR_LEGATE(D5G1;HNPX-38.75;Y15;)I1|ATTR_X(D5G1;HNOJPX-32.75;Y13;)SLE.getdrive()|ATTR_su(D5G1;HNPX-40.25;Y17.5;)I-1
+IredFive:NMOS;1{ic}|NMOS@0||2.75|-3.25|YRR||D5G4;|ATTR_X(D5G1.5;NOLPX-1.75;Y-3;)S2*@X
+IredFive:NMOS;1{ic}|NMOS@1||-2.5|-3.25|XYRR||D5G4;|ATTR_X(D5G1.5;NOLPX-2;Y-3;)S2*@X
+Ngeneric:Facet-Center|art@0||0|0||||AV
+NOff-Page|conn@2||11.25|-17.5|||XR|
+NOff-Page|conn@3||-11.25|-17.5|||YRRR|
+NOff-Page|conn@8||0|15.25|||YRRR|
+NOff-Page|conn@15||17.75|-17.5|||R|
+Inand2nand2;4{ic}|fire@0||16|13.75|||D5G4;
+IredFive:nms1;2{ic}|nms1@6||0|-13.5|X||D5G4;|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;Y0.25;)S2*@X
+NWire_Pin|pin@90||2.75|0.5|||Y|
+NWire_Pin|pin@103||0|0.5|||Y|
+NWire_Pin|pin@110||-2.5|0.5||||
+NWire_Pin|pin@112||-11.25|-3.25||||
+NWire_Pin|pin@115||-2.5|-9.75||||
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+NWire_Pin|pin@120||17.75|-13.5||||
+NWire_Pin|pin@124||0|-9.75||||
+NWire_Pin|pin@128||11.25|-3.25||||
+NWire_Pin|pin@129||7|0.5||||
+Ngeneric:Invisible-Pin|pin@130||-1.25|23.5|||||ART_message(D5G3;)Snand2nand2
+Ngeneric:Invisible-Pin|pin@133||-50|7|||||ART_message(D6G1;)S["When firing (pulling \"out\" low):",- we always have one of inb or inc working (ie high),- we always have ina working (ie high),"therefore, the pull-down network is sized such that",ina plus either inb or inc gives a total net drive of X=15,(via two X=30 in sieres)]
+Ngeneric:Invisible-Pin|pin@134||-52|-2.5|||||ART_message(D6G1;)S["When unfiring (pulling \"out\" back high):",- we always have ina working (ie low),"- in the case where the left side is transitioning Two->One or Done->Done,",we get no help from the inb/inc stack. Unfortunately in the Two->One case,"we really need the fire signal to go away promptly, so we must size these",transistors in such a way that the ina pmos is able to clear the state all by itself.]
+IredFive:pms1;2{ic}|pms1@5||7|4.25|X||D5G4;|ATTR_X(D5FLeave alone;G1.5;NOLPX3.5;)S@X
+Awire|net@228|||2700|NMOS@0|d|2.75|-1.25|pin@90||2.75|0.5
+Awire|net@256|||1800|pin@103||0|0.5|pin@90||2.75|0.5
+Awire|net@257|||900|conn@8|a|0|13.25|pin@103||0|0.5
+Awire|net@299|||1800|pin@110||-2.5|0.5|pin@103||0|0.5
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+Awire|net@357|||900|pin@119||17.75|4.25|pin@120||17.75|-13.5
+Awire|net@358|||2700|conn@15|y|17.75|-15.5|pin@120||17.75|-13.5
+EinRight|ina|D5G2;X-1.75;|conn@15|a|I|ATTR_le(D5G1;NY-1.5;)S1.333
+EMSN[ZeroOrDone]|inb|D4G2;X-0.5;|conn@2|a|I|ATTR_le(D5G1;NX-0.5;Y-3;)S0.666
+EMSN[ZeroOrTwo]|inc|D6G2;X-7;|conn@3|y|I|ATTR_le(D5G1;NX-1.5;Y-1;)S0.666
+Efire[1]|out|D6G2;X4.5;|conn@8|a|O|ATTR_le(D5G1;NY3;)S2
+X
+
+# Cell newCell;1{ic}
+CnewCell;1{ic}||artwork|1242937501096|1253517983786|E
+Ngeneric:Facet-Center|art@0||0|0||||AV
+NTriangle|art@2||3|6.5|3|2|R|
+NTriangle|art@3||3|-8|3|2|R|
+NTriangle|art@4||-5|6.5|3|2|RRR|
+NPin|pin@0||-6|8.5|1|1||
+NPin|pin@1||-6|-10|1|1||
+NPin|pin@2||4|-10|1|1||
+NPin|pin@3||4|8.5|1|1||
+Nschematic:Wire_Pin|pin@9||-6|-7.5||||
+Nschematic:Wire_Pin|pin@16||4|-8.5||||
+Nschematic:Wire_Pin|pin@17||4|6||||
+Nschematic:Wire_Pin|pin@18||-6|6||||
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+NPin|pin@33||-6|-7.5|1|1||
+Nschematic:Bus_Pin|pin@38||-3.5|-10||||
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+Ngeneric:Invisible-Pin|pin@40||-1|-0.5|||||ART_message(D5G2;)S[Counter,GasP,Module]
+Nschematic:Bus_Pin|pin@41||1.5|-10||||
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+ELSN[OneOrTwo]|LSN[TwoOrDone]|D5G1;X5;|pin@17||B
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+X
+
+# Cell newCell;1{sch}
+CnewCell;1{sch}||schematic|1242942044308|1253518958852||LEDRIVE_fire@0()F12.738704|LEDRIVE_inv@63()F7.869788|LEDRIVE_inv@64()F6.7883825|LEDRIVE_nor3@0()F4.0163803|LEDRIVE_pred@1()F21.636974|LEDRIVE_predCond@1()F21.636974|LEDRIVE_predCond@2()F22.513935|LEDRIVE_succCond@3()F22.513935
+IpurpleFive:LEsettings;1{ic}|LEsettin@1||52|25|||D5G4;|ATTR_LESETTINGS(D5G1;NPY-1.5;)I1|ATTR_alpha(D5G1;NPY0.5;)S0|ATTR_epsilon(D5G1;NPY3.5;)F0.0010|ATTR_gate_cap(D5G1;NPY1.5;)F0.19|ATTR_keeper_ratio(D5G1;NPY-0.5;)F0.1|ATTR_max_iter(D5G1;NPY2.5;)I30|ATTR_su(D5G1;NPY5.5;)S4.7|ATTR_wire_ratio(D5G1;NPY4.5;)F0.16|ATTR_x1inverter_length(D5G1;NPY-3.5;)F2.0|ATTR_x1inverter_nwidth(D5G1;NPY-4.5;)F3.0|ATTR_x1inverter_pwidth(D5G1;NPY-5.5;)F6.0
+Ngeneric:Facet-Center|art@0||0|0||||AV
+NOff-Page|conn@0||58.5|-7.5|||Y|
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+Ngeneric:Invisible-Pin|pin@6||16.75|64.5|||||ART_message(D5G15;)SnewCell
+Ngeneric:Invisible-Pin|pin@149||16.25|56|||||ART_message(D5G3;)Sam 13 Sep 2009
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+
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+
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+Ein||D5G2;|contact@6||I
+Estate||D5G2;|pin@55||B
+Evdd||D5G2;|pin@40||U
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+X
+
+# Cell wells;1{lay}
+Cwells;1{lay}||tsmcSun40GP|1250223472728|1252814923322||ATTR_NCC(D5G10;NTX-9;Y224.5;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/","exportsConnectedByParent disableLO /disableLO_[0-9]+/","exportsConnectedByParent disable /disable_[0-9]+/"]|DRC_last_good_drc_bit()I34|DRC_last_good_drc_date()G1252818222491
+Ngeneric:Facet-Center|art@0||0|0||||AV
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+NX-Metal-1-Metal-2-Con|contact@1||-1.5|75||51|R|
+NX-Metal-1-Metal-2-Con|contact@2||-1.5|45||51|R|
+NX-Metal-1-Metal-2-Con|contact@3||-3|-45||52|R|
+NX-Metal-1-Metal-2-Con|contact@4||-3|-75||52|R|
+NX-Metal-1-Metal-2-Con|contact@5||-3|-105||52|R|
+NMetal-2-Pin|pin@0||-3|45||||
+NMetal-2-Pin|pin@1||-3|75||||
+NMetal-2-Pin|pin@2||-3|105||||
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+X
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X
# Cell core;1{sch}
-Ccore;1{sch}||schematic|1253518699023|1253518975166|
+Ccore;1{sch}||schematic|1253518699023|1253732122831|
Ngeneric:Facet-Center|art@0||0|0||||AV
NOff-Page|conn@0||-16|-9|||R|
NOff-Page|conn@1||-14|-9|||R|
NOff-Page|conn@4||-28|-9|||R|
NOff-Page|conn@5||-16|29|||R|
Icore;1{ic}|core@0||-47|23|||D5G4;
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+Inand2nand2;4{ic}|nand2nan@0||-16|12|||D5G4;|ATTR_X(D5G3;NOJPX-5;Y1.5;)S12
+Inor3;1{ic}|nor3@1||-14|0|X||D5G4;|ATTR_X(D5G3;NOJPX-6;Y-2;)S4
NWire_Pin|pin@0||-14|9||||
NWire_Pin|pin@1||-28|5||||
NWire_Pin|pin@2||-19.25|5||||
EinOr3@513479722|out|D5G2;X2;|conn@5|y|O
X
-# Cell fakeForDRC;1{lay}
-CfakeForDRC;1{lay}|oneCell|tsmcSun40GP|1250309607249|1250370709293||ATTR_NCC(D5G10;NTX-360;Y618.75;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/","exportsConnectedByParent disableLO /disableLO_[0-9]+/","exportsConnectedByParent disable /disable_[0-9]+/"]
-Ngeneric:Facet-Center|art@0||0|0||||AV
-IoneCell;1{lay}|oneCell@0||1.5|-164.5|R||D5G4;
-ELSN[OneOrDone]||D5G2;|oneCell@0|LSN[OneOrDone]|B
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-Egnd||D5G2;|oneCell@0|gnd|G
-Egnd_1||D5G2;|oneCell@0|gnd_1|G
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-X
-
# Cell fill;2{lay}
Cfill;2{lay}||tsmcSun40GP|1245108836322|1249630574704||ATTR_NCC(D5G1;NTX31;Y-7;)S[exportsConnectedByParent vdd vdd_2 vdd_1,exportsConnectedByParent gnd gnd_2 gnd_1]|DRC_last_good_drc_bit()I34|DRC_last_good_drc_date()G1249678425898
Ngeneric:Facet-Center|art@0||0|0||||AV
X
# Cell inverterStudyRotated;1{lay}
-CinverterStudyRotated;1{lay}||tsmcSun40GP|1252816454336|1252816462264|
+CinverterStudyRotated;1{lay}|inverterStudy|tsmcSun40GP|1252816454336|1253734734070|
Ngeneric:Facet-Center|art@0||0|0||||AV
IinverterStudy;1{lay}|inverter@0||0|0|R||D5G4;
X
Evdd_5||D5G2;|pin@16||P
X
-# Cell nand2nand2;1{lay}
-Cnand2nand2;1{lay}||tsmcSun40GP|1249541540585|1250571957324||ATTR_NCC(D5G10;NTX-6;Y166;)S["exportsConnectedByParent vdd /vdd_[0-9]+/","exportsConnectedByParent gnd /gnd_[0-9]+/"]|DRC_last_good_drc_area_date()G1250571959793|DRC_last_good_drc_bit()I34|DRC_last_good_drc_date()G1250571959793
-Ngeneric:Facet-Center|art@0||0|0||||AV
-NMetal-1-Poly-Con|contact@13||11|14|-2|18||
-NMetal-1-Poly-Con|contact@16||-29|0|-2|18||
-NMetal-1-Poly-Con|contact@17||29|39|-2|18||
-NX-Metal-1-Metal-2-Con|contact@18||-36|105|||R|
-NX-Metal-1-Metal-2-Con|contact@22||-36|75|||R|
-NAN-Metal-1-P-Diff-Con|contact@23||-36|74|84||R|
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-NN-Transistor|nmos@1||9|-69|84||R|
-NN-Transistor|nmos@2||27|-69|84||XR|
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-NPoly-Pin|pin@34||27|46||||
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-NprBoundary-Node|plnode@15||0|0|90|270||
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-
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X
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-
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X
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-
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X
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-
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